JPS59122635U - ８ビツトマイクロプロセツサ用プログラムデバツグ装置 - Google Patents

８ビツトマイクロプロセツサ用プログラムデバツグ装置

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Publication number
JPS59122635U
JPS59122635U JP1642583U JP1642583U JPS59122635U JP S59122635 U JPS59122635 U JP S59122635U JP 1642583 U JP1642583 U JP 1642583U JP 1642583 U JP1642583 U JP 1642583U JP S59122635 U JPS59122635 U JP S59122635U
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JP
Japan
Prior art keywords
debug
bit microprocessor
program debugging
program
debugging device
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Pending
Application number
JP1642583U
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English (en)
Inventor
保坂　岳深
Original Assignee
日本電気株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示すブロック図、第２図は
本考案の特徴をなすデバッグ機能制御回路の一実施例を
示すブロック図である。 １００・・・・・・マイクロプロセッサ回路、２００・
・・・・・リードオンリーメモリ、３００・・・・・・
ランダムアクセスメモリ、４００・・・・・・デバッグ
機能制御回路、４０１．４０２，４０３，４１０，４１
２゜４３０・・・・・・レジスタ、４０４，４０５，４
１１・・・・・・比較器、４０６，４１３，４１４・・
・・・・ゲート、４１５．４２１・・・・・・タイミン
グ回路、４２０・・・・・・スイッチ、５００・・・・
・・入出力機器制御回路、６００・・・・・・プロセッ
サバス、６０１・・・・・・アドレスバス、６０２・・
・・・・メモリアクセス信号、６０３・・・・・・イン
ストラクションフェッチ信号、６０４・・・・・・デー
タバス、６０５・・・・・・１０書き込み信号、６０６
・・・・・・ＩＯ読み出し信号、６０７・・・・・・割
り込み信号。

Claims (1)

    【実用新案登録請求の範囲】
  1. ８ビツトマイクロプロセツサのプログラムデバッグにお
    いて、ストアトラップとマニュアルトラップとワンステ
    ップ実行の各種デバッグ機能を実現するデバッグ機能制
    御回路と、８ビツトマイクロプロセツサと、前記デバッ
    グ機能を実行するオフライン用モニタプログラムを内蔵
    するリードオンリーメモリと、デバッグプログラムの格
    納及びオフライン用モニタプログラムの作業エリアとし
    て用いるランダムアクセスメモリと”、ＣＲＴディスプ
    レイとキーボードとカセット磁気テープとプリンタの各
    種出力機器を制御する入力機器制御面路とよりなる８ビ
    ツトマイクロプロセツサ用プログラムデバツグ装置。
JP1642583U 1983-02-07 1983-02-07 ８ビツトマイクロプロセツサ用プログラムデバツグ装置 Pending JPS59122635U (ja)

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JP1642583U JPS59122635U (ja) 1983-02-07 1983-02-07 ８ビツトマイクロプロセツサ用プログラムデバツグ装置

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JP1642583U JPS59122635U (ja) 1983-02-07 1983-02-07 ８ビツトマイクロプロセツサ用プログラムデバツグ装置

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JPS59122635U true JPS59122635U (ja) 1984-08-18

Family

ID=30147709

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