JPS585848A - プログラム呼出し制御方式 - Google Patents
プログラム呼出し制御方式Info
- Publication number
- JPS585848A JPS585848A JP56104236A JP10423681A JPS585848A JP S585848 A JPS585848 A JP S585848A JP 56104236 A JP56104236 A JP 56104236A JP 10423681 A JP10423681 A JP 10423681A JP S585848 A JPS585848 A JP S585848A
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- JP
- Japan
- Prior art keywords
- program
- address
- sub
- register
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/44—Arrangements for executing specific programs
- G06F9/448—Execution paradigms, e.g. implementations of programming paradigms
- G06F9/4482—Procedural
- G06F9/4484—Executing subprograms
- G06F9/4486—Formation of subprogram jump address
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、プログラム呼出し制御力式、特に拡張領域指
定レジスタを用いて拡張領域を７タセスするデータ処理
システムにおいて１番サブ・ブーグラムへのエントリ処
理を実行するヤブーブーダラム・アドレス・テーブル処
理部を各サブ・ブーグラム対応に用意し、ブーグラム呼
出し処理に要するダイナミック・ステップを減小させて
ｓｌＩ効率を向上させたプログラム呼出し調御方式記関
するものである。
定レジスタを用いて拡張領域を７タセスするデータ処理
システムにおいて１番サブ・ブーグラムへのエントリ処
理を実行するヤブーブーダラム・アドレス・テーブル処
理部を各サブ・ブーグラム対応に用意し、ブーグラム呼
出し処理に要するダイナミック・ステップを減小させて
ｓｌＩ効率を向上させたプログラム呼出し調御方式記関
するものである。
従来から、アドレスψレジスタの内容によって直接指定
できるアドレス範囲が、必要とする記憶容量にくらべて
小さい場合に、第１図に示す如き。
できるアドレス範囲が、必要とする記憶容量にくらべて
小さい場合に、第１図に示す如き。
記憶容量の拡張方式が採用されている。
１’１図において、ｌは記憶装置、２はアドレス・レジ
スタであって番地ｒ００００ＪからｒＦ Ｆ Ｆ ＦＪ
まで全指定できるもの０図示斜線部はアドレス空間、３
は拡張領域指定レジスタ、４はベース領域。
スタであって番地ｒ００００ＪからｒＦ Ｆ Ｆ ＦＪ
まで全指定できるもの０図示斜線部はアドレス空間、３
は拡張領域指定レジスタ、４はベース領域。
５−１．５−２．・・・・・・は夫々拡張領域、６ない
し８は夫々ブーグラムまたはサブ・ブーグラム、９はエ
ントリ処理部を表わしている。
し８は夫々ブーグラムまたはサブ・ブーグラム、９はエ
ントリ処理部を表わしている。
アドレス・レジスタ２によりて直接指定できるアドレス
空間即ち番地ｒ００００Ｊから番地ｒＦＦＦＦ」までの
空間が不足する場合に、・例えば図示の場合には番地「
・Ｃ００ＯＪから番地ｒＦＦＦＦＪまでの領域に対応し
て複数個の拡張領域５−１．５−２、・・・・・・を用
意する。そして例えば、プログラム６の処理の間にサブ
中ブーグラム７にジャンプす６ ｋ： 当−ｚでは、プ
ログラム６がエントリ処理部９に対して呼出し処理を依
頼する。エントリ処理部９は、−？ブ・プμグチ＾が拡
張領域５−２に存在することから、拡張領域指定レジス
タ３に対して拡張領域ＥＭ２を指示する拡張領域指定情
報をセットしかつサブ・ブーグラム７の先頭アドレス管
アドレス・レジスタ２にセットするようにする。
空間即ち番地ｒ００００Ｊから番地ｒＦＦＦＦ」までの
空間が不足する場合に、・例えば図示の場合には番地「
・Ｃ００ＯＪから番地ｒＦＦＦＦＪまでの領域に対応し
て複数個の拡張領域５−１．５−２、・・・・・・を用
意する。そして例えば、プログラム６の処理の間にサブ
中ブーグラム７にジャンプす６ ｋ： 当−ｚでは、プ
ログラム６がエントリ処理部９に対して呼出し処理を依
頼する。エントリ処理部９は、−？ブ・プμグチ＾が拡
張領域５−２に存在することから、拡張領域指定レジス
タ３に対して拡張領域ＥＭ２を指示する拡張領域指定情
報をセットしかつサブ・ブーグラム７の先頭アドレス管
アドレス・レジスタ２にセットするようにする。
図示のサブ・プログラム８にジャンプする場合には、エ
ントリ処理部９はサブ・ブーグラム８の先頭アドレスを
アドレス串レジスタ２にセットスル。
ントリ処理部９はサブ・ブーグラム８の先頭アドレスを
アドレス串レジスタ２にセットスル。
勿論、エントリ処理部９には、予め、各サブ・プログラ
ムやプログラムがどの位置に格納されているかＩＩａ＠
えばシステムの立上り時に受取っている。
ムやプログラムがどの位置に格納されているかＩＩａ＠
えばシステムの立上り時に受取っている。
従来から、上述の如き拡張方式が採用されているが、第
２図を参照して後述する如（、従来の呼出し制御におい
ては、２１図図示のエントリ処理部におけるダイナミッ
ク・ステップが比較的大であって呼出し制御に要する時
間が大となつていた。
２図を参照して後述する如（、従来の呼出し制御におい
ては、２１図図示のエントリ処理部におけるダイナミッ
ク・ステップが比較的大であって呼出し制御に要する時
間が大となつていた。
本発明は、この点を解決すること管間的としており、い
わば各プμダラ＾詔よびサブ・プレグテム対応に夫々エ
ン）ＩＪ処理部９に相当する処理部を用意し、ダイナミ
ック・ステップを減小することを目的としている。そし
てそのため、本発明のプログラム呼出し制御方式は、記
憶装置上のアドレス空間の一部の領域に対応して同一ア
ドレスをもつ複数の拡張領域を用意し、当該拡張領域を
指定する拡張領域指定レジスタの内容をブーグラムによ
ってセットし該内容とアドレス争レジスタの内容とで１
１同して上記複数の拡張領域の１つを７タセスするデー
タ処理システ＾において、各サブ・ブーグラム毎にｌｙ
Ｉ＃ｌに対応する複数個のサブ・ブーグラム・アドレス
自テーブル処理部をもうけると共に、上記各サブ・ブー
グラムを上記記憶装置上のアドレス空間上に用意′シ、
かつ上記各サブ・ブーグラム・アドレス・テーブル処理
部は。
わば各プμダラ＾詔よびサブ・プレグテム対応に夫々エ
ン）ＩＪ処理部９に相当する処理部を用意し、ダイナミ
ック・ステップを減小することを目的としている。そし
てそのため、本発明のプログラム呼出し制御方式は、記
憶装置上のアドレス空間の一部の領域に対応して同一ア
ドレスをもつ複数の拡張領域を用意し、当該拡張領域を
指定する拡張領域指定レジスタの内容をブーグラムによ
ってセットし該内容とアドレス争レジスタの内容とで１
１同して上記複数の拡張領域の１つを７タセスするデー
タ処理システ＾において、各サブ・ブーグラム毎にｌｙ
Ｉ＃ｌに対応する複数個のサブ・ブーグラム・アドレス
自テーブル処理部をもうけると共に、上記各サブ・ブー
グラムを上記記憶装置上のアドレス空間上に用意′シ、
かつ上記各サブ・ブーグラム・アドレス・テーブル処理
部は。
自己に対応するすブＱプーダラムの先頭アドレスと当該
すブ・ブーグラムが上記拡張領域の１つに存在する場合
に当該拡張領域を指定する拡張領域指定情報とを処理に
先立ってセットされ、当該すブ・ブーグラム・アドレス
・テーブル処理部に分岐された際に上記拡張領域指定情
報を上記拡張領域指定レジスタにセットする処理と上記
先順アドレスをアドレス・レジスタにセットするｌＩ＆
理とを実行するよう構成ざｎてなり、上記アドレス空間
上に存在するブーグラムが上記複数のサブ・ブーグラム
・アドレス・テーブル処理部の１つに対して分岐して対
応するサブ・プログラムを呼出すよう構成したことを特
徴としている。以下図ＩＩを参照しつつ説明する。
すブ・ブーグラムが上記拡張領域の１つに存在する場合
に当該拡張領域を指定する拡張領域指定情報とを処理に
先立ってセットされ、当該すブ・ブーグラム・アドレス
・テーブル処理部に分岐された際に上記拡張領域指定情
報を上記拡張領域指定レジスタにセットする処理と上記
先順アドレスをアドレス・レジスタにセットするｌＩ＆
理とを実行するよう構成ざｎてなり、上記アドレス空間
上に存在するブーグラムが上記複数のサブ・ブーグラム
・アドレス・テーブル処理部の１つに対して分岐して対
応するサブ・プログラムを呼出すよう構成したことを特
徴としている。以下図ＩＩを参照しつつ説明する。
第２＠は従来の呼出し制御方式の一例、第３図は本発明
によるプログラム呼出し制御方式の一実篇例を示す。
によるプログラム呼出し制御方式の一実篇例を示す。
第２図において、符号３．４．５，６．７．８ は夫々
オ１ｆｌｌに対応しており、１０はサブジャンプ処理部
でありて各ブーグラ＾やサブ・ブーグラムに対して共通
に存在するもの、１１はアドレス・テーブルであやて条
プーダツムやサブ・プーダツム対応に存在位置（−ＥＭ
／ＢＭ）情報と先頭アドレスとを保持しているものを表
わしている。
オ１ｆｌｌに対応しており、１０はサブジャンプ処理部
でありて各ブーグラ＾やサブ・ブーグラムに対して共通
に存在するもの、１１はアドレス・テーブルであやて条
プーダツムやサブ・プーダツム対応に存在位置（−ＥＭ
／ＢＭ）情報と先頭アドレスとを保持しているものを表
わしている。
第２図明示の場合１次のように動作する。即ち。
（１） 今プログラム（ＰＲＯＧ）、６が例えばサブ
・プログラム（５ＵＢＩ ）７を呼ぶ場合には、プレグ
ラム６は、サブ・ブーグラム７に関する情報が格納され
ているアドレス・テーブル１１上の位置を示すパラメー
タを指定して、サブ・ジャンプ処理部１０にジャンプす
る。
・プログラム（５ＵＢＩ ）７を呼ぶ場合には、プレグ
ラム６は、サブ・ブーグラム７に関する情報が格納され
ているアドレス・テーブル１１上の位置を示すパラメー
タを指定して、サブ・ジャンプ処理部１０にジャンプす
る。
（りサブ・ジャンプ処理部ｌＯは、受取ったパラメータ
を用いて、アドレス・テーブル（ＡＤＲＴ）１１を索引
する。そしてサブ・プレグラム（ＳＵＢｌ）７が拡張領
域（ＢＭ２）５−２に存在することから、レジスタ３に
対してＥＭＺ番セットする。
を用いて、アドレス・テーブル（ＡＤＲＴ）１１を索引
する。そしてサブ・プレグラム（ＳＵＢｌ）７が拡張領
域（ＢＭ２）５−２に存在することから、レジスタ３に
対してＥＭＺ番セットする。
（ｓ） 次いでサブ・ジャンプ処理部ｌＯは上記パラ
メータを用いて、アドレス・テーブルｌｌｅ索引する。
メータを用いて、アドレス・テーブルｌｌｅ索引する。
そして、サブ・ブーグラム（ＳＵＢＩ）７の先頭アドレ
スを７ドレス・レジスタ２（オｌ因）に−ッ卜する。
スを７ドレス・レジスタ２（オｌ因）に−ッ卜する。
（４） プレグラ＾（ＰＲＯＧ）６がサブ・プログラ
ム（ＳＵＢＺ）８を呼ぶ場合にも同様であるが。
ム（ＳＵＢＺ）８を呼ぶ場合にも同様であるが。
ベース領域（ＢＭ）４上に存在することから。
アドレス・レジスタ２に対してサブ・プログラム（ＳＵ
Ｂｌ）の先頭アドレスをセットする。
Ｂｌ）の先頭アドレスをセットする。
従来上述のように動作するよう構成されている。
この場合には、共通に１つのサブ・体ヤンプ処理部ｌＯ
が存在するだけで足りる利点は存在するけれども、アド
レス・テーブル１１の内容全読取りて判断する処理が存
在し、ダイナミック・ステ。
が存在するだけで足りる利点は存在するけれども、アド
レス・テーブル１１の内容全読取りて判断する処理が存
在し、ダイナミック・ステ。
ブが大となる難点をもりている。
第３図は本発明の一実施例構成を示す０図中の符号３．
４．５．６，７，８．１１Ｊ！２２図に対応し。
４．５．６，７，８．１１Ｊ！２２図に対応し。
１２はサブ・プログラム（ＳＵＢＩ）・アドレス・テー
ブル処理部であってサブ・ブーグラム（ＳＵＢＩ）７に
対応して用意されるもの、１３はすプ・プレグラム（Ｓ
ＵＢｌ）・アドレス・テーブル処理部であってサブ・プ
レグラム（ＳＵＢｌ）８に対応して用意されるものを表
わしている。
ブル処理部であってサブ・ブーグラム（ＳＵＢＩ）７に
対応して用意されるもの、１３はすプ・プレグラム（Ｓ
ＵＢｌ）・アドレス・テーブル処理部であってサブ・プ
レグラム（ＳＵＢｌ）８に対応して用意されるものを表
わしている。
サブ・ブーグラム・アドレス・テーブル処理部１２内に
は、−？ブ・プレグラム（ＳＵＢＩ）７鰺ｆ格納されて
いる拡張領域（ｆ：Ｍ２）５−２８指定する拡張領域指
定情報（ＢＭ２）と当該プレグラムの先頭アドレスとが
予め書替え可能に書込まれている。また同様にサブ・ブ
ーグラム・アドレス・？−’；／ｋｇ理部１３内に線部
１３内プレグ９ｋ（５ＵＢ２ ）８の先頭アドレスが予
め書替え可能に書込まれている。そして次のように動作
する。
は、−？ブ・プレグラム（ＳＵＢＩ）７鰺ｆ格納されて
いる拡張領域（ｆ：Ｍ２）５−２８指定する拡張領域指
定情報（ＢＭ２）と当該プレグラムの先頭アドレスとが
予め書替え可能に書込まれている。また同様にサブ・ブ
ーグラム・アドレス・？−’；／ｋｇ理部１３内に線部
１３内プレグ９ｋ（５ＵＢ２ ）８の先頭アドレスが予
め書替え可能に書込まれている。そして次のように動作
する。
即ち
（ｉ） 今ブーダラムＣＰＲＯＧ）６が例えばサブ・
ブーグラ＾（ＳＵＢＩ）７を呼ぶ場合には、プレグラム
６は、伊プ・ブーグラム７に対応するサブ・プレグラム
（ＳＵＢＩ）・アドレス・テーブル処理部１２にジャン
プする。
ブーグラ＾（ＳＵＢＩ）７を呼ぶ場合には、プレグラム
６は、伊プ・ブーグラム７に対応するサブ・プレグラム
（ＳＵＢＩ）・アドレス・テーブル処理部１２にジャン
プする。
（６） 当該処理部１２は、拡張領域指定情報ＣＥＭ
２〕を拡張領域指定レジスタ３にセットし、かつサブ・
ブーグラム（ＳＵＢＩ）７の先頭アドレスをアドレス・
レジスタ２ （７１図）にセットする。即ち、サブ・プ
ログラム（ＳＵＢＩ）７の処理に入る。
２〕を拡張領域指定レジスタ３にセットし、かつサブ・
ブーグラム（ＳＵＢＩ）７の先頭アドレスをアドレス・
レジスタ２ （７１図）にセットする。即ち、サブ・プ
ログラム（ＳＵＢＩ）７の処理に入る。
（７） プレグラム（ＦＲＯＧ）６がサブ・ブーグラ
＾（ＳＵＢｌ）８を呼ぶ場合にも同様であるが。
＾（ＳＵＢｌ）８を呼ぶ場合にも同様であるが。
ベース領域（ＢＭ）４上に存在することから。
アドレス・レジスタ２に対してサブ・ブーグラム（ＳＵ
Ｂｌ）の先ｊｌＪ７ドレスをセットする。
Ｂｌ）の先ｊｌＪ７ドレスをセットする。
なお２３ＷＡにおいて上記処理部１２とＩＬ−・・との
全体！ ７ドレス・テーブル１１としたのは。
全体！ ７ドレス・テーブル１１としたのは。
図示しない処理によって、拡張領域指定情報〔ＥＭｌ）
、（ＢＭ２）や各プレグラムの先頭アドレスを予めセッ
トするに当って、既存の第２図図示のものと同じ態様で
０．アドレス・テーブル１１を指定してセットすること
ができるようにしているものと考えてよい。
、（ＢＭ２）や各プレグラムの先頭アドレスを予めセッ
トするに当って、既存の第２図図示のものと同じ態様で
０．アドレス・テーブル１１を指定してセットすること
ができるようにしているものと考えてよい。
以上説明した如く１本発明によれば、各サブ・プレグラ
ム・アドレス・テーブル処理部１２．１Ｂ。
ム・アドレス・テーブル処理部１２．１Ｂ。
・・・・・・を複数個もうけることが必要となるが、第
２図図示の場合において必要としていたテーブル参照処
理と判断処理とを省略することがｃｔ、呼び出しに当っ
てのダイナ１ツタ・ステップが大きく減少され、処理効
率が向上する。
２図図示の場合において必要としていたテーブル参照処
理と判断処理とを省略することがｃｔ、呼び出しに当っ
てのダイナ１ツタ・ステップが大きく減少され、処理効
率が向上する。
７１図は領域拡張について説明する説明図０才２図は従
来の呼出し制御方式の一例、第３図は本発明によるプロ
ゲラ＾呼出し制御方式の一実施例を示す。 図中、２はアドレス・レジスタ、３は拡張領域指定レジ
スタ、４はペース領域、５は拡張領域 ６ないし８は夫
々プログラム、１２．１３は夫゛々サブ・プログラム・
アドレス・テーブル処理部を表わす。 特許出願人 富士通株式会社（外１名）代理人弁理士
森 １） 寛 第１図 Ａ′２０
来の呼出し制御方式の一例、第３図は本発明によるプロ
ゲラ＾呼出し制御方式の一実施例を示す。 図中、２はアドレス・レジスタ、３は拡張領域指定レジ
スタ、４はペース領域、５は拡張領域 ６ないし８は夫
々プログラム、１２．１３は夫゛々サブ・プログラム・
アドレス・テーブル処理部を表わす。 特許出願人 富士通株式会社（外１名）代理人弁理士
森 １） 寛 第１図 Ａ′２０
Claims (1)
- 【特許請求の範囲】 記憶侠置上のアドレス空間の一部の領域に対応して同一
７ドレス管もつ複数の拡張領域を用意し。 当該拡張領域を指定する拡張領域指定レジスタの内容を
ブーグラムによりてセットし該内容とアドレス・レジス
タの内容とで協同して上記複数の拡張領域の１’）を７
タセスする一データ処理システムにおいて、各サブ・ブ
ーグラム毎にｌ対ｌに対応する複数個のサブΦプーダラ
ムｅアドレス・テーブル処理部をもうけると共に、上記
各サブ・プロダラ＾を上記記憶羨置上の７ドレ゛ス空間
上に用意し、かつ上記各ｔプΦプログラム螢アドレス・
テーブル処理部は、自己に対応するサブ・ブーグラムの
先ｌ［７ドレスと当＠＋ブ・ブーグラムが上記拡張領域
の１つに存在する場合に当該拡張領域番指定する拡張領
域指定−報とを処理に先立りてセ、ツトされ、当該サブ
・プμグツ＾・アドレス・テーブル処理部に分岐された
際に上記拡張領域指定情報を上記拡張領域指定レジスタ
にセットする処理と上記先頭アドレスを７ドレス・し、
ジスタにセットする処理と全実行するよう構成されてな
り。 上記アドレス空間上に存在するプログラムが上記複数の
サブ・ブーグラム・アドレス・テーブル処理部の１つに
対して分岐して対応するサブ・ブーグラムを呼°出すよ
う構成したことを特徴とするプログラム呼出し制御方式
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56104236A JPS585848A (ja) | 1981-07-03 | 1981-07-03 | プログラム呼出し制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56104236A JPS585848A (ja) | 1981-07-03 | 1981-07-03 | プログラム呼出し制御方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS585848A true JPS585848A (ja) | 1983-01-13 |
| JPS6136661B2 JPS6136661B2 (ja) | 1986-08-19 |
Family
ID=14375320
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56104236A Granted JPS585848A (ja) | 1981-07-03 | 1981-07-03 | プログラム呼出し制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS585848A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59230748A (ja) * | 1983-06-13 | 1984-12-25 | 凸版印刷株式会社 | 化粧シ−ト |
| JPS59231661A (ja) * | 1983-06-13 | 1984-12-26 | Fujitsu Ltd | プログラム分割に伴なうバンク制御方式 |
| JPS61168436U (ja) * | 1985-04-09 | 1986-10-18 | ||
| FR2667417A1 (fr) * | 1990-10-02 | 1992-04-03 | Gemplus Card Int | Carte a microprocesseur concue pour recevoir des programmes multiples en memoire programmable. |
| JPH04353930A (ja) * | 1991-05-31 | 1992-12-08 | Nec Software Kansai Ltd | 被起動パラメータ取り込み制御方式 |
| US10787476B2 (en) | 2013-09-24 | 2020-09-29 | Ajinomoto Co., Inc. | Glycoamino acid and use thereof |
-
1981
- 1981-07-03 JP JP56104236A patent/JPS585848A/ja active Granted
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59230748A (ja) * | 1983-06-13 | 1984-12-25 | 凸版印刷株式会社 | 化粧シ−ト |
| JPS59231661A (ja) * | 1983-06-13 | 1984-12-26 | Fujitsu Ltd | プログラム分割に伴なうバンク制御方式 |
| JPS61168436U (ja) * | 1985-04-09 | 1986-10-18 | ||
| FR2667417A1 (fr) * | 1990-10-02 | 1992-04-03 | Gemplus Card Int | Carte a microprocesseur concue pour recevoir des programmes multiples en memoire programmable. |
| JPH04353930A (ja) * | 1991-05-31 | 1992-12-08 | Nec Software Kansai Ltd | 被起動パラメータ取り込み制御方式 |
| US10787476B2 (en) | 2013-09-24 | 2020-09-29 | Ajinomoto Co., Inc. | Glycoamino acid and use thereof |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6136661B2 (ja) | 1986-08-19 |
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