JPS5848443A - 樹脂封止型半導体装置 - Google Patents
樹脂封止型半導体装置Info
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- JPS5848443A JPS5848443A JP56146558A JP14655881A JPS5848443A JP S5848443 A JPS5848443 A JP S5848443A JP 56146558 A JP56146558 A JP 56146558A JP 14655881 A JP14655881 A JP 14655881A JP S5848443 A JPS5848443 A JP S5848443A
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- resin
- sealed
- semiconductor device
- semiconductor element
- sealing resin
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- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
- H01L23/3135—Double encapsulation or coating and encapsulation
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
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- H01L2224/8592—Applying permanent coating, e.g. protective coating
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- Microelectronics & Electronic Packaging (AREA)
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- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明拡、・樹脂封止型中導体装置Klkする。
従来、所謂二重樹脂型の樹脂封止型半導体装置は、リー
ドフレームのベッドに^u−81共晶や半田エポキシ樹
脂で半導体素子を装着し、半導体素子とアクタ−リード
とをボンディング線で接続すると共に、ベッド上の半導
体素子とポ/ディング#〇一部分を内部鉤止樹脂体で封
止し、爽に、アウターリードの一部分が露出するように
して、ベッド及び内部封止樹脂体、ボンディング線及び
アウターリードのm。部分を外部樹脂封止体で封止し九
構造を、有している。
ドフレームのベッドに^u−81共晶や半田エポキシ樹
脂で半導体素子を装着し、半導体素子とアクタ−リード
とをボンディング線で接続すると共に、ベッド上の半導
体素子とポ/ディング#〇一部分を内部鉤止樹脂体で封
止し、爽に、アウターリードの一部分が露出するように
して、ベッド及び内部封止樹脂体、ボンディング線及び
アウターリードのm。部分を外部樹脂封止体で封止し九
構造を、有している。
而して、このような二重構造の樹脂封止型半導体装置は
、P3部封止樹脂体がシ璽゛アーD硬度で35以上の硬
度の高い材質で形成されているため、温度熱サイクルテ
ストを施す、と内部封止樹脂体を外部封止樹脂体の境界
部分でボンディング線が断線し九ル、戒は半導体素子或
はアクタ−リードどの接続部分でボンディング線が外れ
る開−があつ九。 ・ このような間llt胞避する九めに、・第1図に示す如
く、内部封止樹脂体t’使用せずに半導体素子1、ベッ
ド2、ボンディング線3、アクタ−リード40一部分を
外部封止樹脂体5で一体に封止し一/F、、II造の樹
脂封止型半導体装置6 di開発されている。
、P3部封止樹脂体がシ璽゛アーD硬度で35以上の硬
度の高い材質で形成されているため、温度熱サイクルテ
ストを施す、と内部封止樹脂体を外部封止樹脂体の境界
部分でボンディング線が断線し九ル、戒は半導体素子或
はアクタ−リードどの接続部分でボンディング線が外れ
る開−があつ九。 ・ このような間llt胞避する九めに、・第1図に示す如
く、内部封止樹脂体t’使用せずに半導体素子1、ベッ
ド2、ボンディング線3、アクタ−リード40一部分を
外部封止樹脂体5で一体に封止し一/F、、II造の樹
脂封止型半導体装置6 di開発されている。
しかしながら、このような−1封止型の樹脂封止型半導
体装f6でも特に電力用に使用され止する際に半導体素
子1に歪が発生する之めであることが解明された。この
゛モー゛ルド工程で半導体素子1に発生する歪は、結晶
方位<100>のウェハから形成され九半導体累子であ
る場合には、ウェハに設けるオリエンテーションフラッ
トを45°ずらせることによシ回避することができる。
体装f6でも特に電力用に使用され止する際に半導体素
子1に歪が発生する之めであることが解明された。この
゛モー゛ルド工程で半導体素子1に発生する歪は、結晶
方位<100>のウェハから形成され九半導体累子であ
る場合には、ウェハに設けるオリエンテーションフラッ
トを45°ずらせることによシ回避することができる。
しかしながら、クエへのti!′h方位が<111>の
ものである場合には、依然、上述の素子特性Of動を回
避できない開明があった。
ものである場合には、依然、上述の素子特性Of動を回
避できない開明があった。
本発明は、かかる点に鑑みてなされたもので、ボンディ
ング線の断線、外れを防止し、かつ安定した素子特性を
有する樹脂刺止型半導体装置を提供するものである。
ング線の断線、外れを防止し、かつ安定した素子特性を
有する樹脂刺止型半導体装置を提供するものである。
以下、本発明の冥施例について図面を参照して説明する
。
。
第2図は、不発明の一笑施例の断面図である。
図中10は、半導体素子11が装着されたベッドである
。半導体素子11は、内部封止樹脂体13でベッド10
上に一体に封止されている。
。半導体素子11は、内部封止樹脂体13でベッド10
上に一体に封止されている。
内部封止樹脂体13杜、ショアーD硬度が5以下のゲル
状シリ;−ン樹脂で形成されている。
状シリ;−ン樹脂で形成されている。
また、半導体素子11は、ボンディング線14を介して
アウターリード15に接続されている。
アウターリード15に接続されている。
アウターリード15は、その一部分を外部に露出するよ
うKしてベッド10、半導体素子11、ボンディング線
14、内部封止樹脂体13と共に外部封止樹脂体16に
よって一体に封止され゛ている。
うKしてベッド10、半導体素子11、ボンディング線
14、内部封止樹脂体13と共に外部封止樹脂体16に
よって一体に封止され゛ている。
このように構成され九樹脂封止型半導体装置17では、
一部封止樹脂体13がシlアーD硬度5以下の軟質のフ
ェニル基を有するゲル状シリコーン樹脂で形成されてい
るので、第3図に示す笑験結果からも明らかなように、
半導体素子11を封止する!−Jド工程中に半導体素子
11には全く歪は発生しない。その結果、外部對、止樹
−iを形成し圧抜においても、ボンディング線14の断
線、外れを防止できると共に、極めて安定した素子特性
を維持することができる。
一部封止樹脂体13がシlアーD硬度5以下の軟質のフ
ェニル基を有するゲル状シリコーン樹脂で形成されてい
るので、第3図に示す笑験結果からも明らかなように、
半導体素子11を封止する!−Jド工程中に半導体素子
11には全く歪は発生しない。その結果、外部對、止樹
−iを形成し圧抜においても、ボンディング線14の断
線、外れを防止できると共に、極めて安定した素子特性
を維持することができる。
l
留に、実施例の樹脂封止型半導体装Iji17を構成す
る半導体素子11に加わる応力を調べたところ、第4図
に示す如く、はとんど無視できる程の零に近い値であっ
た。これに対して第1図に示すような一重封止型の樹脂
封止型半導体装置6中の半導体素子1には、約1250
1w/ffi”のの応力が加わっていることが判った。
る半導体素子11に加わる応力を調べたところ、第4図
に示す如く、はとんど無視できる程の零に近い値であっ
た。これに対して第1図に示すような一重封止型の樹脂
封止型半導体装置6中の半導体素子1には、約1250
1w/ffi”のの応力が加わっていることが判った。
また、実施例の樹脂刺止型半導体装置17に溶度熱サイ
クルテストを施したところ、第5図に示す如く、不良品
の発生率はほとんど零%であった。これに対して前述と
同様の従来の樹脂封止型半導体装置6では、約50%で
あった。
クルテストを施したところ、第5図に示す如く、不良品
の発生率はほとんど零%であった。これに対して前述と
同様の従来の樹脂封止型半導体装置6では、約50%で
あった。
以上説明した如く、本発明に係る樹脂封止型半導体装置
によれば、ボンディング−の断線、外れ、を防止し、か
つ安定した素子特性を有する等顕著な効果を奏するもの
である。
によれば、ボンディング−の断線、外れ、を防止し、か
つ安定した素子特性を有する等顕著な効果を奏するもの
である。
第3図はウェハの反pと内部封止樹脂体の硬”度との関
係を示す特性図、第4図は、同実施例の樹脂封止型半導
体装置及び従来の樹脂封止型半導体装置の半導体素子に
かかる応力を示す特性図、第5図は、同実施例の樹脂封
止型半導体装置及び従来の樹脂封止型半導体装置の温度
熱サイクルテストにおける不良品発生率を示す特性図で
ある。
係を示す特性図、第4図は、同実施例の樹脂封止型半導
体装置及び従来の樹脂封止型半導体装置の半導体素子に
かかる応力を示す特性図、第5図は、同実施例の樹脂封
止型半導体装置及び従来の樹脂封止型半導体装置の温度
熱サイクルテストにおける不良品発生率を示す特性図で
ある。
10・・・ベッド、11・・・半導体素子、13・・・
内部封止樹脂体、14・・・ボンディング線、15・・
・アクタ−リード、16・・・外部封止樹脂体、Ll・
・・樹脂封止型半導体装置。
内部封止樹脂体、14・・・ボンディング線、15・・
・アクタ−リード、16・・・外部封止樹脂体、Ll・
・・樹脂封止型半導体装置。
Claims (1)
- 半′導体素子が装着されたベッドと、し1半導体菓子を
封止した内部封止樹脂体と1、前記半導体素子にボンデ
ィング線を介してW、#4されたアクタ−リードと、訪
アウーターリードの一部−分を露出するようにして前記
ベッ゛ド、前P半導体素子、前記ボンディング線、前t
’内部封止樹脂体を一体に封止した外部樹脂封止体とか
らなる樹脂封止型半導体装置において、内部刺止樹脂体
をシ冒アーD硬度5以下の7エエル基を有するゲル状シ
リーーン樹脂で形成したことを特徴とする樹脂封止型中
導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56146558A JPS5848443A (ja) | 1981-09-17 | 1981-09-17 | 樹脂封止型半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56146558A JPS5848443A (ja) | 1981-09-17 | 1981-09-17 | 樹脂封止型半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5848443A true JPS5848443A (ja) | 1983-03-22 |
Family
ID=15410381
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56146558A Pending JPS5848443A (ja) | 1981-09-17 | 1981-09-17 | 樹脂封止型半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5848443A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63226046A (ja) * | 1986-12-19 | 1988-09-20 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | パッケージ化応力の減少した半導体デバイスの製造方法 |
EP1681751A1 (en) * | 2001-04-20 | 2006-07-19 | Sharp Kabushiki Kaisha | Semiconductor laser module, spatial optical transmission system and electronic appliance |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS49116973A (ja) * | 1973-03-10 | 1974-11-08 | ||
JPS50110282A (ja) * | 1974-02-06 | 1975-08-30 | ||
JPS5521175A (en) * | 1978-08-02 | 1980-02-15 | Nec Home Electronics Ltd | Semiconductor device |
-
1981
- 1981-09-17 JP JP56146558A patent/JPS5848443A/ja active Pending
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS49116973A (ja) * | 1973-03-10 | 1974-11-08 | ||
JPS50110282A (ja) * | 1974-02-06 | 1975-08-30 | ||
JPS5521175A (en) * | 1978-08-02 | 1980-02-15 | Nec Home Electronics Ltd | Semiconductor device |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63226046A (ja) * | 1986-12-19 | 1988-09-20 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | パッケージ化応力の減少した半導体デバイスの製造方法 |
EP1681751A1 (en) * | 2001-04-20 | 2006-07-19 | Sharp Kabushiki Kaisha | Semiconductor laser module, spatial optical transmission system and electronic appliance |
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