JPS5836453U - マルチ計算機システムにおけるプログラム動作メモリの有効活用機構 - Google Patents

マルチ計算機システムにおけるプログラム動作メモリの有効活用機構

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JPS5836453U
JPS5836453U JP13096881U JP13096881U JPS5836453U JP S5836453 U JPS5836453 U JP S5836453U JP 13096881 U JP13096881 U JP 13096881U JP 13096881 U JP13096881 U JP 13096881U JP S5836453 U JPS5836453 U JP S5836453U
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JP
Japan
Prior art keywords
central processing
processing unit
program operation
memory
operation memory
Prior art date
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Pending
Application number
JP13096881U
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English (en)
Inventor
林　文聖
Original Assignee
株式会社日立製作所
日立エンジニアリング株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案のマルチ計算機システムの構成図、第２
図は第１図内のメモリ切換制御装置の構造を示した図で
ある。 １・・・・：・バス、２・・・・・・共通データ記憶メ
モリ、３・・・・・・入出力機器制御部、４・・・・・
・タスク管理制御部、５・・・・・・補助記憶装置、６
・・・・・・メモリ切換制御装置、ｃｐｕ、〜ＣＰＬＪ
ｎ・・・・・・中央処理装置、ＰＭ１〜ＰＭｍ・・・・
・・プログラム動作メモリ、ＳＷ１〜ＳＷｍ・・・・・
・切換スイッチ（補助記憶装置用）、Ｓｌ、〜Ｓ’ｍｎ
・・・・・・切換スイッチ（中央処理装置用）。

Claims (1)

    【実用新案登録請求の範囲】
  1. 共通バスとメモリ切換制御装置に接続される２本のバス
    を持った少なくとも１つの中央処理装置と、前記共通バ
    スに接続され前記中央処理装置が読出し書込みを行なう
    為の共通データを格納する共通データ記憶メモリと、前
    記共通バスに接続され入出力機器を制御する入出力機器
    制御部と、前記共通バス及び前記メモリ切換制御装置に
    接続されタスクからの各種信号を入出力するタスク管理
    制御部と、このタスク管理制御部の指令により前記メモ
    リ切換制御装置を介し前記中央処理装置と接続切離され
    る少なくとも１つのプログラム動作メモリと、′補助記
    憶装置とからなるマルチ計算機システムにおいて、前記
    プログラム動作メモリを前記中央処理装置にて有効活用
    し計算機のスループットタイムを短縮させる事を特徴と
    したマルチ計算機システムにおけるプログラム動作メモ
    リの有効活用機構。
JP13096881U 1981-09-04 1981-09-04 マルチ計算機システムにおけるプログラム動作メモリの有効活用機構 Pending JPS5836453U (ja)

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JPS5836453U true JPS5836453U (ja) 1983-03-09

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ID=29924570

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04470U (ja) * 1990-04-18 1992-01-06

Cited By (1)

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Publication number Priority date Publication date Assignee Title
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