JPS59147236U - インタ−フエイス制御装置 - Google Patents
インタ−フエイス制御装置Info
- Publication number
- JPS59147236U JPS59147236U JP2116584U JP2116584U JPS59147236U JP S59147236 U JPS59147236 U JP S59147236U JP 2116584 U JP2116584 U JP 2116584U JP 2116584 U JP2116584 U JP 2116584U JP S59147236 U JPS59147236 U JP S59147236U
- Authority
- JP
- Japan
- Prior art keywords
- unit
- process input
- output unit
- interface
- memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Information Transfer Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は従来のインターフェイス制御装置のブロック図
、第2図は本考案の実施例のブロック図、第3図は計算
機バスインターフェイス部のブロック図、第4図はデバ
イスバスインターフェイス部のブロック図、第5図は従
来の他のインターフェイス制御装置の動作説明図である
。 CPUは中央処理装置、INTはインク−フェイス制御
装置、lNT1は計算機バスインターフェイス部、IN
T2はデバイスバスインターフェイス部、MEMはメモ
リ、D1〜DNはプロセス入出カニニット、LOGCI
は組合せ論理回路、LOGC2はROMシーケンサであ
る。 第2図 第5図
、第2図は本考案の実施例のブロック図、第3図は計算
機バスインターフェイス部のブロック図、第4図はデバ
イスバスインターフェイス部のブロック図、第5図は従
来の他のインターフェイス制御装置の動作説明図である
。 CPUは中央処理装置、INTはインク−フェイス制御
装置、lNT1は計算機バスインターフェイス部、IN
T2はデバイスバスインターフェイス部、MEMはメモ
リ、D1〜DNはプロセス入出カニニット、LOGCI
は組合せ論理回路、LOGC2はROMシーケンサであ
る。 第2図 第5図
Claims (1)
- 中央処理装置とプロセス入出カニニットを接続するイン
ターフェイス制御装置に於いて、計算機バスインターフ
ェイス部と、デバイスインターフ−エイス部ト、該デバ
イスバスインターフェイス部を介して前記プロセス入出
カニニットから送出される入力データ及び前記計算機バ
スインターフェイス部を介して前記中央処理装置から送
出される出力データを記憶するメモリとを備え、前記中
央処理装置から前記プロセス入出カニニットへのデータ
転送は前記中央処理装置から前記計算機バスインターフ
ェイス部を介して前記メモリに書込まれた出力データを
前記デバイスバスインターフェイス部を介して前記プロ
セス入出カニニットを書出すことにより行ない、前記プ
ロセス入出カニニットから前記中央処理装置へのデータ
転送は前記デバイスインターフェイス部を介して前記プ
ロセス入出カニニットから前記メモリに書込まれた入力
データを前記中央処理装置が前記計算機バスインターフ
ェイス部を介して読取ることにより行なう構成とし、且
つ前記両インターフェイス部はPLA又はROMシーケ
ンサ等のソフトロジック構成を有していることを特徴と
するインターフェイス制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2116584U JPS59147236U (ja) | 1984-02-16 | 1984-02-16 | インタ−フエイス制御装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2116584U JPS59147236U (ja) | 1984-02-16 | 1984-02-16 | インタ−フエイス制御装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59147236U true JPS59147236U (ja) | 1984-10-02 |
JPS6324508Y2 JPS6324508Y2 (ja) | 1988-07-05 |
Family
ID=30152299
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2116584U Granted JPS59147236U (ja) | 1984-02-16 | 1984-02-16 | インタ−フエイス制御装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59147236U (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62184557A (ja) * | 1986-02-10 | 1987-08-12 | Nippon Telegr & Teleph Corp <Ntt> | マイクロプロセツサ・バス・インタフエ−ス回路 |
-
1984
- 1984-02-16 JP JP2116584U patent/JPS59147236U/ja active Granted
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62184557A (ja) * | 1986-02-10 | 1987-08-12 | Nippon Telegr & Teleph Corp <Ntt> | マイクロプロセツサ・バス・インタフエ−ス回路 |
Also Published As
Publication number | Publication date |
---|---|
JPS6324508Y2 (ja) | 1988-07-05 |
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