JPS5920351U - マイクロコンピユ−タにおける加算回路 - Google Patents

マイクロコンピユ−タにおける加算回路

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JPS5920351U
JPS5920351U JP11205182U JP11205182U JPS5920351U JP S5920351 U JPS5920351 U JP S5920351U JP 11205182 U JP11205182 U JP 11205182U JP 11205182 U JP11205182 U JP 11205182U JP S5920351 U JPS5920351 U JP S5920351U
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JP
Japan
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adder
microcomputer
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access memory
adder circuit
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JP11205182U
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明 松下
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株式会社東芝
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図はマイクロコンピュータのシステム構成図、第2
図はこの考案の一実施例を示す構成説明図である。 11・・・RAM、12.15・・・バッファ回路、1
3・・・加算器(14・・・CPU、 16・・・ラッ
チ回路、17・・・入出力回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. ランダムアクセスメモリから読み出されたデータを中央
    演算処理装置からの書き込みパルスの前縁で通過させる
    ラッチ回路を含むループと、前記ラッチ回路の出力デー
    タと前記中央演算処理装置からの出力データをハード的
    にビット加算する加算器と、この加算器の出力が加えら
    れ補記書込みパルスの期間に前記ランダムアクセスメモ
    リに出力を加えるバッファ回路とを具備したことを特徴
    トスるマイクロコンピュータにおける加算回路。
JP11205182U 1982-07-23 1982-07-23 マイクロコンピユ−タにおける加算回路 Granted JPS5920351U (ja)

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JPS5920351U true JPS5920351U (ja) 1984-02-07
JPH029401Y2 JPH029401Y2 (ja) 1990-03-08

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01163539U (ja) * 1988-04-28 1989-11-15

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01163539U (ja) * 1988-04-28 1989-11-15
JPH0520439Y2 (ja) * 1988-04-28 1993-05-27

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JPH029401Y2 (ja) 1990-03-08

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