JPS58225464A - 外部記憶サブシステム - Google Patents
外部記憶サブシステムInfo
- Publication number
- JPS58225464A JPS58225464A JP10960382A JP10960382A JPS58225464A JP S58225464 A JPS58225464 A JP S58225464A JP 10960382 A JP10960382 A JP 10960382A JP 10960382 A JP10960382 A JP 10960382A JP S58225464 A JPS58225464 A JP S58225464A
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- JP
- Japan
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- external storage
- disk
- data
- devices
- control device
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- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Human Computer Interaction (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ） 発明の技術分野
本発明は外部記憶サブシステムを構成する外部記憶装置
に該外部記憶装置内の情報の更新が行なわれたことを記
録する手段を設けたととによシ、外部記憶制御装置内に
内蔵されている緩衝記憶機構内のデータを高速に転送可
能とする外部記憶サブシステムに関する。
に該外部記憶装置内の情報の更新が行なわれたことを記
録する手段を設けたととによシ、外部記憶制御装置内に
内蔵されている緩衝記憶機構内のデータを高速に転送可
能とする外部記憶サブシステムに関する。
（ｂ） 従来技術と問題点
従来の外部記憶制御装置内に備えられた緩衝記憶機構は
下記の場合に用いられている。
下記の場合に用いられている。
１） 外部記憶制御装置の上位インタフェースと下位イ
ンタフェースの転送速度差の除去。即ち、一般に外部記
憶制御装置の上位インタフェースは高速のチャンネルに
接続され、下位インタフェースは低速の外部記憶装置、
例えば磁気ディスク装置、磁気テープ装置の如きもので
あるため、データの転送速度に差があシ、高速のチャン
ネルに待ち時間を発生させ情報処理システムの効率を低
下させる。
ンタフェースの転送速度差の除去。即ち、一般に外部記
憶制御装置の上位インタフェースは高速のチャンネルに
接続され、下位インタフェースは低速の外部記憶装置、
例えば磁気ディスク装置、磁気テープ装置の如きもので
あるため、データの転送速度に差があシ、高速のチャン
ネルに待ち時間を発生させ情報処理システムの効率を低
下させる。
２） 外部記憶装置上の物理フォーマットの変換。
即ち、外部記憶装置によシ物理フォーマット、例えば可
変長レコード方式又は固定長レコード方式等の差があり
、これ等の物理フォーマットに差のある外部記憶装置を
そのまま共有して自由にデータの授受は出来ない。
変長レコード方式又は固定長レコード方式等の差があり
、これ等の物理フォーマットに差のある外部記憶装置を
そのまま共有して自由にデータの授受は出来ない。
上記の如き目的の為に用いられる緩衝記憶機構を内蔵す
る外部記憶制御装置は複数の上位装置に接続されランダ
ムにデータ授受が行なわれるが、該緩衝記憶機構内に記
憶されたデータが処理対象のデータであっても、他の上
位装置よシ他の外部記憶制御装置を経て該当データが書
き替えられたかどうか確認をせずには利用することが出
来ない。
る外部記憶制御装置は複数の上位装置に接続されランダ
ムにデータ授受が行なわれるが、該緩衝記憶機構内に記
憶されたデータが処理対象のデータであっても、他の上
位装置よシ他の外部記憶制御装置を経て該当データが書
き替えられたかどうか確認をせずには利用することが出
来ない。
外部記憶装置を例えば磁気ディスク装置とすれば、通常
緩衝記憶機構は該磁気ディスク装置の成るシリンダの成
るトラックのデータを１トラック分記憶している。そし
て、上位装置よシ該当トラック上のレコードのデータ転
送要求があれば、該記憶データを直ちに転送することで
インタフェース上の転送速度差を解消している。しかし
、該データが他の上位装置により書き替えられていた場
合、それを確認せずに転送することは問題で、ｌ、外部
記憶装置よシ再度データの読み込みをしてから転送する
ため、せっかくの前記目的を充分に果たすことができな
い欠点がある。
緩衝記憶機構は該磁気ディスク装置の成るシリンダの成
るトラックのデータを１トラック分記憶している。そし
て、上位装置よシ該当トラック上のレコードのデータ転
送要求があれば、該記憶データを直ちに転送することで
インタフェース上の転送速度差を解消している。しかし
、該データが他の上位装置により書き替えられていた場
合、それを確認せずに転送することは問題で、ｌ、外部
記憶装置よシ再度データの読み込みをしてから転送する
ため、せっかくの前記目的を充分に果たすことができな
い欠点がある。
（ｃ） 発明の目的
本発明の目的は上記欠点を除くため、緩衝記憶憶制御装
置よシ書き替えがなかったかどうかで判定するようにし
て、該データの転送の可否を判断する外部記憶サブシス
テムを提供することにある。
置よシ書き替えがなかったかどうかで判定するようにし
て、該データの転送の可否を判断する外部記憶サブシス
テムを提供することにある。
（ｄ） 発明の構成
本発明の構成は緩衝記憶機構を備えた複数の外部記憶制
御装置と、核外部記憶制御装置に共有されて制御される
複数の外部記憶装置より構成される外部記憶サブシステ
ムに於て、該複数の外部記憶装置に夫々情報を書き替え
たことを記録する手段を設け、前記外部記憶制御装置が
該記録手段の記録内容によシ、該外部記憶制御装置内の
前記緩衝記憶機構に記憶されているデータの転送の可否
を判断するようにしたものである。
御装置と、核外部記憶制御装置に共有されて制御される
複数の外部記憶装置より構成される外部記憶サブシステ
ムに於て、該複数の外部記憶装置に夫々情報を書き替え
たことを記録する手段を設け、前記外部記憶制御装置が
該記録手段の記録内容によシ、該外部記憶制御装置内の
前記緩衝記憶機構に記憶されているデータの転送の可否
を判断するようにしたものである。
（ｅ） 発明の実施例
第１図は本発明の一実施例を示す回路のプ四ツク図であ
る。外部記憶サブシステムにディスクサブシステムを用
いて説明する。ディスクサブシステムの上位装置はチャ
ンネル１と２で夫々チャンネル１はディスク制御装置３
に、チャンネル２はディスク制御装置４に接続される。
る。外部記憶サブシステムにディスクサブシステムを用
いて説明する。ディスクサブシステムの上位装置はチャ
ンネル１と２で夫々チャンネル１はディスク制御装置３
に、チャンネル２はディスク制御装置４に接続される。
ディスク制御装置３及び４は夫々緩衝記憶機構５と６を
内蔵する。ディスク制御装置３及び４は下位装置として
ディスク装置７及び８を共有する。ディスク装置７及び
８は夫々書替記録回路９及び１０を内蔵する。
内蔵する。ディスク制御装置３及び４は下位装置として
ディスク装置７及び８を共有する。ディスク装置７及び
８は夫々書替記録回路９及び１０を内蔵する。
チャンネル１よｐディスク制御装置３に読出し指示があ
るとディスク制御装置３はチャンネル１よシ送られたデ
ィスク装置の機番、例えば７と物理位置を基に目的のデ
ィスク装置７を選択し、ボジシ目ニングを行って所定の
トラックを読出す。
るとディスク制御装置３はチャンネル１よシ送られたデ
ィスク装置の機番、例えば７と物理位置を基に目的のデ
ィスク装置７を選択し、ボジシ目ニングを行って所定の
トラックを読出す。
この時ディスク制御装置３はチャンネル１に目的り分の
データを格納して終了とする。続いて同一トラックにつ
いてデータ要求が発生したことをディスク制御装置３が
判断すると、ディスク制御装置３はディスク装置７の書
替記録回路のライトフラグを調査し、他方のディスク制
御装置４からの書込が実行されていないことを検出する
と、緩衝記憶機構５内のデータをチャンネル１に転送す
る。
データを格納して終了とする。続いて同一トラックにつ
いてデータ要求が発生したことをディスク制御装置３が
判断すると、ディスク制御装置３はディスク装置７の書
替記録回路のライトフラグを調査し、他方のディスク制
御装置４からの書込が実行されていないことを検出する
と、緩衝記憶機構５内のデータをチャンネル１に転送す
る。
チャンネル２よシディスク制御装置４にディスク装置７
の前記と同一トラックに対し書込み指示があると、ディ
スク制御装置４は緩衝記憶機構６に該当φトラックのデ
ータが格納されているか、又は該当トラックのデータが
なければ、該当トラックのデータを格納した後、該緩衝
記憶機構６内の該当トラックの目的レコードを書き替え
ると共にディスク装置７の該当トラックの書込みを実行
する。この時、書替記録回路９のライトフラグを１１＠
にセットする。次にチャンネル１よりディスク制御装置
３にディスク装置７の該当トラックのデータ読出し指示
があると、ディスク制御装置３はディスク装置７の書替
記録回路９のライトフラグがＪｆとなりて、他のディス
ク制御装置４からの書込みがあったことを知シ、現在記
録しているデータの無効を知シ、再度ディスク装置７の
該当トラックのデータを読出す。
の前記と同一トラックに対し書込み指示があると、ディ
スク制御装置４は緩衝記憶機構６に該当φトラックのデ
ータが格納されているか、又は該当トラックのデータが
なければ、該当トラックのデータを格納した後、該緩衝
記憶機構６内の該当トラックの目的レコードを書き替え
ると共にディスク装置７の該当トラックの書込みを実行
する。この時、書替記録回路９のライトフラグを１１＠
にセットする。次にチャンネル１よりディスク制御装置
３にディスク装置７の該当トラックのデータ読出し指示
があると、ディスク制御装置３はディスク装置７の書替
記録回路９のライトフラグがＪｆとなりて、他のディス
ク制御装置４からの書込みがあったことを知シ、現在記
録しているデータの無効を知シ、再度ディスク装置７の
該当トラックのデータを読出す。
上記説明はディスク装置８及び書替記録回路１０につい
てもディスク装置７と書替記録回路９と同−であシ、デ
ータの書込み又は読出し動作もチャンネル１系と２系が
入替りた場合も同一であることは勿論である。又、緩衝
記憶機構の容量が１トラック分として説明したが、該記
憶容量が複数トラック分あれば書替記録回路も該トラッ
ク分の数だけ必要となる。
てもディスク装置７と書替記録回路９と同−であシ、デ
ータの書込み又は読出し動作もチャンネル１系と２系が
入替りた場合も同一であることは勿論である。又、緩衝
記憶機構の容量が１トラック分として説明したが、該記
憶容量が複数トラック分あれば書替記録回路も該トラッ
ク分の数だけ必要となる。
第２図は書替記録回路９及び１０の詳細回路図である。
端子Ａよシディスク制御装置４の書込み信号が入り、ソ
リツブフロップ１１の端子プに入る。端子Ｂよシディス
ク制御装置３からの読出し信号が入りＯＲ回路１３に加
わる。端子Ｅは電源投入時、一時ＯＮとなチＯＲ回路１
３に加わる。
リツブフロップ１１の端子プに入る。端子Ｂよシディス
ク制御装置３からの読出し信号が入りＯＲ回路１３に加
わる。端子Ｅは電源投入時、一時ＯＮとなチＯＲ回路１
３に加わる。
従って、フリップフロップ１１は電源投入でリセットさ
れ、ディスク制御装置４より書込みがあると端子Ｑを１
１１としてライトフラグを１１１とし、ディスク制御装
置３から読出されると１０１にリセットされる。従って
、端子Ｆはディスク制御装置３用のライトフラグとして
用いられる。
れ、ディスク制御装置４より書込みがあると端子Ｑを１
１１としてライトフラグを１１１とし、ディスク制御装
置３から読出されると１０１にリセットされる。従って
、端子Ｆはディスク制御装置３用のライトフラグとして
用いられる。
端子Ｃよシはディスク制御装置３からの書込み信号が入
や、フリップフロップ１２の端子Ｓに入る。端子りよシ
はディスク制御装置４からの読出し信号がＯＲ回路１４
に加わる。従って、クリップフロップ１２の端子Ｑは電
源投入時リセットされ、ディスク制御装置３がら書込み
がある′と端子Ｇを１１１としてディスク制御装置４よ
シ読出されると１０１となる。従って、端子Ｇはディス
ク制御装置４用のライトフラグとして用いられる。
や、フリップフロップ１２の端子Ｓに入る。端子りよシ
はディスク制御装置４からの読出し信号がＯＲ回路１４
に加わる。従って、クリップフロップ１２の端子Ｑは電
源投入時リセットされ、ディスク制御装置３がら書込み
がある′と端子Ｇを１１１としてディスク制御装置４よ
シ読出されると１０１となる。従って、端子Ｇはディス
ク制御装置４用のライトフラグとして用いられる。
（ｆ） 発明の詳細
な説明した如く、本発明は緩衝記憶機構のデータが最新
のものかどうか簡単にチェック出来るため、上位インタ
フェース間で高速のデータ転送が可能となるばかシでな
く、緩衝記憶機構の記憶エリアを大きくシ、記憶するト
ラックの数を多くすればする程、追加するハード量は大
きなものではないため、その効果は大なるものがある。
のものかどうか簡単にチェック出来るため、上位インタ
フェース間で高速のデータ転送が可能となるばかシでな
く、緩衝記憶機構の記憶エリアを大きくシ、記憶するト
ラックの数を多くすればする程、追加するハード量は大
きなものではないため、その効果は大なるものがある。
第１図は本発明の一実施例を示す回路のブロック図、第
２図は書替記録回路の詳細図である。 １．２はチャンネル−３，４はディスク制御装置、５，
６は緩衝記憶機１構、７，８はディスク装置、９．１０
は書替記録回路である。 ３
２図は書替記録回路の詳細図である。 １．２はチャンネル−３，４はディスク制御装置、５，
６は緩衝記憶機１構、７，８はディスク装置、９．１０
は書替記録回路である。 ３
Claims (1)
- 緩衝記憶機構を備えた複数の外部記憶制御装置と、該外
部記憶制御装置に共有されて制御される複数の外部記憶
装置よシ構成される外部記憶サブシステムに於て、該複
数の外部記憶装置に夫々情報を書き替えたことを記録す
る手段を設け、前記外部記憶制御装置が該記録手段の記
録内容によシ、核外、部記憶制御装置内の前記緩衝記憶
機構に記憶されているデータの転送の可否を判断するこ
とを特徴とする外部記憶サブシステム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10960382A JPS58225464A (ja) | 1982-06-25 | 1982-06-25 | 外部記憶サブシステム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10960382A JPS58225464A (ja) | 1982-06-25 | 1982-06-25 | 外部記憶サブシステム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58225464A true JPS58225464A (ja) | 1983-12-27 |
Family
ID=14514462
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10960382A Pending JPS58225464A (ja) | 1982-06-25 | 1982-06-25 | 外部記憶サブシステム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58225464A (ja) |
-
1982
- 1982-06-25 JP JP10960382A patent/JPS58225464A/ja active Pending
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