JPS63306567A - 回転型記憶装置 - Google Patents
回転型記憶装置Info
- Publication number
- JPS63306567A JPS63306567A JP14176487A JP14176487A JPS63306567A JP S63306567 A JPS63306567 A JP S63306567A JP 14176487 A JP14176487 A JP 14176487A JP 14176487 A JP14176487 A JP 14176487A JP S63306567 A JPS63306567 A JP S63306567A
- Authority
- JP
- Japan
- Prior art keywords
- tracks
- head
- combination
- storage device
- track
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000002950 deficient Effects 0.000 abstract description 11
- 230000007547 defect Effects 0.000 abstract description 3
- 238000012545 processing Methods 0.000 abstract description 2
- 238000000034 method Methods 0.000 description 6
- 238000010586 diagram Methods 0.000 description 3
- 238000012546 transfer Methods 0.000 description 2
- 230000007423 decrease Effects 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は磁気ディスク装置、光デイスク装置などの回転
型記憶装置に関し、特に複数Ｉ１１のトラ・・りに対し
並列にデータの読取シ／書込みを実施する高性能回転型
記憶装置に関する。
型記憶装置に関し、特に複数Ｉ１１のトラ・・りに対し
並列にデータの読取シ／書込みを実施する高性能回転型
記憶装置に関する。
近年、コンビエータシステムの発達社めざましく、特に
中央処理装置の高性能化は著しい。これ忙対し、磁気デ
ィスク装置などの外部記憶装置も年々高性能化している
が、スーパーコンビ、−タの出現などにより外部記憶装
置に対する高性能化への要求は益々強まる一方である。
中央処理装置の高性能化は著しい。これ忙対し、磁気デ
ィスク装置などの外部記憶装置も年々高性能化している
が、スーパーコンビ、−タの出現などにより外部記憶装
置に対する高性能化への要求は益々強まる一方である。
この様な高性能化への要求に応えるため、複数個のトラ
ックに対して並列に読取シ又は書込みを実施する外部記
憶装置が開発され、使用されている これらの外部記憶装置においては、複数個のトラック上
にバラバラに存在する欠陥部分を回避するため、あるト
ラック上に欠陥部分が 存在するとき、同時に読取り／書込みが実施されるすべ
てのトラックに対して共通に欠陥部分を回避するための
処理を実施する方法が考えられる。
ックに対して並列に読取シ又は書込みを実施する外部記
憶装置が開発され、使用されている これらの外部記憶装置においては、複数個のトラック上
にバラバラに存在する欠陥部分を回避するため、あるト
ラック上に欠陥部分が 存在するとき、同時に読取り／書込みが実施されるすべ
てのトラックに対して共通に欠陥部分を回避するための
処理を実施する方法が考えられる。
しかしながら、この方法では並列（て読取り／書込みが
実施されるトラック上に存在する欠陥部分の合計がトラ
ックｉｂのデフェクトスキップ処理すべき回数となるた
め、トラック当りの記憶容量が低下するという欠点があ
る。
実施されるトラック上に存在する欠陥部分の合計がトラ
ックｉｂのデフェクトスキップ処理すべき回数となるた
め、トラック当りの記憶容量が低下するという欠点があ
る。
本発明の複数個のトラックに対して並列にデータの読取
シ／書込みを実施する回転型記憶装置は、同時に読取り
又は書込みが実施されるトラックを任意に選択する手段
を有する。
シ／書込みを実施する回転型記憶装置は、同時に読取り
又は書込みが実施されるトラックを任意に選択する手段
を有する。
次に図面を参照して本発明の実施例について説明する。
第１図は本発明の一実施例をブロック的に示した回路図
である。
である。
第１図を参照すると、本発明の一実施例の回転型記憶装
置は、制御ユニット２１とこれに接続される複数個の記
憶ユニット３１．３２．・・・・・・より構成される。
置は、制御ユニット２１とこれに接続される複数個の記
憶ユニット３１．３２．・・・・・・より構成される。
制御ユニット２１は第１インタフエース回路２１１．デ
ータ転送制御回路２１２．第２インタフエース回路２１
３．°ｔイクロプログラム制御回路２１４．及び記憶回
路２１５より構成される。また、記憶ユニット３１はイ
ンタフェース回路３１１．第１Ｒ／Ｗ３１２．第２Ｒ／
Ｗ回路３１３、Ｒ／Ｗヘッド選択回路３１４．第１Ｒ／
Ｗヘツドアドレスレジスタ３１５． 第２ Ｒ／Ｗヘッ
ドアドレスレジスタ３１６１位置決め制御回路３１７、
位置決め機構３１８．第０．１．２．３ Ｒ，／Ｗヘッ
ド３２１ 、３２２．３２３．３２４及び記録媒体３３
１３３２ 、３３３より構成される。本発明の一実施例
においては、２つのトラックに対して並列に読取り７／
書込みを実施することができる。
ータ転送制御回路２１２．第２インタフエース回路２１
３．°ｔイクロプログラム制御回路２１４．及び記憶回
路２１５より構成される。また、記憶ユニット３１はイ
ンタフェース回路３１１．第１Ｒ／Ｗ３１２．第２Ｒ／
Ｗ回路３１３、Ｒ／Ｗヘッド選択回路３１４．第１Ｒ／
Ｗヘツドアドレスレジスタ３１５． 第２ Ｒ／Ｗヘッ
ドアドレスレジスタ３１６１位置決め制御回路３１７、
位置決め機構３１８．第０．１．２．３ Ｒ，／Ｗヘッ
ド３２１ 、３２２．３２３．３２４及び記録媒体３３
１３３２ 、３３３より構成される。本発明の一実施例
においては、２つのトラックに対して並列に読取り７／
書込みを実施することができる。
第２図は並列に読取り、／ｆ込みを実施するトラックの
組合せを記録したトラック群構成テーブルであり、各記
憶ユニット内の記録媒体上の特定のエリアに記録されて
いる。本発明の回転型記憶装置はトラック当りＮ個の欠
陥箇所を避けてデータ読取り／書込みを実施することが
可能であるものとする。また、本発明の一実施例では４
個のＲ／Ｗヘッドが存在し、並列に読取り／９１込みが
実施されろＲ／Ｗヘッドの組合せは通常端ＯＲ／Ｗヘッ
ド３２１及び第１Ｒ／Ｗヘツド３２２並びに第２Ｒ，／
Ｗヘッド３２３及び第３Ｒ／Ｗヘツド３２４とする。こ
の組合せにおいて２つのトラックの欠陥箇所の合計がＮ
個以内であれば正常に処理することができるが、Ｎ個を
越えた場合忙は処理することができないので、並列Ｉτ
読取Ｍ１ｉＦ込みを実施するトラックの組合せを変え、
２つのトラックの欠陥箇所の合計がＮ個以下となるトラ
ックの組合せを選択することが必要である。
組合せを記録したトラック群構成テーブルであり、各記
憶ユニット内の記録媒体上の特定のエリアに記録されて
いる。本発明の回転型記憶装置はトラック当りＮ個の欠
陥箇所を避けてデータ読取り／書込みを実施することが
可能であるものとする。また、本発明の一実施例では４
個のＲ／Ｗヘッドが存在し、並列に読取り／９１込みが
実施されろＲ／Ｗヘッドの組合せは通常端ＯＲ／Ｗヘッ
ド３２１及び第１Ｒ／Ｗヘツド３２２並びに第２Ｒ，／
Ｗヘッド３２３及び第３Ｒ／Ｗヘツド３２４とする。こ
の組合せにおいて２つのトラックの欠陥箇所の合計がＮ
個以内であれば正常に処理することができるが、Ｎ個を
越えた場合忙は処理することができないので、並列Ｉτ
読取Ｍ１ｉＦ込みを実施するトラックの組合せを変え、
２つのトラックの欠陥箇所の合計がＮ個以下となるトラ
ックの組合せを選択することが必要である。
この機なトラックの組合せが選択できた場合には、第２
図における咎エントリ５０１．５（１２，５０３，・・
・・・・に馴々忙組合せを記録していく。第２図におけ
る各エントリ５０１．５０２．−・・・・・はそれぞれ
論理シリンダ番号６０１．論理ヘッド番号６０２及び並
列に読取り／Ｉｌｔ込みが実施される２′つのトラック
のアドレスである物理第１シリンダ番号６０３．物理第
１ヘッド番号６０４及び物理第２シリンダ番号６０５、
物理第２ヘッド番号６０６から構成されている。尚、本
集施例においては“、論理シリンダ番号６０１．物理第
１シリンダ番号６０３及び物理＠２シリンダ番号６０５
の内容は一致している。
図における咎エントリ５０１．５（１２，５０３，・・
・・・・に馴々忙組合せを記録していく。第２図におけ
る各エントリ５０１．５０２．−・・・・・はそれぞれ
論理シリンダ番号６０１．論理ヘッド番号６０２及び並
列に読取り／Ｉｌｔ込みが実施される２′つのトラック
のアドレスである物理第１シリンダ番号６０３．物理第
１ヘッド番号６０４及び物理第２シリンダ番号６０５、
物理第２ヘッド番号６０６から構成されている。尚、本
集施例においては“、論理シリンダ番号６０１．物理第
１シリンダ番号６０３及び物理＠２シリンダ番号６０５
の内容は一致している。
この様なトラックの組合せが選択できずに、２つのトラ
ックの欠陥箇所の合計がＮ個を越えてしまう場合には磁
気ディスクｎｔＵでお艷て不良交代トラック処理として
広く使用されている技術によシ解決することができる。
ックの欠陥箇所の合計がＮ個を越えてしまう場合には磁
気ディスクｎｔＵでお艷て不良交代トラック処理として
広く使用されている技術によシ解決することができる。
また、これらの処理は記憶ユニット３１，３２．・・・
・・・の工場からの出荷以前に実施されるものとする。
・・・の工場からの出荷以前に実施されるものとする。
さて、本発明の回転型記憶装置の初期設定時に制御ユニ
ット２１内のマイクロプログラム制御回路２１４は各記
憶ユニット内の第２図に示すトラック群構成テーブルを
読取し、記憶回路２１５に記憶しておく。
ット２１内のマイクロプログラム制御回路２１４は各記
憶ユニット内の第２図に示すトラック群構成テーブルを
読取し、記憶回路２１５に記憶しておく。
次に本発明の回転型記憶装置が接続されている上位装ｆ
ｌｉｔからアクセス要求があり、Ｒ／Ｗヘッドの位置決
め選択命令が送られると、・マイクロプログラム制御回
路２１４は記憶回路２１５内の選択されてりる記憶ユニ
ツ）Ｋ対応す”るエリアを検索し、Ｒ／Ｗヘッドの位置
決め選択命令によね送られたシリンダ番号、ヘッド番号
と一致する論理シリンダ番号、論理ヘッド番号の有無を
調査する。一致するものがられば、物理第１シリンダ番
号で指定されるシリンダに位置決めを行い、物理第１及
び第２ヘッド番号の内容を記憶ユニット３１内のぞれぞ
れ第１Ｒ，／Ｗヘッドアドレスレジスタ３１５． 第２
Ｒ，／Ｗヘッドアドレスレジスタ３１Ｇにセクトする
。一致するものがなければ、Ｒ／Ｗヘッドの位置決め選
択命令によシ送られたシリンダ番号１τより指定される
シリンダ醗て位置決めを行い、Ｒ／Ｗヘッドの位置決め
選択命令により送られ念ヘッド番号からあらかじめ定め
られたルールで計算されるｔｇｌＲ，／Ｗヘッド番号及
び第２Ｒ，／Ｗヘッド番号を算出し、それぞれ第１Ｒ／
Ｗヘツドアドレスレジスタ３１５及び第２Ｒ／Ｗヘツド
アドレスレジスタにセットする。
ｌｉｔからアクセス要求があり、Ｒ／Ｗヘッドの位置決
め選択命令が送られると、・マイクロプログラム制御回
路２１４は記憶回路２１５内の選択されてりる記憶ユニ
ツ）Ｋ対応す”るエリアを検索し、Ｒ／Ｗヘッドの位置
決め選択命令によね送られたシリンダ番号、ヘッド番号
と一致する論理シリンダ番号、論理ヘッド番号の有無を
調査する。一致するものがられば、物理第１シリンダ番
号で指定されるシリンダに位置決めを行い、物理第１及
び第２ヘッド番号の内容を記憶ユニット３１内のぞれぞ
れ第１Ｒ，／Ｗヘッドアドレスレジスタ３１５． 第２
Ｒ，／Ｗヘッドアドレスレジスタ３１Ｇにセクトする
。一致するものがなければ、Ｒ／Ｗヘッドの位置決め選
択命令によシ送られたシリンダ番号１τより指定される
シリンダ醗て位置決めを行い、Ｒ／Ｗヘッドの位置決め
選択命令により送られ念ヘッド番号からあらかじめ定め
られたルールで計算されるｔｇｌＲ，／Ｗヘッド番号及
び第２Ｒ，／Ｗヘッド番号を算出し、それぞれ第１Ｒ／
Ｗヘツドアドレスレジスタ３１５及び第２Ｒ／Ｗヘツド
アドレスレジスタにセットする。
記憶二二ツ）３１においては第１Ｉ（／Ｗヘッドアドレ
スレジスタ３１５及び第２Ｒ／Ｗヘツドアドレスレジス
タ３１６の内容によシ指定される２つのＲ／Ｗヘッドを
用いて２つのトラックに対して読取シ又は書込みが実施
される。
スレジスタ３１５及び第２Ｒ／Ｗヘツドアドレスレジス
タ３１６の内容によシ指定される２つのＲ／Ｗヘッドを
用いて２つのトラックに対して読取シ又は書込みが実施
される。
以上説明した様釦、うらかじめ記録媒体のテストを実施
し、並列に処理すべきトラック上の欠陥部分の数が一定
数を越えない椋なトラックの組合せを決定し、組合せに
関する情報を記鈴媒体上の特定、のエリアに記録してお
くことにより、トラック幽）のデ７エクトスキップ処理
の数を減らすことができる。
し、並列に処理すべきトラック上の欠陥部分の数が一定
数を越えない椋なトラックの組合せを決定し、組合せに
関する情報を記鈴媒体上の特定、のエリアに記録してお
くことにより、トラック幽）のデ７エクトスキップ処理
の数を減らすことができる。
第１図は本発明の一実施例を示すブロック図、第２図は
各トラックのヘッドアドレスを記憶するメモリエリアを
示す図である。 １１・・・・・・上位装置、２１・・・・・・制御ユニ
ット、２１１・・・・・・第１インターフエース回％、
２１２・・・・・・データ転送制御回路、２１３・−・
・・・第２インターフェース回路、２１４・・・・・・
マイクロプログラム制御回路、２１５・・・・・・記憶
回路、３１．３２・・・・・・記憶ユニット、３１１・
・・・・・インターフェース回路、３１２・・・・・・
第１Ｒ／Ｗ回路、３１３・・・・・・第２Ｒ１／Ｗ回路
、３１４・・・・・・Ｒ／Ｗヘッド選択回路、３１５・
・・・・・第１Ｒ／Ｗヘツドアドレスレジスタ、３１６
・・・・・−第２Ｒ，／Ｗヘッドアドレスレジスタ、３
１７・・・・・・位置決め制御回路、３１８・・・・・
・位置決め機構、３２１・・・・・・第２Ｒ１／Ｗヘツ
ド、３２２・・・・・・第１Ｒ、／Ｗヘッド、３２３・
・・・・・第２Ｒ，／Ｗヘッド１３２°°°°°°第３
Ｒ，／Ｗヘッド、３３１．３３２．３３３・・・・・・
記録媒体、５０１ 、５０２．５０３ 、・・・・・・
エントリー、６０１−°。 ・・・論理シリンダ番号、６０２・・・・・・論理ヘッ
ド番号、６０３・・・・・・物理第１シリンダ番号、６
０４・・・・・・物理第１ヘッド番号、６０５・・・・
・・物理第２シリンダ番号、６０６・・・・・・物理第
２ヘッド番号。 、τ〉 代理人 弁理士 内 原 晋、゛、ｊ＼−一／
各トラックのヘッドアドレスを記憶するメモリエリアを
示す図である。 １１・・・・・・上位装置、２１・・・・・・制御ユニ
ット、２１１・・・・・・第１インターフエース回％、
２１２・・・・・・データ転送制御回路、２１３・−・
・・・第２インターフェース回路、２１４・・・・・・
マイクロプログラム制御回路、２１５・・・・・・記憶
回路、３１．３２・・・・・・記憶ユニット、３１１・
・・・・・インターフェース回路、３１２・・・・・・
第１Ｒ／Ｗ回路、３１３・・・・・・第２Ｒ１／Ｗ回路
、３１４・・・・・・Ｒ／Ｗヘッド選択回路、３１５・
・・・・・第１Ｒ／Ｗヘツドアドレスレジスタ、３１６
・・・・・−第２Ｒ，／Ｗヘッドアドレスレジスタ、３
１７・・・・・・位置決め制御回路、３１８・・・・・
・位置決め機構、３２１・・・・・・第２Ｒ１／Ｗヘツ
ド、３２２・・・・・・第１Ｒ、／Ｗヘッド、３２３・
・・・・・第２Ｒ，／Ｗヘッド１３２°°°°°°第３
Ｒ，／Ｗヘッド、３３１．３３２．３３３・・・・・・
記録媒体、５０１ 、５０２．５０３ 、・・・・・・
エントリー、６０１−°。 ・・・論理シリンダ番号、６０２・・・・・・論理ヘッ
ド番号、６０３・・・・・・物理第１シリンダ番号、６
０４・・・・・・物理第１ヘッド番号、６０５・・・・
・・物理第２シリンダ番号、６０６・・・・・・物理第
２ヘッド番号。 、τ〉 代理人 弁理士 内 原 晋、゛、ｊ＼−一／
Claims (1)
- 複数個のトラックに対して並列にデータの読取り／書込
みを行なう回転型記憶装置において、前記複数個のトラ
ックに各々割当てられた複数個のヘッドと同時に読取り
又は書込みが実施される前記ヘッドの組合わせを選択す
る手段とを有することを特徴とする回転型記憶装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14176487A JPS63306567A (ja) | 1987-06-05 | 1987-06-05 | 回転型記憶装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14176487A JPS63306567A (ja) | 1987-06-05 | 1987-06-05 | 回転型記憶装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63306567A true JPS63306567A (ja) | 1988-12-14 |
Family
ID=15299637
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14176487A Pending JPS63306567A (ja) | 1987-06-05 | 1987-06-05 | 回転型記憶装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63306567A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9142246B1 (en) * | 2014-10-10 | 2015-09-22 | Seagate Technology Llc | Apparatus and methods to reduce hard disk drive manufacturing test time |
| US9361919B1 (en) | 2014-10-10 | 2016-06-07 | Seagate Technology Llc | Disk drive with parallel head actuation |
| US10255943B1 (en) | 2018-05-17 | 2019-04-09 | Seagate Technology Llc | Independent head, dual reader control logic |
-
1987
- 1987-06-05 JP JP14176487A patent/JPS63306567A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9142246B1 (en) * | 2014-10-10 | 2015-09-22 | Seagate Technology Llc | Apparatus and methods to reduce hard disk drive manufacturing test time |
| US9361919B1 (en) | 2014-10-10 | 2016-06-07 | Seagate Technology Llc | Disk drive with parallel head actuation |
| US10255943B1 (en) | 2018-05-17 | 2019-04-09 | Seagate Technology Llc | Independent head, dual reader control logic |
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