JPS58220588A - 映像信号処理装置 - Google Patents
映像信号処理装置Info
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- JPS58220588A JPS58220588A JP57103027A JP10302782A JPS58220588A JP S58220588 A JPS58220588 A JP S58220588A JP 57103027 A JP57103027 A JP 57103027A JP 10302782 A JP10302782 A JP 10302782A JP S58220588 A JPS58220588 A JP S58220588A
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/30—Transforming light or analogous information into electric information
- H04N5/32—Transforming X-rays
- H04N5/3205—Transforming X-rays using subtraction imaging techniques
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05G—X-RAY TECHNIQUE
- H05G1/00—X-ray apparatus involving X-ray tubes; Circuits therefor
- H05G1/08—Electrical details
- H05G1/64—Circuit arrangements for X-ray apparatus incorporating image intensifiers
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Apparatus For Radiation Diagnosis (AREA)
- Analysing Materials By The Use Of Radiation (AREA)
- Synchronizing For Television (AREA)
- Closed-Circuit Television Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は映像信号発生装置より伝送される映像信号を、
映像信号処理装置内部で発生させた内部クロックに基づ
いて所定の処理を打つ映像信号処理装置に関するもので
ある。
映像信号処理装置内部で発生させた内部クロックに基づ
いて所定の処理を打つ映像信号処理装置に関するもので
ある。
従来より、例えばＸ線テレビカメラを使用したＸ線撮影
装置において、テレビカメラの出力である映像信号をそ
のままモニタ上に表示しないで、前記映像信号をルω変
換してフレームメモリ等に記憶させ、所望のディジタル
処理を加えた後再びルク変換してモニタ上に表示するこ
とがある。この場合、例えば前記フレームメモリに記憶
する際のメモリアドレスの都合上、前記映像信号の同期
信号を内部クロックから作成している。ところが、前記
映像信号に重畳している水平同期信号の周期が前記西部
クロックの基本周期の整数倍罠なっていないことが多い
。例えば第１図に示すように、映像信号に重畳している
水平同期信号すの所定の立ち上り部を内部クロックＣの
立ち上り部と一致させた場合、次の水平同期信号すの立
ち上り部が必ずしも内部クロックＣの立ち上り部に一致
するとは限らない。この場合、前記映像信号をフレーム
メモリへ取り込む同期を内部クロックＣを用いて行うと
最大１ピクセル（クロックの一周期分）のずれを発生さ
せることＫなる。このような映像信号をモニタ上に再生
した場合には、モニタ上の画像が細かく揺れ動き、画像
のぶれが生ずることになる。このぶれは、例えば内部ク
ロックのピッチを１００ＷＪＰとすると、１６インチの
モニタ上に再生される画像は最大０．７−の幅で生ずる
こととなり、画像の劣化が著しかった。さら罠、複数枚
の画像を加算平均する場合にあっては、同期信号のずれ
に基づく情報のずれが加算されて空間分解（１１： 能の低下をも招くこととなっ□た。
装置において、テレビカメラの出力である映像信号をそ
のままモニタ上に表示しないで、前記映像信号をルω変
換してフレームメモリ等に記憶させ、所望のディジタル
処理を加えた後再びルク変換してモニタ上に表示するこ
とがある。この場合、例えば前記フレームメモリに記憶
する際のメモリアドレスの都合上、前記映像信号の同期
信号を内部クロックから作成している。ところが、前記
映像信号に重畳している水平同期信号の周期が前記西部
クロックの基本周期の整数倍罠なっていないことが多い
。例えば第１図に示すように、映像信号に重畳している
水平同期信号すの所定の立ち上り部を内部クロックＣの
立ち上り部と一致させた場合、次の水平同期信号すの立
ち上り部が必ずしも内部クロックＣの立ち上り部に一致
するとは限らない。この場合、前記映像信号をフレーム
メモリへ取り込む同期を内部クロックＣを用いて行うと
最大１ピクセル（クロックの一周期分）のずれを発生さ
せることＫなる。このような映像信号をモニタ上に再生
した場合には、モニタ上の画像が細かく揺れ動き、画像
のぶれが生ずることになる。このぶれは、例えば内部ク
ロックのピッチを１００ＷＪＰとすると、１６インチの
モニタ上に再生される画像は最大０．７−の幅で生ずる
こととなり、画像の劣化が著しかった。さら罠、複数枚
の画像を加算平均する場合にあっては、同期信号のずれ
に基づく情報のずれが加算されて空間分解（１１： 能の低下をも招くこととなっ□た。
〔発明の目的〕
本発明は前記事情に鑑みてなされたものであり、映像信
号における水平同期信号と内部クロックとの位相差を軽
減することにより、処理後の画像のぶれの低減を図ると
共圧空間分解能の向上をも図ることができる映像信号処
理装置を提供することを目的とするものである。
号における水平同期信号と内部クロックとの位相差を軽
減することにより、処理後の画像のぶれの低減を図ると
共圧空間分解能の向上をも図ることができる映像信号処
理装置を提供することを目的とするものである。
前記目的を達成するための本発明の概要は、映像信号発
生装置より伝送される映像信号を、映像信号処理装置内
部で発生させた内部クロックに基づいて所定の処理を行
う映像信号処理装置において、一定周期Ｔの基準クロッ
クを発生させる基準クロック発生手段と、該基準クロッ
ク発生手段の出力を入力すると共に基準クロックよりも
ｋＴ／／Ｌ（ル、には整数であってル≧２．０≦に≦ｎ
−１）の位相差を有するｎ通りのクロックを発生させる
遅延手段と、該遅延手段の出力をへカすると共に、前記
映像信号における水平同期信号罠基づいて前記遅延手段
の出力をラッチするランチ回路と、前記遅延手段の出力
を入力すると共に１前記ラッチ回路の出力に基づいて前
記ル通りのクロックのうち前記水平同期信号に位相が最
も近いクロックを選択し、これを内部クロックとして出
力する選択手段とを有することを特徴とするものである
。
生装置より伝送される映像信号を、映像信号処理装置内
部で発生させた内部クロックに基づいて所定の処理を行
う映像信号処理装置において、一定周期Ｔの基準クロッ
クを発生させる基準クロック発生手段と、該基準クロッ
ク発生手段の出力を入力すると共に基準クロックよりも
ｋＴ／／Ｌ（ル、には整数であってル≧２．０≦に≦ｎ
−１）の位相差を有するｎ通りのクロックを発生させる
遅延手段と、該遅延手段の出力をへカすると共に、前記
映像信号における水平同期信号罠基づいて前記遅延手段
の出力をラッチするランチ回路と、前記遅延手段の出力
を入力すると共に１前記ラッチ回路の出力に基づいて前
記ル通りのクロックのうち前記水平同期信号に位相が最
も近いクロックを選択し、これを内部クロックとして出
力する選択手段とを有することを特徴とするものである
。
以下、本発明の一実施例を図面を参照して説明する。第
２図は本発明の一実施例である映像信号処理装置のブロ
ックダイヤグラムである。第２図において、１は映像信
号発生装置例えばＴＶ左カメラあり映像信号αを出力す
る。２はアナログ−ディジタルインターフェース（以下
ルΦインターフェースと略記する）であり、内部クロッ
ク発生装置（詳細は後述する）４の出力である内部クロ
ックＣに基づいて前記映像信号αを画像信号ａ′と水平
同期信号すとに分離する。６は画像メモリであり、前記
ルωインターフェース２の出力である画像信号α′を前
記内部クロック発生装置４の出力である内部クロックＣ
Ｋ基づいて各アドレス毎罠記憶する０次に前記内部クロ
ック発生装置４について説明する。内部クロック発生装
置４において、５は基準クロック発生手段であり、例え
ば水晶発振器６と分局器７とで構成される。この基準ク
ロック発生手段は周期Ｔの基準クロックｃｏを発生させ
る。８は遅延手段であり、前記基準クロック発生手段５
の出力である基準クロックＣ６を入力すると共に１この
基準クロックＣ６の周期Ｔに基づい二順次Ｔ／Ｉｎ（ｒ
Ｌは２以上の整数）の位相だけ遅延したｎ種類のクロッ
クを発生させる。例えば第６図に示すように、基準クロ
ックｃ６の周期Ｔを１００ ｎｙとし、ルを５とすると
、基準周期Ｃ６よりも順次２ＯｎＳづつ遅延したクロッ
ク’Ｉｓ ’２＊ ’３ｅ ’４を発生させ、基準クロ
ックＣ０と共に出力する。９はラッチ回路であり、前記
遅延手段８の出力を入力すると共に１前記ルωインター
フエース２で分離すれた水平同期信号すの同期タイミン
グで前記遅延手段８の出力であるクロックＣ６”” Ｃ
ｒＬをラッチする。
２図は本発明の一実施例である映像信号処理装置のブロ
ックダイヤグラムである。第２図において、１は映像信
号発生装置例えばＴＶ左カメラあり映像信号αを出力す
る。２はアナログ−ディジタルインターフェース（以下
ルΦインターフェースと略記する）であり、内部クロッ
ク発生装置（詳細は後述する）４の出力である内部クロ
ックＣに基づいて前記映像信号αを画像信号ａ′と水平
同期信号すとに分離する。６は画像メモリであり、前記
ルωインターフェース２の出力である画像信号α′を前
記内部クロック発生装置４の出力である内部クロックＣ
Ｋ基づいて各アドレス毎罠記憶する０次に前記内部クロ
ック発生装置４について説明する。内部クロック発生装
置４において、５は基準クロック発生手段であり、例え
ば水晶発振器６と分局器７とで構成される。この基準ク
ロック発生手段は周期Ｔの基準クロックｃｏを発生させ
る。８は遅延手段であり、前記基準クロック発生手段５
の出力である基準クロックＣ６を入力すると共に１この
基準クロックＣ６の周期Ｔに基づい二順次Ｔ／Ｉｎ（ｒ
Ｌは２以上の整数）の位相だけ遅延したｎ種類のクロッ
クを発生させる。例えば第６図に示すように、基準クロ
ックｃ６の周期Ｔを１００ ｎｙとし、ルを５とすると
、基準周期Ｃ６よりも順次２ＯｎＳづつ遅延したクロッ
ク’Ｉｓ ’２＊ ’３ｅ ’４を発生させ、基準クロ
ックＣ０と共に出力する。９はラッチ回路であり、前記
遅延手段８の出力を入力すると共に１前記ルωインター
フエース２で分離すれた水平同期信号すの同期タイミン
グで前記遅延手段８の出力であるクロックＣ６”” Ｃ
ｒＬをラッチする。
例えば第３図に示すように、各クロックＣＯ’％−Ｃ４
に対して図示Ａ線が水平同期信号すの同期タイミングで
あれば、この際のラッチ回路９の出力は（１゜０ 、０
、０，１ ）となる。１０αはＲＯＭであり、前記ラ
ッチ回路９の出カバターンを解読し、この出カバターン
に応じてそれぞれ異なる選択信号ｄを出力する。１０ｂ
はセレクタであり、前記遅延手段８の出力である各クロ
ックｃ０〜〜を入力すると共に１前記ＲＯＭ１０αから
の選択信号ｄＶＣ基づいて、各クロックＣ・〜へのうち
の−っを選択して内部クロックＣとして出力する。前記
ＲＯＭ１０αとセレクタ１０ｂとで選択手段１１を構成
している。前記画像メモ９５に記憶されている映像信号
α′は、所定のディジタル処理例えばサブトラクション
等の処理が行なわれた後、ディジタル−アナログインタ
ーフェース（以下Ｄ／Ａインターフェースと略記する）
１２に入力する。Ｄ／Ａインターフェース１２は前記セ
レクタ１１で選択された内部クロックｃＫ基づいて、前
記画像信号α′をアナログ信号に変換し、モニタ−３上
忙画像表示するよう忙なっている。
に対して図示Ａ線が水平同期信号すの同期タイミングで
あれば、この際のラッチ回路９の出力は（１゜０ 、０
、０，１ ）となる。１０αはＲＯＭであり、前記ラ
ッチ回路９の出カバターンを解読し、この出カバターン
に応じてそれぞれ異なる選択信号ｄを出力する。１０ｂ
はセレクタであり、前記遅延手段８の出力である各クロ
ックｃ０〜〜を入力すると共に１前記ＲＯＭ１０αから
の選択信号ｄＶＣ基づいて、各クロックＣ・〜へのうち
の−っを選択して内部クロックＣとして出力する。前記
ＲＯＭ１０αとセレクタ１０ｂとで選択手段１１を構成
している。前記画像メモ９５に記憶されている映像信号
α′は、所定のディジタル処理例えばサブトラクション
等の処理が行なわれた後、ディジタル−アナログインタ
ーフェース（以下Ｄ／Ａインターフェースと略記する）
１２に入力する。Ｄ／Ａインターフェース１２は前記セ
レクタ１１で選択された内部クロックｃＫ基づいて、前
記画像信号α′をアナログ信号に変換し、モニタ−３上
忙画像表示するよう忙なっている。
以上のように構成された映像信号処理装置の作用につい
て説明する。先ず１．内部クロック発生装置１・ 置４を作動させて基準クロッ、１）・り発生手段５より
基準クロック（’（１を発生させる。前記基準クロック
発生手段５は、水晶発振器６と、この水晶発振器６の出
力を分周する分周期７とから成っているため、例えば第
４図に示すよ５に１００ｒＬｚを周期とする基準クロッ
クＣ６を発生することができる。この基準クロックｃ０
が遅延手段８に入力すると、遅延手段８は例えば基準ク
ロックｃ０よりも順次２０ｎ、？づ′つ遅延された新た
なりロックＣ！〜ｃ４を発生させて、前記基準クロック
Ｃ０と共に５種類のクロックｃ０〜Ｃ４を出力する。こ
の遅延手段８の出力はセレクタ１０ｈＶｃ入力する。セ
レクタ１０ｈでは、ＲＯＭ１０（Ｌの選択信号ｄＶｃ基
づいて前記り四ツクＣ６−（’４のうちのいずれか一つ
を選択すること罠なっているが、ＴＶカメラ１からの映
像信号αが入力する前の初期状態では、例えば基準クロ
ックｃ６を内部クロックＣとして出力する。この後、Ｔ
Ｖカメラ１から映像信号αがルのインターフェース２に
入力すると、ルωインターフェース２では、前記内部ク
ロックＣ（初期状態では基準クロックｃ６が用いられる
）に基づいて前記映像信号αを画像信号α′と水平同期
信号すと罠分離して出力する。この５ちの水平同期信号
すは、ラッチ回路９に入力する。ラッチ回路９では、前
記遅延手段８で発振されたクロックＣ＠−ｃ４が入力さ
れており、前記水平同期信号すの同期タイミングで前記
クロックＣ・〜ｃ４をラッチする。例えば第３図図示Ａ
が最初の水平同期信号すの同期タイミングであれば、こ
のラッチ時のクロックＣ・〜ｃ４の状態は（１、０、０
、０，１）である。このラッチ回路９の出方はＲＯＭ１
０αに入力され、ＲＯＭ１０αでは、前記ラッチ回路９
でのラッチ時のクロックＣ＠−Ｃ４の状態に基づいて、
選択信号ｄを出力する。該選択信号ｄは、セレクタ１０
ｈＫ入力して、セレクタ１０Ａでのクロックの選択に供
される。このセレクタ１ｏｂにおいて選択されるクロッ
クと前記ラッチ回路９におけるラッチ時の各クロックの
状態との関係を表１に示す。
て説明する。先ず１．内部クロック発生装置１・ 置４を作動させて基準クロッ、１）・り発生手段５より
基準クロック（’（１を発生させる。前記基準クロック
発生手段５は、水晶発振器６と、この水晶発振器６の出
力を分周する分周期７とから成っているため、例えば第
４図に示すよ５に１００ｒＬｚを周期とする基準クロッ
クＣ６を発生することができる。この基準クロックｃ０
が遅延手段８に入力すると、遅延手段８は例えば基準ク
ロックｃ０よりも順次２０ｎ、？づ′つ遅延された新た
なりロックＣ！〜ｃ４を発生させて、前記基準クロック
Ｃ０と共に５種類のクロックｃ０〜Ｃ４を出力する。こ
の遅延手段８の出力はセレクタ１０ｈＶｃ入力する。セ
レクタ１０ｈでは、ＲＯＭ１０（Ｌの選択信号ｄＶｃ基
づいて前記り四ツクＣ６−（’４のうちのいずれか一つ
を選択すること罠なっているが、ＴＶカメラ１からの映
像信号αが入力する前の初期状態では、例えば基準クロ
ックｃ６を内部クロックＣとして出力する。この後、Ｔ
Ｖカメラ１から映像信号αがルのインターフェース２に
入力すると、ルωインターフェース２では、前記内部ク
ロックＣ（初期状態では基準クロックｃ６が用いられる
）に基づいて前記映像信号αを画像信号α′と水平同期
信号すと罠分離して出力する。この５ちの水平同期信号
すは、ラッチ回路９に入力する。ラッチ回路９では、前
記遅延手段８で発振されたクロックＣ＠−ｃ４が入力さ
れており、前記水平同期信号すの同期タイミングで前記
クロックＣ・〜ｃ４をラッチする。例えば第３図図示Ａ
が最初の水平同期信号すの同期タイミングであれば、こ
のラッチ時のクロックＣ・〜ｃ４の状態は（１、０、０
、０，１）である。このラッチ回路９の出方はＲＯＭ１
０αに入力され、ＲＯＭ１０αでは、前記ラッチ回路９
でのラッチ時のクロックＣ＠−Ｃ４の状態に基づいて、
選択信号ｄを出力する。該選択信号ｄは、セレクタ１０
ｈＫ入力して、セレクタ１０Ａでのクロックの選択に供
される。このセレクタ１ｏｂにおいて選択されるクロッ
クと前記ラッチ回路９におけるラッチ時の各クロックの
状態との関係を表１に示す。
（ｖＪ下全余白
表 １
表１はラッチ回路９における前記水平同期信号ｂＫ基づ
くラッチ時に１タイミングが最も近似したクロックがセ
レクタＩＯＡ において選択されるような関係が示され
ている。従って第６図図示Ａのラッチ時においては、セ
レクタ１０ｈにおいてクロッりＣ！が選択され、このク
ロックＣ１が初期状態でのクロックＣｏＫ代わって内部
クロックＣとして用いられることＫなる。内部クロック
Ｃとしてセレクタ１０Ａで選択されたクロック１’１は
、ルωインターフェース２に入力して２番目の水平同期
信号すに基づく映像信号αの分離に供されると共に、画
像メモ１７３における先忙分離された画像信号ａ′のメ
モリアドレスの決定に供される。内部クロックＣとして
のクロック（？ＩＫよって前記ルウインターフェース２
において分離された２番目の水平同期信号すは前記と同
様にしてラッチ回路９に入力し、クロックｔ’６””
０４のラッチに供される。この２番目の水平同期信号の
ラッチ時が、例えば第６図図示ＢＫ示す場合であるとす
ると、このラッチ時における各り四ツクの状態は（０，
０，１，１，０）となり、表１に示す関係からセレクタ
１０ｂでは次の内部クロックＣとしてりｄ“ラフｃ４を
選択する。
くラッチ時に１タイミングが最も近似したクロックがセ
レクタＩＯＡ において選択されるような関係が示され
ている。従って第６図図示Ａのラッチ時においては、セ
レクタ１０ｈにおいてクロッりＣ！が選択され、このク
ロックＣ１が初期状態でのクロックＣｏＫ代わって内部
クロックＣとして用いられることＫなる。内部クロック
Ｃとしてセレクタ１０Ａで選択されたクロック１’１は
、ルωインターフェース２に入力して２番目の水平同期
信号すに基づく映像信号αの分離に供されると共に、画
像メモ１７３における先忙分離された画像信号ａ′のメ
モリアドレスの決定に供される。内部クロックＣとして
のクロック（？ＩＫよって前記ルウインターフェース２
において分離された２番目の水平同期信号すは前記と同
様にしてラッチ回路９に入力し、クロックｔ’６””
０４のラッチに供される。この２番目の水平同期信号の
ラッチ時が、例えば第６図図示ＢＫ示す場合であるとす
ると、このラッチ時における各り四ツクの状態は（０，
０，１，１，０）となり、表１に示す関係からセレクタ
１０ｂでは次の内部クロックＣとしてりｄ“ラフｃ４を
選択する。
そして、前記と同様にこのクロックｃ４はルのインター
フェース２における映像信号αの分離及び画像メモ１７
３における画像信号α′の記憶の際のメモリアドレス決
定に供される。以後同様忙して、ラッチ回路９Ｋｉ次入
力する水平同期信号ＡＫ基づいて、ラッチ時に最も近似
した内部クロックＣが選択されて、この内部クロックＣ
に基づいて映像信号処理装置での各処理が行なわれるこ
とＫなる。
フェース２における映像信号αの分離及び画像メモ１７
３における画像信号α′の記憶の際のメモリアドレス決
定に供される。以後同様忙して、ラッチ回路９Ｋｉ次入
力する水平同期信号ＡＫ基づいて、ラッチ時に最も近似
した内部クロックＣが選択されて、この内部クロックＣ
に基づいて映像信号処理装置での各処理が行なわれるこ
とＫなる。
前記画像メモＩＪ３に取り込まれた画像信号は、所定の
ディジタル処理が施された後、 Ｄ／Ａインターフェー
ス１２を介してアナログ信号に変換されてモニタ１３上
に画像表示される。ここで、前記Ａ／Ｄインターフェー
ス１２におけるアナログ信号への変換も前記セレクタ１
０Ａにおい【順次選択される内部クロックＣに基づいて
行なわれるため、外部信号たる映像信号αにおける水平
同期信号すに近似した同期信号に基づいて画像表示する
ことができる。
ディジタル処理が施された後、 Ｄ／Ａインターフェー
ス１２を介してアナログ信号に変換されてモニタ１３上
に画像表示される。ここで、前記Ａ／Ｄインターフェー
ス１２におけるアナログ信号への変換も前記セレクタ１
０Ａにおい【順次選択される内部クロックＣに基づいて
行なわれるため、外部信号たる映像信号αにおける水平
同期信号すに近似した同期信号に基づいて画像表示する
ことができる。
以上説明したように、外部信号たる映像信号αにおける
水平同期愉□ゝ号ｂＫ、基づいて順次内部クロックＣを
選択しているため、各水平同期信号すと内部クロックＣ
との位相差はＴ／ｎ （実施例においては２０ｎＳ）の
許容範囲内で一定に保つことができる。従って、水平同
期信号すと内部クロックＣどの位相差に基因するアーテ
ィファクトを大幅に軽減することができる。
水平同期愉□ゝ号ｂＫ、基づいて順次内部クロックＣを
選択しているため、各水平同期信号すと内部クロックＣ
との位相差はＴ／ｎ （実施例においては２０ｎＳ）の
許容範囲内で一定に保つことができる。従って、水平同
期信号すと内部クロックＣどの位相差に基因するアーテ
ィファクトを大幅に軽減することができる。
本発明は、前記実施例忙限定されるものではなく、本発
明の要旨の範囲内で種々の変形例を包含することは言う
までもない。例えば前記実施例においては、遅延手段８
において、各クロックの位相差Ｔ／ｎＫおける定数ルを
５に設定したが、定数ルは２以上の整数であればよい。
明の要旨の範囲内で種々の変形例を包含することは言う
までもない。例えば前記実施例においては、遅延手段８
において、各クロックの位相差Ｔ／ｎＫおける定数ルを
５に設定したが、定数ルは２以上の整数であればよい。
又、表ＩＫ示ｊラッチ時のクロック状態は、ラッチ回路
９が正常に作動した場合の組み合せを示しているが、例
えばラッチ回路９が誤動作して表１ＶＣ示す以外のクロ
ック状態例えば（１，０゜１．０．１）等の出カバター
ンを示したときＫも、内部クロック発生装置４が所定の
クロックを選択するよう忙設定しておくことが望ましい
。この際、前記定数ルを５とした場合には％ ３２
（２’）通りのクロック状態それぞれＫついてセレクタ
１０Ａの出力を設定しておけばよい。又、複数枚の画像
を加算平均する場合忙あっても、複数枚の各画像を画像
メモリ３に記憶する際、前記内部クロック発生装置４で
選択される内部クロックＣＫ基づいてメモリアドレスを
決定することにより画像間における各画素の不一致が生
ずることはない。従って加算の際における空間分解能の
低下を最小限に押えることができる。“ 〔発明の効果〕 以上説明したように、この発明によると外部信号たる映
像信号における水平同期信号に基づいて、水平同期信号
の同期タイミング忙近似したクロックを順次選択し、こ
の選択されたクロックを内部クロックとして画像処理に
供しているため、アーティファクトの少ない１像を再生
することが可能な映像信号処理装置を提供することがで
きる。
９が正常に作動した場合の組み合せを示しているが、例
えばラッチ回路９が誤動作して表１ＶＣ示す以外のクロ
ック状態例えば（１，０゜１．０．１）等の出カバター
ンを示したときＫも、内部クロック発生装置４が所定の
クロックを選択するよう忙設定しておくことが望ましい
。この際、前記定数ルを５とした場合には％ ３２
（２’）通りのクロック状態それぞれＫついてセレクタ
１０Ａの出力を設定しておけばよい。又、複数枚の画像
を加算平均する場合忙あっても、複数枚の各画像を画像
メモリ３に記憶する際、前記内部クロック発生装置４で
選択される内部クロックＣＫ基づいてメモリアドレスを
決定することにより画像間における各画素の不一致が生
ずることはない。従って加算の際における空間分解能の
低下を最小限に押えることができる。“ 〔発明の効果〕 以上説明したように、この発明によると外部信号たる映
像信号における水平同期信号に基づいて、水平同期信号
の同期タイミング忙近似したクロックを順次選択し、こ
の選択されたクロックを内部クロックとして画像処理に
供しているため、アーティファクトの少ない１像を再生
することが可能な映像信号処理装置を提供することがで
きる。
第１図は、従来の映像信号処理装置にふける水平同期信
号と内部クロックとの位相差を説明するための概略説明
図、第２図は本発明の一実施例である映像信号処理装置
を示すブロックダイヤグラム、第６図は遅延手段で発振
されるクロックの−例とラッチ回路におけるラッチ時と
の関係を示す動作説明図である。 １・・・映像信号発生装置、 ２・・・ルのインターフ
ェース、 ３・・・画像メモリ、 ４・・・内部ク
ロック発生装置、 ５・・・基準クロック発生手段、
８・・・遅延手段、 ９・・・ラッチ回路、１０
α・・・ＲＯＭ 。 １０ｂ・・・セレクタ、 １１・・・選択手段、
１２・・・Ｄ／Ａインターフェース、 α・・・映像
信号、 ｈ・・・水平同期信号、 Ｃ・・・内部ク
ロック、 ｄ・・・選択信号。
号と内部クロックとの位相差を説明するための概略説明
図、第２図は本発明の一実施例である映像信号処理装置
を示すブロックダイヤグラム、第６図は遅延手段で発振
されるクロックの−例とラッチ回路におけるラッチ時と
の関係を示す動作説明図である。 １・・・映像信号発生装置、 ２・・・ルのインターフ
ェース、 ３・・・画像メモリ、 ４・・・内部ク
ロック発生装置、 ５・・・基準クロック発生手段、
８・・・遅延手段、 ９・・・ラッチ回路、１０
α・・・ＲＯＭ 。 １０ｂ・・・セレクタ、 １１・・・選択手段、
１２・・・Ｄ／Ａインターフェース、 α・・・映像
信号、 ｈ・・・水平同期信号、 Ｃ・・・内部ク
ロック、 ｄ・・・選択信号。
Claims (1)
- 映像信号発生装置より伝送される映像信号を、映像信号
処理装置内部で発生させた内部クロック忙基づいて所定
の処理を行う映像信号処理装置において、一定周期Ｔの
基準クロックを発生させる基準クロック発生手段と、該
基準クロック発生手段の出力を入力すると共に基準クロ
ックよりもｋＴ／ｎ（ｎ 、 ｈは整数であってｒＬ≧
２．嘆≦ルー１）の位相差を有するル通りのクロックを
発生させる遅延手段と、該遅延手段の出刃を入力すると
共に１前記映像信号における水平同期信号に基づいて前
記遅延手段の出力をラッチするラッチ回路と、前記遅延
手段の出力を入力すると共に、前記ラッチ回路の出力に
基づいて前記４通りのクロックのうち前記水平同期信号
に位相が最も近いクロックを選択し、これを内部クロッ
クとして出力する選択手段とを有することを特徴とする
映像信号処理装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57103027A JPS58220588A (ja) | 1982-06-17 | 1982-06-17 | 映像信号処理装置 |
| US06/502,951 US4575752A (en) | 1982-06-17 | 1983-06-10 | Diagnostic X-ray apparatus having a master timing control unit |
| EP83303378A EP0097465B1 (en) | 1982-06-17 | 1983-06-10 | Diagnostic x-ray apparatus |
| DE8383303378T DE3371460D1 (en) | 1982-06-17 | 1983-06-10 | Diagnostic x-ray apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57103027A JPS58220588A (ja) | 1982-06-17 | 1982-06-17 | 映像信号処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58220588A true JPS58220588A (ja) | 1983-12-22 |
| JPH0218633B2 JPH0218633B2 (ja) | 1990-04-26 |
Family
ID=14343158
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57103027A Granted JPS58220588A (ja) | 1982-06-17 | 1982-06-17 | 映像信号処理装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4575752A (ja) |
| EP (1) | EP0097465B1 (ja) |
| JP (1) | JPS58220588A (ja) |
| DE (1) | DE3371460D1 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JPS6448586A (en) * | 1987-08-18 | 1989-02-23 | Matsushita Electric Ind Co Ltd | Phase synchronizing clock signal generator |
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| DE4104329A1 (de) * | 1990-02-13 | 1991-08-22 | Matsushita Electric Ind Co Ltd | Impulssignalverzoegerungsvorrichtung, impulssignalphasendetektor und die vorrichtung verwendender taktgenerator |
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| US4723260A (en) * | 1985-01-04 | 1988-02-02 | Yoshibumi Mukai | Medical X-ray photographic apparatus |
| US4878115A (en) * | 1987-09-25 | 1989-10-31 | University Of Kentucky Research Foundation | Dynamic coronary roadmapping |
| JPH02192698A (ja) * | 1989-01-19 | 1990-07-30 | Toshiba Corp | Ｘ線高電圧装置 |
| US5138459A (en) * | 1990-11-20 | 1992-08-11 | Personal Computer Cameras, Inc. | Electronic still video camera with direct personal computer (pc) compatible digital format output |
| DE19640189A1 (de) | 1996-09-30 | 1998-04-02 | Basf Ag | Reaktivfarbstoffe mit einem heterocyclischen Anker |
| FR2768235B1 (fr) * | 1997-09-09 | 2000-02-04 | Aerospatiale | Dispositif d'observation optoelectronique perfectionne pour detecter les tirs laser |
| US6990368B2 (en) * | 2002-04-04 | 2006-01-24 | Surgical Navigation Technologies, Inc. | Method and apparatus for virtual digital subtraction angiography |
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| US4204226A (en) * | 1978-05-16 | 1980-05-20 | Wisconsin Alumni Research Foundation | Real-time digital X-ray time interval difference imaging |
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| US4285063A (en) * | 1979-06-08 | 1981-08-18 | Sperry Corporation | Apparatus for providing evenly delayed digital signals |
| US4393402A (en) * | 1981-06-08 | 1983-07-12 | General Electric Company | Subtraction fluoroscopy method and apparatus |
| US4467358A (en) * | 1982-02-09 | 1984-08-21 | Switsen Henry N | Video tape recorder signal processor |
-
1982
- 1982-06-17 JP JP57103027A patent/JPS58220588A/ja active Granted
-
1983
- 1983-06-10 EP EP83303378A patent/EP0097465B1/en not_active Expired
- 1983-06-10 DE DE8383303378T patent/DE3371460D1/de not_active Expired
- 1983-06-10 US US06/502,951 patent/US4575752A/en not_active Expired - Fee Related
Patent Citations (2)
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| US5179438A (en) * | 1990-02-13 | 1993-01-12 | Matsushita Electric Industrial Co., Ltd. | Pulse signal delay device, and pulse signal phase detector and clock generator using the device |
Also Published As
| Publication number | Publication date |
|---|---|
| DE3371460D1 (en) | 1987-06-11 |
| JPH0218633B2 (ja) | 1990-04-26 |
| EP0097465B1 (en) | 1987-05-06 |
| US4575752A (en) | 1986-03-11 |
| EP0097465A1 (en) | 1984-01-04 |
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