JPS5821358A - 半導体装置の封止方法 - Google Patents

半導体装置の封止方法

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JPS5821358A
JPS5821358A JP11955481A JP11955481A JPS5821358A JP S5821358 A JPS5821358 A JP S5821358A JP 11955481 A JP11955481 A JP 11955481A JP 11955481 A JP11955481 A JP 11955481A JP S5821358 A JPS5821358 A JP S5821358A
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JP
Japan
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adhesive
hardening
resin
semiconductor device
lamp
Prior art date
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Pending
Application number
JP11955481A
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English (en)
Inventor
Kazuyoshi Tominaga
富永 和由
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SEIKO KEIYO KOGYO KK
Original Assignee
SEIKO KEIYO KOGYO KK
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、半導体装置の封止方法に関するものでおる。
従来、半導体装置の封止は第1図、−)に示すように回
路基板1に半導体装置2を熱硬化性ダイアタッチ剤3で
取シ付けていた。そしてムU!ii1等4によって電極
域ル出しを行ない、その後第1図φ)K示すように封止
枠5t−熱硬化性接着剤6により取シ付けた後、熱硬化
性封止樹脂7によって半導体素子2を封止する構造が主
流であった。しかし、熱硬化性接着剤や熱硬化性封止樹
J4¥It完全に硬化するためにt1120℃〜150
18の熱を少なくて410〜15時間加えなければなら
なかった。上記封止方法によると最底3工程の硬化1寝
が必要であった。また、高温を長時間加えるために熱ス
トレスが生じ中すく基板のソリ、ム襲線の断線が発生し
たシした。更に封止樹脂が硬化する際熱りため一時的に
粘度が下が)、基板上に流れ出してしまうという欠点が
あった。
本発f14IIi、上記欠点を除去した新規な牛導体輌
置の封止方法を提供することを目的としている。
次に図面に基づいて本発明の詳細な説明する。
第2図は本発明の好適な実施例であシ半導体装置10が
挿入される貫通孔11t−有する回路基板12に、UV
硬化接着剤13tコーテイングした透明フィルム14を
半導体装置が挿入さnる側の他の側から前記aVmV剤
の粘着力を利用して一時的に取シ付ら牡た状態を示す。
次に半導体装置10t−取シつけ矢印方向に軽(押圧す
る0次に第3図に示すようにUVランプ15を用いてU
V光線を10〜151照射し前記UV接接剤剤3 f:
fI!化する0次に第4図に示すように封止枠16にt
yv硬化接着剤17tスタンピングあるいは印刷によっ
てコーティングし、回路基板に取9つける。封止枠を取
9つけたあとム賢@VKより電極接続上行なう。ム語線
接続後第5図のようにUV硬化麗封止樹脂18t−ボッ
ティング等によって注入する。前記封止樹脂18は、U
V光imKよる硬化と嫌気性による硬化を合わせもった
ものでちゃ可視光線を速断するように着色したものであ
る0次に’av−>7プ19によってUV光線t10〜
15 ”間照射し#記封止樹脂18と封止枠16【固定
するためのUV接溜剤17t−完全に硬化する。しかし
封止樹脂18は、量が多いことと、樹脂厚みが厚いため
UV光線で硬化されるのは表面付近だけである。封止樹
脂18内部の硬化は嫌気性(空気を遮断すると硬化反応
が始まる性質)Kよって行なわnる。
以上の実施例では、封止枠を用いた例で説明したが、第
6図に示すように封止枠を用いずにUV封止樹脂加のみ
で封止してもよい、この場合、封止枠がなくても、Uv
封止樹脂は熱硬化性樹脂のように加熱によシ一時的に粘
性が下がることがなく表面は瞬間的に硬化するため樹脂
のart出しというような問題は発生しない。
以上説明したように、UV1lll剤、[17封止剤を
用いると短時間に(約l−30°)でき、4温を加える
こともないため熱硬化性樹脂に比べて大巾な工数削減と
なる。更に熱の影響を最小限にすることができるので基
板のソリやム襲線等の断線といった事故をなくすことが
できる。
【図面の簡単な説明】
第1図6&) 、 (6)は、従来の半導体装置の封止
方法を示す断面図。 第2図、第3図、第4図、ms図社、本発明による半導
体装置の封止方法を示す断面図。 第6図は、本発明を用いた他の実施例を示す断面図。 1〇−半導体装置  13−UV接溜剤14−透明7(
ルA  15−UVう/プ16−封止枠    17−
 ty v接着剤1B −U V封止樹脂 19− U
 V j ンプ以上 出願人 セイコー京葉工業株式会社 代理人 弁理士 最 上    務

Claims (2)

    【特許請求の範囲】
  1. (1)回路基板の貫通孔に、接着剤をコーティングした
    フィルムを介して半導体素子を収納する工程と、この半
    導体素子をワイヤーボンディングする工程と、繭記早導
    体素子全覆うように前記貫通孔に封止樹脂を注入する工
    程と、との封止樹脂を硬化する工程とからなる半導体装
    置の製造方法において、前記フィルムとしてUV硬化型
    接着剤をコーティングした透明フィルムを用いると共に
    、前記ワイヤボンディングする工程の#に#記ワイヤボ
    ンディングする工程の前に前記UV硬化型接着剤IUV
    ランプによル硬化する工程を有することを特徴とする半
    導体装置の封止方法。
  2. (2)前記封止樹脂として可視光綜が透過しないよjK
    ff色さnたUV硬化型樹脂を硬化することを特徴とす
    る特許請求の範囲第1項記載の半導体装置の封止方法。
JP11955481A 1981-07-29 1981-07-29 半導体装置の封止方法 Pending JPS5821358A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5037779A (en) * 1989-05-19 1991-08-06 Whalley Peter D Method of encapsulating a sensor device using capillary action and the device so encapsulated
US5304513A (en) * 1987-07-16 1994-04-19 Gao Gesellschaft Fur Automation Und Organisation Mbh Method for manufacturing an encapsulated semiconductor package using an adhesive barrier frame
WO2001042766A2 (de) * 1999-12-09 2001-06-14 Micronas Gmbh Verfahren und herstellung eines sensors

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WO2001042766A3 (de) * 1999-12-09 2001-11-01 Micronas Gmbh Verfahren und herstellung eines sensors
US6964927B2 (en) 1999-12-09 2005-11-15 Micronas Gmbh Method and production of a sensor

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