JPS58197825A - 半導体保護層形成方法 - Google Patents
半導体保護層形成方法Info
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- JPS58197825A JPS58197825A JP58073697A JP7369783A JPS58197825A JP S58197825 A JPS58197825 A JP S58197825A JP 58073697 A JP58073697 A JP 58073697A JP 7369783 A JP7369783 A JP 7369783A JP S58197825 A JPS58197825 A JP S58197825A
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- 239000004065 semiconductor Substances 0.000 title description 16
- 238000000034 method Methods 0.000 title description 9
- 239000000758 substrate Substances 0.000 claims description 23
- 239000002245 particle Substances 0.000 claims description 20
- 230000002093 peripheral effect Effects 0.000 claims description 13
- 238000005530 etching Methods 0.000 claims description 8
- 239000010410 layer Substances 0.000 description 48
- 239000011241 protective layer Substances 0.000 description 16
- 239000000463 material Substances 0.000 description 7
- 239000013078 crystal Substances 0.000 description 6
- 230000015572 biosynthetic process Effects 0.000 description 5
- 239000000356 contaminant Substances 0.000 description 5
- 239000007943 implant Substances 0.000 description 5
- 238000002513 implantation Methods 0.000 description 5
- 229910052751 metal Inorganic materials 0.000 description 5
- 239000002184 metal Substances 0.000 description 5
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Chemical compound [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 5
- 239000003570 air Substances 0.000 description 4
- 230000005684 electric field Effects 0.000 description 4
- 229920002120 photoresistant polymer Polymers 0.000 description 4
- JBRZTFJDHDCESZ-UHFFFAOYSA-N AsGa Chemical compound [As]#[Ga] JBRZTFJDHDCESZ-UHFFFAOYSA-N 0.000 description 3
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 3
- 239000010931 gold Substances 0.000 description 3
- 229910052737 gold Inorganic materials 0.000 description 3
- -1 oxygen ions Chemical class 0.000 description 3
- MHAJPDPJQMAIIY-UHFFFAOYSA-N Hydrogen peroxide Chemical compound OO MHAJPDPJQMAIIY-UHFFFAOYSA-N 0.000 description 2
- QAOWNCQODCNURD-UHFFFAOYSA-N Sulfuric acid Chemical compound OS(O)(=O)=O QAOWNCQODCNURD-UHFFFAOYSA-N 0.000 description 2
- 238000010420 art technique Methods 0.000 description 2
- 230000004888 barrier function Effects 0.000 description 2
- 239000003574 free electron Substances 0.000 description 2
- 238000005468 ion implantation Methods 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 2
- 230000007246 mechanism Effects 0.000 description 2
- 238000012544 monitoring process Methods 0.000 description 2
- 229910052760 oxygen Inorganic materials 0.000 description 2
- 239000001301 oxygen Substances 0.000 description 2
- 238000002161 passivation Methods 0.000 description 2
- 238000000059 patterning Methods 0.000 description 2
- 229910052697 platinum Inorganic materials 0.000 description 2
- 230000008569 process Effects 0.000 description 2
- 239000000126 substance Substances 0.000 description 2
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 1
- 239000012080 ambient air Substances 0.000 description 1
- 238000000137 annealing Methods 0.000 description 1
- 239000000969 carrier Substances 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000010884 ion-beam technique Methods 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 230000000873 masking effect Effects 0.000 description 1
- 238000005272 metallurgy Methods 0.000 description 1
- 230000035515 penetration Effects 0.000 description 1
- 238000007747 plating Methods 0.000 description 1
- 239000000843 powder Substances 0.000 description 1
- 239000010453 quartz Substances 0.000 description 1
- 230000008439 repair process Effects 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 239000004575 stone Substances 0.000 description 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
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- H01L29/66196—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by variation of the electric current supplied or the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched, e.g. two-terminal devices with an active layer made of a group 13/15 material
- H01L29/66204—Diodes
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/26—Bombardment with radiation
- H01L21/263—Bombardment with radiation with high-energy radiation
- H01L21/265—Bombardment with radiation with high-energy radiation producing ion implantation
- H01L21/26586—Bombardment with radiation with high-energy radiation producing ion implantation characterised by the angle between the ion beam and the crystal planes or the main crystal surface
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
- H01L21/306—Chemical or electrical treatment, e.g. electrolytic etching
- H01L21/308—Chemical or electrical treatment, e.g. electrolytic etching using masks
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3157—Partial encapsulation or coating
- H01L23/3171—Partial encapsulation or coating the coating being directly applied to the semiconductor body, e.g. passivation layer
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(技術分野)
本発明は、半導体構造を製造する方法に関し、更に詳細
には半導体構造の活性領域内に形成される露出された接
合を保護する方法に関するっ(背景技術) 当該技術分野において周知の如く、半導体構造の活性領
域内に形成された窯出接合を周囲の空気又は汚染物質か
ら保護して、構造の電気的特性が変化しないように、又
は、その構造体内に形成されたテバイスが故障しないよ
うにすることが望ましい、特に表面りに存在する空気又
は汚染物質粒子が表面に電荷を発生させろ、その表面の
電荷か露出された接合間に短絡回路を形成する。その接
合に保護を与えろ1つの方法は接合の露出された表面ト
に不活性層(不動態化層)を被着させることである。こ
の従来技術は著しい不利益をもたらj、、そQ)理由は
、半導体σ)表面部分上に不活性層を被着させろことに
よって、そ09層の形成中に半導体表面上に存在する空
気又1工汚染粒子が半導体表面と被着された不活性1−
との間に捕捉されろ。
には半導体構造の活性領域内に形成される露出された接
合を保護する方法に関するっ(背景技術) 当該技術分野において周知の如く、半導体構造の活性領
域内に形成された窯出接合を周囲の空気又は汚染物質か
ら保護して、構造の電気的特性が変化しないように、又
は、その構造体内に形成されたテバイスが故障しないよ
うにすることが望ましい、特に表面りに存在する空気又
は汚染物質粒子が表面に電荷を発生させろ、その表面の
電荷か露出された接合間に短絡回路を形成する。その接
合に保護を与えろ1つの方法は接合の露出された表面ト
に不活性層(不動態化層)を被着させることである。こ
の従来技術は著しい不利益をもたらj、、そQ)理由は
、半導体σ)表面部分上に不活性層を被着させろことに
よって、そ09層の形成中に半導体表面上に存在する空
気又1工汚染粒子が半導体表面と被着された不活性1−
との間に捕捉されろ。
その捕捉された空気又は汚染粒子°が接合間に短絡回路
乞形成する表面電荷を発生させる。
乞形成する表面電荷を発生させる。
ある生得体材料1例えばガリウム砒素(GaAs)から
成る活性領域か粒子、例えばプロトン(H+)又は酸素
イオン(0)(7)イオン打込みによって半絶縁性にな
ることもまた知られている。結晶の一部に粒子をイオン
打込みすることによってその部分が半絶縁性になること
には2つの明確な物理的メカニズムがある。その1つは
、結晶の格子構造への粒子の衝撃の効果であって、高エ
ネルギ粒子衝撃が格子構造にダメージを与えその電気伝
導性を減少させる。第2のメカニズムは過剰即ち自由電
子に対する打ち込まれた粒子σ)影響であって。
成る活性領域か粒子、例えばプロトン(H+)又は酸素
イオン(0)(7)イオン打込みによって半絶縁性にな
ることもまた知られている。結晶の一部に粒子をイオン
打込みすることによってその部分が半絶縁性になること
には2つの明確な物理的メカニズムがある。その1つは
、結晶の格子構造への粒子の衝撃の効果であって、高エ
ネルギ粒子衝撃が格子構造にダメージを与えその電気伝
導性を減少させる。第2のメカニズムは過剰即ち自由電
子に対する打ち込まれた粒子σ)影響であって。
0+等の打ち込まれた粒子が過剰即ち自由電子と結合す
るキャリア捕捉場所として作用し正味零電荷とする。こ
うして接合の島田された領域11半絶縁性となり活性領
域の他の部分から電気的に分離されろ。こうして形成さ
れた半絶縁領域の空気又は汚染物質に対する露出はその
活性領域の他の電気的に分離された部分の電気的特性に
影響を与えず、テ°゛バイスの1つσ)故障原因をほぼ
防止することかできる。一般に1〜2ミクロンの深の打
ち込みが尚エネルギ・イオ/・ビーム(即ち、10電子
ボルトよりも大きなエネルギを有するビーム)によって
行なわれろ、メサ形半導体σ〕活性領域を半絶縁にする
従来の方法は、一般に次σ)ようなステップを含んでい
7.)、3即ち、基板の1表面上に複数の第1コンタク
トを形成し、その基板の反対表面ヒに活性層を形成し、
その活性層上に複数の同様なホトレジスト領域を設けろ
ことによって活性層を選択的にマスクし、その各領域が
基板の反対側の表面上の第1コンタクトの対応するもの
と位置が合せられ、次に活性層σ)マスクされない部分
に粒子が打ち込まれてそσ)マスクされない部分のすべ
てが半絶縁性になる。この時活性層上に支持層が形成さ
れ、選択された位置の基板がエツチングされて半絶縁表
面部分を有するメサ形半導体か供給される。この従来技
術はいくつかの応用において有効であるけれども、ホト
レジスト層のパターン化のステップ、aち活性層上に複
数のホトレジスト領域を設は頂部コンタクトと位置合せ
することが、パター/・マスクと頂部コンタクトとの前
面及び後面の位置合せを必要とするっこの位置合せのス
テップが難しいステップで、処理時間を増加させデバイ
スの歩留りを低下させる。更に、活性領域の打ち込みビ
ームによる最大透入深さは一般に1〜2ミクロン程度で
、これは高周波半導体についての薄い活性層(1〜2ミ
クロン)を半絶縁にするには充分であるが、低周波デバ
イスについてσ)より厚い活性層領域(6〜6ミクロン
)を半絶縁にするには不充分である。
るキャリア捕捉場所として作用し正味零電荷とする。こ
うして接合の島田された領域11半絶縁性となり活性領
域の他の部分から電気的に分離されろ。こうして形成さ
れた半絶縁領域の空気又は汚染物質に対する露出はその
活性領域の他の電気的に分離された部分の電気的特性に
影響を与えず、テ°゛バイスの1つσ)故障原因をほぼ
防止することかできる。一般に1〜2ミクロンの深の打
ち込みが尚エネルギ・イオ/・ビーム(即ち、10電子
ボルトよりも大きなエネルギを有するビーム)によって
行なわれろ、メサ形半導体σ〕活性領域を半絶縁にする
従来の方法は、一般に次σ)ようなステップを含んでい
7.)、3即ち、基板の1表面上に複数の第1コンタク
トを形成し、その基板の反対表面ヒに活性層を形成し、
その活性層上に複数の同様なホトレジスト領域を設けろ
ことによって活性層を選択的にマスクし、その各領域が
基板の反対側の表面上の第1コンタクトの対応するもの
と位置が合せられ、次に活性層σ)マスクされない部分
に粒子が打ち込まれてそσ)マスクされない部分のすべ
てが半絶縁性になる。この時活性層上に支持層が形成さ
れ、選択された位置の基板がエツチングされて半絶縁表
面部分を有するメサ形半導体か供給される。この従来技
術はいくつかの応用において有効であるけれども、ホト
レジスト層のパターン化のステップ、aち活性層上に複
数のホトレジスト領域を設は頂部コンタクトと位置合せ
することが、パター/・マスクと頂部コンタクトとの前
面及び後面の位置合せを必要とするっこの位置合せのス
テップが難しいステップで、処理時間を増加させデバイ
スの歩留りを低下させる。更に、活性領域の打ち込みビ
ームによる最大透入深さは一般に1〜2ミクロン程度で
、これは高周波半導体についての薄い活性層(1〜2ミ
クロン)を半絶縁にするには充分であるが、低周波デバ
イスについてσ)より厚い活性層領域(6〜6ミクロン
)を半絶縁にするには不充分である。
(発明の概要)
本発明によれば、半絶縁l保護r―が、メサ形結晶の半
導体構造内の接合の周辺部から形成されるう頂部コンタ
クト電、極がエツチング・マスクとして使用され、その
構造の選択された部分がエツチングされ傾斜側壁を有す
るメサ形半導体を形成″′fる、こσ)ようにして形成
されたメサ形半導体構造はljt部コンタクトの周辺を
越えて伸びる露出された接合周辺部乞有する。この頂部
コンタクト電極は次に打ち込みマスクとして使用され、
奏→≠−#−臓出された周辺接合部に粒子が打ち込まれ
る。
導体構造内の接合の周辺部から形成されるう頂部コンタ
クト電、極がエツチング・マスクとして使用され、その
構造の選択された部分がエツチングされ傾斜側壁を有す
るメサ形半導体を形成″′fる、こσ)ようにして形成
されたメサ形半導体構造はljt部コンタクトの周辺を
越えて伸びる露出された接合周辺部乞有する。この頂部
コンタクト電極は次に打ち込みマスクとして使用され、
奏→≠−#−臓出された周辺接合部に粒子が打ち込まれ
る。
こθ)ようにし−(打ち込まれた部分の導電度は低下し
、保護層を供給する。このような構成によって。
、保護層を供給する。このような構成によって。
活性接合部は半絶縁性になる、その理由1ま、外部周辺
接合表面部分シエ粒子によって打ち込みされ。
接合表面部分シエ粒子によって打ち込みされ。
半導体の結晶粒子かダメージケ受け、それによつ−(表
面部分の導電度が低下するからであるう更に。
面部分の導電度が低下するからであるう更に。
頂部コンタクトをエツチング拳マスク及び打ち込みマス
クσ)両方として使用することによって、打ち込みマス
クとエツチング・マスクσ)前後面σ)位置合せが不要
になり、自己不活性化メサ形構造の組立てが簡単になる
。
クσ)両方として使用することによって、打ち込みマス
クとエツチング・マスクσ)前後面σ)位置合せが不要
になり、自己不活性化メサ形構造の組立てが簡単になる
。
本発明の更に別の特徴によれば、第1領域及び第2領域
を有する材料の選択部分から!保護層を ・形成−rる
方法を工1選択した第1及び小2偵域乞エツチ/ダして
第1饋域σ〕周辺に伸びろ第2領域を為出し、第1領域
σ)一部をマスクし、iI出された第2領域の延長した
部分及び第1領域σ)マスクされない部分に粒子を打ち
込み、そσ〕打ち込んだ領域σ〕導電度を減少させろ、
ステップを含む、第2領域の露出された表面に打麩フ込
みする構成によって、第2VA域のあらゆる厚さの部分
の導電度が低下する。更に、材料の表面部分を低い導電
性の保護層に変換することによって、その材料−ヒに存
在−「ろあらゆる表面汚染物質1工、減少した導電度の
保護層によって与えられる材料の保護を低下させない。
を有する材料の選択部分から!保護層を ・形成−rる
方法を工1選択した第1及び小2偵域乞エツチ/ダして
第1饋域σ〕周辺に伸びろ第2領域を為出し、第1領域
σ)一部をマスクし、iI出された第2領域の延長した
部分及び第1領域σ)マスクされない部分に粒子を打ち
込み、そσ〕打ち込んだ領域σ〕導電度を減少させろ、
ステップを含む、第2領域の露出された表面に打麩フ込
みする構成によって、第2VA域のあらゆる厚さの部分
の導電度が低下する。更に、材料の表面部分を低い導電
性の保護層に変換することによって、その材料−ヒに存
在−「ろあらゆる表面汚染物質1工、減少した導電度の
保護層によって与えられる材料の保護を低下させない。
(実施例σ)説明)
本発明を以下実施例に従って詳細に説明する。
本発明の教示に従って保護層に変換された表面部分を有
する複数の半導体デバイスの構造を第1〜6図Q)断面
図に関連して述べる。最初に第1図を参照すると、薄く
された基板12、ここではN++をドーグしたガリウム
砒素(GaAs)’&含むウェハ10が示され、該基板
1ま底面に活性層14.ここではN形のエピタキシャル
成長したGaAsσ)半導体層を有する。活性層14は
・、ダイオードに対する所望の電気的特性によって多く
の異なったドーピング濃度プロファイルの1つを有する
ことができろ。ここでは1例えば木甲神許第4,160
.992号(1979年7月10日)に記載されるドー
ピング嬢度グロファイルが使用される。接合15が活性
層14と第1金属層16(ここでは白金Pt)とQ)間
に形成され、活性層14σ)表面にスパッタされて10
0〜200オングストローム(A)の範囲θ)厚さにな
る。白金層16の上には第2金属層18(ココテ’tl
f タyTi)が1000〜200OA(7)範囲の厚
さにスパッタされる。電気的にそして熱的に島い伝導性
層20(ここでシ工金Au)が層18の上に1000〜
200OAの厚さで蒸着される。
する複数の半導体デバイスの構造を第1〜6図Q)断面
図に関連して述べる。最初に第1図を参照すると、薄く
された基板12、ここではN++をドーグしたガリウム
砒素(GaAs)’&含むウェハ10が示され、該基板
1ま底面に活性層14.ここではN形のエピタキシャル
成長したGaAsσ)半導体層を有する。活性層14は
・、ダイオードに対する所望の電気的特性によって多く
の異なったドーピング濃度プロファイルの1つを有する
ことができろ。ここでは1例えば木甲神許第4,160
.992号(1979年7月10日)に記載されるドー
ピング嬢度グロファイルが使用される。接合15が活性
層14と第1金属層16(ここでは白金Pt)とQ)間
に形成され、活性層14σ)表面にスパッタされて10
0〜200オングストローム(A)の範囲θ)厚さにな
る。白金層16の上には第2金属層18(ココテ’tl
f タyTi)が1000〜200OA(7)範囲の厚
さにスパッタされる。電気的にそして熱的に島い伝導性
層20(ここでシ工金Au)が層18の上に1000〜
200OAの厚さで蒸着される。
次に、第2の電気的にそして熱的に伝導性の層22(こ
こで1工金)が第1の層20の上に12〜2゜ミクロン
σ〕厚さでメッキされる。この層221メサ・エツチン
グの間ウェハに対する支持を提供し、組立て及びダイス
の後を1個々のメサ形ダイオード50σ)ためσ)ヒー
トシンク及び電気的コンタクトとして作用する。丁員部
コンタクト24(ここで(1金)k’!、Mj知0)ホ
トレジスト・マスク及び金メツキ技術を使用して基板1
2の上側表面上に形成される。頂部コンタクト24はエ
ツチング・マスク! として使用され、メサ形ダイオード6oが形成さ
1れろ基板12の範囲を画定する。
こで1工金)が第1の層20の上に12〜2゜ミクロン
σ〕厚さでメッキされる。この層221メサ・エツチン
グの間ウェハに対する支持を提供し、組立て及びダイス
の後を1個々のメサ形ダイオード50σ)ためσ)ヒー
トシンク及び電気的コンタクトとして作用する。丁員部
コンタクト24(ここで(1金)k’!、Mj知0)ホ
トレジスト・マスク及び金メツキ技術を使用して基板1
2の上側表面上に形成される。頂部コンタクト24はエ
ツチング・マスク! として使用され、メサ形ダイオード6oが形成さ
1れろ基板12の範囲を画定する。
第2図馨参照すると、複数のメサ形ダイオード60が示
され該ダイオードは基板12の選択された部分から形成
される。基板12の上側に形成される頂部コンタクト2
4は、前述の如く、基板12のエツチングのためのエツ
チング・マスクラ供給する。等方性の化学的基板エツチ
ング剤、ここでは硫酸()1.so)、過酸化水素(H
20□)、及び水、、4 の3:1:1の比率の溶液が、基板12σ)上側表面の
マスクされない部分と接触し、基板σ)選択された部分
28がエツチングされて広がった側壁15を有する複数
のメサ形ダイオード60を供給する。
され該ダイオードは基板12の選択された部分から形成
される。基板12の上側に形成される頂部コンタクト2
4は、前述の如く、基板12のエツチングのためのエツ
チング・マスクラ供給する。等方性の化学的基板エツチ
ング剤、ここでは硫酸()1.so)、過酸化水素(H
20□)、及び水、、4 の3:1:1の比率の溶液が、基板12σ)上側表面の
マスクされない部分と接触し、基板σ)選択された部分
28がエツチングされて広がった側壁15を有する複数
のメサ形ダイオード60を供給する。
ウェハ10は化学的エツチング剤の槽(図示せず)の中
に配置され、該エツチング剤によって図示σ)如く基板
12のマスクされない部分28が除去されろ。基板12
の部分28は、メサ形ダイオード60が延長¥ろベース
領域29を有する広がった側壁15を設けるまでエツチ
ング剤一ろ。各延長したベース領域29は活性層14の
一部とエツチングされた基板12の一部を含んでいる。
に配置され、該エツチング剤によって図示σ)如く基板
12のマスクされない部分28が除去されろ。基板12
の部分28は、メサ形ダイオード60が延長¥ろベース
領域29を有する広がった側壁15を設けるまでエツチ
ング剤一ろ。各延長したベース領域29は活性層14の
一部とエツチングされた基板12の一部を含んでいる。
接合16は頂部コンタクトの周囲を越えて伸びる露出さ
れた周辺接合部15′を有する。各延長したベース領域
29及び露出された周辺接合部16′ハメサ形ダイオー
ド50上に形成された対応する頂部コンタクト240円
周を越えて伸びている。各メサ形ダイオード30は、ベ
ース部51を形成する活性層14及び露出された周辺接
合部1′5′を含むベース部61の直径が対応する頂部
コンタクト24の直径よりも太ぎくなろよ゛うに形成さ
れろということを注目すべきである。エッチノブ処理は
後述する技術によってモニタされ、基板12の選択され
た部分28か充分にエツチングされる時点が決定さJし
て図示!/)如く延長したベース領域が供給される。
れた周辺接合部15′を有する。各延長したベース領域
29及び露出された周辺接合部16′ハメサ形ダイオー
ド50上に形成された対応する頂部コンタクト240円
周を越えて伸びている。各メサ形ダイオード30は、ベ
ース部51を形成する活性層14及び露出された周辺接
合部1′5′を含むベース部61の直径が対応する頂部
コンタクト24の直径よりも太ぎくなろよ゛うに形成さ
れろということを注目すべきである。エッチノブ処理は
後述する技術によってモニタされ、基板12の選択され
た部分28か充分にエツチングされる時点が決定さJし
て図示!/)如く延長したベース領域が供給される。
そのよ5なメサ形ダイオードの形成をモニタする1つ0
)技術は、形成されるに従ってそのメサ形ダイオード6
0の1又はそれ以上のキャパシタンス値がモータされ、
所定のキャパシタンス値が得られる造石なわれる。メサ
形ダイオード50の形成をモニタする他σ)技術は、頂
部コンタクト側(第2A図)から適当な顕微鏡(図示せ
ず)を通して観察し、ベース領域61の直径が所定の直
径にな ′つたことを監視する方法である。後述する如
く。
)技術は、形成されるに従ってそのメサ形ダイオード6
0の1又はそれ以上のキャパシタンス値がモータされ、
所定のキャパシタンス値が得られる造石なわれる。メサ
形ダイオード50の形成をモニタする他σ)技術は、頂
部コンタクト側(第2A図)から適当な顕微鏡(図示せ
ず)を通して観察し、ベース領域61の直径が所定の直
径にな ′つたことを監視する方法である。後述する如
く。
メサ形ダイオードの活性層14の後続の望ましい打ち込
みを保証するために、活性11i#14は頂部コンタク
ト240円周2越えて、第5図に関連して説明する打ち
込み段階の間頂部コンタクト24が活性層14をマスク
しないようにしなければならない、 ここで、第2A図を参照すると、基板の一部は。
みを保証するために、活性11i#14は頂部コンタク
ト240円周2越えて、第5図に関連して説明する打ち
込み段階の間頂部コンタクト24が活性層14をマスク
しないようにしなければならない、 ここで、第2A図を参照すると、基板の一部は。
メサ形ダイオード600ペース61が活性層14の金属
層16の連続する部分で申り囲まれ、露出した周辺接合
部15′が頂部コンタクト240周辺を越えて伸びるま
でエツチングされる。
層16の連続する部分で申り囲まれ、露出した周辺接合
部15′が頂部コンタクト240周辺を越えて伸びるま
でエツチングされる。
第6図において、メサ形ダイオード60のウェハ10は
、延長したベース領域290表面部分と前もって露出し
た周辺接合部i′5’v供給する半導体部分とから保護
層62を形成するために適当な装置(図示せず)の中に
配置される。ここで、メサ形ダイオードろ0の表面部を
保護層62に変換する望ましい方法は、メサ形ダイオー
ド60をイオン打ち込み装置(図示せず)の中に配!+
f L 、プロトノ(H+)又は酸素イオン(0+)等
のイオン打ぢ込み粒子流57をメサ形ダイオード60の
延長した部分290表面に打ち込む、ステップを含み。
、延長したベース領域290表面部分と前もって露出し
た周辺接合部i′5’v供給する半導体部分とから保護
層62を形成するために適当な装置(図示せず)の中に
配置される。ここで、メサ形ダイオードろ0の表面部を
保護層62に変換する望ましい方法は、メサ形ダイオー
ド60をイオン打ち込み装置(図示せず)の中に配!+
f L 、プロトノ(H+)又は酸素イオン(0+)等
のイオン打ぢ込み粒子流57をメサ形ダイオード60の
延長した部分290表面に打ち込む、ステップを含み。
その粒子流ろ7はウェハ100〕表面にある入射角、こ
こで11泊部コンタクト240表面に垂直に向けられろ
、その粒子11頂部コンタクト24によってマスクされ
たメサ形ダイオード500部分には打ち込まれない、こ
うして頂部コンタクト24はイオン打込み中打ち込みマ
スクとして作用し保護層を形成する。前もって供給され
た露出周辺接合部された接合部16“をもたらす。この
結晶格子構造ダメージは保護層52の導電性ケ低下させ
る。更に、ダメージを受けた格子構造へ埋められた例え
ばO+粉粒子、格子ダメージの結果として発生されろ自
由キャリア又は結晶中にそれまでに存在する過剰電子の
いずれに対してもキャリア捕捉(トラップ)場所を提供
する。これらの捕捉場F9Tは更に格子構造の導電性を
低下させる。一般に、格子構造にダメージを与える程に
達しないエネルギを有する粒子を打ち込むことによって
、また5打ち込み後ダメージを受けた構造をアニールし
てそのダメージを回復させることによって達成されるよ
うなダメージを受けてない格子構造にトラップを与えて
導電性の低下した保護層62が供給される。
こで11泊部コンタクト240表面に垂直に向けられろ
、その粒子11頂部コンタクト24によってマスクされ
たメサ形ダイオード500部分には打ち込まれない、こ
うして頂部コンタクト24はイオン打込み中打ち込みマ
スクとして作用し保護層を形成する。前もって供給され
た露出周辺接合部された接合部16“をもたらす。この
結晶格子構造ダメージは保護層52の導電性ケ低下させ
る。更に、ダメージを受けた格子構造へ埋められた例え
ばO+粉粒子、格子ダメージの結果として発生されろ自
由キャリア又は結晶中にそれまでに存在する過剰電子の
いずれに対してもキャリア捕捉(トラップ)場所を提供
する。これらの捕捉場F9Tは更に格子構造の導電性を
低下させる。一般に、格子構造にダメージを与える程に
達しないエネルギを有する粒子を打ち込むことによって
、また5打ち込み後ダメージを受けた構造をアニールし
てそのダメージを回復させることによって達成されるよ
うなダメージを受けてない格子構造にトラップを与えて
導電性の低下した保護層62が供給される。
更に5粒子を打ち込むことによってキャリア・トラップ
σ)ないダメージを受けfこ格子構造を生じさせ、同様
に保護層62を供給する領域の4宙性を低下させろ、そ
のような保護層52を設けるには一般に0,25〜1.
0ミクロンの深さの打ち込みで充分である。
σ)ないダメージを受けfこ格子構造を生じさせ、同様
に保護層62を供給する領域の4宙性を低下させろ、そ
のような保護層52を設けるには一般に0,25〜1.
0ミクロンの深さの打ち込みで充分である。
ここで、第4図を参照すると、接合161工、N形のド
ープされた領域14とショットキ・バリア・コンタクト
16′(ここでは金属層16σ)一部)とによって与え
られろ。このタイプのダイオード構造はしばしばショッ
トキ・バリア・ダイオードと呼ばれろ。このダイオード
11N形領域14の小さい部分に限定されバリ7嗜コン
タクト表面16′で終丁する高電界強度領域69を供給
する。メサ形ダイオード50の打ち込まれた表面部分か
ら形成されろ保護層ろ2(工、高電界領域が含まれろN
形材料から成る変換された露出周辺接合部15′ヲ供給
するっ 第5A図及び第5B図は、他のダイオード活性領域構造
を示し、これhはダブル・ドリフトeダイオード(第5
A図)及びシングル拳ドリフト・ダイオード60“(第
5B図)と呼ばれる。ダブル・ドリフト・ダイオード6
0′1まP++形ドープ層41゜P形ドープ層42及び
その上に形成されたN形ドープ層44を含む5層42.
44の境界は接合46を形成する。そσ)接合451″
S、変換された露出周辺接合部4ろ“ケ供給する、最も
商い電界の領域1工接合430領域にほぼ限定されろ、
保護層62′はP形材料42及び1く形材料440表面
部分から形成され、変容′tされた露出周辺接合部43
′、即ち高電界領域なメサ形ダイオード60の内部に対
しt気的に分離する。シングル・ドリフト構造60“(
第5B図)は、薄いP 形層46とその上に形成される
N形/i48とから成り1層46.48は接合47を形
lj′y、−i−石、接合47はあらかじめ変換された
^出筒辺接合部47′ヲ供給する。ここでも高電界強度
は接合47の領域にほぼ限定されろ。保護層32“もま
た層46及び48の表面部分から与えられ、変換された
施用周辺接合部47′を限定し。
ープされた領域14とショットキ・バリア・コンタクト
16′(ここでは金属層16σ)一部)とによって与え
られろ。このタイプのダイオード構造はしばしばショッ
トキ・バリア・ダイオードと呼ばれろ。このダイオード
11N形領域14の小さい部分に限定されバリ7嗜コン
タクト表面16′で終丁する高電界強度領域69を供給
する。メサ形ダイオード50の打ち込まれた表面部分か
ら形成されろ保護層ろ2(工、高電界領域が含まれろN
形材料から成る変換された露出周辺接合部15′ヲ供給
するっ 第5A図及び第5B図は、他のダイオード活性領域構造
を示し、これhはダブル・ドリフトeダイオード(第5
A図)及びシングル拳ドリフト・ダイオード60“(第
5B図)と呼ばれる。ダブル・ドリフト・ダイオード6
0′1まP++形ドープ層41゜P形ドープ層42及び
その上に形成されたN形ドープ層44を含む5層42.
44の境界は接合46を形成する。そσ)接合451″
S、変換された露出周辺接合部4ろ“ケ供給する、最も
商い電界の領域1工接合430領域にほぼ限定されろ、
保護層62′はP形材料42及び1く形材料440表面
部分から形成され、変容′tされた露出周辺接合部43
′、即ち高電界領域なメサ形ダイオード60の内部に対
しt気的に分離する。シングル・ドリフト構造60“(
第5B図)は、薄いP 形層46とその上に形成される
N形/i48とから成り1層46.48は接合47を形
lj′y、−i−石、接合47はあらかじめ変換された
^出筒辺接合部47′ヲ供給する。ここでも高電界強度
は接合47の領域にほぼ限定されろ。保護層32“もま
た層46及び48の表面部分から与えられ、変換された
施用周辺接合部47′を限定し。
故に高電界領域をメサ形ダイオード50“の内部に限定
する。
する。
延長したベース部29に含まれろ活性層140表面部分
は半絶縁にされる。従来は、これに反して活性層の深部
が半絶縁にされた。このように接合部が奥出されその奥
出された接合領域が保護層に変換される。不活性化する
本発明の技術は打ち込みσ)深さに制限されない。従っ
て、従来技術と異なり、より低い周波数のより厚い層に
対しても同様に使用することがでとる。
は半絶縁にされる。従来は、これに反して活性層の深部
が半絶縁にされた。このように接合部が奥出されその奥
出された接合領域が保護層に変換される。不活性化する
本発明の技術は打ち込みσ)深さに制限されない。従っ
て、従来技術と異なり、より低い周波数のより厚い層に
対しても同様に使用することがでとる。
本発明を好適実施例に従って説明したが1本発明はこの
実施例に限定されることなく他の実施例に適用されるこ
とは当業者には明らかである。
実施例に限定されることなく他の実施例に適用されるこ
とは当業者には明らかである。
第1〜6図はメサ形ダイオードの延長された表面部分に
半絶縁I@ヲ有するメサ形ダイオードの製造σ)ステッ
プを示す一連の断面図で、第2図は第2A図の#2−2
からQ)断面図である。 第2A図1工第2図に示す工程のメサ形ダイオードの上
面図であるっ 第4図は第6図に示すような活性層によって供給されろ
接合の詳細図である。 第5A、5B図は別σ〕型式の活性層によって供給され
ろ接合の詳細図である。 (符号説明) 10:1クエハ、 12:基板、 16:接合。 14:活性層、 16.18:金属層、 24:頂
部コノタクト、 50二メサ形ダイオード。 52=保護層。 %許出に人 レイセオン・カンパニー(外4名)
(
半絶縁I@ヲ有するメサ形ダイオードの製造σ)ステッ
プを示す一連の断面図で、第2図は第2A図の#2−2
からQ)断面図である。 第2A図1工第2図に示す工程のメサ形ダイオードの上
面図であるっ 第4図は第6図に示すような活性層によって供給されろ
接合の詳細図である。 第5A、5B図は別σ〕型式の活性層によって供給され
ろ接合の詳細図である。 (符号説明) 10:1クエハ、 12:基板、 16:接合。 14:活性層、 16.18:金属層、 24:頂
部コノタクト、 50二メサ形ダイオード。 52=保護層。 %許出に人 レイセオン・カンパニー(外4名)
(
Claims (1)
- 【特許請求の範囲】 基板の第1表面に接合領域を有する活性領域を形成し、 前記基板の第2表面に電極コンタクトラ形成し、前記電
極コンタクトラマスクとして使用して基板の一部をエツ
チングしてメサ形構造を形成し。 前記電極コンタクトの円周を越えて伸びる前記構造の周
辺接合部ヲ露出し。 前記電極コンタクトをマスクとして使用して前記周辺接
合部に粒子を打ち込む、 ステップから構成される保護層形成方法、
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US06/371,857 US4474623A (en) | 1982-04-26 | 1982-04-26 | Method of passivating a semiconductor body |
US371857 | 1982-04-26 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58197825A true JPS58197825A (ja) | 1983-11-17 |
JPH0251265B2 JPH0251265B2 (ja) | 1990-11-06 |
Family
ID=23465680
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58073697A Granted JPS58197825A (ja) | 1982-04-26 | 1983-04-26 | 半導体保護層形成方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US4474623A (ja) |
JP (1) | JPS58197825A (ja) |
FR (1) | FR2525814B1 (ja) |
GB (1) | GB2119568B (ja) |
Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0312965B1 (de) * | 1987-10-23 | 1992-12-30 | Siemens Aktiengesellschaft | Verfahren zur Herstellung eines planaren selbstjustierten Heterobipolartransistors |
US5160492A (en) * | 1989-04-24 | 1992-11-03 | Hewlett-Packard Company | Buried isolation using ion implantation and subsequent epitaxial growth |
GB9315798D0 (en) * | 1993-07-30 | 1993-09-15 | Philips Electronics Uk Ltd | Manufacture of electronic devices comprising thin-film transistors |
US6046109A (en) * | 1997-12-29 | 2000-04-04 | Industrial Technology Research Institute | Creation of local semi-insulating regions on semiconductor substrates |
US5998294A (en) * | 1998-04-29 | 1999-12-07 | The United States Of America As Represented By The Secretary Of The Navy | Method for forming improved electrical contacts on non-planar structures |
US6800563B2 (en) * | 2001-10-11 | 2004-10-05 | Ovonyx, Inc. | Forming tapered lower electrode phase-change memories |
ATE388520T1 (de) * | 2004-05-06 | 2008-03-15 | Nxp Bv | Elektronische einrichtung |
US7622358B2 (en) * | 2005-09-30 | 2009-11-24 | Taiwan Semiconductor Manufacturing Co., Ltd. | Semiconductor device with semi-insulating substrate portions and method for forming the same |
US11069995B1 (en) * | 2020-02-07 | 2021-07-20 | Northrop Grumman Systems Corporation | Single self-insulating contact for wet electrical connector |
Family Cites Families (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
GB1300186A (en) * | 1970-07-22 | 1972-12-20 | Motorola Inc | Method for passivating mesa pn junction structures |
US3886580A (en) * | 1973-10-09 | 1975-05-27 | Cutler Hammer Inc | Tantalum-gallium arsenide schottky barrier semiconductor device |
US3923975A (en) * | 1973-10-09 | 1975-12-02 | Cutler Hammer Inc | Tantalum-gallium arsenide schottky barrier semiconductor device |
FR2268355B1 (ja) * | 1974-04-16 | 1978-01-20 | Thomson Csf | |
JPS5136878A (en) * | 1974-09-14 | 1976-03-27 | Tokyo Shibaura Electric Co | Handotaisochi no seizohoho |
US3912546A (en) * | 1974-12-06 | 1975-10-14 | Hughes Aircraft Co | Enhancement mode, Schottky-barrier gate gallium arsenide field effect transistor |
US4110488A (en) * | 1976-04-09 | 1978-08-29 | Rca Corporation | Method for making schottky barrier diodes |
US4075650A (en) * | 1976-04-09 | 1978-02-21 | Cutler-Hammer, Inc. | Millimeter wave semiconductor device |
US4098921A (en) * | 1976-04-28 | 1978-07-04 | Cutler-Hammer | Tantalum-gallium arsenide schottky barrier semiconductor device |
JPS5356972A (en) * | 1976-11-01 | 1978-05-23 | Mitsubishi Electric Corp | Mesa type semiconductor device |
US4157610A (en) * | 1976-12-20 | 1979-06-12 | Tokyo Shibaura Electric Co., Ltd. | Method of manufacturing a field effect transistor |
US4197557A (en) * | 1977-05-05 | 1980-04-08 | Rca Corporation | Brightness control circuit employing a closed control loop |
US4172906A (en) * | 1977-05-11 | 1979-10-30 | Rockwell International Corporation | Method for passivating III-V compound semiconductors |
US4160992A (en) * | 1977-09-14 | 1979-07-10 | Raytheon Company | Plural semiconductor devices mounted between plural heat sinks |
DE2755168A1 (de) * | 1977-12-10 | 1979-06-13 | Itt Ind Gmbh Deutsche | Verfahren zur herstellung von halbleiterbauelementen |
GB1601059A (en) * | 1978-05-31 | 1981-10-21 | Secr Defence | Fet devices and their fabrication |
US4198250A (en) * | 1979-02-05 | 1980-04-15 | Intel Corporation | Shadow masking process for forming source and drain regions for field-effect transistors and like regions |
GB2071411B (en) * | 1980-03-07 | 1983-12-21 | Philips Electronic Associated | Passivating p-n junction devices |
DE3047821A1 (de) * | 1980-12-18 | 1982-07-15 | Siemens AG, 1000 Berlin und 8000 München | Schottky-diode und verfahren zu deren herstellung |
-
1982
- 1982-04-26 US US06/371,857 patent/US4474623A/en not_active Expired - Fee Related
-
1983
- 1983-04-19 GB GB08310609A patent/GB2119568B/en not_active Expired
- 1983-04-26 JP JP58073697A patent/JPS58197825A/ja active Granted
- 1983-04-26 FR FR8306815A patent/FR2525814B1/fr not_active Expired
Also Published As
Publication number | Publication date |
---|---|
GB2119568A (en) | 1983-11-16 |
JPH0251265B2 (ja) | 1990-11-06 |
GB2119568B (en) | 1986-01-08 |
GB8310609D0 (en) | 1983-05-25 |
FR2525814B1 (fr) | 1986-03-14 |
FR2525814A1 (fr) | 1983-10-28 |
US4474623A (en) | 1984-10-02 |
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