JPS58154319A - 保護継電器 - Google Patents
保護継電器Info
- Publication number
- JPS58154319A JPS58154319A JP57035392A JP3539282A JPS58154319A JP S58154319 A JPS58154319 A JP S58154319A JP 57035392 A JP57035392 A JP 57035392A JP 3539282 A JP3539282 A JP 3539282A JP S58154319 A JPS58154319 A JP S58154319A
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- JP
- Japan
- Prior art keywords
- signal
- output
- detection element
- outputs
- differential
- Prior art date
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- Granted
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- Emergency Protection Circuit Devices (AREA)
- Protection Of Transformers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、変圧器等、投入時に大電流が流れる電力系
統の機器を保護対象に含む保護継電器に関する。
統の機器を保護対象に含む保護継電器に関する。
従来、この種の継電器は、変圧器等を系統に接続した際
に流れる励磁突入電流と、応動すべき対象の故障電流と
を区別するために、入力信号に含まれる瀉２高調成分分
を検出し、これが基本波成分に対して一定比率以上のも
のであったときは当該の入力信号は励磁突入電流のもの
であると判定し、応動しないようにしていた。
に流れる励磁突入電流と、応動すべき対象の故障電流と
を区別するために、入力信号に含まれる瀉２高調成分分
を検出し、これが基本波成分に対して一定比率以上のも
のであったときは当該の入力信号は励磁突入電流のもの
であると判定し、応動しないようにしていた。
第１図は、このような機能をもつ従来の保護継電器の回
路図である。第１図において、１は電力系統において保
護対象の機器に関する電流から検出されたいわゆる抑制
入力（信号）、２はその電流から検出されたいわゆる差
動人力（信号）、３は抑制人力１及び差動入力２を入力
し、差動入力２が両者間の比を所定値以上にする大きさ
となったときに信号すを出力する比率差動要素、ＪＦｉ
差動入力２が系統の重故障に対応させた所定レベル以上
の大入力レベルになるのを検出したときは信号ｅを出力
する検出要素、５，６は差動入力２に含まれる第２高調
波成分Ｉ、が所定値以上となるのを検出したときに信号
ａ、ｅを出力する検出要素、７は信号ｅを入力し、動作
に遅延のある遅延回路、８Ｆｉ遅延回路の出力を入力し
、復帰して遅延のある遅延回路、９は比率差動検出要素
３の信号０と検出要素５の信号色の反転論理との論理積
をとるアンド・グー）、１０Ｆｉ検出要素５の信号０を
動作させる信号ｄを出力するオア・ゲート。
路図である。第１図において、１は電力系統において保
護対象の機器に関する電流から検出されたいわゆる抑制
入力（信号）、２はその電流から検出されたいわゆる差
動人力（信号）、３は抑制人力１及び差動入力２を入力
し、差動入力２が両者間の比を所定値以上にする大きさ
となったときに信号すを出力する比率差動要素、ＪＦｉ
差動入力２が系統の重故障に対応させた所定レベル以上
の大入力レベルになるのを検出したときは信号ｅを出力
する検出要素、５，６は差動入力２に含まれる第２高調
波成分Ｉ、が所定値以上となるのを検出したときに信号
ａ、ｅを出力する検出要素、７は信号ｅを入力し、動作
に遅延のある遅延回路、８Ｆｉ遅延回路の出力を入力し
、復帰して遅延のある遅延回路、９は比率差動検出要素
３の信号０と検出要素５の信号色の反転論理との論理積
をとるアンド・グー）、１０Ｆｉ検出要素５の信号０を
動作させる信号ｄを出力するオア・ゲート。
１１は信号ｄの反転論理と遅延回路８信号とのアンドを
とり、継電器をロックさせる信号ｆを出力するアンド・
ゲートである。
とり、継電器をロックさせる信号ｆを出力するアンド・
ゲートである。
次（動作について説明する。＠２図は第１図に示す回路
の各部の信号波形を示す波形図である。
の各部の信号波形を示す波形図である。
いま保護対象が時刻ｔ０で投入され１時刻ｔ、で何らか
の原因でレベルを減少したとすると、差動入力□ ２の波形は図示のように時刻ｔ０からあるレベルのもの
となり１時刻ｔ、からレベルを低下させる。これにより
、差動入力２の差動量ＩＤは時刻ｔ０からレベルを増大
させ、また時刻ｔ、から減少に転じ、第２高調波成分Ｉ
、 Ｆｉ検出要素５，６のＱ（尖鋭度）により時刻ｔ０
及びｔ、後において一時的に発生する。
の原因でレベルを減少したとすると、差動入力□ ２の波形は図示のように時刻ｔ０からあるレベルのもの
となり１時刻ｔ、からレベルを低下させる。これにより
、差動入力２の差動量ＩＤは時刻ｔ０からレベルを増大
させ、また時刻ｔ、から減少に転じ、第２高調波成分Ｉ
、 Ｆｉ検出要素５，６のＱ（尖鋭度）により時刻ｔ０
及びｔ、後において一時的に発生する。
検出要素６は基本波成分１７を検出することにより１図
示のようにパルスの信号ｅを出力する（ただし１時刻ｔ
０以前において１１′になっているのはバイアスのため
である）。投入時は信号ｅの発生期間が短いため、遅延
回路７はパルスを出力せス従ってアンド・ゲート１１は
信号ｆを出力しない。
示のようにパルスの信号ｅを出力する（ただし１時刻ｔ
０以前において１１′になっているのはバイアスのため
である）。投入時は信号ｅの発生期間が短いため、遅延
回路７はパルスを出力せス従ってアンド・ゲート１１は
信号ｆを出力しない。
しかし、時刻ｔ、後の期間では信号ｅのパルス幅が遅延
回路７の遅延時間を超えているため、信号ｆが出力され
てしまう。即ち、検出要素４の信号０が１０１になった
後に、検出要素５の信号ａが１１１になると、比率差動
要素６の信号すが図示のように出力し続けてもアンド・
ゲート９により禁止され、信号ｄはＩＯｌとなる。信号
Ｃが１０１となると、アンド・グー・、ト１１は、信号
０による禁止：・１・１ が解かれ、遅延回路８の出力を通過させ、信号ｆを出力
する。このような誤出力は、遅延回路７及び８の遅延時
間を増大させることによプ抑制可能だが、同時に継電器
としての動作時間を遅くするので、保護継電器の機能目
的を達成できなくなる。
回路７の遅延時間を超えているため、信号ｆが出力され
てしまう。即ち、検出要素４の信号０が１０１になった
後に、検出要素５の信号ａが１１１になると、比率差動
要素６の信号すが図示のように出力し続けてもアンド・
ゲート９により禁止され、信号ｄはＩＯｌとなる。信号
Ｃが１０１となると、アンド・グー・、ト１１は、信号
０による禁止：・１・１ が解かれ、遅延回路８の出力を通過させ、信号ｆを出力
する。このような誤出力は、遅延回路７及び８の遅延時
間を増大させることによプ抑制可能だが、同時に継電器
としての動作時間を遅くするので、保護継電器の機能目
的を達成できなくなる。
この発明は、上記のような従来のものの欠点を除去する
ためになされたもので、継電器をロックする条件が成立
しても所定時限以下のときはロック信号を出力しないよ
うにすることにより、差動入力の減少時もロック信号の
誤出力をなくすことができる保護継電器を提供すること
を目的とする。
ためになされたもので、継電器をロックする条件が成立
しても所定時限以下のときはロック信号を出力しないよ
うにすることにより、差動入力の減少時もロック信号の
誤出力をなくすことができる保護継電器を提供すること
を目的とする。
以下、この発明の一実施例を図について説明する。ＩＫ
３図において、第１図と同一符号は同一部分を示し、１
２は検出要素４の信号０の反転論理と検出要素６の信号
・との論理積をとるアンド・ゲートで、その出力は遅延
回路７及び８を介して図外に供給され、継電器をロック
する信号ｇとなる。
３図において、第１図と同一符号は同一部分を示し、１
２は検出要素４の信号０の反転論理と検出要素６の信号
・との論理積をとるアンド・ゲートで、その出力は遅延
回路７及び８を介して図外に供給され、継電器をロック
する信号ｇとなる。
次に動作について説明する。第３図に示す回路の動作の
波形図を第４図に示す。信号ｄ及びθについての動作は
、第１図の回路と同一であり、既にｔｌｉ、＠１．たと
おりである。図示のとおり、検出要素４の信号Ｃが出力
されている間はアンド・グーｉ２ｔ：Ｉ禁止され、信号
ｇが出力されることはない。信号Ｃが１０１になると、
アンド・ゲート１２の禁止が解かれ、検出要素６の信号
ｅはアンド・ゲート１２を通って遅延回路７に：入力さ
れる。しかし、アンド・ゲート１２の出力におけるパル
スの幅は、信号・より狭められているので、遅延回路７
はパルスを出力せず、従って信号ｇは出力されない。
波形図を第４図に示す。信号ｄ及びθについての動作は
、第１図の回路と同一であり、既にｔｌｉ、＠１．たと
おりである。図示のとおり、検出要素４の信号Ｃが出力
されている間はアンド・グーｉ２ｔ：Ｉ禁止され、信号
ｇが出力されることはない。信号Ｃが１０１になると、
アンド・ゲート１２の禁止が解かれ、検出要素６の信号
ｅはアンド・ゲート１２を通って遅延回路７に：入力さ
れる。しかし、アンド・ゲート１２の出力におけるパル
スの幅は、信号・より狭められているので、遅延回路７
はパルスを出力せず、従って信号ｇは出力されない。
なお、遅延回路７は、アンド・ゲート１２に従属接続さ
れているので、その遅延時間を第１図のものより短く設
定しても安定な動作を保つことができ、上記実施例と同
様な効果を奏する。
れているので、その遅延時間を第１図のものより短く設
定しても安定な動作を保つことができ、上記実施例と同
様な効果を奏する。
以上のように、この発明によれば、ロック条件の信号が
所定時限継続したときにロック信号を出力するようにし
たので、信頼性の高い動作が得られ、４応動時間も速い
ものが得られる効果がある。
所定時限継続したときにロック信号を出力するようにし
たので、信頼性の高い動作が得られ、４応動時間も速い
ものが得られる効果がある。
第１図は従来の保護継電器の回路図、７Ｊ！２図は第１
図に示す保護継電器の動作の波形図、蘂３図はこの発明
の一実施例による保護継電器の回路図。 第４図ｉｆ第３図に示す保護継電器の波形図である。 ３・−・比率差動要素、４，５．６・・・検出要素、７
．８・・・遅延回路、９，１１．１２・・・アンド・ゲ
ート。なお、図中、同一符号は同一部分を示す。 代理人 葛野信−（ほか１名） 第 ２ 図 第 ４ 図
図に示す保護継電器の動作の波形図、蘂３図はこの発明
の一実施例による保護継電器の回路図。 第４図ｉｆ第３図に示す保護継電器の波形図である。 ３・−・比率差動要素、４，５．６・・・検出要素、７
．８・・・遅延回路、９，１１．１２・・・アンド・ゲ
ート。なお、図中、同一符号は同一部分を示す。 代理人 葛野信−（ほか１名） 第 ２ 図 第 ４ 図
Claims (1)
- 電力系統における保護対象に関する電流から検出された
差動入力が上記電流から検出された抑制入力より所定以
上の比率の値となったときに信号を出力する比率差動要
素と、上記差動入力が所定値以上となったときに信号を
出力する粥１検出要素と、上記差動入力に含まれるｉＭ
２高調波成分が所定レベル以上のときに信号を出力する
＠２及び纂３検出要素と、上記比率差動検出要素の信号
が出力され、かつ上記壓２＆出要素の信号が出力されな
いとき及び上記第１検出要素の信号が出力されたとｔＩ
に動作信号を出力し、上記＠１検出要素の信号が出力さ
れず、かつ上記粥３検出要素の信号が出力される状態が
所定時限継続したときにロック信号を出力する論理回路
とを備え、上記動作信号により動作し、上記ロック信号
により不動作となる保護継電器。
Priority Applications (10)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57035392A JPS58154319A (ja) | 1982-03-05 | 1982-03-05 | 保護継電器 |
| DE8282112011T DE3270515D1 (en) | 1981-12-29 | 1982-12-24 | Protective relay for power system |
| AU91866/82A AU557935B2 (en) | 1981-12-29 | 1982-12-24 | Power system protection relay |
| EP85102628A EP0161407B1 (en) | 1981-12-29 | 1982-12-24 | Protective relay for a power system |
| EP82112011A EP0083097B1 (en) | 1981-12-29 | 1982-12-24 | Protective relay for power system |
| DE8585102567T DE3277670D1 (en) | 1981-12-29 | 1982-12-24 | Protective relay for a power system |
| EP85102567A EP0161403B1 (en) | 1981-12-29 | 1982-12-24 | Protective relay for a power system |
| DE8585102628T DE3279527D1 (en) | 1981-12-29 | 1982-12-24 | Protective relay for a power system |
| US06/454,066 US4513344A (en) | 1981-12-29 | 1982-12-28 | Protective relay for power system |
| CA000418671A CA1193707A (en) | 1981-12-29 | 1982-12-29 | Protective relay for power system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57035392A JPS58154319A (ja) | 1982-03-05 | 1982-03-05 | 保護継電器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58154319A true JPS58154319A (ja) | 1983-09-13 |
| JPH023374B2 JPH023374B2 (ja) | 1990-01-23 |
Family
ID=12440636
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57035392A Granted JPS58154319A (ja) | 1981-12-29 | 1982-03-05 | 保護継電器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58154319A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH048293U (ja) * | 1990-05-07 | 1992-01-24 |
-
1982
- 1982-03-05 JP JP57035392A patent/JPS58154319A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH023374B2 (ja) | 1990-01-23 |
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