JPH01259720A - 変圧器保護リレー - Google Patents
変圧器保護リレーInfo
- Publication number
- JPH01259720A JPH01259720A JP8610688A JP8610688A JPH01259720A JP H01259720 A JPH01259720 A JP H01259720A JP 8610688 A JP8610688 A JP 8610688A JP 8610688 A JP8610688 A JP 8610688A JP H01259720 A JPH01259720 A JP H01259720A
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- Japan
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- inrush
- circuits
- phase
- lock
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- Pending
Links
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- 238000004804 winding Methods 0.000 claims description 8
- 238000001514 detection method Methods 0.000 claims 1
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- 238000000034 method Methods 0.000 description 2
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Landscapes
- Protection Of Transformers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、電力系統に設置される変圧器の内部事故を
検出し保護する変圧器保護リレーに関するものである。
検出し保護する変圧器保護リレーに関するものである。
第２図は従来の変圧器保護リレーの内部回路中の主要部
分を抜ぎ出した原理構成図で、図中、（６）は変圧器保
護リレー（以降ＴＰリレーと略す） 、（７１）、（７
２）、（７３）はＴＰリレー３相分それぞれの比率差動
回路、（８１） 、 （８２） 、 （８３）は同じく
３相分それぞれのインラッシュロック判定回路で、基本
波電流成分に対する第２高調波の割合が一定値以上の時
に励磁電流であると判定しロックをかけるようになって
おり、（９１） 、 （９２） 、 （９３）はインヒ
ビット回路である。
分を抜ぎ出した原理構成図で、図中、（６）は変圧器保
護リレー（以降ＴＰリレーと略す） 、（７１）、（７
２）、（７３）はＴＰリレー３相分それぞれの比率差動
回路、（８１） 、 （８２） 、 （８３）は同じく
３相分それぞれのインラッシュロック判定回路で、基本
波電流成分に対する第２高調波の割合が一定値以上の時
に励磁電流であると判定しロックをかけるようになって
おり、（９１） 、 （９２） 、 （９３）はインヒ
ビット回路である。
しかして、第３図はＴＰリレー周辺の回路構成を示す図
であり、図中、（１１）、（１２）、（１３）は電源、
（２１） 、 （２２） 、 （２３）は変圧器投入・
用しゃ断器、（３１） 、 （３２） 、 （３３）は
ＣＴで、デルタ接続された後でＴＰリレー （６）にＣ
Ｔ大入力して導入される。又（４１） 、 （４２）
、 （４３）は保護対象変圧器のスター側各相巻線、
（５）は中性点接地抵抗器である。
であり、図中、（１１）、（１２）、（１３）は電源、
（２１） 、 （２２） 、 （２３）は変圧器投入・
用しゃ断器、（３１） 、 （３２） 、 （３３）は
ＣＴで、デルタ接続された後でＴＰリレー （６）にＣ
Ｔ大入力して導入される。又（４１） 、 （４２）
、 （４３）は保護対象変圧器のスター側各相巻線、
（５）は中性点接地抵抗器である。
上記構成において、第４図に示す電流分布は、しゃ断器
（３１） 、 （３２） 、 （３３）が閉じた時に変
圧器巻線のＡ相（４１）とＣ相（４３）に励磁突流が発
生した場合のものであり、一般に突流が発生した相の電
流は残る２相に均等分流する為、合計値としてＡ粗巻従
って、ＴＰリレー （６）には 第３相：Ｃ相巻線電流−Ａ相巻線電流：の電流が各相に
供給される。
（３１） 、 （３２） 、 （３３）が閉じた時に変
圧器巻線のＡ相（４１）とＣ相（４３）に励磁突流が発
生した場合のものであり、一般に突流が発生した相の電
流は残る２相に均等分流する為、合計値としてＡ粗巻従
って、ＴＰリレー （６）には 第３相：Ｃ相巻線電流−Ａ相巻線電流：の電流が各相に
供給される。
次に動作について説明する。先ず、スタ接続された変圧
器保護用ＣＴからの第１相デルタ人力ＩＡ−ＩａがＴＰ
リレー （６）に導入され比率差動回路（７１）とイン
ラッシュロック判定回路（８１）に印加される。
器保護用ＣＴからの第１相デルタ人力ＩＡ−ＩａがＴＰ
リレー （６）に導入され比率差動回路（７１）とイン
ラッシュロック判定回路（８１）に印加される。
尚、両回路には残る片側の変圧器巻線側からのＣＴ人力
も導入されるが、この発明の主旨とは直接の関係は無い
ので図面上、ならびに説明も省略する。
も導入されるが、この発明の主旨とは直接の関係は無い
ので図面上、ならびに説明も省略する。
上記印加された入力により比率差動回路（７１）が出力
を出せば変圧器本体に内部事故が発生したと判断し、イ
ンヒビット回路（９１）から第１相出力が出される。
を出せば変圧器本体に内部事故が発生したと判断し、イ
ンヒビット回路（９１）から第１相出力が出される。
一方、比率差動回路（７１）が出力を出していても、同
時にインラッシュロック判定回路（８１）からも出力が
出ている場合は変圧器投入時の励磁突流とみなし、イン
ヒビット回路（９１）が機能し、第１相出力は阻止され
る。
時にインラッシュロック判定回路（８１）からも出力が
出ている場合は変圧器投入時の励磁突流とみなし、イン
ヒビット回路（９１）が機能し、第１相出力は阻止され
る。
第２、第３相についてもＣＴ人力相が変わるのみで作用
、動作は第１相と同様である。
、動作は第１相と同様である。
従来のＴＰリレーは以上のように構成されているので、
次の様な問題点が有った。第４図の様にＡ、Ｃ相に突流
が発生した場合、ＴＰリレーの第３相には第５図（ａ）
、 （ｂ）で示される様な基本波電流ならびに第２高
調波電流が供給されるが、図を見て分かる事は、基本波
成分が原波形に比して増大するのに対し、第２高調波電
流分が原波形と変わらない事である。一般にＴＰリレー
のインラッシュロック判定回路は基本波電流成分に対す
る第２高調波電流の割合が一定値以上になフた事で励磁
突流と判断し、ロックをかける原理である為、原波形が
ほぼそのまま入る第１、第２相は問題ないが第３相のご
とく基本渡分が増大して見えるものは励磁突流の際にロ
ックがかからず誤出力を出してしまう。
次の様な問題点が有った。第４図の様にＡ、Ｃ相に突流
が発生した場合、ＴＰリレーの第３相には第５図（ａ）
、 （ｂ）で示される様な基本波電流ならびに第２高
調波電流が供給されるが、図を見て分かる事は、基本波
成分が原波形に比して増大するのに対し、第２高調波電
流分が原波形と変わらない事である。一般にＴＰリレー
のインラッシュロック判定回路は基本波電流成分に対す
る第２高調波電流の割合が一定値以上になフた事で励磁
突流と判断し、ロックをかける原理である為、原波形が
ほぼそのまま入る第１、第２相は問題ないが第３相のご
とく基本渡分が増大して見えるものは励磁突流の際にロ
ックがかからず誤出力を出してしまう。
この発明は、この様な問題点を解消するためになされた
ものであり、励磁突流の場合は確実にインラッシュロッ
ク機能が作動する様にする事を目的とする。
ものであり、励磁突流の場合は確実にインラッシュロッ
ク機能が作動する様にする事を目的とする。
この発明に係る変圧器保護リレーは、変圧器各相巻線に
流れる電流の検出に基いて基本波電流成分に対する第２
高調波電流成分が一定値以上の時動作する第１のインヒ
ビット回路を備えた変圧器保護リレーにおいて、上記各
相インラッシュロック信号の２相毎のＡＮＤ条件をそれ
ぞれとるＡＮＤ回路、この各ＡＮＤ回路の出力を各相リ
レーの出力段で動作ロック用信号として用いる第２のイ
ンヒビット回路を備えたものである。
流れる電流の検出に基いて基本波電流成分に対する第２
高調波電流成分が一定値以上の時動作する第１のインヒ
ビット回路を備えた変圧器保護リレーにおいて、上記各
相インラッシュロック信号の２相毎のＡＮＤ条件をそれ
ぞれとるＡＮＤ回路、この各ＡＮＤ回路の出力を各相リ
レーの出力段で動作ロック用信号として用いる第２のイ
ンヒビット回路を備えたものである。
この発明において、インラッシュロック信号の２相ＡＮ
Ｄ条件は、励磁突流の際、デルタ電流導出の為に第２高
調波成分が基本成分に比して減少して見える任意相のリ
レー要素に、確実にロック信号が期待できる他の２相の
インラッシュロック信号ＡＮＤ条件でロックをかける事
で任意相の誤動作を防止する作用を有する。
Ｄ条件は、励磁突流の際、デルタ電流導出の為に第２高
調波成分が基本成分に比して減少して見える任意相のリ
レー要素に、確実にロック信号が期待できる他の２相の
インラッシュロック信号ＡＮＤ条件でロックをかける事
で任意相の誤動作を防止する作用を有する。
以下、この発明の一実施例を第２図と同一部分は同一符
号を付して示す第１図について説明する。第１図におい
て（１０１） 、 （１０２） 、 （１０３）は各イ
ンラッシュロック判定回路（８１） 、 （８２） 、
（８３）からの出力の２相ＡＮＤ出力を得る為のＡＮ
Ｄ回路、（９４） 、 （９５） 、 （９８）は最終
段に於て、上記インラッシュロックの２相ＡＮＤ条件で
ロックを効かせる為のインヒビット回路である。
号を付して示す第１図について説明する。第１図におい
て（１０１） 、 （１０２） 、 （１０３）は各イ
ンラッシュロック判定回路（８１） 、 （８２） 、
（８３）からの出力の２相ＡＮＤ出力を得る為のＡＮ
Ｄ回路、（９４） 、 （９５） 、 （９８）は最終
段に於て、上記インラッシュロックの２相ＡＮＤ条件で
ロックを効かせる為のインヒビット回路である。
次にこの実施例の作用及び動作について前述しの為、第
２高調波成分が基本波に対して減って見える為、第３相
のインラッシュロック判定回路（８３）から出力が出す
、インピット回路（９３）から出力が出てしまう。
２高調波成分が基本波に対して減って見える為、第３相
のインラッシュロック判定回路（８３）から出力が出す
、インピット回路（９３）から出力が出てしまう。
一方、第１、第２相共、インラッシュロック判定回路（
８１） 、 （８２）の出力が確実に出る為、ＡＮＤ回
路（１０３）から出力が出て、インピット回路（９６）
で信号が阻止され、最終段の第３相出力は出ない。
８１） 、 （８２）の出力が確実に出る為、ＡＮＤ回
路（１０３）から出力が出て、インピット回路（９６）
で信号が阻止され、最終段の第３相出力は出ない。
他相に於ても同様に第１相をロックするのは第２、第３
相の各相インラッシュロック信号のＡＮＤ条件、第２相
をロックするのは第１、第３相の各相インラッシュロッ
ク信号のＡＮＤ条件である。
相の各相インラッシュロック信号のＡＮＤ条件、第２相
をロックするのは第１、第３相の各相インラッシュロッ
ク信号のＡＮＤ条件である。
（発明の効果）
以上のように、この発明によれば、各相インラッシュロ
ック信号の２相ＡＮＤ条件を、従来の各相インラッシュ
ロック方式に追加利用できる様に回路構成したので、従
来のインラッシュロック方式を補完した形で確実なイン
ラッシュロックが期待できる。
ック信号の２相ＡＮＤ条件を、従来の各相インラッシュ
ロック方式に追加利用できる様に回路構成したので、従
来のインラッシュロック方式を補完した形で確実なイン
ラッシュロックが期待できる。
第１図はこの発明の一実施例を示す回路構成図、第２図
は従来の回路構成図、第３図はＴＰリレー周辺回路構成
図、第４図と第５図（ａ） 、 （ｂ）はＡ、Ｃ相励磁
突流時の電流波形図ならびにベクトル図である。 （６）：変圧器保護リレー、 （８１）〜（８３）：インラッシュロック判定回路、（
９１）〜（９６）：インピット回路、（１０１） 、
（１０２） 、 （１０３） ： Ａ Ｎ ０回路。 なお、図中同一符号は同−又は相当部分を示す。 代理人 大 岩 増 雄 第１図 １０１〜１０３： Ａ Ｎ Ｄ５１ト 第２図 （。 （ａ） （ｂ）
は従来の回路構成図、第３図はＴＰリレー周辺回路構成
図、第４図と第５図（ａ） 、 （ｂ）はＡ、Ｃ相励磁
突流時の電流波形図ならびにベクトル図である。 （６）：変圧器保護リレー、 （８１）〜（８３）：インラッシュロック判定回路、（
９１）〜（９６）：インピット回路、（１０１） 、
（１０２） 、 （１０３） ： Ａ Ｎ ０回路。 なお、図中同一符号は同−又は相当部分を示す。 代理人 大 岩 増 雄 第１図 １０１〜１０３： Ａ Ｎ Ｄ５１ト 第２図 （。 （ａ） （ｂ）
Claims (1)
- 変圧器各相巻線に流れる電流の検出に基いて基本波電流
成分に対する第２高調波電流成分が一定値以上の時動作
する第１のインヒビット回路を備えた変圧器保護リレー
において、上記各相インラッシュロック信号の２相毎の
ＡＮＤ条件をそれぞれとるＡＮＤ回路、この各ＡＮＤ回
路の出力を各相リレーの出力段で動作ロック用信号とし
て用いる第２のインヒビット回路を備えたことを特徴と
する変圧器保護リレー。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8610688A JPH01259720A (ja) | 1988-04-06 | 1988-04-06 | 変圧器保護リレー |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8610688A JPH01259720A (ja) | 1988-04-06 | 1988-04-06 | 変圧器保護リレー |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01259720A true JPH01259720A (ja) | 1989-10-17 |
Family
ID=13877452
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8610688A Pending JPH01259720A (ja) | 1988-04-06 | 1988-04-06 | 変圧器保護リレー |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01259720A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0384820U (ja) * | 1989-12-20 | 1991-08-28 | ||
| EP2259402A1 (fr) * | 2009-06-05 | 2010-12-08 | Schneider Electric Industries SAS | Dispositif et procédé de protection de défaut terre |
| JP2011015528A (ja) * | 2009-07-02 | 2011-01-20 | Toshiba Corp | 送電線保護用電流差動継電装置 |
| JP2020058142A (ja) * | 2018-10-02 | 2020-04-09 | 三菱電機株式会社 | 保護リレー装置 |
-
1988
- 1988-04-06 JP JP8610688A patent/JPH01259720A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0384820U (ja) * | 1989-12-20 | 1991-08-28 | ||
| EP2259402A1 (fr) * | 2009-06-05 | 2010-12-08 | Schneider Electric Industries SAS | Dispositif et procédé de protection de défaut terre |
| FR2946470A1 (fr) * | 2009-06-05 | 2010-12-10 | Schneider Electric Ind Sas | Dispositif et procede de protection de defaut terre |
| JP2011015528A (ja) * | 2009-07-02 | 2011-01-20 | Toshiba Corp | 送電線保護用電流差動継電装置 |
| JP2020058142A (ja) * | 2018-10-02 | 2020-04-09 | 三菱電機株式会社 | 保護リレー装置 |
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