JPS58144270A - 記憶装置システム - Google Patents
記憶装置システムInfo
- Publication number
- JPS58144270A JPS58144270A JP57027065A JP2706582A JPS58144270A JP S58144270 A JPS58144270 A JP S58144270A JP 57027065 A JP57027065 A JP 57027065A JP 2706582 A JP2706582 A JP 2706582A JP S58144270 A JPS58144270 A JP S58144270A
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- Japan
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- power supply
- data
- computer
- storage device
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
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- Stand-By Power Supply Arrangements (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、複数の記憶装置を備えた記隠装価システム
に関する。
に関する。
例えば磁気ディスク装置を使用した記憶装置／ステムで
あるディスクシステムにおいては、磁気ディスク装置の
リード／ライトヘッドと磁気ディスクとの衝突（ヘッド
クララシュラによるヘッド不良や磁気ディスクの破損、
あるいはヘッド部の！ 再生アンプの故障等によって、磁気ディスクに記録され
たデータが消失したり、データの再生がイミ可能になる
。
あるディスクシステムにおいては、磁気ディスク装置の
リード／ライトヘッドと磁気ディスクとの衝突（ヘッド
クララシュラによるヘッド不良や磁気ディスクの破損、
あるいはヘッド部の！ 再生アンプの故障等によって、磁気ディスクに記録され
たデータが消失したり、データの再生がイミ可能になる
。
そのため、従来から磁気ディスクを使用したディスクシ
ステムには、磁気ディスク装置のデータバックアンプ用
補助記憶装置を備えている。
ステムには、磁気ディスク装置のデータバックアンプ用
補助記憶装置を備えている。
第１図は、このようなディスクシステムをｉＪ＜すブロ
ック図である。
ック図である。
このディスクシステムは、コンピューターと、このコン
ピューターからのデータを格納するための主記憶装置で
ある磁気ディスク装置２と、この磁気ディスク装置２の
データバツクアソン用補助記憶装置である磁気テープ装
置３と、コンピュータ１からのディスク制御用コマンド
を適宜変換するコマンド変換装置４と、このコマンド変
換装置４からのデータに基づいて磁気ディスク装置２及
び磁気テープ装置３を制御する制御装置５と、各部に給
電する電源装置６とからなる。
ピューターからのデータを格納するための主記憶装置で
ある磁気ディスク装置２と、この磁気ディスク装置２の
データバツクアソン用補助記憶装置である磁気テープ装
置３と、コンピュータ１からのディスク制御用コマンド
を適宜変換するコマンド変換装置４と、このコマンド変
換装置４からのデータに基づいて磁気ディスク装置２及
び磁気テープ装置３を制御する制御装置５と、各部に給
電する電源装置６とからなる。
このディスクシステムにおいては、磁気ディスク装置２
及び磁気テープ装置６を制御する指令はすべてコンピュ
ータ１から出力され、また電源装置６によってシステム
全体への給電が行なわれている。
及び磁気テープ装置６を制御する指令はすべてコンピュ
ータ１から出力され、また電源装置６によってシステム
全体への給電が行なわれている。
そこで、磁気ディスク装置２のデータを磁気テープ装置
乙に転送する際には、オペレータがコンピュータ１にそ
の旨指令してデータ転送動作を行なわせ、データ転送終
了時にオペレータが再度コンピュータ１に終了の指示を
与える。
乙に転送する際には、オペレータがコンピュータ１にそ
の旨指令してデータ転送動作を行なわせ、データ転送終
了時にオペレータが再度コンピュータ１に終了の指示を
与える。
このように、従来のディスクシステムにおいては、コン
ピュータ１及びオ゛ペレータが介在しなければ磁気ディ
スク装置２のデータのバックアップを行なえず、バンク
アップに要する時間が長い場合には無駄な待ち時間が生
ずる等操作が煩しく、またコンピュータの負担も重くな
るという不都合があった。
ピュータ１及びオ゛ペレータが介在しなければ磁気ディ
スク装置２のデータのバックアップを行なえず、バンク
アップに要する時間が長い場合には無駄な待ち時間が生
ずる等操作が煩しく、またコンピュータの負担も重くな
るという不都合があった。
この発明は上記の点に鑑みてなされたものであシ、複数
の記憶装置を備えた記憶装置システムにおいて、コンピ
ュータ及びオペレータの介在なしに主記憶装置のデータ
バックアップを行ない得るようにすることを目的とする
。
の記憶装置を備えた記憶装置システムにおいて、コンピ
ュータ及びオペレータの介在なしに主記憶装置のデータ
バックアップを行ない得るようにすることを目的とする
。
そのため、この発明による記憶装置システムは、コンピ
ュータ用の主電源装置とは別個に主記憶装置とデータバ
ンクアップ用補助記憶装置及び制御装置用の補助電源装
置を設け、主電源装置の切断を検知し、この検知結果に
基づいて制御装置を制御して主記憶装置のデータを補助
記憶装置に転送させ、データ転送終了時に補助電源装置
も切断するようにしたものである。
ュータ用の主電源装置とは別個に主記憶装置とデータバ
ンクアップ用補助記憶装置及び制御装置用の補助電源装
置を設け、主電源装置の切断を検知し、この検知結果に
基づいて制御装置を制御して主記憶装置のデータを補助
記憶装置に転送させ、データ転送終了時に補助電源装置
も切断するようにしたものである。
以下、この発明の実施例を添付図面の第２図以降を参照
して説明する。
して説明する。
第２図は、この発明を実施した記憶装置システムである
ディスクシステムのブロック図である。
ディスクシステムのブロック図である。
同図しこおいて、このディスクシステムは、コンピュー
タ１１と、主記憶装置である磁気ディスク装置１２と、
データバンクアンプ用補助記憶装置である磁気テープ装
置１３と、主電源切断検知手段、データバックアップ制
御手段及び補助電源装置丁・段を含むコマンド変換装置
１４と、制御装置１５と、コンピュータ１１に給電する
主電源装置１６と、磁気ディスク装置１２．磁気テープ
装置１６、コマンド変換装置１４及び制御装置１５に給
電する補助電源装置１７とからなる。
タ１１と、主記憶装置である磁気ディスク装置１２と、
データバンクアンプ用補助記憶装置である磁気テープ装
置１３と、主電源切断検知手段、データバックアップ制
御手段及び補助電源装置丁・段を含むコマンド変換装置
１４と、制御装置１５と、コンピュータ１１に給電する
主電源装置１６と、磁気ディスク装置１２．磁気テープ
装置１６、コマンド変換装置１４及び制御装置１５に給
電する補助電源装置１７とからなる。
そのコマンド変換装置１４は、第６図に示すように、主
電源切断検知手段である電圧レベル検知回路１９と、コ
マンド入力ランチ回路２０と、ＣＰＵ回路２１と、プロ
グラム格納用ＲＯＭ ２２と、ＲＯＭアドレス制御回路
２６と、コマンド出カラソテ回路２４と、補助電源切断
手段である電源オフ指令回路２５からなる。
電源切断検知手段である電圧レベル検知回路１９と、コ
マンド入力ランチ回路２０と、ＣＰＵ回路２１と、プロ
グラム格納用ＲＯＭ ２２と、ＲＯＭアドレス制御回路
２６と、コマンド出カラソテ回路２４と、補助電源切断
手段である電源オフ指令回路２５からなる。
電圧レベル検知回路１９は、主電源装置１６が切断（オ
フ）されたか否かを主電源装置１゛６の出ツノ電圧をチ
ェックして判定し、主電源装置１６が切断されたときに
主電源切断検知信号Ｓｃを出力する。
フ）されたか否かを主電源装置１゛６の出ツノ電圧をチ
ェックして判定し、主電源装置１６が切断されたときに
主電源切断検知信号Ｓｃを出力する。
また、ＣＰＵ回路２１の主要部は、第４図に小すように
、ＣＰＵ （中央処理装置）２７９割込みポート２８及
びエンコーダ２９によって構成されている。
、ＣＰＵ （中央処理装置）２７９割込みポート２８及
びエンコーダ２９によって構成されている。
そして、このＣＰＵ回路２１は、エンコーダ２９に割込
み要求信号５ｌ−８ｎのいずれがが入力さｉすることに
よって、エンコーダ２９が優先順位を判定してＣＰＵ
２７に割込み信号ＩＮＴを出力し、これに対してＣＰＵ
２７が割込みチェック信号ＩＮＴＡを出力して割込みの
内容をチェックするようになっている。
み要求信号５ｌ−８ｎのいずれがが入力さｉすることに
よって、エンコーダ２９が優先順位を判定してＣＰＵ
２７に割込み信号ＩＮＴを出力し、これに対してＣＰＵ
２７が割込みチェック信号ＩＮＴＡを出力して割込みの
内容をチェックするようになっている。
それによって、割込みポート２８にＲＯＭ ２２のどの
部分ヘジャンプするかの情報を記憶させておくことによ
シ、割込み要求信号５ｌ−ＳＬｌでＲＯＭ２２のどの部
分へでも自由にアクセスできる。
部分ヘジャンプするかの情報を記憶させておくことによ
シ、割込み要求信号５ｌ−ＳＬｌでＲＯＭ２２のどの部
分へでも自由にアクセスできる。
そこで、電圧レベル検知回路２５からの主電源切断検知
信号Ｓｃを割込み要求信号としてＣＰＵ回路２１に入力
している。
信号Ｓｃを割込み要求信号としてＣＰＵ回路２１に入力
している。
−力、ＲＯＭアドレス制御回路２６は、電圧レベル検知
回路１９から主電源切断検知信号Ｓｃが人力されると、
ＲＯＭ ２２のバンクナ１のアドレスを指定できるよう
にその内容が変更される。
回路１９から主電源切断検知信号Ｓｃが人力されると、
ＲＯＭ ２２のバンクナ１のアドレスを指定できるよう
にその内容が変更される。
そして、ＣＰＵ回路２１は、電圧レベル検知回路１９か
ら主電源切断検知信号Ｓｃが入力されない間はコンピュ
ータ１１からコマンド入力ラッチ回路２０に転送されて
きたディスク制御用コマンドを、ＲＯＭ ２２のバンク
＋０に格納されたプログラムに従って処理し、その処理
結果をコマンド出力ランチ回路２４を介して制御装置１
５に転送する。
ら主電源切断検知信号Ｓｃが入力されない間はコンピュ
ータ１１からコマンド入力ラッチ回路２０に転送されて
きたディスク制御用コマンドを、ＲＯＭ ２２のバンク
＋０に格納されたプログラムに従って処理し、その処理
結果をコマンド出力ランチ回路２４を介して制御装置１
５に転送する。
また、このＣＰＵ回路２１は、電圧レベル検知回路１９
からの主電源切断検知信号Ｓｃが割込み要求信号として
入力されることによって、ＲＯＭ２２のバンクナ１の所
定のアドレスにジャンプして、バンクナ１に格納した磁
気ディスク装置１２のデータを磁気テープ装置１６に転
送するためのデータ転送コマンドを、コマンド出力ラッ
チ回路２４を介して制御装置１５に転送する。 すなわ
ち、ＣＰＵ回路２１は、データバックアップ制（財）手
段を兼ねている。
からの主電源切断検知信号Ｓｃが割込み要求信号として
入力されることによって、ＲＯＭ２２のバンクナ１の所
定のアドレスにジャンプして、バンクナ１に格納した磁
気ディスク装置１２のデータを磁気テープ装置１６に転
送するためのデータ転送コマンドを、コマンド出力ラッ
チ回路２４を介して制御装置１５に転送する。 すなわ
ち、ＣＰＵ回路２１は、データバックアップ制（財）手
段を兼ねている。
電源オフ指令回路２５は、ＣＰ、Ｕ回路２１からデータ
転送制御が終了した旨の信号を受けたときに、補助電源
装置１７を切断（オフ）する。
転送制御が終了した旨の信号を受けたときに、補助電源
装置１７を切断（オフ）する。
第２図に戻って、制御装置１５は、第５図に示すように
、磁気ディスク装置１２及び磁気テープ装置１６を制御
する制御回路６０とデータバッファ３１とからなる。
、磁気ディスク装置１２及び磁気テープ装置１６を制御
する制御回路６０とデータバッファ３１とからなる。
そして、この制御装置１５０制御回路６０は、コマンド
変換装置１４から転送されてきたコマンドに従って磁気
ディスク装置１之及び磁気テープ装置１６を制御して、
コンピュータ１１からのデータの磁気ディスク装置１２
への格納及び磁気、ディスク装置１２からの胱出し制御
を行なうと共に、磁気ディスク装置１２と磁気テープ装
置１６との間でのデータ転送を制御する。
変換装置１４から転送されてきたコマンドに従って磁気
ディスク装置１之及び磁気テープ装置１６を制御して、
コンピュータ１１からのデータの磁気ディスク装置１２
への格納及び磁気、ディスク装置１２からの胱出し制御
を行なうと共に、磁気ディスク装置１２と磁気テープ装
置１６との間でのデータ転送を制御する。
この制御回路６０は、１ブロツク毎にデータ転送を行な
い、内部のブロックカウンタによって所定量のデータの
転送が終了したか否かをチェックし、、データの転送が
終了した時点でコマンド変換装置１４のＣＰＵ回路２１
にその旨を示すステータス信号を転送する。
い、内部のブロックカウンタによって所定量のデータの
転送が終了したか否かをチェックし、、データの転送が
終了した時点でコマンド変換装置１４のＣＰＵ回路２１
にその旨を示すステータス信号を転送する。
次に、このように構成した実施例の作用について説明す
る。
る。
マス、通常の動作時においては、コンピュータ１１から
ディスク制御用コマンドがコマンド変換装置１４に人力
され、そのＣＰＵ回路２１がＲＯＭ２２のバンクナＯの
プログラムに基づいて制御装置１５にコマンドを伝達し
、それによって制御装置１５が磁気ディスク装置１２を
制御してデータの格納及び読出しを行なう。
ディスク制御用コマンドがコマンド変換装置１４に人力
され、そのＣＰＵ回路２１がＲＯＭ２２のバンクナＯの
プログラムに基づいて制御装置１５にコマンドを伝達し
、それによって制御装置１５が磁気ディスク装置１２を
制御してデータの格納及び読出しを行なう。
そして、日常業務終了時にオペレータが主電源装置１６
を切断すると、コマンド変換装置１４の電圧レベル検知
回路１９が主電源切断検知信号Ｓｃを出力する。
を切断すると、コマンド変換装置１４の電圧レベル検知
回路１９が主電源切断検知信号Ｓｃを出力する。
それによって、コマンド変換装置１４のＣＰＵ回路２１
は、ＲＯＭ２２のバンク÷１のデータ転送コマンドを制
御装置１５に伝達し、制御装置１５は磁気ディスク装置
１２のデータを磁気テープ装置１６に転送させる制御を
行なう。
は、ＲＯＭ２２のバンク÷１のデータ転送コマンドを制
御装置１５に伝達し、制御装置１５は磁気ディスク装置
１２のデータを磁気テープ装置１６に転送させる制御を
行なう。
そして、データの転送が終了すると、制御装置１５から
ＣＰＵ回路２１にデータ転送終了を７４”すステータス
信号が入力されるので、ＣＰＵ回路２１は電源オフ指令
回路２５にデータ転送終了を示す信号を出力する。
ＣＰＵ回路２１にデータ転送終了を７４”すステータス
信号が入力されるので、ＣＰＵ回路２１は電源オフ指令
回路２５にデータ転送終了を示す信号を出力する。
それによって、電源オフ指令回路２５は、補助電源装置
１７を切断し、すべての動作が終了する。
１７を切断し、すべての動作が終了する。
このように、オペレータが主電源装置１６をオフするこ
とによって、コンピュータ１１が介在することなく自動
的に磁気ディスク装置１２のデータが磁気テープ装置１
３に転送される。
とによって、コンピュータ１１が介在することなく自動
的に磁気ディスク装置１２のデータが磁気テープ装置１
３に転送される。
なお、主記憶装置及び補助記憶装置は、−］二記実施例
の記憶装置に限るものではない。
の記憶装置に限るものではない。
以上説明したように、この発明によれば、記憶装置シス
テムにおいてコンピュータ及びオペレータの介在なしに
主記憶装置のデータのバンクアンプを行なうことができ
るようになり、操作性が向上すると共にコンピュータの
負担も軽くなる。
テムにおいてコンピュータ及びオペレータの介在なしに
主記憶装置のデータのバンクアンプを行なうことができ
るようになり、操作性が向上すると共にコンピュータの
負担も軽くなる。
第１図は、従来の記憶装置システムの一例を示すブロッ
ク図、 第２図は、この発明を実施した記憶装置システムである
ディスクンステムの一例を示すブロック図、 第６図は、第２図のコマンド変換装置１４の詳細を示す
ブロック図、 第４図は、第６図のＣＰＵ回路２１の主要部を示すブロ
ック図、 第５図は、第２図の制御装置１５の詳細を示すブロック
図である。 １１・・・コンピュータ １２・・・磁気ディスク装置（主記憶装置）１６・・・
磁気テープ装置（データバンクアップ用補助記憶装置） １４・・・コマンド変換装置 １５・・・制御装置１６
・・・主電源装置 １７・・・補助電源装置１９
・・・電圧レベル検知回路（主電源切断検知手段〉 ２１・・・ＣＰＵ回路（データバッファラフ制飢手段） ２５・・・電源オフ指令回路（補助電源装置丁５段）出
願人 株式会社 リ コ −
ク図、 第２図は、この発明を実施した記憶装置システムである
ディスクンステムの一例を示すブロック図、 第６図は、第２図のコマンド変換装置１４の詳細を示す
ブロック図、 第４図は、第６図のＣＰＵ回路２１の主要部を示すブロ
ック図、 第５図は、第２図の制御装置１５の詳細を示すブロック
図である。 １１・・・コンピュータ １２・・・磁気ディスク装置（主記憶装置）１６・・・
磁気テープ装置（データバンクアップ用補助記憶装置） １４・・・コマンド変換装置 １５・・・制御装置１６
・・・主電源装置 １７・・・補助電源装置１９
・・・電圧レベル検知回路（主電源切断検知手段〉 ２１・・・ＣＰＵ回路（データバッファラフ制飢手段） ２５・・・電源オフ指令回路（補助電源装置丁５段）出
願人 株式会社 リ コ −
Claims (1)
- １ コンピュータからの各種データを格納するための主
記憶装置と、該主記憶装置のデータバックアンプ用補助
記憶装置と、前記主記憶装置及び補助記憶装置を制御す
る制御装置を備えた記憶装置システムにおいて、前記コ
ンピュータに給電する主電源装置と別個に前記主記憶装
置と補助記憶装置及び制御装置に給電する補助電源装置
を設けると共に、前記主電源装置の切断を検知する主電
源切断検知手段と１、該主電源切断検知手段の検知結果
に基づいて前記制御装置を制御して前記主記憶装置のデ
ータを補助記憶装置に転送させるデータバックアップ制
御手段と、該データバックアップ制御手段によるデータ
転送制御終了時に前記補助電源装置を切断する補助電源
切断手段とを設けたことを特徴とする記憶装置システム
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57027065A JPS58144270A (ja) | 1982-02-20 | 1982-02-20 | 記憶装置システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57027065A JPS58144270A (ja) | 1982-02-20 | 1982-02-20 | 記憶装置システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58144270A true JPS58144270A (ja) | 1983-08-27 |
Family
ID=12210666
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57027065A Pending JPS58144270A (ja) | 1982-02-20 | 1982-02-20 | 記憶装置システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58144270A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01252132A (ja) * | 1988-03-30 | 1989-10-06 | Shindengen Electric Mfg Co Ltd | 無停電電源装置 |
| GB2380596A (en) * | 2001-07-07 | 2003-04-09 | Hewlett Packard Co | Data backup using a tape drive and a non-volatile memory |
-
1982
- 1982-02-20 JP JP57027065A patent/JPS58144270A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01252132A (ja) * | 1988-03-30 | 1989-10-06 | Shindengen Electric Mfg Co Ltd | 無停電電源装置 |
| GB2380596A (en) * | 2001-07-07 | 2003-04-09 | Hewlett Packard Co | Data backup using a tape drive and a non-volatile memory |
| GB2380596B (en) * | 2001-07-07 | 2005-07-27 | Hewlett Packard Co | Data backup |
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