JPS58143405A - 時間軸圧縮伸長装置の制御回路 - Google Patents
時間軸圧縮伸長装置の制御回路Info
- Publication number
- JPS58143405A JPS58143405A JP2632182A JP2632182A JPS58143405A JP S58143405 A JPS58143405 A JP S58143405A JP 2632182 A JP2632182 A JP 2632182A JP 2632182 A JP2632182 A JP 2632182A JP S58143405 A JPS58143405 A JP S58143405A
- Authority
- JP
- Japan
- Prior art keywords
- constant
- circuit
- companding
- clock
- control circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/00007—Time or data compression or expansion
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
- Reduction Or Emphasis Of Bandwidth Of Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は楽音の同波数をリアルタイムで変換する時間軸
圧縮伸長装置の遠隔制御回路に関するものである。
圧縮伸長装置の遠隔制御回路に関するものである。
や
歌謡曲等の伴奏音楽のみを録音したテープかディスクレ
コードを再生し、手軽に伴奏付きで歌を唄おうとする、
いわゆるカラオケ(空・オーケストツの略)装置が種々
製造販売されているっ取扱いの簡便さからコンパクト・
カセットテープ、8トラツク・カートリッジテープを用
い九ものが現在は主流であろう この種のカラオケ装置において、しばしば問題となるの
は伴奏音楽の音域と利用者の声の音域が合致しない事で
あり、特に女性歌手の曲を男性が唄おうとする時、もし
くけその逆の場合に顕著である。この使用上の問題から
のがれる目的で、この種装置においては録音テープの再
生スピードの調整が可能となっている。すなわち、録音
時のテープスピードよシも、速いスピードで再生すれば
、再生音の同波数が°全体に高い方に移動し、逆に録音
時のテープスピードよシも遅く再生すれば、再生音の#
1波数が全体に低い方へ移動するという原理に基づいた
対策法であり、例えば第1図に示すように可変抵抗器V
R(13による定電圧(vc )の分電圧vdを再生ス
ピード制御電圧としてモータ制御回路(2)K与え、再
生モータ(3)のスピードを可変にしている。この方法
により再生し九場合、伴奏音楽の音の高さは確かに調節
可能となるが、録音時とけ異なったスピードで再生して
いる事から演奏時間やテンポにも変化を龜たし、問題と
なる事がある。
コードを再生し、手軽に伴奏付きで歌を唄おうとする、
いわゆるカラオケ(空・オーケストツの略)装置が種々
製造販売されているっ取扱いの簡便さからコンパクト・
カセットテープ、8トラツク・カートリッジテープを用
い九ものが現在は主流であろう この種のカラオケ装置において、しばしば問題となるの
は伴奏音楽の音域と利用者の声の音域が合致しない事で
あり、特に女性歌手の曲を男性が唄おうとする時、もし
くけその逆の場合に顕著である。この使用上の問題から
のがれる目的で、この種装置においては録音テープの再
生スピードの調整が可能となっている。すなわち、録音
時のテープスピードよシも、速いスピードで再生すれば
、再生音の同波数が°全体に高い方に移動し、逆に録音
時のテープスピードよシも遅く再生すれば、再生音の#
1波数が全体に低い方へ移動するという原理に基づいた
対策法であり、例えば第1図に示すように可変抵抗器V
R(13による定電圧(vc )の分電圧vdを再生ス
ピード制御電圧としてモータ制御回路(2)K与え、再
生モータ(3)のスピードを可変にしている。この方法
により再生し九場合、伴奏音楽の音の高さは確かに調節
可能となるが、録音時とけ異なったスピードで再生して
いる事から演奏時間やテンポにも変化を龜たし、問題と
なる事がある。
このような問題を解決する丸めに、音声信号の時間軸圧
縮伸長回路(以下、時間軸圧伸回路と言う)が用いられ
るっ時間軸圧伸回路は入力音響信号をサンプリングして
バッファメモリに書き込み、パックアメモリから読み出
す際に、書き込みクロックとは異なる同期の読み出しク
ロックを用い、入力音響信号の時間軸を変化させ、その
結果として入力音響信号のl波数を変換しようとするも
ので、再生時間やテンポに変化を与えず、而も周波数の
みを変える事ができろう 第2図に時間軸圧伸回路(4)を適用し九伴奏音楽演奏
装置の構成例を示す。次に第2図について説明する。再
生ヘッド(5)からの再生信号はイコライデアンプ(図
示せず)を含む再生アンプ(6)により増幅され、時間
軸圧伸回Ml(4)K入力されろう入力信号は入力低域
通過フィルタ())Kよって処理対象外の同波11に成
分がカットされ、A/D変換回路(8)に送られるつA
/D変換回路(8)では入力信号をサンプリングした後
、アナログ−ディジクル変換し、ディジタル信号に変換
する。ディジタル信号化された入力音響信号はRAMに
よって構成されるパックアメモリ(9)に書き込まれる
。パックアメモリ(9)から読み出されるディジクル信
号はD/A変換回路a〔を経ることでアナログ信号に変
換され、出力低域通過フィルタ住υを通り出力される。
縮伸長回路(以下、時間軸圧伸回路と言う)が用いられ
るっ時間軸圧伸回路は入力音響信号をサンプリングして
バッファメモリに書き込み、パックアメモリから読み出
す際に、書き込みクロックとは異なる同期の読み出しク
ロックを用い、入力音響信号の時間軸を変化させ、その
結果として入力音響信号のl波数を変換しようとするも
ので、再生時間やテンポに変化を与えず、而も周波数の
みを変える事ができろう 第2図に時間軸圧伸回路(4)を適用し九伴奏音楽演奏
装置の構成例を示す。次に第2図について説明する。再
生ヘッド(5)からの再生信号はイコライデアンプ(図
示せず)を含む再生アンプ(6)により増幅され、時間
軸圧伸回Ml(4)K入力されろう入力信号は入力低域
通過フィルタ())Kよって処理対象外の同波11に成
分がカットされ、A/D変換回路(8)に送られるつA
/D変換回路(8)では入力信号をサンプリングした後
、アナログ−ディジクル変換し、ディジタル信号に変換
する。ディジタル信号化された入力音響信号はRAMに
よって構成されるパックアメモリ(9)に書き込まれる
。パックアメモリ(9)から読み出されるディジクル信
号はD/A変換回路a〔を経ることでアナログ信号に変
換され、出力低域通過フィルタ住υを通り出力される。
バッファメモ1月9)へのディジタル信号の書き込みク
ロックは一定で、読み出しタロツクの方を変化させ、入
力信号の時間軸を圧伸し、−波数変換を行なうつパック
アメモリ(9)のアドレス信号及び、A/D変換回M(
8)、 D/A変換回路Qlに対する各クロック信号は
CPU(laと、このCPU(13によシ制御されるク
ロック生成回路(11とから成るクロック制御回路α4
によって作成される。定数設定回路(L!9は時間軸圧
伸回路(4)の圧伸定数を決定し、ディジタル・コード
の形で前記クロック制御回路α尋に与えるっ伴奏音楽演
奏装置に時間軸圧伸回路(4)を用いる場合、周波数の
可変範囲は1オクターグあれば充分であり、その範囲を
何等分かして段階的に同波数変換処理を行なうつその段
階に応じた圧伸定数を発生するのが定数設定回路α$で
、各段階に対応する[kのスイッチae、αη、鱈で構
成される。
ロックは一定で、読み出しタロツクの方を変化させ、入
力信号の時間軸を圧伸し、−波数変換を行なうつパック
アメモリ(9)のアドレス信号及び、A/D変換回M(
8)、 D/A変換回路Qlに対する各クロック信号は
CPU(laと、このCPU(13によシ制御されるク
ロック生成回路(11とから成るクロック制御回路α4
によって作成される。定数設定回路(L!9は時間軸圧
伸回路(4)の圧伸定数を決定し、ディジタル・コード
の形で前記クロック制御回路α尋に与えるっ伴奏音楽演
奏装置に時間軸圧伸回路(4)を用いる場合、周波数の
可変範囲は1オクターグあれば充分であり、その範囲を
何等分かして段階的に同波数変換処理を行なうつその段
階に応じた圧伸定数を発生するのが定数設定回路α$で
、各段階に対応する[kのスイッチae、αη、鱈で構
成される。
ヴオーカル・!イクα値からの音声信号は入力端子■を
経てマイクアンプシDで増幅された後、信号混合器@で
、前記出力フィルタaυの出力と混合される。信号混合
器@の出力はパワーアンプ(至)で電力増幅され、スピ
ーカ@から出力されるつ尚、時間軸圧伸回路(′4)の
詳しい動作説明は割愛するうさで、実際に伴奏音楽再生
装置を用いる場合、使用者は装置から離れた位置で歌を
唄うためキーコントロールを遠隔操作できれば、実用上
大いに利するところがある。
経てマイクアンプシDで増幅された後、信号混合器@で
、前記出力フィルタaυの出力と混合される。信号混合
器@の出力はパワーアンプ(至)で電力増幅され、スピ
ーカ@から出力されるつ尚、時間軸圧伸回路(′4)の
詳しい動作説明は割愛するうさで、実際に伴奏音楽再生
装置を用いる場合、使用者は装置から離れた位置で歌を
唄うためキーコントロールを遠隔操作できれば、実用上
大いに利するところがある。
本発明はこのキーコントロールの遠隔操作を簡単な構成
で実現する回路を提供するものである。
で実現する回路を提供するものである。
本発明による回路の具体例を第3図に示す。以下第6図
により本発明の内容を詳述する。使用者が手元に持つリ
モートスイッチ四は接続端子(至)を経て定数循環回路
(5)に接続されろう定数循環回路cat−t%前記リ
モートスイッチ(ハ)が開放の場合は、定数設定回路a
シからの圧伸定数をそのままタロツク制御回路に与、え
、前記リモートスイッチ(至)が閉成した場合は、定数
設定回路a[有]で設定された圧伸定数を起点として前
記li!1IfIL数可変範囲内で一定時間毎に各段階
を追って変化させ、前記クロック制御回路α尋に出力す
るっ定数循環回路@は第4図に示すように、最終出力と
入力を接続し九/<ラレル・イン・パラレル・アウトの
シフトレジスタ(至)と、クロック制御回路Iからのシ
フトクロックをゲートするANDゲートによるクロック
ゲート(至)と、前記定数循環回路a9のスイッチ閉成
を検知するためのANDゲートによる閉成検知回路(至
)と、閉成検知回路(至)出力をリモートスイッチ(ハ
)の開成でゲートシてシフトレジスタ(至)のデークロ
ード信号とするORゲート6υと、リモートスイッチ(
ハ)のバッファとしても動作するインバータ(至)とか
ら構成されるつりモートスイッチ(ハ)が開放の場合で
、定数設定回路α9のスイッチのどれかが閉成した場合
、開成検知回路(至)出力信号FiORグー)C(1)
を通じ、シフトレジスタ(至)のロード端子に印加され
(アクティブ、ロー)、シフトレジスタ(至)のパクレ
ル・データ入力端子に接続され九定歇設定回路aSから
の圧伸定数がシフトレジスタ(至)のパクレル出力端子
に現われ、そのままクロック制御回路Q尋に送られる。
により本発明の内容を詳述する。使用者が手元に持つリ
モートスイッチ四は接続端子(至)を経て定数循環回路
(5)に接続されろう定数循環回路cat−t%前記リ
モートスイッチ(ハ)が開放の場合は、定数設定回路a
シからの圧伸定数をそのままタロツク制御回路に与、え
、前記リモートスイッチ(至)が閉成した場合は、定数
設定回路a[有]で設定された圧伸定数を起点として前
記li!1IfIL数可変範囲内で一定時間毎に各段階
を追って変化させ、前記クロック制御回路α尋に出力す
るっ定数循環回路@は第4図に示すように、最終出力と
入力を接続し九/<ラレル・イン・パラレル・アウトの
シフトレジスタ(至)と、クロック制御回路Iからのシ
フトクロックをゲートするANDゲートによるクロック
ゲート(至)と、前記定数循環回路a9のスイッチ閉成
を検知するためのANDゲートによる閉成検知回路(至
)と、閉成検知回路(至)出力をリモートスイッチ(ハ
)の開成でゲートシてシフトレジスタ(至)のデークロ
ード信号とするORゲート6υと、リモートスイッチ(
ハ)のバッファとしても動作するインバータ(至)とか
ら構成されるつりモートスイッチ(ハ)が開放の場合で
、定数設定回路α9のスイッチのどれかが閉成した場合
、開成検知回路(至)出力信号FiORグー)C(1)
を通じ、シフトレジスタ(至)のロード端子に印加され
(アクティブ、ロー)、シフトレジスタ(至)のパクレ
ル・データ入力端子に接続され九定歇設定回路aSから
の圧伸定数がシフトレジスタ(至)のパクレル出力端子
に現われ、そのままクロック制御回路Q尋に送られる。
時間軸圧伸回路(4)(第3図)はとの圧伸定数にした
がって信号の圧伸処理を行なう。
がって信号の圧伸処理を行なう。
次に、以上の状謙からリモートスイッチ(至)が閉成さ
れた場合の動作について説明する。りそ−トスイッチ(
至)の開成によりシフトクロックはクロックゲート(ハ
)を通過してシフトレジスタ@に印加され、シフトレジ
スタ(至)の出力、すなわち圧伸定数を順次段階的にシ
フトさせる事になる。この時、シフトクロックの周期は
使用者が各段階での再生音域を確認するのに必要な長さ
にしなければならないつりモートスイッチ(至)の閉成
が続くと、シフトレジスタ(至)出力は循環する。即ち
時間軸圧伸処理は、リモートスイッチ(ハ)の開成時点
の圧伸定数を起点として、時間軸圧縮率の高くなる向き
(tたはその逆向き)に一定時間毎に推移し、圧縮率(
もしくは伸長率)AI大眼に達した次のシフトクロック
でその正反対の圧伸率に対応する処理に移行し、同様の
向きに変化し続ける。使用者は各段階で音域確認を行な
い適当な音域であることを確認し九時点でリモートスイ
ッチ(ハ)を開放にする。
れた場合の動作について説明する。りそ−トスイッチ(
至)の開成によりシフトクロックはクロックゲート(ハ
)を通過してシフトレジスタ@に印加され、シフトレジ
スタ(至)の出力、すなわち圧伸定数を順次段階的にシ
フトさせる事になる。この時、シフトクロックの周期は
使用者が各段階での再生音域を確認するのに必要な長さ
にしなければならないつりモートスイッチ(至)の閉成
が続くと、シフトレジスタ(至)出力は循環する。即ち
時間軸圧伸処理は、リモートスイッチ(ハ)の開成時点
の圧伸定数を起点として、時間軸圧縮率の高くなる向き
(tたはその逆向き)に一定時間毎に推移し、圧縮率(
もしくは伸長率)AI大眼に達した次のシフトクロック
でその正反対の圧伸率に対応する処理に移行し、同様の
向きに変化し続ける。使用者は各段階で音域確認を行な
い適当な音域であることを確認し九時点でリモートスイ
ッチ(ハ)を開放にする。
リモートスイッチ(至)の開放により圧伸定数の循環動
作は終了し、リモートスイッチ(ハ)が開放された時点
での圧伸定数にしたがった時間軸圧伸処理が行なわれる
事になる。
作は終了し、リモートスイッチ(ハ)が開放された時点
での圧伸定数にしたがった時間軸圧伸処理が行なわれる
事になる。
このように本発明の装置によれば、伴奏音演奏装置の再
生音域の遠隔操作を簡単な回路構成で実現できる。
生音域の遠隔操作を簡単な回路構成で実現できる。
第1図は再生モータ速度の可変回路の一例を示すグロッ
ク回路図、第2図は時間軸圧伸装置を用すブロック回路
図、第4図は本発明に使用する定数循環回路の具体例を
示すブロック回路図である。 (4)・・・時間軸圧縮伸長回路、a$・・・定数設定
回路、(ハ)・・・リモート・スイッチ、(財)・・・
定数循環回路。 2
ク回路図、第2図は時間軸圧伸装置を用すブロック回路
図、第4図は本発明に使用する定数循環回路の具体例を
示すブロック回路図である。 (4)・・・時間軸圧縮伸長回路、a$・・・定数設定
回路、(ハ)・・・リモート・スイッチ、(財)・・・
定数循環回路。 2
Claims (1)
- (1) 時開軸圧縮伸長地理を一定の可変範囲内で段
階的に行なうための圧伸定数を設定する定数設定手段と
、リモートスイッチと、該りそ一トスイツチの開閉によ
って制御され前記リモートスイッチが閉成され九場合閉
成の時点での前記定数設定手段からの圧伸定数を起点と
して圧伸定数を前記可変範囲内で段階的に循環させる定
数循環手段とを備えた事を特徴とする時間軸圧縮伸長装
置の遠隔制御回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2632182A JPS58143405A (ja) | 1982-02-19 | 1982-02-19 | 時間軸圧縮伸長装置の制御回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2632182A JPS58143405A (ja) | 1982-02-19 | 1982-02-19 | 時間軸圧縮伸長装置の制御回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58143405A true JPS58143405A (ja) | 1983-08-26 |
Family
ID=12190130
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2632182A Pending JPS58143405A (ja) | 1982-02-19 | 1982-02-19 | 時間軸圧縮伸長装置の制御回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58143405A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6097991A (ja) * | 1983-11-02 | 1985-05-31 | Yoshinori Kitani | 1,2−ジアミノシクロヘキサン白金(2)錯体 |
-
1982
- 1982-02-19 JP JP2632182A patent/JPS58143405A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6097991A (ja) * | 1983-11-02 | 1985-05-31 | Yoshinori Kitani | 1,2−ジアミノシクロヘキサン白金(2)錯体 |
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