JPS58140165A - 電界効果半導体装置 - Google Patents
電界効果半導体装置Info
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- JPS58140165A JPS58140165A JP2322782A JP2322782A JPS58140165A JP S58140165 A JPS58140165 A JP S58140165A JP 2322782 A JP2322782 A JP 2322782A JP 2322782 A JP2322782 A JP 2322782A JP S58140165 A JPS58140165 A JP S58140165A
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 6
- 239000000758 substrate Substances 0.000 claims abstract description 14
- 230000005684 electric field Effects 0.000 abstract description 5
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- 229920000742 Cotton Polymers 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7833—Field effect transistors with field effect produced by an insulated gate with lightly doped drain or source extension, e.g. LDD MOSFET's; DDD MOSFET's
- H01L29/7835—Field effect transistors with field effect produced by an insulated gate with lightly doped drain or source extension, e.g. LDD MOSFET's; DDD MOSFET's with asymmetrical source and drain regions, e.g. lateral high-voltage MISFETs with drain offset region, extended drain MISFETs
-
- H—ELECTRICITY
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- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/10—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode not carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/1025—Channel region of field-effect devices
- H01L29/1029—Channel region of field-effect devices of field-effect transistors
- H01L29/1033—Channel region of field-effect devices of field-effect transistors with insulated gate, e.g. characterised by the length, the width, the geometric contour or the doping structure
- H01L29/1041—Channel region of field-effect devices of field-effect transistors with insulated gate, e.g. characterised by the length, the width, the geometric contour or the doping structure with a non-uniform doping structure in the channel region surface
- H01L29/1045—Channel region of field-effect devices of field-effect transistors with insulated gate, e.g. characterised by the length, the width, the geometric contour or the doping structure with a non-uniform doping structure in the channel region surface the doping structure being parallel to the channel length, e.g. DMOS like
-
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
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- H01L29/10—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode not carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/107—Substrate region of field-effect devices
- H01L29/1075—Substrate region of field-effect devices of field-effect transistors
- H01L29/1079—Substrate region of field-effect devices of field-effect transistors with insulated gate
- H01L29/1083—Substrate region of field-effect devices of field-effect transistors with insulated gate with an inactive supplementary region, e.g. for preventing punch-through, improving capacity effect or leakage current
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明hw電界効果半導体装着特にMO3形電界効果
半導体装冒に関すみ。
半導体装冒に関すみ。
たとえばMO8形電界効果゛トランジス4 (FET’
)は従来低耐圧形として扱われてきたが、近時その制用
S囲が広まふにつれて数1(’10 V程崖の電圧の下
でも利用されみようになってきた。そのために1!;耐
圧のこの種半導体*Wが強く要求されるようになってき
てbふ。これらの要求に対応+るためIC第1図に示す
ような構成のものがすでに提案されている。
)は従来低耐圧形として扱われてきたが、近時その制用
S囲が広まふにつれて数1(’10 V程崖の電圧の下
でも利用されみようになってきた。そのために1!;耐
圧のこの種半導体*Wが強く要求されるようになってき
てbふ。これらの要求に対応+るためIC第1図に示す
ような構成のものがすでに提案されている。
同図において、lは基板、2Fiソース領域、3はドレ
イン領域、4はシリフン酸化膜かちなる絶縁膜、5けソ
ースW、極、6Fiゲート電極、ツはFレイン電極であ
る。これらの構成は通常の D型MO8−FE’l’と
同じであるが−Hz図のa1成では基板1内にあって、
ソース雷竣2を囲み、かつゲート電極6の直下にまでま
たがる。基板lと同じ導電型の領域8を設は、かつ、領
域8とドレイン領域3との間にドレイン領域と同じ導電
型でドレイン領域植よりも低濃度のド@7F層9を介在
させである。この構成によれば、ゲートIF極6にゲー
ト電圧を印加したとき領域80表面には、@[8とけ反
対の導電型のφヤンネVが形成され、これによってドレ
イン、ソース間に漬れる電流が制御され石、そして領域
8とドレイン領域3との間にけ低濃度のドリフト層9が
介在していふととによ%、FI)フト層9とII斌8と
の境面におけb耐圧が向上+ふととによって高耐圧化が
可能と′lkふのであふ。
イン領域、4はシリフン酸化膜かちなる絶縁膜、5けソ
ースW、極、6Fiゲート電極、ツはFレイン電極であ
る。これらの構成は通常の D型MO8−FE’l’と
同じであるが−Hz図のa1成では基板1内にあって、
ソース雷竣2を囲み、かつゲート電極6の直下にまでま
たがる。基板lと同じ導電型の領域8を設は、かつ、領
域8とドレイン領域3との間にドレイン領域と同じ導電
型でドレイン領域植よりも低濃度のド@7F層9を介在
させである。この構成によれば、ゲートIF極6にゲー
ト電圧を印加したとき領域80表面には、@[8とけ反
対の導電型のφヤンネVが形成され、これによってドレ
イン、ソース間に漬れる電流が制御され石、そして領域
8とドレイン領域3との間にけ低濃度のドリフト層9が
介在していふととによ%、FI)フト層9とII斌8と
の境面におけb耐圧が向上+ふととによって高耐圧化が
可能と′lkふのであふ。
しかしとのよう&aI成によみと1開門ら4明らfIh
lkX ウK V −x 、 F vイyfllFi、
領域8 Fす7ト層9によって連続していふめで、高
電圧のもとでの動作@に訃けふ耐圧社、領竣8とドリフ
ト層9との界面Kかける耐圧能力によって決定されフ、
+橙わちこの界面での耐圧がこの種トリンジスIの耐圧
の限界と1にふ。ところがこのような構成によふと前記
した界面で電界集中が生じふ。特に点Aにおいて電界が
裏か(な秒、これによって耐圧の上限が限定されてしま
うようkなる。このことは又ドリフト層9がドレイン領
域3と同じ導WtIjでしかも低濃度であるため、im
記界面における空乏層がドリフト層9内にあまり深く形
成されないようKlkす、したがって層広い空乏層がW
IS成されかいことkより、耐圧に@界が〒で(bとも
考え臥れふ。
lkX ウK V −x 、 F vイyfllFi、
領域8 Fす7ト層9によって連続していふめで、高
電圧のもとでの動作@に訃けふ耐圧社、領竣8とドリフ
ト層9との界面Kかける耐圧能力によって決定されフ、
+橙わちこの界面での耐圧がこの種トリンジスIの耐圧
の限界と1にふ。ところがこのような構成によふと前記
した界面で電界集中が生じふ。特に点Aにおいて電界が
裏か(な秒、これによって耐圧の上限が限定されてしま
うようkなる。このことは又ドリフト層9がドレイン領
域3と同じ導WtIjでしかも低濃度であるため、im
記界面における空乏層がドリフト層9内にあまり深く形
成されないようKlkす、したがって層広い空乏層がW
IS成されかいことkより、耐圧に@界が〒で(bとも
考え臥れふ。
この発明#i11;電圧下の動作によっても耐圧の向上
を8iIることを目的とすふものであり0この発明はゲ
ー)1111iの直下において、ソース領域と)171
層との閲忙しきい値の高い領域すなわち高濃度のIJI
竣と、との領域とは異なふ導電型でしきb値の低い領域
すなわち低濃度の債埴を形成中すことKよって耐圧の向
上を図ふことを特徴と−Fふ。
を8iIることを目的とすふものであり0この発明はゲ
ー)1111iの直下において、ソース領域と)171
層との閲忙しきい値の高い領域すなわち高濃度のIJI
竣と、との領域とは異なふ導電型でしきb値の低い領域
すなわち低濃度の債埴を形成中すことKよって耐圧の向
上を図ふことを特徴と−Fふ。
この発明の実施例を第2図以降の各図によって説明+ふ
、な訃第1図と同じ符号を附した部分は同−又は対応中
す部分を指す、第2図に示す構成において、領域8?ゲ
ージ電1i6の直下Kl$6成すふとともyc′、yt
<ゲート電極6の直下に基板1と連続+る領域lOを形
成させふ。ことにIII埴8は基板1の同じ導電型であ
って高濃度であるのに対して、基板lは低濃度であふか
ら、領域8はしきい値の高い領域4領域lOはしきい値
の低い領域となふ、ソース領域すとドリフト層9との闇
に両領竣8.10が位IF+J、ことに′lkふ。
、な訃第1図と同じ符号を附した部分は同−又は対応中
す部分を指す、第2図に示す構成において、領域8?ゲ
ージ電1i6の直下Kl$6成すふとともyc′、yt
<ゲート電極6の直下に基板1と連続+る領域lOを形
成させふ。ことにIII埴8は基板1の同じ導電型であ
って高濃度であるのに対して、基板lは低濃度であふか
ら、領域8はしきい値の高い領域4領域lOはしきい値
の低い領域となふ、ソース領域すとドリフト層9との闇
に両領竣8.10が位IF+J、ことに′lkふ。
上記の纜tによふと、第1図の構成のように領域8とド
リフト層9とが互!/sK接してb″&いので。
リフト層9とが互!/sK接してb″&いので。
その界面が存在しなhととKfkす、したがってその界
面のlI:Lに電界が集中しなりようになふ。すなわち
電界は領域10に分散するよう#c1に石ので°、耐圧
Fil!に向上すふ。このことは又次のようにも考えら
れふ。+なわちドリフト層9Fiとれと反対の導電型の
lI竣と接合すふのけ領域10であるから、*域1o2
ドリフト層9との接合面が界面となふが、領域1oFi
低濃度であみから、空乏層はドリフト層9.領域IQf
>両方に深く形成され為ようになり、それだけ空乏層の
幅が広くなふことにより耐圧が更に向上すると考えられ
るのであみ。
面のlI:Lに電界が集中しなりようになふ。すなわち
電界は領域10に分散するよう#c1に石ので°、耐圧
Fil!に向上すふ。このことは又次のようにも考えら
れふ。+なわちドリフト層9Fiとれと反対の導電型の
lI竣と接合すふのけ領域10であるから、*域1o2
ドリフト層9との接合面が界面となふが、領域1oFi
低濃度であみから、空乏層はドリフト層9.領域IQf
>両方に深く形成され為ようになり、それだけ空乏層の
幅が広くなふことにより耐圧が更に向上すると考えられ
るのであみ。
領域8#−i従来でdソースilr械lの全肩囲に形成
していふが、必ずし4千の必要はな(、第2図に示すよ
うにドリフト層9に向−bhい合う面及びソース領域1
の下面にわたふ節回であってもよい。又第3図に示すよ
うにドリフト層9に向かい合う面、!J(Fi第4図に
示すようにソース―塚1とドリフト層9との闇のいずれ
かの個所Klk成してもよい。
していふが、必ずし4千の必要はな(、第2図に示すよ
うにドリフト層9に向−bhい合う面及びソース領域1
の下面にわたふ節回であってもよい。又第3図に示すよ
うにドリフト層9に向かい合う面、!J(Fi第4図に
示すようにソース―塚1とドリフト層9との闇のいずれ
かの個所Klk成してもよい。
いずれにしてもゲート電1ii6の直下のしきい値電圧
をエンハンスメントW4にすればよい。
をエンハンスメントW4にすればよい。
以上の4IP実施例ではいずれもNチャンネルMO8と
して説明したが、これに@ちれる屯のではなくP4−ヤ
ンネA/MOS Kついてもこの発明は適用でき石。
して説明したが、これに@ちれる屯のではなくP4−ヤ
ンネA/MOS Kついてもこの発明は適用でき石。
以上詳述しえようにこの発明に・よればドリフト層を備
えた櫃故にシミて、その耐圧をWIlc向上させふとと
ができふ効果が得ちれふ。
えた櫃故にシミて、その耐圧をWIlc向上させふとと
ができふ効果が得ちれふ。
第1vIJ#i従来例の断面図、第2図はこの発明の実
施例を飛す断面図、第3図、菖4図は別の実施例を示す
断面図であふ。 l−基板、2・・・・・・ソース領域、 3−・ドレイ
ン領械、6−・ゲート電極、8−・−・高濃度の領域。
施例を飛す断面図、第3図、菖4図は別の実施例を示す
断面図であふ。 l−基板、2・・・・・・ソース領域、 3−・ドレイ
ン領械、6−・ゲート電極、8−・−・高濃度の領域。
Claims (1)
- 一導電型の基板に、前記基板とけ異なる導電型のソース
領域並びにドレイン領域を、又前記ドレイン領域に連々
って前記ドレイン領域と同じ導電型で低濃度のドリフト
層を、PKゲート1F極の直下に位着し、#紀ソース領
域に並んで前記基板と同じ導電型で窩濃廣の領域をそれ
ぞれ有し、この領域と前記ドリフト層との間にあってか
つ前記ゲ−)t[の直下に付着するように、itr記基
板基板じ導電型で低濃度の領域を設けてなる電界効果半
導体装着。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2322782A JPS58140165A (ja) | 1982-02-15 | 1982-02-15 | 電界効果半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2322782A JPS58140165A (ja) | 1982-02-15 | 1982-02-15 | 電界効果半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58140165A true JPS58140165A (ja) | 1983-08-19 |
Family
ID=12104738
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2322782A Pending JPS58140165A (ja) | 1982-02-15 | 1982-02-15 | 電界効果半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58140165A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4665418A (en) * | 1983-01-10 | 1987-05-12 | Tokyo Shibaura Denki Kabushiki Kaisha | Semiconductor memory device |
US5374843A (en) * | 1991-05-06 | 1994-12-20 | Silinconix, Inc. | Lightly-doped drain MOSFET with improved breakdown characteristics |
US5386136A (en) * | 1991-05-06 | 1995-01-31 | Siliconix Incorporated | Lightly-doped drain MOSFET with improved breakdown characteristics |
WO1997013277A1 (de) * | 1995-10-02 | 1997-04-10 | El Mos Elektronik In Mos-Technologie Gmbh | Mos-transistor mit hoher ausgangsspannungsfestigkeit |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS4937582A (ja) * | 1972-08-07 | 1974-04-08 |
-
1982
- 1982-02-15 JP JP2322782A patent/JPS58140165A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS4937582A (ja) * | 1972-08-07 | 1974-04-08 |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
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US5514608A (en) * | 1991-05-06 | 1996-05-07 | Siliconix Incorporated | Method of making lightly-doped drain DMOS with improved breakdown characteristics |
WO1997013277A1 (de) * | 1995-10-02 | 1997-04-10 | El Mos Elektronik In Mos-Technologie Gmbh | Mos-transistor mit hoher ausgangsspannungsfestigkeit |
US6153916A (en) * | 1995-10-02 | 2000-11-28 | El Mos Elektronik In Mos-Technologie Gmbh | MOS transistor with high output voltage endurance |
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