JPS58124681A - 半導体装置 - Google Patents
半導体装置Info
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- JPS58124681A JPS58124681A JP57006335A JP633582A JPS58124681A JP S58124681 A JPS58124681 A JP S58124681A JP 57006335 A JP57006335 A JP 57006335A JP 633582 A JP633582 A JP 633582A JP S58124681 A JPS58124681 A JP S58124681A
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- power supply
- power
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- H04N1/40031—Circuits exciting or modulating particular heads for reproducing continuous tone value scales for a plurality of reproducing elements simultaneously
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Electronic Switches (AREA)
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- Accessory Devices And Overall Control Thereof (AREA)
- Semiconductor Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（１）０発明の技術分野
本発明は半導体装置、特にサーマルプリンタ内部回路へ
の通電をその必要な期間のみ生じさせるようにした半導
体装置に関する。
の通電をその必要な期間のみ生じさせるようにした半導
体装置に関する。
（２）９発明の背景
半導体装置に用いられる内部回路には、絶えず給電を要
するものと必要なときのみ給電を行えば十分なものとが
める。このような半導体装置において、その全体に給電
する給電スイッチ回路を設けた場合、上記前者の範躊に
属する内部回路の要求には応えられるが、上記後者の範
＠ｔｐｃ属する内部回路には必要以上の給電を続けると
とに１ｋＦ）、消費電力の節減上、又放熱対策上野まし
くないので、その改善が要求されている。
するものと必要なときのみ給電を行えば十分なものとが
める。このような半導体装置において、その全体に給電
する給電スイッチ回路を設けた場合、上記前者の範躊に
属する内部回路の要求には応えられるが、上記後者の範
＠ｔｐｃ属する内部回路には必要以上の給電を続けると
とに１ｋＦ）、消費電力の節減上、又放熱対策上野まし
くないので、その改善が要求されている。
（３）、従来技術と問題点
例えば、ファクシミリ等で用いられているサーマルプリ
ンタにおいては、サーマルヘッド駆動制御用集積回路に
よりサーマルヘッドへ通電してその印字が終了した後、
次の行の印字のため紙送りを行っては次行の印字を遂行
していくように構成されている。このような紙送りの期
間中上記集積回路への通電は本来不要のものである。そ
して、このような期間は上記集積回路へ通電する期間の
約７倍にも及ぶ、従って、上記集積回路での消費電力が
嵩むばかシでなく、その放熱対策にも注意を払わねばな
らない。
ンタにおいては、サーマルヘッド駆動制御用集積回路に
よりサーマルヘッドへ通電してその印字が終了した後、
次の行の印字のため紙送りを行っては次行の印字を遂行
していくように構成されている。このような紙送りの期
間中上記集積回路への通電は本来不要のものである。そ
して、このような期間は上記集積回路へ通電する期間の
約７倍にも及ぶ、従って、上記集積回路での消費電力が
嵩むばかシでなく、その放熱対策にも注意を払わねばな
らない。
（他 発明の目的
本発明は上述の従来装置の有する欠点ＫＩ！みて創案さ
れたもので、その目的は非使用状態にある内部回路への
給電を遮断じて消費電力の節減等を図った半導体装置を
提供することＫるる。
れたもので、その目的は非使用状態にある内部回路への
給電を遮断じて消費電力の節減等を図った半導体装置を
提供することＫるる。
（〜０発明の構成
そして、この目的は、各々、使用状態と非使用状態とが
切換えられて使用される少なくとも１つの回路を有する
半導体装置において、上記回路の使用状態と非使用状態
とを制御する回路の非使用状態制御信号に応答して、上
記回路と電源との間に介設された給電スイッチ回路をオ
フさせることによって達成される。
切換えられて使用される少なくとも１つの回路を有する
半導体装置において、上記回路の使用状態と非使用状態
とを制御する回路の非使用状態制御信号に応答して、上
記回路と電源との間に介設された給電スイッチ回路をオ
フさせることによって達成される。
（６）１発明の実施例
以下、添付図面を参照しながら、本発明の詳細な説明す
る。
る。
第１図は本発明の実施例装置を示す。この装置は常時使
用状態に置かれる第１の回路ｌと、各々、使用状態と非
使用状態とを有する第２の回路２とを含み（これら両回
路はチップ３に形成されている）、第１の回路１へは電
源回路４が直接に電源端子５と線５を通して接続され、
第２の回路２と電源回路４との間に給電スイッチ回路６
が介設され、回路６は制御回路７によって制御されるよ
うにして構成されている。このように構成される装置例
はサーマルプリンタであり、以下これについて説明する
。この例において、１ｓ２の回路（内部回路）２は行列
状に配設されたフリップフロップ回路８から成る。これ
らフリップフロップ回路８には、対応する第１の回路（
周辺回路）１の入力バッファ９の出力が接続されると共
に、第１の回路１を構成するクロック回路１Ｇのクロッ
ク出力がそのクロック入力へ接続されている。また、フ
リップフリ２ブ回路８の出力は、対応する出力駆動回路
１１の入力へ接続され、該駆動回路１１の出力は対応す
るサーマルヘッド（図示せず）へ接続されている。駆動
回路１１も又第１の回路ｌの構成要素である。
用状態に置かれる第１の回路ｌと、各々、使用状態と非
使用状態とを有する第２の回路２とを含み（これら両回
路はチップ３に形成されている）、第１の回路１へは電
源回路４が直接に電源端子５と線５を通して接続され、
第２の回路２と電源回路４との間に給電スイッチ回路６
が介設され、回路６は制御回路７によって制御されるよ
うにして構成されている。このように構成される装置例
はサーマルプリンタであり、以下これについて説明する
。この例において、１ｓ２の回路（内部回路）２は行列
状に配設されたフリップフロップ回路８から成る。これ
らフリップフロップ回路８には、対応する第１の回路（
周辺回路）１の入力バッファ９の出力が接続されると共
に、第１の回路１を構成するクロック回路１Ｇのクロッ
ク出力がそのクロック入力へ接続されている。また、フ
リップフリ２ブ回路８の出力は、対応する出力駆動回路
１１の入力へ接続され、該駆動回路１１の出力は対応す
るサーマルヘッド（図示せず）へ接続されている。駆動
回路１１も又第１の回路ｌの構成要素である。
各フリップフロップ回路への給電制御を行う給電スイッ
チ回路６は第１の回路ｌ内４Ｃ６り第２ｒｌＡＫ示すよ
うに１制御回路７の出力へベースが接続されたＰＮＰ形
トランジスタ１２と、制御回路７の出力とトランジスタ
１２の出力とに対応するダイオード１３．１４を経てペ
ースが接続されたＮＰＮ形トランジスタ１５と、該トラ
ンジスタ１５の出力にベースが接続されたＮＰＮ形トラ
ンジスタ１６と、該トランジスタ１６の出力へ接続され
たダーリントン接続のＮＰＮ形トランジスタ１７゜１８
とから主に構成され、１９．２０はダイオードであり、
２１． ２２． ２３． ２４． ２５は抵抗でるる。
チ回路６は第１の回路ｌ内４Ｃ６り第２ｒｌＡＫ示すよ
うに１制御回路７の出力へベースが接続されたＰＮＰ形
トランジスタ１２と、制御回路７の出力とトランジスタ
１２の出力とに対応するダイオード１３．１４を経てペ
ースが接続されたＮＰＮ形トランジスタ１５と、該トラ
ンジスタ１５の出力にベースが接続されたＮＰＮ形トラ
ンジスタ１６と、該トランジスタ１６の出力へ接続され
たダーリントン接続のＮＰＮ形トランジスタ１７゜１８
とから主に構成され、１９．２０はダイオードであり、
２１． ２２． ２３． ２４． ２５は抵抗でるる。
トランジスタ１８の出力２６が給電スイッチ回路６の出
力である。この出力２６は第３図に示す第２の回路２で
ろるＩＩＬ回路の電源ＶＤの端子２６′に接続されてい
る。
力である。この出力２６は第３図に示す第２の回路２で
ろるＩＩＬ回路の電源ＶＤの端子２６′に接続されてい
る。
次に、上述構成の本発明装置の動作について説明する。
サーマルプリンタが印字動作つまり使用状態になると、
その旨を表わす使用状態制御信号が制御回路７から発生
されて、給電スイッチ回路６を次のようにオンに転じて
第２の回路（内部回路）２に電源回路４の電圧ＶＣＣか
ら以下に述べる値だけ差引いた電圧値を給電する。即ち
、制御回路７がら出力される低レベルの使用状態制御信
号が第２図に示すトランジスタ１２のペースに供給され
ると、トランジスタ１２がオンとなり、これに伴ってト
ランジスタ１５．１６もオフになる。従って、ダーリン
トン接続のトランジスタ１７゜１８はオンに転じてその
出力には’ｘｖｃｃ −２ＶＢＥ （ＶＢＥはトラン
ジスタ１７．１８のペース−エミッタ電圧降下）が現わ
れて第２の回路２へ給電される。このような給電スイッ
チ回路６のオフからオンへの切換りは、それが論理回路
から構成されているので、静電容量効果が効いて立上り
の遅い主電源のオアーオン切換えよりも非常に速くオフ
−オン切換えを行いうる。従って、回路動作に支障を来
たすことはない。又、回路中に誘発されるノイズも小さ
く、回路動作上好都合である。
その旨を表わす使用状態制御信号が制御回路７から発生
されて、給電スイッチ回路６を次のようにオンに転じて
第２の回路（内部回路）２に電源回路４の電圧ＶＣＣか
ら以下に述べる値だけ差引いた電圧値を給電する。即ち
、制御回路７がら出力される低レベルの使用状態制御信
号が第２図に示すトランジスタ１２のペースに供給され
ると、トランジスタ１２がオンとなり、これに伴ってト
ランジスタ１５．１６もオフになる。従って、ダーリン
トン接続のトランジスタ１７゜１８はオンに転じてその
出力には’ｘｖｃｃ −２ＶＢＥ （ＶＢＥはトラン
ジスタ１７．１８のペース−エミッタ電圧降下）が現わ
れて第２の回路２へ給電される。このような給電スイッ
チ回路６のオフからオンへの切換りは、それが論理回路
から構成されているので、静電容量効果が効いて立上り
の遅い主電源のオアーオン切換えよりも非常に速くオフ
−オン切換えを行いうる。従って、回路動作に支障を来
たすことはない。又、回路中に誘発されるノイズも小さ
く、回路動作上好都合である。
上述のような給電が行われると同時に、公知の態様で印
字データが入力バッファ９にセットされ、そしてクロッ
ク回路１０のクロックの制御の下にフリップフロップ回
路８にセットされて、そのセットされたデータに従って
出力駆動回路１１が動作され、それによシサーマルヘッ
ドに所定の印字動作を生じさせる。
字データが入力バッファ９にセットされ、そしてクロッ
ク回路１０のクロックの制御の下にフリップフロップ回
路８にセットされて、そのセットされたデータに従って
出力駆動回路１１が動作され、それによシサーマルヘッ
ドに所定の印字動作を生じさせる。
この印字動作が終了すると、次の印字行をサーマルヘッ
ドの下に持ち来たすべく紙送り動作が生ぜしめられる。
ドの下に持ち来たすべく紙送り動作が生ぜしめられる。
この動作に入ると、制御回路７からは高レベルの非使用
状態制御信号が発生されるから、これに応答する給電ス
イッチ回路６はオフする。即ち、第２図のトランジスタ
１２はオフし、トランジスタ１５．１６はオンし、ダー
リントン接続のトランジスタ１７．１８はオフするので
、第２の回路２を構成する各フリップフロップ回路へは
給電されない。
状態制御信号が発生されるから、これに応答する給電ス
イッチ回路６はオフする。即ち、第２図のトランジスタ
１２はオフし、トランジスタ１５．１６はオンし、ダー
リントン接続のトランジスタ１７．１８はオフするので
、第２の回路２を構成する各フリップフロップ回路へは
給電されない。
このような給電停止は上述の紙送り期間（該期間は印字
期間の約７倍でるる）中、続行する。従って、第２の回
路における節電は大幅に向上する。これは放熱量の低減
をもたらすから、放熱上にも有利性が得られる。このよ
うな効果はその回路の、消費電力が太きければ大きいほ
ど大きい。
期間の約７倍でるる）中、続行する。従って、第２の回
路における節電は大幅に向上する。これは放熱量の低減
をもたらすから、放熱上にも有利性が得られる。このよ
うな効果はその回路の、消費電力が太きければ大きいほ
ど大きい。
一方、入力バッファ９や出力駆動回路１】は外部回路に
接続されているため、それらの回路への給電を止めると
、その時のノイズにより出力駆動回路１１の出力に不所
望のデータが出力されたり、また、給電が行われないこ
とにより、入力バッファ９に接続される外部の回路に悪
影響を与えたりするため、それらの回路９，１１に対し
てはひき続いて給電が行われる。また、これらの回路９
．１１は第２の回路２に比べて消費電流は非常に小さい
ため給電しつづけてもさほど問題にはならない。
接続されているため、それらの回路への給電を止めると
、その時のノイズにより出力駆動回路１１の出力に不所
望のデータが出力されたり、また、給電が行われないこ
とにより、入力バッファ９に接続される外部の回路に悪
影響を与えたりするため、それらの回路９，１１に対し
てはひき続いて給電が行われる。また、これらの回路９
．１１は第２の回路２に比べて消費電流は非常に小さい
ため給電しつづけてもさほど問題にはならない。
そして、上述のような紙送りが終了すると、又動作説明
の最初で説明した印字動作に入るか、印字した印字行が
最終行でろれは、サーマルプリンタの動作は停止する。
の最初で説明した印字動作に入るか、印字した印字行が
最終行でろれは、サーマルプリンタの動作は停止する。
上述の実施例においては、ファクシミリ等のサーマルプ
リンタの駆動用集積回路について説明したが、装置構成
の中に給電停止を行いうる回路部分を有するものであれ
ば、その部分に本発明を適用しうるちのである。
リンタの駆動用集積回路について説明したが、装置構成
の中に給電停止を行いうる回路部分を有するものであれ
ば、その部分に本発明を適用しうるちのである。
（７）１発明の効果
以上の説明から明らかなように、本発明によれば、
（１） 消費電力を節減出来、
（２） この効果により放熱上に有利性が得られる外
、 （３）その効果を回路動作に悪影響を生ぜしめることな
く享受出来る等である。
、 （３）その効果を回路動作に悪影響を生ぜしめることな
く享受出来る等である。
第１図は本発明の一実施例を示す図、第２図は本発明の
一実施例の給電スイッチ回路を示す図、第３図は第１図
の第２の回路例を示す回路図である。 図中、１は第１の回路、２は第２の回路、４は電源回路
、６は給電回路、７は制御回路である。 特許 出 願人 富士通株式会社
一実施例の給電スイッチ回路を示す図、第３図は第１図
の第２の回路例を示す回路図である。 図中、１は第１の回路、２は第２の回路、４は電源回路
、６は給電回路、７は制御回路である。 特許 出 願人 富士通株式会社
Claims (2)
- （１） 半導体基板内に各々、使用状態と非使用状態
とを有する少なくとも１つの回路を含む半導体装置にお
いて、外部より電源電圧が供給される該装置の電源端子
と前記回路の電源端子の間に給電スイッチ回路を設け、
前記回路の使用及び非使用の状態に応答して対応する回
路へ給電す・る給電スイッチ回路をオン又はオフさせる
ように構成したことを特徴とする半導体装置。 - （２） 前記第１の回路は外部に直接接続される入力
バッファ及び出力駆動回路と給電スイッチ回路で、前記
第２の回路は他の内部回路であることを特徴とする特許
請求の範囲第１項記載の半導体装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP633582A JPH0613223B2 (ja) | 1982-01-19 | 1982-01-19 | プリンタの駆動制御装置 |
| US06/458,849 US4447704A (en) | 1982-01-19 | 1983-01-18 | Semiconductor device for driving thermal print heads |
| DE8383300225T DE3381039D1 (de) | 1982-01-19 | 1983-01-18 | Halbleitervorrichtung, z.b. zum steuern eines thermischen druckkopfs. |
| EP83300225A EP0088487B1 (en) | 1982-01-19 | 1983-01-18 | Semiconductor device, e.g. for controlling a thermal printing head |
| IE100/83A IE55455B1 (en) | 1982-01-19 | 1983-01-19 | Semiconductor device,e.g.for controlling a thermal printing head |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP633582A JPH0613223B2 (ja) | 1982-01-19 | 1982-01-19 | プリンタの駆動制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58124681A true JPS58124681A (ja) | 1983-07-25 |
| JPH0613223B2 JPH0613223B2 (ja) | 1994-02-23 |
Family
ID=11635489
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP633582A Expired - Lifetime JPH0613223B2 (ja) | 1982-01-19 | 1982-01-19 | プリンタの駆動制御装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4447704A (ja) |
| EP (1) | EP0088487B1 (ja) |
| JP (1) | JPH0613223B2 (ja) |
| DE (1) | DE3381039D1 (ja) |
| IE (1) | IE55455B1 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58199176A (ja) * | 1982-05-17 | 1983-11-19 | Nippon Telegr & Teleph Corp <Ntt> | サ−マルヘツドにおける蓄熱温度の抑圧方法 |
| JPS60107380A (ja) * | 1983-11-17 | 1985-06-12 | Brother Ind Ltd | プリンタ |
Families Citing this family (2)
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| US5473755A (en) * | 1992-06-01 | 1995-12-05 | Intel Corporation | System for controlling data stream by changing fall through FIFO last cell state of first component whenever data read out of second component last latch |
| GB2416539A (en) | 2004-07-24 | 2006-02-01 | Reckitt Benckiser | Liquid cleaning composition, catalyst therefor and methods of cleaning |
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| JPS55150082A (en) * | 1979-05-11 | 1980-11-21 | Matsushita Electric Ind Co Ltd | Terminal printer equipment |
| JPS5677175U (ja) * | 1979-11-20 | 1981-06-23 |
Family Cites Families (10)
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| IT939920B (it) * | 1971-10-04 | 1973-02-10 | Olivetti & Co Spa | Unita di stampa termografica |
| US4070587A (en) * | 1975-02-14 | 1978-01-24 | Canon Kabushiki Kaisha | Energizing control system for an intermittently energized device |
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| JPS54114927A (en) * | 1978-02-28 | 1979-09-07 | Fujitsu Ltd | Current consumption reduction system for memory unit |
| JPS5570987A (en) * | 1978-11-24 | 1980-05-28 | Hitachi Ltd | Semiconductor integrated circuit device |
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| JPS56109769A (en) * | 1980-02-06 | 1981-08-31 | Ricoh Co Ltd | Heat sensitive recorder |
| US4376942A (en) * | 1980-12-01 | 1983-03-15 | Cubic Western Data | Thermal printing system |
-
1982
- 1982-01-19 JP JP633582A patent/JPH0613223B2/ja not_active Expired - Lifetime
-
1983
- 1983-01-18 DE DE8383300225T patent/DE3381039D1/de not_active Expired - Fee Related
- 1983-01-18 US US06/458,849 patent/US4447704A/en not_active Expired - Lifetime
- 1983-01-18 EP EP83300225A patent/EP0088487B1/en not_active Expired
- 1983-01-19 IE IE100/83A patent/IE55455B1/en not_active IP Right Cessation
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| JPS60107380A (ja) * | 1983-11-17 | 1985-06-12 | Brother Ind Ltd | プリンタ |
Also Published As
| Publication number | Publication date |
|---|---|
| DE3381039D1 (de) | 1990-02-01 |
| EP0088487B1 (en) | 1989-12-27 |
| US4447704A (en) | 1984-05-08 |
| JPH0613223B2 (ja) | 1994-02-23 |
| EP0088487A3 (en) | 1986-10-29 |
| IE55455B1 (en) | 1990-09-26 |
| IE830100L (en) | 1983-07-19 |
| EP0088487A2 (en) | 1983-09-14 |
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