JPS5812068A - 電子式キヤツシユレジスタの群管理システム - Google Patents
電子式キヤツシユレジスタの群管理システムInfo
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- JPS5812068A JPS5812068A JP56111144A JP11114481A JPS5812068A JP S5812068 A JPS5812068 A JP S5812068A JP 56111144 A JP56111144 A JP 56111144A JP 11114481 A JP11114481 A JP 11114481A JP S5812068 A JPS5812068 A JP S5812068A
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- G06—COMPUTING; CALCULATING OR COUNTING
- G06Q—INFORMATION AND COMMUNICATION TECHNOLOGY [ICT] SPECIALLY ADAPTED FOR ADMINISTRATIVE, COMMERCIAL, FINANCIAL, MANAGERIAL OR SUPERVISORY PURPOSES; SYSTEMS OR METHODS SPECIALLY ADAPTED FOR ADMINISTRATIVE, COMMERCIAL, FINANCIAL, MANAGERIAL OR SUPERVISORY PURPOSES, NOT OTHERWISE PROVIDED FOR
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- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Cash Registers Or Receiving Machines (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は電子式キャッシュレジスタの群管理システム
に関し、特に部門コードまたは商品コードの入力に基づ
いて登録処理する電子式キャッシュレジスタを群管理す
るシステムに関する。
に関し、特に部門コードまたは商品コードの入力に基づ
いて登録処理する電子式キャッシュレジスタを群管理す
るシステムに関する。
最近、登録操作の容易化および登録処理の迅速化を図る
目的で、販売商品の単品ごとに商品コード（または単品
コード）を定めて詔き、商品コードを入力することによ
って単価などを登録処理するような、いわゆるプライス
ルックアップ（以下ＦＬＵと略称する）登録方式の電子
式キャッシュレジスタ（以下ΣＣＲ）が実用されている
。ところで、従来知られているデＬυ登録方式のｉｉ：
ｃｉシステムは、複数のＥＣＲを１つの中央処理装置に
共通的に接続し、中央処理装置にＦＬＵ登鎌のためのＦ
ＬＵコード別の単価データを記憶するＰＬＵファイル奢
よびＦＬＵコード別の合計額を記憶する記憶領域を含む
メモリを備え、各ＥＣＲと中央処理装置との間でデータ
伝送しながら登録処環を行なうものである。ところが、
このようなシステムは、中央処理装置に接続されるＫＣ
Ｒの台数が多い場合に、］ＩＣＲ別に伝送ラインを設け
ると、中央処理装置がＥＣＲとの間でデータ伝送するた
めの回線の管理にロスを生じやすいという問題点があっ
た。また、ＩＲＣラインなどの１回線で複数のｘｃｉｔ
を制御する場合は、１回線に接続できるＥＣＲの台数が
データ伝送速度上制約を受けるので１台数が限られると
いう問題点があった。
目的で、販売商品の単品ごとに商品コード（または単品
コード）を定めて詔き、商品コードを入力することによ
って単価などを登録処理するような、いわゆるプライス
ルックアップ（以下ＦＬＵと略称する）登録方式の電子
式キャッシュレジスタ（以下ΣＣＲ）が実用されている
。ところで、従来知られているデＬυ登録方式のｉｉ：
ｃｉシステムは、複数のＥＣＲを１つの中央処理装置に
共通的に接続し、中央処理装置にＦＬＵ登鎌のためのＦ
ＬＵコード別の単価データを記憶するＰＬＵファイル奢
よびＦＬＵコード別の合計額を記憶する記憶領域を含む
メモリを備え、各ＥＣＲと中央処理装置との間でデータ
伝送しながら登録処環を行なうものである。ところが、
このようなシステムは、中央処理装置に接続されるＫＣ
Ｒの台数が多い場合に、］ＩＣＲ別に伝送ラインを設け
ると、中央処理装置がＥＣＲとの間でデータ伝送するた
めの回線の管理にロスを生じやすいという問題点があっ
た。また、ＩＲＣラインなどの１回線で複数のｘｃｉｔ
を制御する場合は、１回線に接続できるＥＣＲの台数が
データ伝送速度上制約を受けるので１台数が限られると
いう問題点があった。
また、このシステムは、ＥＣＲから中央処理装置に割込
処理要求をかけるのが単価登録のたびに発生するので、
他のＥＣＩＬが使用できなくなる。これを解消しようと
思えば、中央処理装置と各ＥＣｋ間ごとに回線を設けれ
ばよい。ところが、中央処理装置と各ＥＣＩごとに回線
を設ければ、中央処理装置のメモリの６育時間の問題が
生じる。
処理要求をかけるのが単価登録のたびに発生するので、
他のＥＣＩＬが使用できなくなる。これを解消しようと
思えば、中央処理装置と各ＥＣｋ間ごとに回線を設けれ
ばよい。ところが、中央処理装置と各ＥＣＩごとに回線
を設ければ、中央処理装置のメモリの６育時間の問題が
生じる。
そこで、他のデＬＵ管理システムとしては、各ＫＣＩＬ
ととＫ Ｐ Ｌ Ｕコード別の単価情報および合計額を
記憶するメモリを設けることが考えられる。
ととＫ Ｐ Ｌ Ｕコード別の単価情報および合計額を
記憶するメモリを設けることが考えられる。
ところが、ｉ’ＬＵ登録のためのメモリを各ＥＣＲごと
に設けるのは、１’ＬＵコードの数が極めて多いので、
各ＫＣＲに備えるメモリの容量の増大を来し、極めて高
価となる問題点を含む。
に設けるのは、１’ＬＵコードの数が極めて多いので、
各ＫＣＲに備えるメモリの容量の増大を来し、極めて高
価となる問題点を含む。
このような問題点は、商品別にＰＬＵコードの決められ
たものを登録処理するＦＬＵ登録システムのみならず、
商品の分類すなわち部門コード別に登録処理する方式に
おいても同様屹生じる。
たものを登録処理するＦＬＵ登録システムのみならず、
商品の分類すなわち部門コード別に登録処理する方式に
おいても同様屹生じる。
ンや高速の中央処理装置を用いることなく、部門コード
またはＦＬＵコードの入力によって登録処理でき、各Ｅ
ＣＲを安価にできるような、ＥＣＩＬの群管理システム
を提供することである。
またはＦＬＵコードの入力によって登録処理でき、各Ｅ
ＣＲを安価にできるような、ＥＣＩＬの群管理システム
を提供することである。
この発明は、要約すれば、中央処理装置から各ＥＣＲに
対して行なう割込処理と各ＥＣＲから中央処理装置にか
ける割込処理の頻度ｔよび速度の違いに応じて、その機
能を分担するための中間外部記憶装置を設ける。この中
間外部記憶装置は。
対して行なう割込処理と各ＥＣＲから中央処理装置にか
ける割込処理の頻度ｔよび速度の違いに応じて、その機
能を分担するための中間外部記憶装置を設ける。この中
間外部記憶装置は。
ＦＬＵ登録のためのメモリファイルを内蔵するとともに
、登録処理データを中央処理装置へ一括して伝送制御す
る機能を含む。
、登録処理データを中央処理装置へ一括して伝送制御す
る機能を含む。
次に１図面を参照してこの発明の具体的な実施例につい
て説明する。
て説明する。
第１図はこの発明の一実施例のＥＣＲの群管理システム
のブロック図である。
のブロック図である。
この実施例ては、相対的に多い数（Ｍ）のＥＣ１が相対
的に少ない数（たとえばＮ）ごとにグループ化され、各
グループごとに中間外部記憶装置１０が設けられる。そ
して、各中間外部記憶装置１０が中央処理装置２０と接
続される。なお、図示では、説明の簡略化のために、１
つのグループのＥＣＲとそのグループに対応する中間外
部記憶装置１０と中央処理装置２０・との関係を示す。
的に少ない数（たとえばＮ）ごとにグループ化され、各
グループごとに中間外部記憶装置１０が設けられる。そ
して、各中間外部記憶装置１０が中央処理装置２０と接
続される。なお、図示では、説明の簡略化のために、１
つのグループのＥＣＲとそのグループに対応する中間外
部記憶装置１０と中央処理装置２０・との関係を示す。
より具体的には、中間外部記憶装置１０は、演算処理手
段の一例のＣＰＵＩＩを含む。ＣＰ Ｕｌｌには、パス
ライン１２を介してリードオンリメモリ１３（以下ＲＯ
Ｍ）１３およびランダムアクセスメモリ（以下ＲＡＭ）
ｌ ４が接続される。ＲＯＭ１３は、各ＥＣＲＩ−Ｎお
よび中央処理装置冗とのデータ伝送制御のためのプログ
ラムを設定記憶する伝送制御プログラム記憶領域１３１
およびＥＣＲまたは中央処理装置からの指令（コマンド
）または命令に基づいて処理するためのコマンド処理プ
ログラムを記憶する記憶領域１３２を含む。
段の一例のＣＰＵＩＩを含む。ＣＰ Ｕｌｌには、パス
ライン１２を介してリードオンリメモリ１３（以下ＲＯ
Ｍ）１３およびランダムアクセスメモリ（以下ＲＡＭ）
ｌ ４が接続される。ＲＯＭ１３は、各ＥＣＲＩ−Ｎお
よび中央処理装置冗とのデータ伝送制御のためのプログ
ラムを設定記憶する伝送制御プログラム記憶領域１３１
およびＥＣＲまたは中央処理装置からの指令（コマンド
）または命令に基づいて処理するためのコマンド処理プ
ログラムを記憶する記憶領域１３２を含む。
ＲＡＭ１４はＦＬＵ登録処理に必要なデータを記憶する
メモリファイルであって、その詳細を後述の第３図に示
す。
メモリファイルであって、その詳細を後述の第３図に示
す。
また、ＣＰＵ１１には、受信バッファ１５０゜１５１〜
１５Ｎｔｄよび送信バッファ１６０ 、１６１〜１６Ｎ
が接続される。受信バッファ１５０および送信バッファ
１６０は、中央処理装置２０との間でデータ伝送を行な
う場合の受信データまたは送信データを一時記憶するも
のである。受信バッファ１５０および送信バッファ１６
０には、中央処理装置２０との間でデータ伝送を行なう
ための伝送制御回路１７０が接続される。伝送制御回路
１７０には伝送ラインを介して中央処理装置２０が接続
される。受信バッファ１５１〜１５Ｎ＃よび送信バッフ
ァ１６１〜１６Ｎは対応するＥＣＲ１〜Ｎとデータを受
信または送信する際に一時記憶するものであって、バッ
フアメそりまたはシＷの記憶領域が用いられる。受信バ
ッファ１５１および送信バッファ１６１には、伝送制御
回路１７１を介して対応するΣＣＲＩが接続される。同
様にして、受信バッファ１５２ｔｄよび１６２．〜１５
Ｎおよび１６Ｎには、伝送制御回路１７２〜１７Ｎを介
して対応するＫＣＲ２〜Ｎが接続される。
１５Ｎｔｄよび送信バッファ１６０ 、１６１〜１６Ｎ
が接続される。受信バッファ１５０および送信バッファ
１６０は、中央処理装置２０との間でデータ伝送を行な
う場合の受信データまたは送信データを一時記憶するも
のである。受信バッファ１５０および送信バッファ１６
０には、中央処理装置２０との間でデータ伝送を行なう
ための伝送制御回路１７０が接続される。伝送制御回路
１７０には伝送ラインを介して中央処理装置２０が接続
される。受信バッファ１５１〜１５Ｎ＃よび送信バッフ
ァ１６１〜１６Ｎは対応するＥＣＲ１〜Ｎとデータを受
信または送信する際に一時記憶するものであって、バッ
フアメそりまたはシＷの記憶領域が用いられる。受信バ
ッファ１５１および送信バッファ１６１には、伝送制御
回路１７１を介して対応するΣＣＲＩが接続される。同
様にして、受信バッファ１５２ｔｄよび１６２．〜１５
Ｎおよび１６Ｎには、伝送制御回路１７２〜１７Ｎを介
して対応するＫＣＲ２〜Ｎが接続される。
第２図は前記ＲＡＭ１４の記憶領域を図解的に示した図
である。ＩＬＡＭ１４は、キーコードまたはＦＬＵコー
ド別に単価を記憶する単価データ記憶領域１４１％ＦＬ
Ｕコード別の売上高を記憶する売上高データ記憶領域１
４２、およびＦＬＵコード別の部門（または商品の属性
もしくは種類など）を記憶する部門データ記憶領域１４
３を含む。
である。ＩＬＡＭ１４は、キーコードまたはＦＬＵコー
ド別に単価を記憶する単価データ記憶領域１４１％ＦＬ
Ｕコード別の売上高を記憶する売上高データ記憶領域１
４２、およびＦＬＵコード別の部門（または商品の属性
もしくは種類など）を記憶する部門データ記憶領域１４
３を含む。
このＦＬＵコード別の単価データは、中央処理装置２０
から一括的に設定記憶される。売上額は。
から一括的に設定記憶される。売上額は。
中間外部記憶装置１０に接続されたＩＣ１１〜Ｎからの
登録のあるごとに、記憶領域１４２の対応するデＬυコ
ード別に累計記憶される。
登録のあるごとに、記憶領域１４２の対応するデＬυコ
ード別に累計記憶される。
なお、ユーザ【よっては、商品ごとにＦＬＵコードを決
めるのに替えて、商品の種類によって同じ単価が決めら
れている場合に１部門コードの登録によって単価を読出
しかつその単価を記憶領域１４２に累計記憶させるよう
に使用する場合がある。その場合は、Ｉ’ＬＵコードに
替えて１部門コード別に単価データが設定記憶される。
めるのに替えて、商品の種類によって同じ単価が決めら
れている場合に１部門コードの登録によって単価を読出
しかつその単価を記憶領域１４２に累計記憶させるよう
に使用する場合がある。その場合は、Ｉ’ＬＵコードに
替えて１部門コード別に単価データが設定記憶される。
第３図はこの発明の詳細な説明するための中央処理装置
２０と中間外部記憶装置１０とある１台のＩＥｃＲとの
間でデータ伝送またはデータＪ６１１される状態をそれ
ぞれの記憶領域と゛の関係で図解的に示した図である。
２０と中間外部記憶装置１０とある１台のＩＥｃＲとの
間でデータ伝送またはデータＪ６１１される状態をそれ
ぞれの記憶領域と゛の関係で図解的に示した図である。
前記中央処理装置２０は、基本となるＦＬＵコード別の
単価データ等を記憶する２、基本ＦＬＵファイル２１、
集計データを記憶するレポートデータ記憶用メモリ２２
およびアドレスレジスタ（図示せず）を含む。この中央
処理装置２０と中間外部記憶装置１０との間では、デＬ
Ｕコード別の単価データの登録処理およびＲＡＭ１４に
記憶されているＰＬυコード別の売上額データの収集処
理が行なわれる。中間外部記憶装置１０と各ＩＣ１ｌ〜
Ｎとの間では、単品登録処理が行なわれる。
単価データ等を記憶する２、基本ＦＬＵファイル２１、
集計データを記憶するレポートデータ記憶用メモリ２２
およびアドレスレジスタ（図示せず）を含む。この中央
処理装置２０と中間外部記憶装置１０との間では、デＬ
Ｕコード別の単価データの登録処理およびＲＡＭ１４に
記憶されているＰＬυコード別の売上額データの収集処
理が行なわれる。中間外部記憶装置１０と各ＩＣ１ｌ〜
Ｎとの間では、単品登録処理が行なわれる。
以下に、中央処理装置２０と外部記憶装置間１０および
中間外部記憶装置１０とＥＣＩＩ〜Ｎ間における具体的
な動作を説明する。
中間外部記憶装置１０とＥＣＩＩ〜Ｎ間における具体的
な動作を説明する。
１１１４図は中央処理装置２０から中間外部記憶装置１
０へＰＬυコードとその単価情報を設定する場合の動作
を示すフローチャートである。
０へＰＬυコードとその単価情報を設定する場合の動作
を示すフローチャートである。
中央処理装置２０で設定されているＦＬＵコード別の単
価データを中間外部記憶装置１０のＲＡＭ１４へ設定記
憶させる場合は、次のどと（行なわれる。すなわち、中
央処理装置２Ｇは、ステップｌにおいてプリセットキー
が押圧されたか否か。
価データを中間外部記憶装置１０のＲＡＭ１４へ設定記
憶させる場合は、次のどと（行なわれる。すなわち、中
央処理装置２Ｇは、ステップｌにおいてプリセットキー
が押圧されたか否か。
換言すれば基本ＦＬＵファイル２１に予め設定記憶して
いるＰＬυコード別の単価データを伝送開始指令するス
イッチが操作されたか否かを判断している。そして、伝
送開始指令されると、ステップ２に詔いて、中央処理装
置２０は中央処理装置２０内のメモリのルコード分のア
ドレスを指定するためのアドレスデータＡＤＲＸおよび
中間外部記憶装置１０に含まれるＲＡＭ１４のルコード
分のアドレスを指定するためのアドレスデータＡＤＲＹ
をそれぞれ先頭番地（たとえば０番地）に設定する。続
いて、中央処理装置２０は、アドレスデータＡＤＲＸで
指定される内部メモリ（この場合は基本ＦＬＵファイル
２１）の内容を続出して伝送制御回路１７０に伝送し、
中間外部記憶装置１０のＲＡＭ１４Ｒ−書込指令する。
いるＰＬυコード別の単価データを伝送開始指令するス
イッチが操作されたか否かを判断している。そして、伝
送開始指令されると、ステップ２に詔いて、中央処理装
置２０は中央処理装置２０内のメモリのルコード分のア
ドレスを指定するためのアドレスデータＡＤＲＸおよび
中間外部記憶装置１０に含まれるＲＡＭ１４のルコード
分のアドレスを指定するためのアドレスデータＡＤＲＹ
をそれぞれ先頭番地（たとえば０番地）に設定する。続
いて、中央処理装置２０は、アドレスデータＡＤＲＸで
指定される内部メモリ（この場合は基本ＦＬＵファイル
２１）の内容を続出して伝送制御回路１７０に伝送し、
中間外部記憶装置１０のＲＡＭ１４Ｒ−書込指令する。
これに応じて、中間外部記憶装置１０のＣＰＵ１１は、
ステップ４に奢いて受信したデータをアドレスデータＡ
ＤＲＹで指定されるＲＡＭ１４に書込制御する。その後
、ＣＰＵＩ １は書込完了フラグを送信バッファ１６０
を介して伝送制御回路１７０に与え、中央処理装置２０
へ伝送させる。
ステップ４に奢いて受信したデータをアドレスデータＡ
ＤＲＹで指定されるＲＡＭ１４に書込制御する。その後
、ＣＰＵＩ １は書込完了フラグを送信バッファ１６０
を介して伝送制御回路１７０に与え、中央処理装置２０
へ伝送させる。
中央処理装置２０は、ステップ６において、書込完了フ
ラグを受信する。続いて、ステップ７において、中央処
理装置２０はアドレスデータＡＤＲＸに１回に伝送され
るデータ量りを加算して次に読出ｔべき内部メモリのア
ドレスを歩進させる。
ラグを受信する。続いて、ステップ７において、中央処
理装置２０はアドレスデータＡＤＲＸに１回に伝送され
るデータ量りを加算して次に読出ｔべき内部メモリのア
ドレスを歩進させる。
また、中央処理装置２０は、アドレスデータＡＤＲＹに
１回に送るデータ量りを加算して、次に中間外部記憶装
置１４に書込むべきアドレスを求め。
１回に送るデータ量りを加算して、次に中間外部記憶装
置１４に書込むべきアドレスを求め。
アドレスレジスタにロードさせる。続いて、ステップ８
において、中央処理装置２０は中間外部記憶装置１０に
伝送すべきデータすなわちＦＬＵコード別の単価データ
の呼出しがすべて完了したか否かを判断する。完了して
いなければ、前述のステップ３へもどり、ステップ３な
いし８の動作が繰返される。一方、中央処理装置２０が
基本ＰＬＵファイル２１に記憶されているデータを中間
外部記憶装置１０へ伝送終了すると、ステップ８におい
てプリセットデータの伝送終了したことが判断されステ
ップ９へ進む、ステップ９において、プリセットデータ
の伝送終了を表わすメツセージ情報を印字記録した後、
前述のステップ１へもどる。
において、中央処理装置２０は中間外部記憶装置１０に
伝送すべきデータすなわちＦＬＵコード別の単価データ
の呼出しがすべて完了したか否かを判断する。完了して
いなければ、前述のステップ３へもどり、ステップ３な
いし８の動作が繰返される。一方、中央処理装置２０が
基本ＰＬＵファイル２１に記憶されているデータを中間
外部記憶装置１０へ伝送終了すると、ステップ８におい
てプリセットデータの伝送終了したことが判断されステ
ップ９へ進む、ステップ９において、プリセットデータ
の伝送終了を表わすメツセージ情報を印字記録した後、
前述のステップ１へもどる。
このような第４図に示す動作は、すべての中間外部記憶
装置（図示せず）との間で順次行なわれる。
装置（図示せず）との間で順次行なわれる。
第５図はＦＬＵ登録処理の場合におけるＥＣＲと中間外
部記憶装置の動作を説明するためのフローチャートであ
る。図において、ある五〇Ｒ（たとえばＥＣＩＩ）は、
ステップ１０において、常れかのキー人力のあったこと
を判断すると、ステップ１１へ進む。ステップ１１にお
いて％ＥＣＲ１がキー人力データすなわちキーコードを
伝送ラインを介して中間外部記憶装置１ｏに含まれる伝
送制御回路１７１に伝送する。
部記憶装置の動作を説明するためのフローチャートであ
る。図において、ある五〇Ｒ（たとえばＥＣＩＩ）は、
ステップ１０において、常れかのキー人力のあったこと
を判断すると、ステップ１１へ進む。ステップ１１にお
いて％ＥＣＲ１がキー人力データすなわちキーコードを
伝送ラインを介して中間外部記憶装置１ｏに含まれる伝
送制御回路１７１に伝送する。
これに応じて、ｃｐｕｌｌはＥＣＲ１から伝送されたキ
ーコードに対応するＦＬＵコードを検索し、当該ＦＬＵ
コードの単価データを読出す。続いて％ＣＰＵ１１は続
出したＦＬＵコードに対応する単価データを送信バッフ
ァ１６０に与えて記憶させる。これによって、読出され
たＰＬＵコードが伝送制御回路１７１によってＥＣＲ１
に伝送される。
ーコードに対応するＦＬＵコードを検索し、当該ＦＬＵ
コードの単価データを読出す。続いて％ＣＰＵ１１は続
出したＦＬＵコードに対応する単価データを送信バッフ
ァ１６０に与えて記憶させる。これによって、読出され
たＰＬＵコードが伝送制御回路１７１によってＥＣＲ１
に伝送される。
これに応じて、ＥＣＲ１はステップ１４において中間外
部記憶装置１０から伝送されたＦＬＵコードに対応する
単価データを受信する。続いて、ＥＣＲ１は伝送された
ＰＬＵコードに対応する単価データに売上個数を乗算し
て売上額を演算する。
部記憶装置１０から伝送されたＦＬＵコードに対応する
単価データを受信する。続いて、ＥＣＲ１は伝送された
ＰＬＵコードに対応する単価データに売上個数を乗算し
て売上額を演算する。
続いて、ステップ１６において、ＥＣＲＩはステップ１
５で求めた売上額を中間外部記憶装置１０へ伝送する。
５で求めた売上額を中間外部記憶装置１０へ伝送する。
これに応じて、中間外部記憶装置１０のＣＰＵ１１は、
ＦＬＵコードに対応する記憶領域１４２の内容にＥＣＲ
から伝送された売上高を加算して売上高を累積的に記憶
させる。続いて、ｃＰｕｌｌは書込完了フラグをＥＣＲ
１に伝送する。ＥＣＲ１は中間外部記憶装置１０から伝
送された書込完了フラグを受信し、ステップ１０へもど
る。
ＦＬＵコードに対応する記憶領域１４２の内容にＥＣＲ
から伝送された売上高を加算して売上高を累積的に記憶
させる。続いて、ｃＰｕｌｌは書込完了フラグをＥＣＲ
１に伝送する。ＥＣＲ１は中間外部記憶装置１０から伝
送された書込完了フラグを受信し、ステップ１０へもど
る。
このような第５図に示すＦＬＵ登録処理のための動作は
、中間外部記憶装置１０に共通的に接続された各ＫＣ＊
でＦＬＵコードの入力を行なうごとに順次行なわれる。
、中間外部記憶装置１０に共通的に接続された各ＫＣ＊
でＦＬＵコードの入力を行なうごとに順次行なわれる。
第６図は中央処理装置２０と外部記憶装置１０との間て
行なわれるデータ収集処理動作すなわちレポート動作の
フローチャートである。たとえば。
行なわれるデータ収集処理動作すなわちレポート動作の
フローチャートである。たとえば。
中央処理装置２０が中間外部記憶装置１０のＲＡＭ１４
（記憶されているＰＬＵコード別の売上額を集計する場
合は、集計すべき中間外部記憶装置１０を指定しかつそ
の部門を指定する。なお、ＦＬＵコード別に一括して収
集する場合は、部門の指定が不要となる。このとき、中
央処理装置１０は。
（記憶されているＰＬＵコード別の売上額を集計する場
合は、集計すべき中間外部記憶装置１０を指定しかつそ
の部門を指定する。なお、ＦＬＵコード別に一括して収
集する場合は、部門の指定が不要となる。このとき、中
央処理装置１０は。
ステップ２０において部門キーの入力があったか否かを
常時判断している。そして、部門キーが操作されたこと
を判断すると、ステップ２１において検索すべき先頭番
地（たとえば０番地）をアドレスレジスタにロードさせ
る。続いて、中央処理装置２０は、アドレスレジスタに
ストアされているアドレスデータ人ＤＲ３および先に入
力された部門データを中間外部記憶装置１０へ伝送する
。
常時判断している。そして、部門キーが操作されたこと
を判断すると、ステップ２１において検索すべき先頭番
地（たとえば０番地）をアドレスレジスタにロードさせ
る。続いて、中央処理装置２０は、アドレスレジスタに
ストアされているアドレスデータ人ＤＲ３および先に入
力された部門データを中間外部記憶装置１０へ伝送する
。
これに応じて、ＣＰＵＩＩは、ステップ２３（おいてア
ドレスデータＡＤＲ５で指定されるキーフードのＦＬＵ
コードを検索し、検索すべきＦＬＵコードが見つかると
ステップ２４へ進む。ステップ２４において、ＣＰＵＩ
ｌは検索すべきＦＬＵコードのアドレスデータ（ＡＤ
Ｒ）と当該ＰＬＵコードの売上額を中央処理装置２０へ
伝送する。これ（応じて、中央処理装置２０は中間外部
記憶装置１０からデータ伝送終了したか否かを判断する
。
ドレスデータＡＤＲ５で指定されるキーフードのＦＬＵ
コードを検索し、検索すべきＦＬＵコードが見つかると
ステップ２４へ進む。ステップ２４において、ＣＰＵＩ
ｌは検索すべきＦＬＵコードのアドレスデータ（ＡＤ
Ｒ）と当該ＰＬＵコードの売上額を中央処理装置２０へ
伝送する。これ（応じて、中央処理装置２０は中間外部
記憶装置１０からデータ伝送終了したか否かを判断する
。
終了していなければ、ステップ２６に＄いて、中間外部
記憶装置１０から伝送されたＰＬυコード別の売上額を
読込み、ステップ２７において部門別に集計記憶する。
記憶装置１０から伝送されたＰＬυコード別の売上額を
読込み、ステップ２７において部門別に集計記憶する。
中央処理装置２０はステップ２８ｉＣおいて検索すべき
先頭アドレスデータＡＤＲ３に１つのＩ’Ｌυコードの
データ量りを加算して次に検索すべきアドレスデータを
求めた後ステップ２２へ進む。そして、前述のステップ
２２ないしステップ２８の動作が繰返される。
先頭アドレスデータＡＤＲ３に１つのＩ’Ｌυコードの
データ量りを加算して次に検索すべきアドレスデータを
求めた後ステップ２２へ進む。そして、前述のステップ
２２ないしステップ２８の動作が繰返される。
そして、中央処理装置２０が中間外部記憶装置１０に含
まれるｉＬＡＭ１４のすべてのＦＬＵコード別のデータ
を収集したことを判断すると、ステップ２９Ｉへ踵む、
ステップ２ｇＩにおいて、中央処理装置２０は１つの中
間外部記憶装置１０から収集したＦＬＵコード別の売上
額を集計印字する。
まれるｉＬＡＭ１４のすべてのＦＬＵコード別のデータ
を収集したことを判断すると、ステップ２９Ｉへ踵む、
ステップ２ｇＩにおいて、中央処理装置２０は１つの中
間外部記憶装置１０から収集したＦＬＵコード別の売上
額を集計印字する。
このようにして、集計動作が終了する。
以上のように、この発明によれば、中央処理装置と複数
のＫＣＲとの間に中間外部記憶装置を設け、中間外部記
憶装置にＦＬＵ登録処理のためのファイルを設け１通常
のＦＬＵ登録処理では中間外部記憶装置とＥＣＵとの間
てデータ伝送を行なぃ、ＦＬＵコードの設定またはデー
タ収集を中間外部記憶装置と中央処理装置との間で行な
っているので、動作別の割込頻度怠よび速度の違いによ
ってその機能を分担することがＴ！き、従来システムに
比べてデータ伝送効率を向上でき、ＰＬυ登録のための
メモリの占有時間を短縮できる利点がある。
のＫＣＲとの間に中間外部記憶装置を設け、中間外部記
憶装置にＦＬＵ登録処理のためのファイルを設け１通常
のＦＬＵ登録処理では中間外部記憶装置とＥＣＵとの間
てデータ伝送を行なぃ、ＦＬＵコードの設定またはデー
タ収集を中間外部記憶装置と中央処理装置との間で行な
っているので、動作別の割込頻度怠よび速度の違いによ
ってその機能を分担することがＴ！き、従来システムに
比べてデータ伝送効率を向上でき、ＰＬυ登録のための
メモリの占有時間を短縮できる利点がある。
以上のように、この発明によれば、ＥＣ１Ｌの台数が多
い場合であってもＰＬυ登録処理または部門コードに基
づく登録処理を迅速かつ効率的に行なうことができ、し
かも各ＫＣＲを安価に製作できるなどの特有の効果が奏
される。
い場合であってもＰＬυ登録処理または部門コードに基
づく登録処理を迅速かつ効率的に行なうことができ、し
かも各ＫＣＲを安価に製作できるなどの特有の効果が奏
される。
第１図はこの発明の一実施例のブロック図である。第２
図は中間外部記憶装置１０に含まれる１ＡＭ１４の記憶
領域を図解的に示した図である。 第３図はこの実施例の動作状態を図解的に示した図であ
る。第４図ないし第６図はこの発明の詳細な説明するた
めのフローチャートである。 図において、１〜Ｎはｘｃ＊、１６は中間外部記憶装置
、１１は演算手段の一例のＣＰＵ、１４はＲＡＭ、２０
は中央処理装置を示す。 特許出願人 立石電機株式会社 代理人 弁理士 深 見 久 部 第 ５ 記 ′％ 乙 記
図は中間外部記憶装置１０に含まれる１ＡＭ１４の記憶
領域を図解的に示した図である。 第３図はこの実施例の動作状態を図解的に示した図であ
る。第４図ないし第６図はこの発明の詳細な説明するた
めのフローチャートである。 図において、１〜Ｎはｘｃ＊、１６は中間外部記憶装置
、１１は演算手段の一例のＣＰＵ、１４はＲＡＭ、２０
は中央処理装置を示す。 特許出願人 立石電機株式会社 代理人 弁理士 深 見 久 部 第 ５ 記 ′％ 乙 記
Claims (1)
- 【特許請求の範囲】 複数台の電子式キャッシュレジスタをグループ化しかつ
各グループごとに電子式キャッシュレジスタを制御する
中間外部記憶装置、詔よび前記各中間外部記憶装置を共
通的に制御する中央処理装置を備えた電子式キャッシュ
レジスタの群管理システムにおいて、 前記中間外部記憶装置は。 少なくとも１部門コード別の単価データを記憶する部門
別単価データ記憶領域と、部門別の売上額を記憶する売
上額データ記憶領域とを含むメモリ、ならびに 前記電子式キャッシュレジスタの操作に応じて、前記部
門別単価データに基づいて登録処理し、前記中央処理装
置からの指令に応じて前記メモリの内容を中央処理装置
へ伝送制御する演算手段を備える。電子式キャッシュレ
ジスタの群管理システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56111144A JPS5812068A (ja) | 1981-07-14 | 1981-07-14 | 電子式キヤツシユレジスタの群管理システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56111144A JPS5812068A (ja) | 1981-07-14 | 1981-07-14 | 電子式キヤツシユレジスタの群管理システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5812068A true JPS5812068A (ja) | 1983-01-24 |
Family
ID=14553565
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56111144A Pending JPS5812068A (ja) | 1981-07-14 | 1981-07-14 | 電子式キヤツシユレジスタの群管理システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5812068A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61156471A (ja) * | 1984-12-28 | 1986-07-16 | Fujitsu Ltd | 集計フアイル集計制御方式 |
| JPS61156470A (ja) * | 1984-12-28 | 1986-07-16 | Fujitsu Ltd | データ処理装置 |
| JPS61281924A (ja) * | 1985-06-07 | 1986-12-12 | Ishida Scales Mfg Co Ltd | 計量値付システム |
| JPS62126493A (ja) * | 1985-11-27 | 1987-06-08 | オムロン株式会社 | Ｐｌｕ管理装置 |
| JPS63316296A (ja) * | 1987-06-19 | 1988-12-23 | 三洋電機株式会社 | 販売時点情報管理システム |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS49131656A (ja) * | 1973-04-21 | 1974-12-17 | ||
| JPS5450230A (en) * | 1977-09-28 | 1979-04-20 | Hitachi Ltd | Terminal system |
-
1981
- 1981-07-14 JP JP56111144A patent/JPS5812068A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS49131656A (ja) * | 1973-04-21 | 1974-12-17 | ||
| JPS5450230A (en) * | 1977-09-28 | 1979-04-20 | Hitachi Ltd | Terminal system |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61156471A (ja) * | 1984-12-28 | 1986-07-16 | Fujitsu Ltd | 集計フアイル集計制御方式 |
| JPS61156470A (ja) * | 1984-12-28 | 1986-07-16 | Fujitsu Ltd | データ処理装置 |
| JPH0223896B2 (ja) * | 1984-12-28 | 1990-05-25 | Fujitsu Ltd | |
| JPH0310999B2 (ja) * | 1984-12-28 | 1991-02-14 | Fujitsu Ltd | |
| JPS61281924A (ja) * | 1985-06-07 | 1986-12-12 | Ishida Scales Mfg Co Ltd | 計量値付システム |
| JPS62126493A (ja) * | 1985-11-27 | 1987-06-08 | オムロン株式会社 | Ｐｌｕ管理装置 |
| JPS63316296A (ja) * | 1987-06-19 | 1988-12-23 | 三洋電機株式会社 | 販売時点情報管理システム |
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