JPH11353874A5 - - Google Patents
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- JPH11353874A5 JPH11353874A5 JP1998157684A JP15768498A JPH11353874A5 JP H11353874 A5 JPH11353874 A5 JP H11353874A5 JP 1998157684 A JP1998157684 A JP 1998157684A JP 15768498 A JP15768498 A JP 15768498A JP H11353874 A5 JPH11353874 A5 JP H11353874A5
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Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15768498A JP3939858B2 (ja) | 1998-06-05 | 1998-06-05 | 同期型dramのアクセス方法、インタフェース回路、及び、半導体集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15768498A JP3939858B2 (ja) | 1998-06-05 | 1998-06-05 | 同期型dramのアクセス方法、インタフェース回路、及び、半導体集積回路装置 |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JPH11353874A JPH11353874A (ja) | 1999-12-24 |
| JPH11353874A5 true JPH11353874A5 (enExample) | 2005-02-24 |
| JP3939858B2 JP3939858B2 (ja) | 2007-07-04 |
Family
ID=15655137
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15768498A Expired - Fee Related JP3939858B2 (ja) | 1998-06-05 | 1998-06-05 | 同期型dramのアクセス方法、インタフェース回路、及び、半導体集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3939858B2 (enExample) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4524439B2 (ja) * | 2000-03-30 | 2010-08-18 | ラウンド ロック リサーチ、エルエルシー | ゼロレイテンシ機能、ゼロバスターンアラウンド機能を有するシンクロナスフラッシュメモリ |
| JP2002244920A (ja) * | 2001-02-15 | 2002-08-30 | Oki Electric Ind Co Ltd | Dramインターフェース回路 |
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| CN113383317B (zh) * | 2019-01-31 | 2023-07-18 | 华为技术有限公司 | 一种处理装置、方法及相关设备 |
-
1998
- 1998-06-05 JP JP15768498A patent/JP3939858B2/ja not_active Expired - Fee Related
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