JPH10276075A - 電圧駆動形半導体素子の駆動回路 - Google Patents
電圧駆動形半導体素子の駆動回路Info
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- JPH10276075A JPH10276075A JP10031067A JP3106798A JPH10276075A JP H10276075 A JPH10276075 A JP H10276075A JP 10031067 A JP10031067 A JP 10031067A JP 3106798 A JP3106798 A JP 3106798A JP H10276075 A JPH10276075 A JP H10276075A
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Abstract
絡事故時などに、過電流しゃ断時の飛躍電圧を抑制する
とともに、素子の消費エネルギーを低減して過電流から
素子を確実に保護できる。 【解決手段】 少なくとも信号絶縁用フォトカプラ5と
相補的に動作する1対の出力トランジスタ9,10を構成
要素とする駆動部と、トランジスタ14、ツェナーダイオ
ード13、ダイオード15、及び抵抗17によりなるもので、
駆動信号がある場合に電圧駆動形半導体素子の入力側主
端子の電圧を監視し、この電圧が所定の値を越えたこと
を検出する検出手段と、抵抗18とコンデンサ20からな
り、前記検出手段が動作している間、時間の経過に伴
い、電圧を徐々に降下させる可変電圧源とからなり、前
記可変電圧源と出力トランジスタ9,10 のベース端子間
にこのベース端子側がアノードとなるようにダイオード
21を接続する。
Description
MOSFETなどの電圧駆動形半導体素子の駆動回路に
関し、特に、インバータなどの電力変換装置において、
短絡事故などによって生じる過電流から、これらの素子
を保護する過電流保護機能を有する駆動回路に関する。
の過電流故障の中で、素子破壊につながる故障として負
荷短絡や地絡がある。電圧駆動形半導体素子としてIG
BTを例にとり、電力変換装置における短絡事故時の模
擬回路と、素子の電圧、電流波形を図3、図4に示す。
路電圧が印加された状態で短絡電流が流れる。図中1は
直流電源、3は配線インダクタンスを示す。
(高耐圧の素子では10倍程度) にも達する。従って、短
絡期間中に素子に印加される瞬時電力は極めて大きく、
短絡検知後、所定の時間(10 μsec 程度) 内にゲートを
オフすることにより過電流をしゃ断する必要がある。
図5に示す。4は主スイッチング素子としてのIGB
T、5は信号絶縁用フォトカプラ、6および7はそれぞ
れオンゲート電圧印加用電圧源とオフゲート電圧印加用
電圧源であり、これら電圧源6,7には、フォトカプラ
5によりトランジスタ8を介して与えられる信号により
該フォトカプラ5と相補的に動作する1対のトランジス
タ9,10が接続されている。これら出力段トランジスタ
9,10のエミッタ同士は抵抗11を介してIGBT4のベ
ースに、また電圧源6,7の接続中点はIGBT4のエ
ミッタに接続されて駆動部が構成される。
ド13、ダイオード15、及び抵抗17により、IGBT4の
コレクタ端子の電圧を監視し、かつこの電圧が所定の値
を越えたことを検出する過電流検知部が構成される。さ
らに、この過電流検知部の前段にはコンデンサ16により
遅延回路が形成される。
ラ5がオンすると、トランジスタ8がオフし、この結
果、トランジスタ9がオン、トランジスタ10がオフとな
って、IGBT4のゲート・エミッタ間には抵抗11を介
してオンゲート電圧V1 が印加される。
から、抵抗12、ツェナーダイオード13を介してトランジ
スタ14にベース電流が流れようとするが、抵抗17を設け
ることによってトランジスタ14が動作するタイミングを
遅らせている。IGBT4のゲート・エミッタ間にオン
ゲート電圧が与えられると、このIGBT4はオンしそ
のコレクタ・エミッタ間電圧はオン電圧(VCE(ON)とす
る) まで低下する。従って、 VZD1 +VBE >V2 +VCE(ON)+VF VZD1 :ツェナーダイオード13のしきい電圧 VBE :トランジスタ14のベース・エミッタ間電圧 VF :ダイオード15の順方向電圧 となるように部品を選定して置くことにより、IGBT
4のオン状態ではトランジスタ14をオフに保っている。
ランジスタ8がオンし、これにより、トランジスタ9が
オフ、トランジスタ10がオンとなって、IGBT4のゲ
ート・エミッタ間には抵抗11を介してオフゲート電圧が
印加されIGBT4はオフとなる。このとき、トランジ
スタ8のオンによりコンデンサ16の電荷を放電してター
ンオン動作に備えている。
故が発生した場合には、コレクタ・エミッタ間電圧の増
大に伴い、 VZD1 +VBE <V2 +VCE(ON)+VF となり、トランジスタ14が導通し、IGBT4のゲート
・エミッタ間にオフゲート電圧を印加してIGBT4を
オフし、過電流をしゃ断する。
駆動回路の過電流保護動作では、トランジスタ14の導通
と同時にIGBT4のゲートにはオフゲート電圧が印加
されることから過電流をしゃ断する際の電流の減少率
(−di/dt)が大きく、このため、IGBT4には
配線のインダクタンスに誘起した電圧(ls・di/d
t)と直流回路電圧の和の電圧である過大な電圧が加わ
る危険性がある。
があることから、過電流の検知に時間遅れを生じ、短絡
発生から過電流のしゃ断までの間に素子で消費されるエ
ネルギーが必要以上に大きくなるという問題があった。
し、過電流しゃ断時の飛躍電圧を抑制するとともに、素
子の消費エネルギーを低減して過電流から素子を確実に
保護できる電圧駆動形半導体素子の駆動回路を提供する
ことにある。
するため、少なくとも信号絶縁用フォトカプラと相補的
に動作する1対の出力トランジスタを構成要素とする駆
動部と、駆動信号がある場合に電圧駆動形半導体素子の
入力側主端子の電圧を監視し、この電圧が所定の値を越
えたことを検出する検出手段と、この検出手段が動作し
ている間、時間の経過に伴い、電圧を徐々に降下させる
可変電圧源とからなり、前記可変電圧源と出力トランジ
スタのベース端子間にこのベース端子側がアノードとな
るようにダイオードを接続したこと、及びこれに加え
て、前記検出手段が、電圧駆動形半導体素子の入力側主
端子の電圧が所定の値を越えたことを検出した時に導通
するトランジスタのコレクタ端子と、信号絶縁用フォト
カプラのコレクタ端子とをトランジスタ側に順方向なダ
イオードを介して接続することを要旨とするものであ
る。
流検知後、半導体素子のゲート・エミッタ間電圧は時間
の経過と共に徐々に減少する。半導体素子に流れる短絡
電流ICPの値は、図6に示すようにゲート・エミッタ間
に印加される電圧VGEに依存することから、ゲート・エ
ミッタ間電圧の減少に対応して短絡電流も減少する。従
って、過電流をしゃ断する際の−di/dtを小さな値
に抑制できる。また、ゲート・エミッタ間電圧が素子の
しきい電圧より大きければ、半導体素子は導通状態とな
ることから、過電流検知部のトランジスタの導通後、ゲ
ート・エミッタ間電圧がしきい電圧に等しくなるまでの
時間を半導体素子のターンオン時間以上に設定しておく
ことにより、従来回路に必要であった遅延回路は不要と
なり、従って、過電流発生時にも遅れなく保護動作が可
能となり、素子が消費するエネルギーを低減できる。
作用に加えて、過電流検知部が動作している間は、オフ
信号が信号絶縁用フォトカプラに入力されても、ゲート
・オフ動作をさせずに可変電圧源の動作を優先して行う
ので、過電流保護動作が継続して行われることになる。
の形態を詳細に説明する。図1は本発明の電圧駆動形半
導体素子の駆動回路の第1実施形態を示す回路図で、前
記従来例を示す図5と同一構成要素には同一参照符号を
付したものである。
GBT4に対し、信号絶縁用フォトカプラ5と、このフ
ォトカプラ5に対しトランジスタ8を介して相補的に動
作する1対のトランジスタ9,10及びこれに直列接続す
るオンゲート電圧印加用電圧源6、オフゲート電圧印加
用電圧源7と、抵抗11とで駆動部が形成される点は前記
従来例と同じである。
ツェナーダイオード13、抵抗17及びトランジスタ14から
なり、IGBT4のコレクタ端子側の電圧を監視し、こ
の電圧が所定の値を越えたことを検出する過電流検知部
を、前記駆動部の出力段トランジスタ9 ,10のベースに
接続された抵抗18とコンデンサ20での可変電源からなる
電圧制限回路に接続した。
に接続され、また、このコンデンサ20と抵抗19との接続
中点はダイオード21を介して出力段トランジスタ9,10
のベースに接続され、その場合のダイオード21はトラン
ジスタ9,10側がアノードとなる。
スタ23のベースが接続され、このトランジスタ23のコレ
クタは、前記過電流検知部のツェナーダイオード13とダ
イオード15の接続中点及び、抵抗22を介して正側端子に
接続され、エミッタは負側端子に接続されることにより
IGBT4のオン期間を検知し、これを過電流検知部に
伝える回路を構成した。
20は最初抵抗19を介して電圧源6,7により充電され、
コンデンサ20の両端電圧はV1 +V2 となる。コンデン
サ20の正側端子とトランジスタ9,10のベースとの間に
は、図示のように、ダイオード21がこのベース端子側が
アノードとなるように接続されていることから、通常の
動作にはほとんど影響を及ぼさない。
ランジスタ14が導通する。これに伴い、コンデンサ20の
電荷は抵抗18を介して放電される。そして、コンデンサ
20の両端電圧とV2 の差の電圧がダイオード21、トラン
ジスタ9を介して出力される。
とすればR1 ,R3 >R2 と選定しておくことにより、
VGEをIGBT4がオフするのに必要な低い電圧とする
ことができる。トランジスタ23は、IGBT4のオン期
間であることを過電流検知部に知らしめる。なお、抵抗
18は定電流ダイオードでもよい。
過電流検知部が過電流を検知し、トランジスタ14が導通
し、IGBT4のゲート・エミッタ間電圧が減少中で
も、オフ信号が入力されると、通常のオフ動作が働くこ
とになる。その結果、充分に短絡電流を減少出来ずにし
ゃ断することになり、しゃ断時の電流の減少率(−di
/dt)が大きくなってしまう。そのため、素子に過大
な電圧が加わるおそれがある。
にも対処できるように、信号絶縁用フォトカプラ5のコ
レクタ端子とトランジスタ14とをダイオード24を介して
接続した。この図2に示す回路でも、過電流検知部が過
電流を検知した場合は、トランジスタ14が導通する。こ
の時、オフ信号が入力するとフォトカプラ5はオフす
る。
・エミッタ間電圧VBE、トランジスタ14のコレクタ・エ
ミッタ間電圧VCE、ダイオード24の順方向電圧VF の関
係が、 VBE ≫ VCE+VF (式1) となるように部品を選定しておけば、電源6,7から抵
抗25を介して流れる電流はトランジスタ8,23のベース
に流れずに、ダイオード24を通ってトランジスタ14に流
れる。
ランジスタ(25C945L)ではVBE>VCEであり、
更にダイオード24にはショットキーダイオード(SC8
02一04)のようにVF の低いものがある。これらに
よれば、 VBE(MAX) =1.0,VCE(MAX) =0.3,VF(MAX)=
0.55 VDE=1.0>VCE+VF =0.85となり、前記式1
の関係が成立する。
ことなく過電流保護動作が行われることになる。また、
通常のオフ動作時では、トランジスタ14が導通しないの
で、トランジスタ8,23のベースに電流が流れるための
影響を及ぼさない。
導体素子の駆動回路は、短絡事故時などに、過電流しゃ
断時の飛躍電圧を抑制するとともに、素子の消費エネル
ギーを低減して過電流から素子を確実に保護できるもの
である。
1実施形態を示す回路図である。
2実施形態を示す回路図である。
である。
波形図である。
示すグラフである。
Claims (2)
- 【請求項1】 少なくとも信号絶縁用フォトカプラと相
補的に動作する1対の出力トランジスタを構成要素とす
る駆動部と、駆動信号がある場合に電圧駆動形半導体素
子の入力側主端子の電圧を監視し、この電圧が所定の値
を越えたことを検出する検出手段と、この検出手段が動
作している間、時間の経過に伴い、電圧を徐々に降下さ
せる可変電圧源とからなり、前記可変電圧源と出力トラ
ンジスタのベース端子間にこのベース端子側がアノード
となるようにダイオードを接続したことを特徴とする電
圧駆動形半導体素子の駆動回路。 - 【請求項2】 駆動信号がある場合に電圧駆動形半導体
素子の入力側主端子の電圧を監視し、この電圧が所定の
値を越えたことを検出手段が検出した時に導通するトラ
ンジスタのコレクタ端子と、信号絶縁用フォトカプラの
コレクタ端子とをトランジスタ側に順方向なダイオード
を介して接続することを特徴とする請求項第1項記載の
電圧駆動形半導体素子の駆動回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10031067A JP2973997B2 (ja) | 1988-12-22 | 1998-02-13 | 電圧駆動形半導体素子の駆動回路 |
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Application Number | Priority Date | Filing Date | Title |
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JP1-68821 | 1989-03-20 | ||
JP63-324359 | 1989-03-20 | ||
JP6882189 | 1989-03-20 | ||
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CN113625145A (zh) * | 2021-08-12 | 2021-11-09 | 合肥恒钧检测技术有限公司 | 一种测试光耦的设备及方法 |
CN113625145B (zh) * | 2021-08-12 | 2024-05-28 | 恒钧检测技术有限公司 | 一种测试光耦的设备及方法 |
-
1998
- 1998-02-13 JP JP10031067A patent/JP2973997B2/ja not_active Expired - Fee Related
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