JPH10129046A - 印字制御方法 - Google Patents
印字制御方法Info
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- JPH10129046A JPH10129046A JP8286931A JP28693196A JPH10129046A JP H10129046 A JPH10129046 A JP H10129046A JP 8286931 A JP8286931 A JP 8286931A JP 28693196 A JP28693196 A JP 28693196A JP H10129046 A JPH10129046 A JP H10129046A
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Abstract
(57)【要約】
【課題】上位装置から複数のブロックの印字データが別
々に送信された場合でも、１パスの印字を行うことがで
きるようにする。 【解決手段】複数の仮想イメージバッファセルから成る
仮想イメージバッファを設定し、前記各仮想イメージバ
ッファセルに対応させてセルリストを設定し、イメージ
データが仮想展開されない場合、仮想イメージバッファ
セルに対応するセルリストのアドレスへの書込みを行わ
ず、イメージデータが仮想展開される場合、仮想イメー
ジバッファセルに対応するセルリストのアドレスに先頭
アドレスを書き込む。この場合、例えば、あるブロック
のイメージデータを仮想イメージバッファに仮想展開す
る場合、イメージデータが仮想展開されない仮想イメー
ジバッファセルについては、対応するセルリストのアド
レスには書込みが行われず、０のままになる。
々に送信された場合でも、１パスの印字を行うことがで
きるようにする。 【解決手段】複数の仮想イメージバッファセルから成る
仮想イメージバッファを設定し、前記各仮想イメージバ
ッファセルに対応させてセルリストを設定し、イメージ
データが仮想展開されない場合、仮想イメージバッファ
セルに対応するセルリストのアドレスへの書込みを行わ
ず、イメージデータが仮想展開される場合、仮想イメー
ジバッファセルに対応するセルリストのアドレスに先頭
アドレスを書き込む。この場合、例えば、あるブロック
のイメージデータを仮想イメージバッファに仮想展開す
る場合、イメージデータが仮想展開されない仮想イメー
ジバッファセルについては、対応するセルリストのアド
レスには書込みが行われず、０のままになる。
Description
【０００１】
【発明の属する技術分野】本発明は、印字制御方法に関
するものである。
するものである。
【０００２】
【従来の技術】従来、シリアルドットプリンタ（以下
「プリンタ」という。）において、例えば、１行の印字
を２パスで行う必要がある場合、上位装置は、１行目の
印字データをプリンタに送信した後、改行を示すキャリ
ッジリターンコードＣＲをプリンタに送信し、その後、
２行目の印字データをプリンタに送信するようにしてい
る。
「プリンタ」という。）において、例えば、１行の印字
を２パスで行う必要がある場合、上位装置は、１行目の
印字データをプリンタに送信した後、改行を示すキャリ
ッジリターンコードＣＲをプリンタに送信し、その後、
２行目の印字データをプリンタに送信するようにしてい
る。
【０００３】図２はプリンタに送信された印字データを
示す図、図３は第１ブロックの印字データを示す図、図
４は第２ブロックの印字データを示す図、図５は従来の
プリンタによる印字結果を示す図、図６は従来のプリン
タのイメージバッファに展開されたイメージデータを示
す図、図７は従来のプリンタの第１ブロックのイメージ
データを格納したイメージバッファセルの状態図、図８
は従来のプリンタの第２ブロックのイメージデータを格
納したイメージバッファセルの状態図である。なお、□
はスペースを示す。
示す図、図３は第１ブロックの印字データを示す図、図
４は第２ブロックの印字データを示す図、図５は従来の
プリンタによる印字結果を示す図、図６は従来のプリン
タのイメージバッファに展開されたイメージデータを示
す図、図７は従来のプリンタの第１ブロックのイメージ
データを格納したイメージバッファセルの状態図、図８
は従来のプリンタの第２ブロックのイメージデータを格
納したイメージバッファセルの状態図である。なお、□
はスペースを示す。
【０００４】図２に示すように、上位装置において、 “□□□□□□ＡＢＣ□□□ＤＥＦ”＋ＣＲ＋“ＨＩＪ
□□□□□□ＫＬＭ” の印字データを発生させ、該印字データをプリンタに送
信すると、該プリンタのマイクロプロセッサは、まず、
印字ヘッドを主走査方向に移動させ、図３に示すよう
に、キャリッジリターンコードＣＲが指定されるまでの
第１ブロックの印字データ “□□□□□□ＡＢＣ□□□ＤＥＦ” の印字を行う。
□□□□□□ＫＬＭ” の印字データを発生させ、該印字データをプリンタに送
信すると、該プリンタのマイクロプロセッサは、まず、
印字ヘッドを主走査方向に移動させ、図３に示すよう
に、キャリッジリターンコードＣＲが指定されるまでの
第１ブロックの印字データ “□□□□□□ＡＢＣ□□□ＤＥＦ” の印字を行う。
【０００５】続いて、印字ヘッドをホームポジションま
で戻し、主走査方向に再び移動させ、図４に示すよう
に、キャリッジリターンコードＣＲが指定された後の第
２ブロックの印字データ “ＨＩＪ□□□□□□ＫＬＭ” の印字を行うと、図５に示すような印字結果 ＨＩＪ□□□ＡＢＣＫＬＭＤＥＦ を得ることができる。
で戻し、主走査方向に再び移動させ、図４に示すよう
に、キャリッジリターンコードＣＲが指定された後の第
２ブロックの印字データ “ＨＩＪ□□□□□□ＫＬＭ” の印字を行うと、図５に示すような印字結果 ＨＩＪ□□□ＡＢＣＫＬＭＤＥＦ を得ることができる。
【０００６】ところで、上位装置から送信される印字デ
ータは、キャラクタコードから成るが、前記マイクロプ
ロセッサは、受信した印字データを解析してイメージデ
ータにし、図６に示すように、ＲＡＭのイメージバッフ
ァに展開する。該イメージバッファは、４バイトで１カ
ラム分のイメージデータを格納し、２４ピンの印字ヘッ
ドを有するプリンタにおいては、１バイト分はＮＵＬＬ
データになる。
ータは、キャラクタコードから成るが、前記マイクロプ
ロセッサは、受信した印字データを解析してイメージデ
ータにし、図６に示すように、ＲＡＭのイメージバッフ
ァに展開する。該イメージバッファは、４バイトで１カ
ラム分のイメージデータを格納し、２４ピンの印字ヘッ
ドを有するプリンタにおいては、１バイト分はＮＵＬＬ
データになる。
【０００７】そして、前記イメージバッファは、図７及
び８に示すように、１０２４バイトごとに複数のイメー
ジバッファセルＩ1 、Ｉ2 、Ｉ3 、…に分割され、各イ
メージバッファセルＩ1 、Ｉ2 、Ｉ3 、…に１０２４個
のアドレスが付与される。なお、図７及び８において、
ＬＭはレフトマージン、ＲＭはライトマージン、Ｐ１は
第１ブロックのイメージデータの印字開始位置、Ｐ２は
第１ブロックのイメージデータの印字終了位置、Ｐ３は
第２ブロックのイメージデータの印字開始位置、Ｐ４は
第２ブロックのイメージデータの印字終了位置である。
び８に示すように、１０２４バイトごとに複数のイメー
ジバッファセルＩ1 、Ｉ2 、Ｉ3 、…に分割され、各イ
メージバッファセルＩ1 、Ｉ2 、Ｉ3 、…に１０２４個
のアドレスが付与される。なお、図７及び８において、
ＬＭはレフトマージン、ＲＭはライトマージン、Ｐ１は
第１ブロックのイメージデータの印字開始位置、Ｐ２は
第１ブロックのイメージデータの印字終了位置、Ｐ３は
第２ブロックのイメージデータの印字開始位置、Ｐ４は
第２ブロックのイメージデータの印字終了位置である。
【０００８】また、前記イメージバッファセルＩ1 、Ｉ
2 、Ｉ3 、…を管理するために、データテーブルから成
るセルリストが使用される。該セルリストには、イメー
ジバッファセルＩ1 、Ｉ2 、Ｉ3 、…の先頭のアドレス
が書き込まれる。この場合、各イメージバッファセルＩ
1 、Ｉ2 、Ｉ3 、…の先頭のアドレスは、１０００、２
０２４、３０４８、…であるので、前記セルリストのア
ドレスＬ１、Ｌ２、Ｌ３、…には、それぞれ先頭のアド
レス１０００、２０２４、３０４８、…が書き込まれ
る。
2 、Ｉ3 、…を管理するために、データテーブルから成
るセルリストが使用される。該セルリストには、イメー
ジバッファセルＩ1 、Ｉ2 、Ｉ3 、…の先頭のアドレス
が書き込まれる。この場合、各イメージバッファセルＩ
1 、Ｉ2 、Ｉ3 、…の先頭のアドレスは、１０００、２
０２４、３０４８、…であるので、前記セルリストのア
ドレスＬ１、Ｌ２、Ｌ３、…には、それぞれ先頭のアド
レス１０００、２０２４、３０４８、…が書き込まれ
る。
【０００９】ところで、第１ブロックにおいては、イメ
ージバッファセルＩ1 、Ｉ2 の全体がＮＵＬＬデータで
あり、イメージデータは展開されない。また、第２ブロ
ックにおいては、イメージバッファセルＩ1 にイメージ
データの“ＨＩＪ”が展開される。ところが、いずれ
も、前記セルリストの先頭のアドレスＬ１にはイメージ
バッファセルＩ1 の先頭のアドレス１０００が書き込ま
れる。
ージバッファセルＩ1 、Ｉ2 の全体がＮＵＬＬデータで
あり、イメージデータは展開されない。また、第２ブロ
ックにおいては、イメージバッファセルＩ1 にイメージ
データの“ＨＩＪ”が展開される。ところが、いずれ
も、前記セルリストの先頭のアドレスＬ１にはイメージ
バッファセルＩ1 の先頭のアドレス１０００が書き込ま
れる。
【００１０】
【発明が解決しようとする課題】しかしながら、前記従
来のプリンタにおいては、上位装置から第１ブロックの
印字データと第２ブロックの印字データとが別々に送信
されると、２パスの印字が行われてしまい、１パスの印
字を行うことができない。そこで、一つのイメージバッ
ファに第１ブロックのイメージデータと第２ブロックの
イメージデータとの論理和（ＯＲ）を採って展開するこ
とが考えられるが、第２ブロックのイメージデータの
“ＨＩＪ”よりレフトマージンＬＭ側に第１ブロックの
イメージデータの“ＡＢＣ”が位置するので、一旦（い
ったん）第１ブロックのイメージデータをイメージバッ
ファに展開すると、第２ブロックのイメージデータを同
じイメージバッファに展開することができない。
来のプリンタにおいては、上位装置から第１ブロックの
印字データと第２ブロックの印字データとが別々に送信
されると、２パスの印字が行われてしまい、１パスの印
字を行うことができない。そこで、一つのイメージバッ
ファに第１ブロックのイメージデータと第２ブロックの
イメージデータとの論理和（ＯＲ）を採って展開するこ
とが考えられるが、第２ブロックのイメージデータの
“ＨＩＪ”よりレフトマージンＬＭ側に第１ブロックの
イメージデータの“ＡＢＣ”が位置するので、一旦（い
ったん）第１ブロックのイメージデータをイメージバッ
ファに展開すると、第２ブロックのイメージデータを同
じイメージバッファに展開することができない。
【００１１】また、イメージバッファセルＩ1 、Ｉ2 の
ように全体がＮＵＬＬデータであると、印字ヘッドは駆
動されないようになっているが、セルリストの各アドレ
スＬ１、Ｌ２にはそれぞれ先頭のアドレス１０００、２
０２４が書き込まれるようになっているので、印字ヘッ
ドは実際に印字を行う速度で移動させられる（ＮＵＬＬ
カラムスペース動作）。したがって、印字速度がその分
低くなってしまう。
ように全体がＮＵＬＬデータであると、印字ヘッドは駆
動されないようになっているが、セルリストの各アドレ
スＬ１、Ｌ２にはそれぞれ先頭のアドレス１０００、２
０２４が書き込まれるようになっているので、印字ヘッ
ドは実際に印字を行う速度で移動させられる（ＮＵＬＬ
カラムスペース動作）。したがって、印字速度がその分
低くなってしまう。
【００１２】本発明は、前記従来のプリンタの問題点を
解決して、上位装置から複数のブロックの印字データが
別々に送信された場合でも、１パスの印字を行うことが
でき、印字速度を高くすることができる印字制御方法を
提供することを目的とする。
解決して、上位装置から複数のブロックの印字データが
別々に送信された場合でも、１パスの印字を行うことが
でき、印字速度を高くすることができる印字制御方法を
提供することを目的とする。
【００１３】
【課題を解決するための手段】そのために、本発明の印
字制御方法においては、複数の仮想イメージバッファセ
ルから成る仮想イメージバッファを設定し、前記各仮想
イメージバッファセルに対応させてセルリストを設定
し、イメージデータが仮想展開されない場合、仮想イメ
ージバッファセルに対応するセルリストのアドレスへの
書込みを行わず、イメージデータが仮想展開される場
合、仮想イメージバッファセルに対応するセルリストの
アドレスに先頭のアドレスを書き込む。
字制御方法においては、複数の仮想イメージバッファセ
ルから成る仮想イメージバッファを設定し、前記各仮想
イメージバッファセルに対応させてセルリストを設定
し、イメージデータが仮想展開されない場合、仮想イメ
ージバッファセルに対応するセルリストのアドレスへの
書込みを行わず、イメージデータが仮想展開される場
合、仮想イメージバッファセルに対応するセルリストの
アドレスに先頭のアドレスを書き込む。
【００１４】
【発明の実施の形態】以下、本発明の実施の形態につい
て図面を参照しながら詳細に説明する。図１は本発明の
実施の形態におけるプリンタのブロック図である。図に
おいて、１１はマイクロプロセッサ、１２は図示しない
上位装置から印字データを受信する受信回路、１３は、
例えば、ドットインパクト型の印字ヘッド、１４は該印
字ヘッド１３を主走査方向に移動させるスペースモータ
（Ｍ）、１５は前記印字ヘッド１３を副走査方向に移動
させる改行モータ（Ｍ）、１６は図示しないイメージバ
ッファを備えたＲＡＭ、１７は制御用プログラムが格納
されたＲＯＭ、１８はＩ／Ｏ制御回路、２２はセンサで
ある。そして、前記印字ヘッド１３は印字ヘッド制御回
路１９によって、前記スペースモータ１４はスペースモ
ータ制御回路２０によって、前記改行モータ１５は改行
モータ制御回路２１によってそれぞれ制御され、スペー
スモータ位置検出回路２３は、前記センサ２２によって
得られた信号に基づいて前記印字ヘッド１３の位置を検
出する。
て図面を参照しながら詳細に説明する。図１は本発明の
実施の形態におけるプリンタのブロック図である。図に
おいて、１１はマイクロプロセッサ、１２は図示しない
上位装置から印字データを受信する受信回路、１３は、
例えば、ドットインパクト型の印字ヘッド、１４は該印
字ヘッド１３を主走査方向に移動させるスペースモータ
（Ｍ）、１５は前記印字ヘッド１３を副走査方向に移動
させる改行モータ（Ｍ）、１６は図示しないイメージバ
ッファを備えたＲＡＭ、１７は制御用プログラムが格納
されたＲＯＭ、１８はＩ／Ｏ制御回路、２２はセンサで
ある。そして、前記印字ヘッド１３は印字ヘッド制御回
路１９によって、前記スペースモータ１４はスペースモ
ータ制御回路２０によって、前記改行モータ１５は改行
モータ制御回路２１によってそれぞれ制御され、スペー
スモータ位置検出回路２３は、前記センサ２２によって
得られた信号に基づいて前記印字ヘッド１３の位置を検
出する。
【００１５】前記マイクロプロセッサ１１は、受信回路
１２を介して上位装置から印字データを受信すると、該
印字データを解析してイメージデータにする。また、マ
イクロプロセッサ１１は、スペースモータ１４及び改行
モータ１５を駆動し、印字ヘッド１３を作動させる。該
印字ヘッド１３は、前記イメージデータに従って所定の
ドットパターンを図示しない印字用紙に形成する。
１２を介して上位装置から印字データを受信すると、該
印字データを解析してイメージデータにする。また、マ
イクロプロセッサ１１は、スペースモータ１４及び改行
モータ１５を駆動し、印字ヘッド１３を作動させる。該
印字ヘッド１３は、前記イメージデータに従って所定の
ドットパターンを図示しない印字用紙に形成する。
【００１６】図９は本発明の実施の形態におけるイメー
ジデータを格納したイメージバッファセルの状態図、図
１０は本発明の実施の形態における仮想イメージバッフ
ァセルの第１の状態図、図１１は本発明の実施の形態に
おける仮想イメージバッファセルの第２の状態図であ
る。なお、この場合、図２に示した印字データに従って
印字を行うこととする。
ジデータを格納したイメージバッファセルの状態図、図
１０は本発明の実施の形態における仮想イメージバッフ
ァセルの第１の状態図、図１１は本発明の実施の形態に
おける仮想イメージバッファセルの第２の状態図であ
る。なお、この場合、図２に示した印字データに従って
印字を行うこととする。
【００１７】この場合、上位装置から送信される印字デ
ータは、キャラクタコードから成るが、プリンタのマイ
クロプロセッサ１１は、受信した印字データを解析して
イメージデータにし、ＲＡＭ１６（図１）のイメージバ
ッファに展開する。該イメージバッファは、４バイトで
１カラム分のイメージデータを格納し、２４ピンの印字
ヘッド１３を有するプリンタにおいては、１バイト分は
ＮＵＬＬデータになる。
ータは、キャラクタコードから成るが、プリンタのマイ
クロプロセッサ１１は、受信した印字データを解析して
イメージデータにし、ＲＡＭ１６（図１）のイメージバ
ッファに展開する。該イメージバッファは、４バイトで
１カラム分のイメージデータを格納し、２４ピンの印字
ヘッド１３を有するプリンタにおいては、１バイト分は
ＮＵＬＬデータになる。
【００１８】そして、前記イメージバッファは、図９に
示すように、１０２４バイトごとに複数のイメージバッ
ファセルＩ1 、Ｉ2 、Ｉ3 、…に分割され、各イメージ
バッファセルＩ1 、Ｉ2 、Ｉ3 、…に１０２４個のアド
レスが付与される。また、前記イメージバッファセルＩ
1 、Ｉ2 、Ｉ3 、…を管理するために、データテーブル
から成るセルリストが使用され、該セルリストによって
仮想イメージバッファセルＪ1 、Ｊ2 、Ｊ3 、…から成
る仮想イメージバッファが設定される。
示すように、１０２４バイトごとに複数のイメージバッ
ファセルＩ1 、Ｉ2 、Ｉ3 、…に分割され、各イメージ
バッファセルＩ1 、Ｉ2 、Ｉ3 、…に１０２４個のアド
レスが付与される。また、前記イメージバッファセルＩ
1 、Ｉ2 、Ｉ3 、…を管理するために、データテーブル
から成るセルリストが使用され、該セルリストによって
仮想イメージバッファセルＪ1 、Ｊ2 、Ｊ3 、…から成
る仮想イメージバッファが設定される。
【００１９】そして、各仮想イメージバッファセル
Ｊ1 、Ｊ2 、Ｊ3 、…にイメージデータが仮想展開され
る場合、前記セルリストの各アドレスＬ１、Ｌ２、Ｌ
３、…に、各仮想イメージバッファセルＪ1 、Ｊ2 、Ｊ
3 、…の先頭のアドレスがそれぞれ書き込まれる。な
お、各仮想イメージバッファセルＪ1 、Ｊ2 、Ｊ3 、…
の先頭のアドレスは、仮想展開されるイメージデータ
が、図９のイメージバッファに実際に展開されるイメー
ジバッファセルＩ1 、Ｉ2 、Ｉ3 、…の先頭のアドレス
１０００、２０２４、３０４８、…と等しくされる。
Ｊ1 、Ｊ2 、Ｊ3 、…にイメージデータが仮想展開され
る場合、前記セルリストの各アドレスＬ１、Ｌ２、Ｌ
３、…に、各仮想イメージバッファセルＪ1 、Ｊ2 、Ｊ
3 、…の先頭のアドレスがそれぞれ書き込まれる。な
お、各仮想イメージバッファセルＪ1 、Ｊ2 、Ｊ3 、…
の先頭のアドレスは、仮想展開されるイメージデータ
が、図９のイメージバッファに実際に展開されるイメー
ジバッファセルＩ1 、Ｉ2 、Ｉ3 、…の先頭のアドレス
１０００、２０２４、３０４８、…と等しくされる。
【００２０】ところで、前記セルリストは、印字が終了
して前記イメージバッファが開放されるのに伴って初期
化され、各アドレスＬ１、Ｌ２、Ｌ３、…には０が書き
込まれるようになっている。したがって、第１ブロック
のイメージデータを仮想イメージバッファセルＪ1 、Ｊ
2 、Ｊ3 、…に展開する場合、図１０に示すように、仮
想イメージバッファセルＪ1 、Ｊ2 には、イメージデー
タが仮想展開されないので、前記セルリストのアドレス
Ｌ１、Ｌ２には書込みが行われず、それぞれ０のままに
なる。
して前記イメージバッファが開放されるのに伴って初期
化され、各アドレスＬ１、Ｌ２、Ｌ３、…には０が書き
込まれるようになっている。したがって、第１ブロック
のイメージデータを仮想イメージバッファセルＪ1 、Ｊ
2 、Ｊ3 、…に展開する場合、図１０に示すように、仮
想イメージバッファセルＪ1 、Ｊ2 には、イメージデー
タが仮想展開されないので、前記セルリストのアドレス
Ｌ１、Ｌ２には書込みが行われず、それぞれ０のままに
なる。
【００２１】また、仮想イメージバッファセルＪ3 には
イメージデータの“ＡＢＣ”が仮想展開されるので、前
記セルリストのアドレスＬ３には、図９においてイメー
ジデータの“ＡＢＣ”が展開されるイメージバッファセ
ルＩ1 の先頭のアドレス１０００が書き込まれる。同様
に、仮想イメージバッファセルＪ4 にはイメージデータ
が仮想展開されないので、前記セルリストのアドレスＬ
４には書込みが行われず、０のままになり、仮想イメー
ジバッファセルＪ5 にはイメージデータの“ＤＥＦ”が
仮想展開されるので、前記セルリストのアドレスＬ５に
は、図９のイメージバッファセルＩ 2 の先頭のアドレス
２０２４が書き込まれる。
イメージデータの“ＡＢＣ”が仮想展開されるので、前
記セルリストのアドレスＬ３には、図９においてイメー
ジデータの“ＡＢＣ”が展開されるイメージバッファセ
ルＩ1 の先頭のアドレス１０００が書き込まれる。同様
に、仮想イメージバッファセルＪ4 にはイメージデータ
が仮想展開されないので、前記セルリストのアドレスＬ
４には書込みが行われず、０のままになり、仮想イメー
ジバッファセルＪ5 にはイメージデータの“ＤＥＦ”が
仮想展開されるので、前記セルリストのアドレスＬ５に
は、図９のイメージバッファセルＩ 2 の先頭のアドレス
２０２４が書き込まれる。
【００２２】このように、仮想イメージバッファセルＪ
1 、Ｊ2 、Ｊ3 、…にイメージデータが仮想展開されな
い場合、セルリストの各アドレスＬ１、Ｌ２、Ｌ３、…
には書込みが行われず、それぞれ０のままになるので、
イメージバッファに第１ブロックのイメージデータと第
２ブロックのイメージデータとの論理和を採って展開す
ることができる。
1 、Ｊ2 、Ｊ3 、…にイメージデータが仮想展開されな
い場合、セルリストの各アドレスＬ１、Ｌ２、Ｌ３、…
には書込みが行われず、それぞれ０のままになるので、
イメージバッファに第１ブロックのイメージデータと第
２ブロックのイメージデータとの論理和を採って展開す
ることができる。
【００２３】すなわち、第２ブロックのイメージデータ
を前記仮想イメージバッファセルＪ 1 、Ｊ2 、Ｊ3 、…
に重ねて展開する場合、図１１に示すように、仮想イメ
ージバッファセルＪ1 には、イメージデータの“ＨＩ
Ｊ”が仮想展開されるので、前記セルリストのアドレス
Ｌ１には、図９のイメージバッファセルＩ3 の先頭のア
ドレス３０４８が書き込まれる。
を前記仮想イメージバッファセルＪ 1 、Ｊ2 、Ｊ3 、…
に重ねて展開する場合、図１１に示すように、仮想イメ
ージバッファセルＪ1 には、イメージデータの“ＨＩ
Ｊ”が仮想展開されるので、前記セルリストのアドレス
Ｌ１には、図９のイメージバッファセルＩ3 の先頭のア
ドレス３０４８が書き込まれる。
【００２４】また、仮想イメージバッファセルＪ4 に
は、イメージデータの“ＫＬＭ”が仮想展開されるの
で、前記セルリストのアドレスＬ４には、図９のイメー
ジバッファセルＩ4 の先頭のアドレス４０７２が書き込
まれる。このように、セルリストの各アドレスＬ１、Ｌ
２、Ｌ３、…にそれぞれ３０４８、０、１０００、４０
７２、２０２４、…が書き込まれるので、一つのイメー
ジバッファに第１ブロックのイメージデータと第２ブロ
ックのイメージデータとを論理和を採って仮想展開する
ことができる。
は、イメージデータの“ＫＬＭ”が仮想展開されるの
で、前記セルリストのアドレスＬ４には、図９のイメー
ジバッファセルＩ4 の先頭のアドレス４０７２が書き込
まれる。このように、セルリストの各アドレスＬ１、Ｌ
２、Ｌ３、…にそれぞれ３０４８、０、１０００、４０
７２、２０２４、…が書き込まれるので、一つのイメー
ジバッファに第１ブロックのイメージデータと第２ブロ
ックのイメージデータとを論理和を採って仮想展開する
ことができる。
【００２５】したがって、上位装置から第１ブロックの
印字データと第２ブロックの印字データとが別々に送信
された場合でも、１パスの印字を行うことができる。ま
た、全体がＮＵＬＬデータになる仮想イメージバッファ
セルのセルリストが０であると判断され、スキップ動作
が行われる。したがって、印字速度を高くすることがで
きる。
印字データと第２ブロックの印字データとが別々に送信
された場合でも、１パスの印字を行うことができる。ま
た、全体がＮＵＬＬデータになる仮想イメージバッファ
セルのセルリストが０であると判断され、スキップ動作
が行われる。したがって、印字速度を高くすることがで
きる。
【００２６】なお、本発明は前記実施の形態に限定され
るものではなく、本発明の趣旨に基づいて種々変形させ
ることが可能であり、これらを本発明の範囲から排除す
るものではない。
るものではなく、本発明の趣旨に基づいて種々変形させ
ることが可能であり、これらを本発明の範囲から排除す
るものではない。
【００２７】
【発明の効果】以上詳細に説明したように、本発明によ
れば、印字制御方法においては、複数の仮想イメージバ
ッファセルから成る仮想イメージバッファを設定し、前
記各仮想イメージバッファセルに対応させてセルリスト
を設定し、イメージデータが仮想展開されない場合、仮
想イメージバッファセルに対応するセルリストのアドレ
スへの書込みを行わず、イメージデータが仮想展開され
る場合、仮想イメージバッファセルに対応するセルリス
トのアドレスに先頭のアドレスを書き込む。
れば、印字制御方法においては、複数の仮想イメージバ
ッファセルから成る仮想イメージバッファを設定し、前
記各仮想イメージバッファセルに対応させてセルリスト
を設定し、イメージデータが仮想展開されない場合、仮
想イメージバッファセルに対応するセルリストのアドレ
スへの書込みを行わず、イメージデータが仮想展開され
る場合、仮想イメージバッファセルに対応するセルリス
トのアドレスに先頭のアドレスを書き込む。
【００２８】この場合、例えば、あるブロックのイメー
ジデータを仮想イメージバッファに仮想展開する場合、
イメージデータが仮想展開されない仮想イメージバッフ
ァセルについては、対応するセルリストのアドレスには
書込みが行われず、０のままになる。そして、次のブロ
ックのイメージデータを仮想展開する場合、同じ仮想イ
メージバッファの各仮想イメージバッファセルにイメー
ジデータが仮想展開される。
ジデータを仮想イメージバッファに仮想展開する場合、
イメージデータが仮想展開されない仮想イメージバッフ
ァセルについては、対応するセルリストのアドレスには
書込みが行われず、０のままになる。そして、次のブロ
ックのイメージデータを仮想展開する場合、同じ仮想イ
メージバッファの各仮想イメージバッファセルにイメー
ジデータが仮想展開される。
【００２９】したがって、一つのイメージバッファに複
数のブロックのイメージデータを論理和を採って仮想展
開することができるので、上位装置から複数のブロック
の印字データが別々に送信された場合でも、１パスの印
字を行うことができる。また、全体がＮＵＬＬデータに
なる仮想イメージバッファセルのセルリストが０である
と判断され、スキップ動作が行われる。したがって、印
字速度を高くすることができる。
数のブロックのイメージデータを論理和を採って仮想展
開することができるので、上位装置から複数のブロック
の印字データが別々に送信された場合でも、１パスの印
字を行うことができる。また、全体がＮＵＬＬデータに
なる仮想イメージバッファセルのセルリストが０である
と判断され、スキップ動作が行われる。したがって、印
字速度を高くすることができる。
【図１】本発明の実施の形態におけるプリンタのブロッ
ク図である。
ク図である。
【図２】プリンタに送信された印字データを示す図であ
る。
る。
【図３】第１ブロックの印字データを示す図である。
【図４】第２ブロックの印字データを示す図である。
【図５】従来のプリンタによる印字結果を示す図であ
る。
る。
【図６】従来のプリンタのイメージバッファに展開され
たイメージデータを示す図である。
たイメージデータを示す図である。
【図７】従来のプリンタの第１ブロックのイメージデー
タを格納したイメージバッファセルの状態図である。
タを格納したイメージバッファセルの状態図である。
【図８】従来のプリンタの第２ブロックのイメージデー
タを格納したイメージバッファセルの状態図である。
タを格納したイメージバッファセルの状態図である。
【図９】本発明の実施の形態におけるイメージデータを
格納したイメージバッファセルの状態図である。
格納したイメージバッファセルの状態図である。
【図１０】本発明の実施の形態における仮想イメージバ
ッファセルの第１の状態図である。
ッファセルの第１の状態図である。
【図１１】本発明の実施の形態における仮想イメージバ
ッファセルの第２の状態図である。
ッファセルの第２の状態図である。
１６ ＲＡＭ Ｊ1 、Ｊ2 、Ｊ3 、… 仮想イメージバッファセル
Claims (1)
- 【請求項１】 （ａ）複数の仮想イメージバッファセル
から成る仮想イメージバッファを設定し、（ｂ）前記各
仮想イメージバッファセルに対応させてセルリストを設
定し、（ｃ）イメージデータが仮想展開されない場合、
仮想イメージバッファセルに対応するセルリストのアド
レスへの書込みを行わず、イメージデータが仮想展開さ
れる場合、仮想イメージバッファセルに対応するセルリ
ストのアドレスに先頭のアドレスを書き込むことを特徴
とする印字制御方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP28693196A JP3313987B2 (ja) | 1996-10-29 | 1996-10-29 | 印字制御方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP28693196A JP3313987B2 (ja) | 1996-10-29 | 1996-10-29 | 印字制御方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10129046A true JPH10129046A (ja) | 1998-05-19 |
| JP3313987B2 JP3313987B2 (ja) | 2002-08-12 |
Family
ID=17710819
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP28693196A Expired - Fee Related JP3313987B2 (ja) | 1996-10-29 | 1996-10-29 | 印字制御方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3313987B2 (ja) |
-
1996
- 1996-10-29 JP JP28693196A patent/JP3313987B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP3313987B2 (ja) | 2002-08-12 |
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|---|---|---|---|
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Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20020521 |
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