JPH096280A - マトリクス方式プラズマディスプレイパネルの駆動方法 - Google Patents
マトリクス方式プラズマディスプレイパネルの駆動方法Info
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Abstract
(57)【要約】
【課題】 画素データに対応した正確な発光表示が可能
なマトリクス方式プラズマディスプレイパネルの駆動方
法を提供することを目的とする。 【解決手段】 全行電極に一斉に第１プライミングパル
スを印加して一斉プライミングを実行した後に、放電空
間内の荷電粒子を再形成させるための第２プライミング
パルス、及び画素データ書き込みのための走査パルスを
連続印加して各行毎に画素データの書き込みを行う。
なマトリクス方式プラズマディスプレイパネルの駆動方
法を提供することを目的とする。 【解決手段】 全行電極に一斉に第１プライミングパル
スを印加して一斉プライミングを実行した後に、放電空
間内の荷電粒子を再形成させるための第２プライミング
パルス、及び画素データ書き込みのための走査パルスを
連続印加して各行毎に画素データの書き込みを行う。
Description
【０００１】
【産業上の利用分野】本発明は、交流放電型のマトリク
ス方式プラズマディスプレイパネルの駆動方法に関す
る。
ス方式プラズマディスプレイパネルの駆動方法に関す
る。
【０００２】
【従来の技術】プラズマディスプレイパネルは、周知の
如く、薄形の２次画面表示器の１つとして近時種々の研
究がなされており、その１つにメモリ機能を有する交流
放電型マトリクス方式のプラズマディスプレイパネルが
知られている。図１は、かかるプラズマディスプレイパ
ネルを含むプラズマディスプレイ装置の概略構成を示す
図である。
如く、薄形の２次画面表示器の１つとして近時種々の研
究がなされており、その１つにメモリ機能を有する交流
放電型マトリクス方式のプラズマディスプレイパネルが
知られている。図１は、かかるプラズマディスプレイパ
ネルを含むプラズマディスプレイ装置の概略構成を示す
図である。
【０００３】かかる図１において、駆動装置１００は、
入力されたビデオ信号を１画素毎に対応したディジタル
の画素データに変換して、この画素データに対応した画
素データパルスをＰＤＰ（プラズマディスプレイパネ
ル）１１の列電極Ｄ1 〜Ｄm に印加する。ＰＤＰ１１
は、上記列電極Ｄ1 〜Ｄm 、及びかかる列電極と直交し
且つＸ及びＹなる一対にて１行を構成する行電極Ｘ1 〜
Ｘn 及びＹ1 〜Ｙn を備えている。これら列電極及び行
電極対各々は図示せぬ誘電体を挟んで形成されており、
１つの列電極及び行電極対が交差する部分に１つの画素
セルが形成される。
入力されたビデオ信号を１画素毎に対応したディジタル
の画素データに変換して、この画素データに対応した画
素データパルスをＰＤＰ（プラズマディスプレイパネ
ル）１１の列電極Ｄ1 〜Ｄm に印加する。ＰＤＰ１１
は、上記列電極Ｄ1 〜Ｄm 、及びかかる列電極と直交し
且つＸ及びＹなる一対にて１行を構成する行電極Ｘ1 〜
Ｘn 及びＹ1 〜Ｙn を備えている。これら列電極及び行
電極対各々は図示せぬ誘電体を挟んで形成されており、
１つの列電極及び行電極対が交差する部分に１つの画素
セルが形成される。
【０００４】駆動装置１００は、上記ＰＤＰ１１の全て
の上記行電極対間に強制的に放電励起せしめて壁電荷を
形成（もしくは消去）させるためのプライミングパルス
ＰＰx 及びＰＰy を発生してこれらをＰＤＰ１１の行電
極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn夫々に印加する。又、駆動
装置１００は、ＰＤＰ１１に上記画素データを書き込む
ための走査パルスＳＰ、放電発光を維持するための維持
パルスＩＰx 及びＩＰy 、更に、維持放電発光を停止さ
せるための消去パルスＥＰの各々を発生してこれらをＰ
ＤＰ１１の行電極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn に印加す
る。
の上記行電極対間に強制的に放電励起せしめて壁電荷を
形成（もしくは消去）させるためのプライミングパルス
ＰＰx 及びＰＰy を発生してこれらをＰＤＰ１１の行電
極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn夫々に印加する。又、駆動
装置１００は、ＰＤＰ１１に上記画素データを書き込む
ための走査パルスＳＰ、放電発光を維持するための維持
パルスＩＰx 及びＩＰy 、更に、維持放電発光を停止さ
せるための消去パルスＥＰの各々を発生してこれらをＰ
ＤＰ１１の行電極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn に印加す
る。
【０００５】図２は、上記の各種駆動パルスの印加タイ
ミングを示す図である。図２において、先ず、駆動装置
１００は、負電圧のプライミングパルスＰＰxを全ての
行電極Ｘ1 〜Ｘn に印加すると同時に、正電圧のプライ
ミングパルスＰＰy を行電極Ｙ1 〜Ｙn の各々に印加す
る。かかるプライミングパルスの印加によりＰＤＰ１１
の全ての行電極対間に放電が生じる。かかる放電によ
り、各画素セル内において荷電粒子が発生し、その放電
終息後に壁電荷が蓄積形成される（一斉プライミング行
程）。
ミングを示す図である。図２において、先ず、駆動装置
１００は、負電圧のプライミングパルスＰＰxを全ての
行電極Ｘ1 〜Ｘn に印加すると同時に、正電圧のプライ
ミングパルスＰＰy を行電極Ｙ1 〜Ｙn の各々に印加す
る。かかるプライミングパルスの印加によりＰＤＰ１１
の全ての行電極対間に放電が生じる。かかる放電によ
り、各画素セル内において荷電粒子が発生し、その放電
終息後に壁電荷が蓄積形成される（一斉プライミング行
程）。
【０００６】次に、駆動装置１００は、各行毎の画素デ
ータに対応した画素データパルスＤＰ1 〜ＤＰn を順
次、列電極Ｄ1 〜Ｄm に印加する。駆動装置１００は、
上記画素データパルスＤＰ1 〜ＤＰn 夫々の印加タイミ
ングに同期して走査パルスＳＰを行電極Ｙ1 〜Ｙn へ順
次印加して行く。この際、かかる画素データパルスＤ
Ｐ、及び走査パルスＳＰが夫々列電極及び行電極に同時
に印加された画素セルにのみ放電が生じて、上記一斉プ
ライミングにて形成された壁電荷の大半が消滅する。一
方、走査パルスＳＰが印加されたものの画素データパル
スＤＰが印加されない画素セルにおいては、上述の如き
放電が生じないので、上記一斉プライミングにて形成さ
れた所望量の壁電荷はそのまま残留する。つまり、上記
一斉プライミングにて形成された所望量の壁電荷は、画
素データの内容に応じて選択的に消去されるのである
（画素データ書込行程）。
ータに対応した画素データパルスＤＰ1 〜ＤＰn を順
次、列電極Ｄ1 〜Ｄm に印加する。駆動装置１００は、
上記画素データパルスＤＰ1 〜ＤＰn 夫々の印加タイミ
ングに同期して走査パルスＳＰを行電極Ｙ1 〜Ｙn へ順
次印加して行く。この際、かかる画素データパルスＤ
Ｐ、及び走査パルスＳＰが夫々列電極及び行電極に同時
に印加された画素セルにのみ放電が生じて、上記一斉プ
ライミングにて形成された壁電荷の大半が消滅する。一
方、走査パルスＳＰが印加されたものの画素データパル
スＤＰが印加されない画素セルにおいては、上述の如き
放電が生じないので、上記一斉プライミングにて形成さ
れた所望量の壁電荷はそのまま残留する。つまり、上記
一斉プライミングにて形成された所望量の壁電荷は、画
素データの内容に応じて選択的に消去されるのである
（画素データ書込行程）。
【０００７】次に、駆動装置１００は、正極性の維持パ
ルスＩＰx を連続して行電極Ｘ1 〜Ｘn の夫々に印加す
ると共に、かかる維持パルスＩＰx の印加タイミングと
は、ずれたタイミングにて正極性の維持パルスＩＰy を
連続して行電極Ｙ1 〜Ｙn の夫々に印加する。かかる維
持パルスが連続して印加されている期間にわたり上記壁
電荷が残留したままになっている画素セルのみが放電発
光を維持する（維持放電行程）。
ルスＩＰx を連続して行電極Ｘ1 〜Ｘn の夫々に印加す
ると共に、かかる維持パルスＩＰx の印加タイミングと
は、ずれたタイミングにて正極性の維持パルスＩＰy を
連続して行電極Ｙ1 〜Ｙn の夫々に印加する。かかる維
持パルスが連続して印加されている期間にわたり上記壁
電荷が残留したままになっている画素セルのみが放電発
光を維持する（維持放電行程）。
【０００８】次に、駆動装置１００は、消去パルスＥＰ
を行電極Ｘ1 〜Ｘn 夫々に印加することにより、上記維
持放電を停止せしめる（維持放電停止行程）。かかるプ
ラズマディスプレイ装置においては、上記一斉プライミ
ングによって、全画素セルの放電空間内に荷電粒子を発
生させて予め所望量の空間電荷を形成しておくことによ
り、走査パルスＳＰのパルス幅を狭くしても放電が生じ
るようにしている。
を行電極Ｘ1 〜Ｘn 夫々に印加することにより、上記維
持放電を停止せしめる（維持放電停止行程）。かかるプ
ラズマディスプレイ装置においては、上記一斉プライミ
ングによって、全画素セルの放電空間内に荷電粒子を発
生させて予め所望量の空間電荷を形成しておくことによ
り、走査パルスＳＰのパルス幅を狭くしても放電が生じ
るようにしている。
【０００９】しかしながら、かかる荷電粒子は、時間経
過と共に徐々に消滅して行くので、図２に示されるが如
く、一斉プライミングの終了後、走査パルスＳＰが印加
されるまでの時間が長くなる例えばｎ行目における各画
素セルの放電空間内に存在する荷電粒子の量は、走査パ
ルスＳＰの印加直前において微量となる。この際、かか
る微量の荷電粒子しか存在していない画素セルに対し
て、図２に示されるが如く、パルス幅の狭い画素データ
パルスＤＰ及び走査パルスＳＰの同時印加を行っても直
ちに放電が開始されないため、画素データに対応した壁
電荷を形成することが出来ない場合が生じる。よって、
この際、誤った発光表示が為されるという問題が発生し
た。
過と共に徐々に消滅して行くので、図２に示されるが如
く、一斉プライミングの終了後、走査パルスＳＰが印加
されるまでの時間が長くなる例えばｎ行目における各画
素セルの放電空間内に存在する荷電粒子の量は、走査パ
ルスＳＰの印加直前において微量となる。この際、かか
る微量の荷電粒子しか存在していない画素セルに対し
て、図２に示されるが如く、パルス幅の狭い画素データ
パルスＤＰ及び走査パルスＳＰの同時印加を行っても直
ちに放電が開始されないため、画素データに対応した壁
電荷を形成することが出来ない場合が生じる。よって、
この際、誤った発光表示が為されるという問題が発生し
た。
【００１０】
【発明が解決しようとする課題】本発明はかかる問題を
解決するために為されたものであり、画素データに対応
した正確な発光表示が可能なマトリクス方式プラズマデ
ィスプレイパネルの駆動方法を提供することを目的とす
る。
解決するために為されたものであり、画素データに対応
した正確な発光表示が可能なマトリクス方式プラズマデ
ィスプレイパネルの駆動方法を提供することを目的とす
る。
【００１１】
【課題を解決するための手段】本発明によるマトリクス
方式プラズマディスプレイパネルの駆動方法は、２本ず
つ対となるように配列された複数の行電極対と前記行電
極対に直行する方向に配列され複数の列電極とからなる
マトリクス方式プラズマディスプレイパネルの駆動方法
であって、全ての前記行電極対に第１プライミングパル
スを同時に印加して前記行電極対間に放電を励起させる
一斉プライミング行程と、前記行電極対の一方に第２プ
ライミングパルスを印加して前記行電極対間に放電を励
起せしめた直後に、走査パルスを印加すると同時に前記
列電極に画素データパルスを印加して画素データの書き
込みを行う画素データ書込行程と、前記行電極対に交互
に維持パルスを印加して放電維持を行う維持放電行程
と、前記行電極対の一方に消去パルスを印加して前記放
電維持を停止させる維持放電停止行程とからなる。
方式プラズマディスプレイパネルの駆動方法は、２本ず
つ対となるように配列された複数の行電極対と前記行電
極対に直行する方向に配列され複数の列電極とからなる
マトリクス方式プラズマディスプレイパネルの駆動方法
であって、全ての前記行電極対に第１プライミングパル
スを同時に印加して前記行電極対間に放電を励起させる
一斉プライミング行程と、前記行電極対の一方に第２プ
ライミングパルスを印加して前記行電極対間に放電を励
起せしめた直後に、走査パルスを印加すると同時に前記
列電極に画素データパルスを印加して画素データの書き
込みを行う画素データ書込行程と、前記行電極対に交互
に維持パルスを印加して放電維持を行う維持放電行程
と、前記行電極対の一方に消去パルスを印加して前記放
電維持を停止させる維持放電停止行程とからなる。
【００１２】
【作用】全行電極に一斉に第１プライミングパルスを印
加して一斉プライミングを実行した後に、放電空間内の
荷電粒子を再形成させるための第２プライミングパル
ス、及び画素データ書き込みのための走査パルスを連続
印加して各行毎に画素データの書き込みを行う。
加して一斉プライミングを実行した後に、放電空間内の
荷電粒子を再形成させるための第２プライミングパル
ス、及び画素データ書き込みのための走査パルスを連続
印加して各行毎に画素データの書き込みを行う。
【００１３】
【実施例】図３は、本発明による駆動方法にてパネル駆
動を行う駆動装置を備えたプラズマディスプレイ装置の
構成を示す図である。かかる図３において、同期分離回
路１は、供給された入力ビデオ信号中から水平及び垂直
同期信号を抽出してこれらをタイミングパルス発生回路
２に供給する。タイミングパルス発生回路２は、これら
抽出された水平及び垂直同期信号に基づいた抽出同期信
号タイミングパルスを発生してこれをＡ／Ｄ変換器３、
メモリ制御回路５及び読出タイミング信号発生回路７の
各々に供給する。Ａ／Ｄ変換器３は、上記抽出同期信号
タイミングパルスに同期して入力ビデオ信号を１画素毎
に対応したディジタル画素データに変換し、これをフレ
ームメモリ４に供給する。メモリ制御回路５は、上記抽
出同期信号タイミングパルスに同期した書込信号及び読
出信号をフレームメモリ４に供給する。フレームメモリ
４は、かかる書込信号に応じて、Ａ／Ｄ変換器３から供
給された各画素データを順次取り込む。又、フレームメ
モリ４は、かかる読出信号に応じて、このフレームメモ
リ４内に記憶されている画素データを順次読み出して次
段の出力処理回路６へ供給する。読出タイミング信号発
生回路７は、放電発光動作を制御するための各種タイミ
ング信号を発生してこれらを行電極駆動パルス発生回路
１０、及び出力処理回路６の各々に供給する。出力処理
回路６は、読出しタイミング信号発生回路７からのタイ
ミング信号に同期させて、上記フレームメモリ４から供
給された画素データを画素データパルス発生回路１２に
供給する。
動を行う駆動装置を備えたプラズマディスプレイ装置の
構成を示す図である。かかる図３において、同期分離回
路１は、供給された入力ビデオ信号中から水平及び垂直
同期信号を抽出してこれらをタイミングパルス発生回路
２に供給する。タイミングパルス発生回路２は、これら
抽出された水平及び垂直同期信号に基づいた抽出同期信
号タイミングパルスを発生してこれをＡ／Ｄ変換器３、
メモリ制御回路５及び読出タイミング信号発生回路７の
各々に供給する。Ａ／Ｄ変換器３は、上記抽出同期信号
タイミングパルスに同期して入力ビデオ信号を１画素毎
に対応したディジタル画素データに変換し、これをフレ
ームメモリ４に供給する。メモリ制御回路５は、上記抽
出同期信号タイミングパルスに同期した書込信号及び読
出信号をフレームメモリ４に供給する。フレームメモリ
４は、かかる書込信号に応じて、Ａ／Ｄ変換器３から供
給された各画素データを順次取り込む。又、フレームメ
モリ４は、かかる読出信号に応じて、このフレームメモ
リ４内に記憶されている画素データを順次読み出して次
段の出力処理回路６へ供給する。読出タイミング信号発
生回路７は、放電発光動作を制御するための各種タイミ
ング信号を発生してこれらを行電極駆動パルス発生回路
１０、及び出力処理回路６の各々に供給する。出力処理
回路６は、読出しタイミング信号発生回路７からのタイ
ミング信号に同期させて、上記フレームメモリ４から供
給された画素データを画素データパルス発生回路１２に
供給する。
【００１４】画素データパルス発生回路１２は、出力処
理回路６から供給される各画素データに応じた画素デー
タパルスＤＰを発生して上記ＰＤＰ（プラズマディスプ
レイパネル）１１の列電極Ｄ1 〜Ｄm に印加する。行電
極駆動パルス発生回路１０は、上記ＰＤＰ１１の全ての
行電極対間に強制的に放電を励起せしめて後述する放電
空間に荷電粒子を発生させるための第１プライミングパ
ルスＰＰx 及びＰＰy 、上記荷電粒子を再形成させるた
めの第２プライミングパルスＰＰ、画素データ書き込み
のための走査パルスＳＰ、放電発光を維持するための維
持パルスＩＰx 及びＩＰy 、更に上記維持放電発光を停
止させるための消去パルスＥＰの各々を発生して、これ
らを上記読出タイミング信号発生回路７から供給された
各種のタイミング信号に応じたタイミングにてＰＤＰ１
１の行電極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn に印加する。
理回路６から供給される各画素データに応じた画素デー
タパルスＤＰを発生して上記ＰＤＰ（プラズマディスプ
レイパネル）１１の列電極Ｄ1 〜Ｄm に印加する。行電
極駆動パルス発生回路１０は、上記ＰＤＰ１１の全ての
行電極対間に強制的に放電を励起せしめて後述する放電
空間に荷電粒子を発生させるための第１プライミングパ
ルスＰＰx 及びＰＰy 、上記荷電粒子を再形成させるた
めの第２プライミングパルスＰＰ、画素データ書き込み
のための走査パルスＳＰ、放電発光を維持するための維
持パルスＩＰx 及びＩＰy 、更に上記維持放電発光を停
止させるための消去パルスＥＰの各々を発生して、これ
らを上記読出タイミング信号発生回路７から供給された
各種のタイミング信号に応じたタイミングにてＰＤＰ１
１の行電極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn に印加する。
【００１５】図４は、かかるＰＤＰ１１の構造を示す図
である。図４において、表示面である前面ガラス基板１
１０の内面（後述する背面ガラス基板１１３と対向する
面）には、互いに対となるように行電極Ｙ1 〜Ｙn 及び
行電極Ｘ1 〜Ｘn 夫々が形成されている。これら行電極
は、誘電体層１１１にて被覆されている。かかる誘電体
層１１１には、ＭｇＯ（酸化マグネシウム）層１１２が
蒸着されている。ＭｇＯ層１１２と背面ガラス基板１１
３との間には放電空間１１４が形成されている。背面ガ
ラス基板１１３には、蛍光体が塗布された列電極Ｄ1 〜
Ｄm が形成されている。この際、上記行電極Ｙ1 〜Ｙn
及び行電極Ｘ1 〜Ｘn は、Ｘ及びＹなる一対にて画像の
１行を形成するようになっており、この１行分の行電極
対Ｘｉ，Ｙｉ（i=1,・・・・,n）と、１つの列電極Ｄｊ（j=
1,・・・・,m）とが交差（上面から見て）する部分に１つの
画素セルＰi,j が形成される。
である。図４において、表示面である前面ガラス基板１
１０の内面（後述する背面ガラス基板１１３と対向する
面）には、互いに対となるように行電極Ｙ1 〜Ｙn 及び
行電極Ｘ1 〜Ｘn 夫々が形成されている。これら行電極
は、誘電体層１１１にて被覆されている。かかる誘電体
層１１１には、ＭｇＯ（酸化マグネシウム）層１１２が
蒸着されている。ＭｇＯ層１１２と背面ガラス基板１１
３との間には放電空間１１４が形成されている。背面ガ
ラス基板１１３には、蛍光体が塗布された列電極Ｄ1 〜
Ｄm が形成されている。この際、上記行電極Ｙ1 〜Ｙn
及び行電極Ｘ1 〜Ｘn は、Ｘ及びＹなる一対にて画像の
１行を形成するようになっており、この１行分の行電極
対Ｘｉ，Ｙｉ（i=1,・・・・,n）と、１つの列電極Ｄｊ（j=
1,・・・・,m）とが交差（上面から見て）する部分に１つの
画素セルＰi,j が形成される。
【００１６】次に、かかる図３にて示されるプラズマデ
ィスプレイ装置にて実施される本発明によるマトリクス
方式プラズマディスプレイパネルの駆動方法について述
べる。図５は、かかる本発明の駆動方法による第１の実
施例を示し、この第１の実施例にてパネル駆動を行う際
にＰＤＰ１１に印加される各種パルスの印加タイミング
を示す図である。
ィスプレイ装置にて実施される本発明によるマトリクス
方式プラズマディスプレイパネルの駆動方法について述
べる。図５は、かかる本発明の駆動方法による第１の実
施例を示し、この第１の実施例にてパネル駆動を行う際
にＰＤＰ１１に印加される各種パルスの印加タイミング
を示す図である。
【００１７】図５において、先ず、行電極駆動パルス発
生回路１０は、正電圧の第１プライミングパルスＰＰx
を全ての行電極Ｘ1 〜Ｘn に印加すると同時に、負電圧
の第１プライミングパルスＰＰy を行電極Ｙ1 〜Ｙn の
各々に印加する。かかる第１プライミングパルスの印加
によりＰＤＰ１１の全ての行電極対間に放電が励起し
て、全画素セルＰi,j の放電空間１１４内に荷電粒子が
発生する。この放電終息後、全画素セルの誘電体層１１
１には一様に所定量の壁電荷が形成される（一斉プライ
ミング行程）。
生回路１０は、正電圧の第１プライミングパルスＰＰx
を全ての行電極Ｘ1 〜Ｘn に印加すると同時に、負電圧
の第１プライミングパルスＰＰy を行電極Ｙ1 〜Ｙn の
各々に印加する。かかる第１プライミングパルスの印加
によりＰＤＰ１１の全ての行電極対間に放電が励起し
て、全画素セルＰi,j の放電空間１１４内に荷電粒子が
発生する。この放電終息後、全画素セルの誘電体層１１
１には一様に所定量の壁電荷が形成される（一斉プライ
ミング行程）。
【００１８】次に、画素データパルス発生回路１２は、
各行毎の画素データに対応した正電圧の画素データパル
スＤＰ1 〜ＤＰn を順次、列電極Ｄ1 〜Ｄm に印加す
る。この際、行電極駆動パルス発生回路１０は、上記画
素データパルスＤＰ1 〜ＤＰnの各印加タイミングに同
期して、小なるパルス幅の走査パルスＳＰを行電極Ｙ1
〜Ｙn へ順次印加する。ここで、行電極駆動パルス発生
回路１０は、かかる走査パルスＳＰを各行電極Ｙ1 〜Ｙ
n の各々に印加する直前に、図５にて示されるが如き正
電圧の第２プライミングパルスＰＰを行電極Ｙ1 〜Ｙn
各々に印加するのである。
各行毎の画素データに対応した正電圧の画素データパル
スＤＰ1 〜ＤＰn を順次、列電極Ｄ1 〜Ｄm に印加す
る。この際、行電極駆動パルス発生回路１０は、上記画
素データパルスＤＰ1 〜ＤＰnの各印加タイミングに同
期して、小なるパルス幅の走査パルスＳＰを行電極Ｙ1
〜Ｙn へ順次印加する。ここで、行電極駆動パルス発生
回路１０は、かかる走査パルスＳＰを各行電極Ｙ1 〜Ｙ
n の各々に印加する直前に、図５にて示されるが如き正
電圧の第２プライミングパルスＰＰを行電極Ｙ1 〜Ｙn
各々に印加するのである。
【００１９】かかる第２プライミングパルスＰＰの印加
により、上記一斉プライミングにて得られて時間経過と
共に減少してしまった荷電粒子が、放電空間１１４内に
再形成される。よって、放電空間１１４内に所望量の荷
電粒子が存在する内に、上記走査パルスＳＰの印加によ
る画素データ書き込みが為されるのである。例えば、画
素データの内容が論理「０」である場合には、走査パル
スＳＰと共に画素データパルスＤＰが同時印加されるの
で、画素セル内部に形成されている壁電荷は消滅する。
一方、画素データの内容が論理「１」である場合には、
走査パルスＳＰのみが印加されるので放電が生じず、そ
の画素セル内部に形成されている壁電荷はそのまま保持
される。つまり、かかる走査パルスＳＰとは、画素セル
内に形成されている壁電荷を画素データに応じて選択的
に消去せしめるためのトリガとなる選択消去パルスとい
えるのである（画素データ書込行程）。
により、上記一斉プライミングにて得られて時間経過と
共に減少してしまった荷電粒子が、放電空間１１４内に
再形成される。よって、放電空間１１４内に所望量の荷
電粒子が存在する内に、上記走査パルスＳＰの印加によ
る画素データ書き込みが為されるのである。例えば、画
素データの内容が論理「０」である場合には、走査パル
スＳＰと共に画素データパルスＤＰが同時印加されるの
で、画素セル内部に形成されている壁電荷は消滅する。
一方、画素データの内容が論理「１」である場合には、
走査パルスＳＰのみが印加されるので放電が生じず、そ
の画素セル内部に形成されている壁電荷はそのまま保持
される。つまり、かかる走査パルスＳＰとは、画素セル
内に形成されている壁電荷を画素データに応じて選択的
に消去せしめるためのトリガとなる選択消去パルスとい
えるのである（画素データ書込行程）。
【００２０】次に、行電極駆動パルス発生回路１０は、
正電圧の維持パルスＩＰx を連続して行電極Ｘ1 〜Ｘn
の夫々に印加すると共に、かかる維持パルスＩＰx の印
加タイミングとは、ずれたタイミングにて正電圧の維持
パルスＩＰy を連続して行電極Ｙ1 〜Ｙn の夫々に印加
する。かかる維持パルスが連続して印加されている期間
にわたり、上記壁電荷が残留したままとなっている画素
セルのみが放電発光を維持する（維持放電行程）。
正電圧の維持パルスＩＰx を連続して行電極Ｘ1 〜Ｘn
の夫々に印加すると共に、かかる維持パルスＩＰx の印
加タイミングとは、ずれたタイミングにて正電圧の維持
パルスＩＰy を連続して行電極Ｙ1 〜Ｙn の夫々に印加
する。かかる維持パルスが連続して印加されている期間
にわたり、上記壁電荷が残留したままとなっている画素
セルのみが放電発光を維持する（維持放電行程）。
【００２１】次に、行電極駆動パルス発生回路１０は、
消去パルスＥＰを行電極Ｘ1 〜Ｘn夫々に印加すること
により、上記維持放電を停止せしめる（維持放電停止行
程）。以上の如く、かかるプラズマディスプレイパネル
の駆動方法においては、全行電極に一斉に第１プライミ
ングパルスを印加して一斉プライミングを実行した後
に、放電空間内の荷電粒子を再形成させるための第２プ
ライミングパルス、及び画素データ書き込みのための走
査パルスを連続印加して各行毎に画素データの書き込み
を行うようにしている。
消去パルスＥＰを行電極Ｘ1 〜Ｘn夫々に印加すること
により、上記維持放電を停止せしめる（維持放電停止行
程）。以上の如く、かかるプラズマディスプレイパネル
の駆動方法においては、全行電極に一斉に第１プライミ
ングパルスを印加して一斉プライミングを実行した後
に、放電空間内の荷電粒子を再形成させるための第２プ
ライミングパルス、及び画素データ書き込みのための走
査パルスを連続印加して各行毎に画素データの書き込み
を行うようにしている。
【００２２】従って、この第２プライミングパルスによ
る荷電粒子の再形成から画素データの書き込みが実施さ
れるまでの時間は全ての行において同一の短時間とな
る。よって、全ての行において、放電空間１１４内に所
望量の荷電粒子が存在する内に、上記走査パルスＳＰの
印加による画素データ書き込みが為されるので、画素デ
ータの書き込みが正確に為されるようになるのである。
る荷電粒子の再形成から画素データの書き込みが実施さ
れるまでの時間は全ての行において同一の短時間とな
る。よって、全ての行において、放電空間１１４内に所
望量の荷電粒子が存在する内に、上記走査パルスＳＰの
印加による画素データ書き込みが為されるので、画素デ
ータの書き込みが正確に為されるようになるのである。
【００２３】尚、上記実施例においては、Ｘ、Ｙなる一
対の行電極の片側の電極に正電圧の第２プライミングパ
ルスＰＰ、続いて負電圧の走査パルスＳＰを夫々印加し
て、これらを行毎にスキャンするようにしているが、か
かる構成に限定されるものではない。図６及び図７は、
それぞれ本発明の第２及び第３の実施例による駆動方法
を示し、各々の駆動方法における駆動パルスの印加タイ
ミングを示す図である。
対の行電極の片側の電極に正電圧の第２プライミングパ
ルスＰＰ、続いて負電圧の走査パルスＳＰを夫々印加し
て、これらを行毎にスキャンするようにしているが、か
かる構成に限定されるものではない。図６及び図７は、
それぞれ本発明の第２及び第３の実施例による駆動方法
を示し、各々の駆動方法における駆動パルスの印加タイ
ミングを示す図である。
【００２４】かかる図６及び図７の実施例においては、
Ｘ、Ｙなる一対の行電極の内、Ｘ電極に負電圧の第２プ
ライミングパルスＰＰ、続いてＹ電極に負電圧の走査パ
ルスＳＰを夫々印加してこれらを行毎にスキャンするよ
うにしている。尚、図７においては、画素データパルス
ＤＰ1 〜ＤＰn の印加による画素データ書き込みが為さ
れている期間にわたり、走査パルスＳＰを印加する方の
電極、すなわち行電極Ｘを正電圧にオフセットするよう
にしている。
Ｘ、Ｙなる一対の行電極の内、Ｘ電極に負電圧の第２プ
ライミングパルスＰＰ、続いてＹ電極に負電圧の走査パ
ルスＳＰを夫々印加してこれらを行毎にスキャンするよ
うにしている。尚、図７においては、画素データパルス
ＤＰ1 〜ＤＰn の印加による画素データ書き込みが為さ
れている期間にわたり、走査パルスＳＰを印加する方の
電極、すなわち行電極Ｘを正電圧にオフセットするよう
にしている。
【００２５】このように上述の実施例の駆動方法におい
ては、全行電極に一斉に第１プライミングパルスを印加
して一斉プライミングを実行した後、第２プライミング
パルスを印加しその直後に画素データ書き込み用の走査
パルスを印加して各行毎に画素データの書き込みを行う
ようにしている。すなわち、全ての行において、走査パ
ルスを印加する際の各画素セルの放電空間内の荷電粒子
量を所定量に調節した直後に画素データ書き込みがなさ
れるので、画素データに対応した所望電荷量の壁電荷を
形成することができ、正確な表示画像を得ることが可能
となる。
ては、全行電極に一斉に第１プライミングパルスを印加
して一斉プライミングを実行した後、第２プライミング
パルスを印加しその直後に画素データ書き込み用の走査
パルスを印加して各行毎に画素データの書き込みを行う
ようにしている。すなわち、全ての行において、走査パ
ルスを印加する際の各画素セルの放電空間内の荷電粒子
量を所定量に調節した直後に画素データ書き込みがなさ
れるので、画素データに対応した所望電荷量の壁電荷を
形成することができ、正確な表示画像を得ることが可能
となる。
【００２６】さらに、前述のプライミングパルスの印加
方法に加えて、プライミングパルスの波形を調整する
と、全ての行においてさらに正確な画像の表示をなすこ
とができる。次に、プライミングパルスの波形を調整し
てプラズマディスプレイパネルを駆動する本発明の駆動
方法を以下に説明する。プライミングパルスの波形を調
整してパネル駆動を行う際に使用される駆動装置のう
ち、行電極駆動パルス発生回路１０ａの詳細な構成を図
８に示す。なお、行電極駆動パルス発生回路以外の駆動
装置は、図３と同一の装置を用いるものである。
方法に加えて、プライミングパルスの波形を調整する
と、全ての行においてさらに正確な画像の表示をなすこ
とができる。次に、プライミングパルスの波形を調整し
てプラズマディスプレイパネルを駆動する本発明の駆動
方法を以下に説明する。プライミングパルスの波形を調
整してパネル駆動を行う際に使用される駆動装置のう
ち、行電極駆動パルス発生回路１０ａの詳細な構成を図
８に示す。なお、行電極駆動パルス発生回路以外の駆動
装置は、図３と同一の装置を用いるものである。
【００２７】図８において、行電極駆動パルス発生回路
１０ａは、行電極Ｘ駆動部１０ｘと、行電極Ｙ駆動部１
０ｙと、コントローラ２２を含む。１つの画素セルＰi,
j は、行電極対Ｘi ，Ｙi と列電極Ｄj とを有し、行電
極Ｘi は行電極Ｘ駆動部１０ｘに接続され、行電極Ｙi
は行電極Ｙ駆動部１０ｙに接続され、列電極Ｄj は画素
データパルス発生回路１２に接続されている。
１０ａは、行電極Ｘ駆動部１０ｘと、行電極Ｙ駆動部１
０ｙと、コントローラ２２を含む。１つの画素セルＰi,
j は、行電極対Ｘi ，Ｙi と列電極Ｄj とを有し、行電
極Ｘi は行電極Ｘ駆動部１０ｘに接続され、行電極Ｙi
は行電極Ｙ駆動部１０ｙに接続され、列電極Ｄj は画素
データパルス発生回路１２に接続されている。
【００２８】行電極駆動パルス発生回路１０ａは、画素
セルを駆動するためのパルスとして、ＰＤＰ１１の全て
の行電極対間に強制的に放電を励起せしめて放電空間に
荷電粒子を発生させるための第１プライミングパルスＰ
Ｐx 及びＰＰy 、上記荷電粒子を再形成させるための第
２プライミングパルスＰＰ、画素データ書き込みのため
の走査パルスＳＰ、放電発光を維持するための維持パル
スＩＰx 及びＩＰy 、更に上記維持放電発光を停止させ
るための消去パルスＥＰの各々を発生して、これらを上
記読出タイミング信号発生回路７から供給された各種の
タイミング信号に応じたタイミングにてＰＤＰ１１の行
電極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn に印加する。
セルを駆動するためのパルスとして、ＰＤＰ１１の全て
の行電極対間に強制的に放電を励起せしめて放電空間に
荷電粒子を発生させるための第１プライミングパルスＰ
Ｐx 及びＰＰy 、上記荷電粒子を再形成させるための第
２プライミングパルスＰＰ、画素データ書き込みのため
の走査パルスＳＰ、放電発光を維持するための維持パル
スＩＰx 及びＩＰy 、更に上記維持放電発光を停止させ
るための消去パルスＥＰの各々を発生して、これらを上
記読出タイミング信号発生回路７から供給された各種の
タイミング信号に応じたタイミングにてＰＤＰ１１の行
電極Ｘ1 〜Ｘn 及びＹ1 〜Ｙn に印加する。
【００２９】コントローラ２２は、読出タイミング信号
発生回路７から供給される各種のタイミング信号に同期
して、後述する各スイッチの開閉を含む各種パルスの印
加を制御する。行電極Ｘ駆動部１０ｘは、図８に示すよ
うに、各々対応するスイッチＳＷＸ１〜ＳＷＸ３を直列
に含む複数のスイッチング電流路Ｐｘ１〜Ｐｘ３が互い
に並列に接続されて構成されている。かかるスイッチＳ
ＷＸ１〜ＳＷＸ３の各々は、スイッチコントローラ２２
からの指令によって開閉が制御される。
発生回路７から供給される各種のタイミング信号に同期
して、後述する各スイッチの開閉を含む各種パルスの印
加を制御する。行電極Ｘ駆動部１０ｘは、図８に示すよ
うに、各々対応するスイッチＳＷＸ１〜ＳＷＸ３を直列
に含む複数のスイッチング電流路Ｐｘ１〜Ｐｘ３が互い
に並列に接続されて構成されている。かかるスイッチＳ
ＷＸ１〜ＳＷＸ３の各々は、スイッチコントローラ２２
からの指令によって開閉が制御される。
【００３０】スイッチング電流路Ｐｘ１は、電流制限素
子２０ａとスイッチＳＷＸ１とが直列に接続されてな
り、スイッチＳＷＸ１の接点ａには、正極性の第１電位
＋Ｖp1が接続され、スイッチＳＷＸ１の接点ｂは、電流
制限素子２０ａを介して行電極Ｘi に接続されている。
スイッチＳＷＸ１は、スイッチコントローラ２２から供
給される第１プライミングパルスＰＰx に反応して閉成
されて、電位＋Ｖp1を電流制限素子２０ａを介して行電
極Ｘi に印加する。かかる電流制限素子２０ａは、好ま
しくは抵抗値Ｒ1 を有する抵抗器からなる。
子２０ａとスイッチＳＷＸ１とが直列に接続されてな
り、スイッチＳＷＸ１の接点ａには、正極性の第１電位
＋Ｖp1が接続され、スイッチＳＷＸ１の接点ｂは、電流
制限素子２０ａを介して行電極Ｘi に接続されている。
スイッチＳＷＸ１は、スイッチコントローラ２２から供
給される第１プライミングパルスＰＰx に反応して閉成
されて、電位＋Ｖp1を電流制限素子２０ａを介して行電
極Ｘi に印加する。かかる電流制限素子２０ａは、好ま
しくは抵抗値Ｒ1 を有する抵抗器からなる。
【００３１】スイッチング電流路Ｐｘ２において、スイ
ッチＳＷＸ２の接点ａには、正極性の電位＋Ｖｓが接続
され、スイッチＳＷＸ２の接点ｂは行電極Ｘi に接続さ
れている。スイッチＳＷＸ２は、コントローラ２２から
供給される維持パルスＩＰxに反応して閉成されて、電
位＋Ｖｓを行電極Ｘi に印加する。スイッチング電流路
Ｐｘ３において、スイッチＳＷＸ３の接点ａは、ＧＮＤ
電位に接続され、スイッチＳＷＸ３の接点ｂは行電極Ｘ
i に接続されている。スイッチＳＷＸ３は、上記スイッ
チＳＷＸ１，ＳＷＸ２の両者が同時に開放しているとき
のみ閉成されて、行電極Ｘi にＧＮＤ電位を印加する。
ッチＳＷＸ２の接点ａには、正極性の電位＋Ｖｓが接続
され、スイッチＳＷＸ２の接点ｂは行電極Ｘi に接続さ
れている。スイッチＳＷＸ２は、コントローラ２２から
供給される維持パルスＩＰxに反応して閉成されて、電
位＋Ｖｓを行電極Ｘi に印加する。スイッチング電流路
Ｐｘ３において、スイッチＳＷＸ３の接点ａは、ＧＮＤ
電位に接続され、スイッチＳＷＸ３の接点ｂは行電極Ｘ
i に接続されている。スイッチＳＷＸ３は、上記スイッ
チＳＷＸ１，ＳＷＸ２の両者が同時に開放しているとき
のみ閉成されて、行電極Ｘi にＧＮＤ電位を印加する。
【００３２】行電極Ｙ駆動部１０ｙも、行電極Ｘ駆動部
１０ｘとほぼ同様に構成されている。行電極Ｙ駆動部１
０ｙは、各々対応するスイッチＳＷＹ１〜ＳＷＹ５を直
列に含む複数のスイッチング電流路Ｐｙ１〜Ｐｙ５が互
いに並列に接続されて構成されている。かかるスイッチ
ＳＷＹ１〜ＳＷＹ５の各々は、コントローラ２２からの
指令によって開閉が制御される。
１０ｘとほぼ同様に構成されている。行電極Ｙ駆動部１
０ｙは、各々対応するスイッチＳＷＹ１〜ＳＷＹ５を直
列に含む複数のスイッチング電流路Ｐｙ１〜Ｐｙ５が互
いに並列に接続されて構成されている。かかるスイッチ
ＳＷＹ１〜ＳＷＹ５の各々は、コントローラ２２からの
指令によって開閉が制御される。
【００３３】スイッチング電流路Ｐｙ１は、電流制限素
子２０ｂとスイッチＳＷＹ１とが直列に接続されてな
り、スイッチＳＷＹ１の接点ａには、負極性の電位−Ｖ
p1が接続され、スイッチＳＷＹ１の接点ｂは、電流制限
素子２０ｂを介して行電極Ｙiに接続されている。スイ
ッチＳＷＹ１は、コントローラ２２から供給される第１
プライミングパルスＰＰｙに反応して閉成されて、電位
−Ｖp1を行電極Ｙi に電流制限素子２０ｂを介して印加
する。かかる電流制限素子２０ｂは、好ましくは抵抗値
Ｒ2 を有する抵抗器からなる。
子２０ｂとスイッチＳＷＹ１とが直列に接続されてな
り、スイッチＳＷＹ１の接点ａには、負極性の電位−Ｖ
p1が接続され、スイッチＳＷＹ１の接点ｂは、電流制限
素子２０ｂを介して行電極Ｙiに接続されている。スイ
ッチＳＷＹ１は、コントローラ２２から供給される第１
プライミングパルスＰＰｙに反応して閉成されて、電位
−Ｖp1を行電極Ｙi に電流制限素子２０ｂを介して印加
する。かかる電流制限素子２０ｂは、好ましくは抵抗値
Ｒ2 を有する抵抗器からなる。
【００３４】スイッチング電流路Ｐｙ２において、スイ
ッチＳＷＹ２の接点ａには、正極性の電位＋Ｖp2が接続
され、スイッチＳＷＹ２の接点ｂは行電極Ｙi に接続さ
れている。スイッチＳＷＸ２は、コントローラ２２から
供給される第２プライミングパルスＰＰに反応して閉成
されて、電位＋Ｖp2を行電極Ｙi に印加する。スイッチ
ング電流路Ｐｙ３において、スイッチＳＷＹ３の接点ａ
には、画素データを選択するための負極性の電位−Ｖｅ
が接続され、スイッチＳＷＹ３の接点ｂは行電極Ｙi に
接続されている。スイッチＳＷＸ３は、コントローラ２
２から供給される走査パルスＳＰに反応して閉成され
て、電位＋Ｖp2を行電極Ｙi に印加する。
ッチＳＷＹ２の接点ａには、正極性の電位＋Ｖp2が接続
され、スイッチＳＷＹ２の接点ｂは行電極Ｙi に接続さ
れている。スイッチＳＷＸ２は、コントローラ２２から
供給される第２プライミングパルスＰＰに反応して閉成
されて、電位＋Ｖp2を行電極Ｙi に印加する。スイッチ
ング電流路Ｐｙ３において、スイッチＳＷＹ３の接点ａ
には、画素データを選択するための負極性の電位−Ｖｅ
が接続され、スイッチＳＷＹ３の接点ｂは行電極Ｙi に
接続されている。スイッチＳＷＸ３は、コントローラ２
２から供給される走査パルスＳＰに反応して閉成され
て、電位＋Ｖp2を行電極Ｙi に印加する。
【００３５】スイッチング電流路Ｐｙ４において、スイ
ッチＳＷＹ４の接点ａには、放電を維持するための正極
性の電位＋Ｖｓが接続され、スイッチＳＷＹ４の接点ｂ
は直接行電極Ｙi に接続されている。スイッチＳＷＹ４
は、コントローラ２２から供給される維持パルスＩＰｙ
に反応して閉成されて、電位＋Ｖｓを行電極Ｙi に印加
する。
ッチＳＷＹ４の接点ａには、放電を維持するための正極
性の電位＋Ｖｓが接続され、スイッチＳＷＹ４の接点ｂ
は直接行電極Ｙi に接続されている。スイッチＳＷＹ４
は、コントローラ２２から供給される維持パルスＩＰｙ
に反応して閉成されて、電位＋Ｖｓを行電極Ｙi に印加
する。
【００３６】スイッチング電流路Ｐｙ５において、スイ
ッチＳＷＹ５の接点ａは、ＧＮＤ電位に接続され、スイ
ッチＳＷＹ５の接点ｂは直接行電極Ｙi に接続されてい
る。スイッチＳＷＹ５は、上記スイッチＳＷＹ１〜ＳＷ
Ｙ４の全てが同時に開放しているときのみ閉成されて、
行電極Ｙi にＧＮＤ電位を印加する。画素データパルス
発生回路１２は、画素Ｐi,j の表示に対応したレベルを
有するデータ信号を列電極Ｄj に供給する。
ッチＳＷＹ５の接点ａは、ＧＮＤ電位に接続され、スイ
ッチＳＷＹ５の接点ｂは直接行電極Ｙi に接続されてい
る。スイッチＳＷＹ５は、上記スイッチＳＷＹ１〜ＳＷ
Ｙ４の全てが同時に開放しているときのみ閉成されて、
行電極Ｙi にＧＮＤ電位を印加する。画素データパルス
発生回路１２は、画素Ｐi,j の表示に対応したレベルを
有するデータ信号を列電極Ｄj に供給する。
【００３７】このように、各画素セルＰi,j （i=1-n, j
=1-m）に対して、行電極駆動パルス発生回路１０ａは上
述の如く構成されている。なお、上記電流制限素子２０
ａ，２０ｂは、抵抗器にて構成する場合、かかる抵抗器
はｋΩのオーダの抵抗値を有することが好ましい。次
に、図８にて示されるプラズマディスプレイ装置を使用
して行われる本発明によるマトリクス方式プラズマディ
スプレイパネルの駆動方法について述べる。
=1-m）に対して、行電極駆動パルス発生回路１０ａは上
述の如く構成されている。なお、上記電流制限素子２０
ａ，２０ｂは、抵抗器にて構成する場合、かかる抵抗器
はｋΩのオーダの抵抗値を有することが好ましい。次
に、図８にて示されるプラズマディスプレイ装置を使用
して行われる本発明によるマトリクス方式プラズマディ
スプレイパネルの駆動方法について述べる。
【００３８】図９は、本発明の駆動方法の第４の実施例
にてパネル駆動を行う際にＰＤＰ１１に印加される各種
パルスの印加タイミングを示す図である。図９におい
て、先ず、行電極駆動パルス発生回路１０ａは、正電圧
の第１プライミングパルスＰＰx を全ての行電極Ｘ1 〜
Ｘn に印加すると同時に、負電圧の第１プライミングパ
ルスＰＰy を行電極Ｙ1 〜Ｙn の各々に印加する。この
時、スイッチＳＷＸ１，ＳＷＹ１の各々が閉成されて、
行電極Ｘi には電流制限素子２０ａを介して電位＋Ｖp1
が印加され、行電極Ｙi には電位−Ｖp1が電流制限素子
２０ｂを介して印加される。各行電極対間に印加された
電位＋Ｖp1と電位−Ｖp1とにて生成される電位差が放電
開始電圧を越えると、ＰＤＰ１１の全ての行電極対間に
放電が励起されて、全画素セルＰi,j の放電空間１１４
内に荷電粒子が発生する。第１プライミングパルスの印
加による放電の終息後、全画素セルの誘電体層１１１に
は一様に所定量の壁電荷が形成される（一斉プライミン
グ行程）。
にてパネル駆動を行う際にＰＤＰ１１に印加される各種
パルスの印加タイミングを示す図である。図９におい
て、先ず、行電極駆動パルス発生回路１０ａは、正電圧
の第１プライミングパルスＰＰx を全ての行電極Ｘ1 〜
Ｘn に印加すると同時に、負電圧の第１プライミングパ
ルスＰＰy を行電極Ｙ1 〜Ｙn の各々に印加する。この
時、スイッチＳＷＸ１，ＳＷＹ１の各々が閉成されて、
行電極Ｘi には電流制限素子２０ａを介して電位＋Ｖp1
が印加され、行電極Ｙi には電位−Ｖp1が電流制限素子
２０ｂを介して印加される。各行電極対間に印加された
電位＋Ｖp1と電位−Ｖp1とにて生成される電位差が放電
開始電圧を越えると、ＰＤＰ１１の全ての行電極対間に
放電が励起されて、全画素セルＰi,j の放電空間１１４
内に荷電粒子が発生する。第１プライミングパルスの印
加による放電の終息後、全画素セルの誘電体層１１１に
は一様に所定量の壁電荷が形成される（一斉プライミン
グ行程）。
【００３９】通常、パルス電圧の印加により生じたセル
の放電によって、セルは瞬時に発光し、その発光輝度は
放電によりセルを流れる放電電流量とほぼ線形関係を有
している。しかしながら、上記第１プライミングパルス
ＰＰx,ＰＰy による放電によってセルを流れる放電電流
は、セルに直列に接続された電流制限素子２０ａ，２０
ｂを流れるために、電流制限素子２０ａ，２０ｂによっ
てかなり小量に抑制される。
の放電によって、セルは瞬時に発光し、その発光輝度は
放電によりセルを流れる放電電流量とほぼ線形関係を有
している。しかしながら、上記第１プライミングパルス
ＰＰx,ＰＰy による放電によってセルを流れる放電電流
は、セルに直列に接続された電流制限素子２０ａ，２０
ｂを流れるために、電流制限素子２０ａ，２０ｂによっ
てかなり小量に抑制される。
【００４０】さらに、電流路Ｐｘ１，Ｐｙ１には電流制
限素子が直列に接続されているのでセルＰi,j は容量性
負荷を有している。故に、第１プライミングパルスＰＰ
x ，ＰＰy が電流路Ｐｘ１，Ｐｙ１に印加されたときに
行電極Ｘi ，Ｙi の各々に現れる電位変化は、図９に示
すように緩やかに立ち上がる波形を有する。このよう
に、第１プライミングパルスＰＰx ，ＰＰy によって行
電極Ｘi ，Ｙi の各々に現れる電位変化が緩やかな立ち
上がり波形を有するとともにセルを流れる放電電流量が
少ないことによって、セル内では緩やかに小量の電流が
流れるのみで画素セル内の放電エネルギー量が少なくな
り、よって放電空間１１４内に発生する荷電粒子量が抑
制される。従って、第１プライミングパルスの印加によ
る放電発光の輝度は、低減されて低くなり、プラズマデ
ィスプレイパネルにおけるコントラストを改善すること
ができる。
限素子が直列に接続されているのでセルＰi,j は容量性
負荷を有している。故に、第１プライミングパルスＰＰ
x ，ＰＰy が電流路Ｐｘ１，Ｐｙ１に印加されたときに
行電極Ｘi ，Ｙi の各々に現れる電位変化は、図９に示
すように緩やかに立ち上がる波形を有する。このよう
に、第１プライミングパルスＰＰx ，ＰＰy によって行
電極Ｘi ，Ｙi の各々に現れる電位変化が緩やかな立ち
上がり波形を有するとともにセルを流れる放電電流量が
少ないことによって、セル内では緩やかに小量の電流が
流れるのみで画素セル内の放電エネルギー量が少なくな
り、よって放電空間１１４内に発生する荷電粒子量が抑
制される。従って、第１プライミングパルスの印加によ
る放電発光の輝度は、低減されて低くなり、プラズマデ
ィスプレイパネルにおけるコントラストを改善すること
ができる。
【００４１】次に、画素データパルス発生回路１２は、
各行毎の画素データに対応した正電圧の画素データパル
スＤＰ1 〜ＤＰn を順次、列電極Ｄ1 〜Ｄm に印加す
る。この際、行電極駆動パルス発生回路１０ａは、上記
画素データパルスＤＰ1 〜ＤＰn の各印加タイミングに
同期して、小なるパルス幅の走査パルスＳＰを行電極Ｙ
1 〜Ｙn へ順次印加する。ここで、行電極駆動パルス発
生回路１０ａは、かかる走査パルスＳＰを各行電極Ｙ1
〜Ｙn の各々に印加する直前に、図９にて示されるが如
き正電圧の第２プライミングパルスＰＰを行電極Ｙ1 〜
Ｙn の各々に印加する。
各行毎の画素データに対応した正電圧の画素データパル
スＤＰ1 〜ＤＰn を順次、列電極Ｄ1 〜Ｄm に印加す
る。この際、行電極駆動パルス発生回路１０ａは、上記
画素データパルスＤＰ1 〜ＤＰn の各印加タイミングに
同期して、小なるパルス幅の走査パルスＳＰを行電極Ｙ
1 〜Ｙn へ順次印加する。ここで、行電極駆動パルス発
生回路１０ａは、かかる走査パルスＳＰを各行電極Ｙ1
〜Ｙn の各々に印加する直前に、図９にて示されるが如
き正電圧の第２プライミングパルスＰＰを行電極Ｙ1 〜
Ｙn の各々に印加する。
【００４２】かかる第２プライミングパルスＰＰの印加
により、上記一斉プライミングにて得られて時間経過と
共に減少してしまった荷電粒子が、放電空間１１４内に
再形成される。よって、放電空間１１４内に所望量の荷
電粒子が存在する内に、上記走査パルスＳＰの印加によ
る画素データ書き込みが為されるのである。例えば、画
素データの内容が論理「０」である場合には、走査パル
スＳＰと共に画素データパルスＤＰが同時印加されるの
で、画素セル内部に形成されている壁電荷は消滅する。
一方、画素データの内容が論理「１」である場合には、
走査パルスＳＰのみが印加されるので放電が生じず、そ
の画素セル内部に形成されている壁電荷はそのまま保持
される。つまり、かかる走査パルスＳＰとは、画素セル
内に形成されている壁電荷を画素データに応じて選択的
に消去せしめるためのトリガとなる選択消去パルスとい
えるのである（画素データ書込行程）。
により、上記一斉プライミングにて得られて時間経過と
共に減少してしまった荷電粒子が、放電空間１１４内に
再形成される。よって、放電空間１１４内に所望量の荷
電粒子が存在する内に、上記走査パルスＳＰの印加によ
る画素データ書き込みが為されるのである。例えば、画
素データの内容が論理「０」である場合には、走査パル
スＳＰと共に画素データパルスＤＰが同時印加されるの
で、画素セル内部に形成されている壁電荷は消滅する。
一方、画素データの内容が論理「１」である場合には、
走査パルスＳＰのみが印加されるので放電が生じず、そ
の画素セル内部に形成されている壁電荷はそのまま保持
される。つまり、かかる走査パルスＳＰとは、画素セル
内に形成されている壁電荷を画素データに応じて選択的
に消去せしめるためのトリガとなる選択消去パルスとい
えるのである（画素データ書込行程）。
【００４３】次に、行電極駆動パルス発生回路１０ａ
は、正電圧の維持パルスＩＰx を行電極Ｘ1 〜Ｘn の夫
々に印加する。次に、かかる維持パルスＩＰx の印加タ
イミングとは、ずれたタイミングにて正電圧の維持パル
スＩＰy を行電極Ｙ1 〜Ｙn の夫々に印加する。かかる
維持パルスが連続して行電極Ｘi,Ｙi に交互に印加され
ている期間にわたり、上記壁電荷が残留したままとなっ
ている画素セルのみが放電発光を維持する（維持放電行
程）。
は、正電圧の維持パルスＩＰx を行電極Ｘ1 〜Ｘn の夫
々に印加する。次に、かかる維持パルスＩＰx の印加タ
イミングとは、ずれたタイミングにて正電圧の維持パル
スＩＰy を行電極Ｙ1 〜Ｙn の夫々に印加する。かかる
維持パルスが連続して行電極Ｘi,Ｙi に交互に印加され
ている期間にわたり、上記壁電荷が残留したままとなっ
ている画素セルのみが放電発光を維持する（維持放電行
程）。
【００４４】なお、この維持放電行程において、最初
に、すなわち第１番目に行電極に印加される維持パルス
ＩＰx は、第２番目以降に印加される維持パルスＩＰy
、ＩＰx ・・・に比してパルス幅を長めに設定してあ
る。この理由を以下に説明する。画素データ及び走査パ
ルスによる画素セルへのデータの書き込みは、第１行目
から第ｎ行目まで順次行われるので、画素データが書き
込まれた後、維持放電行程に入るまでの時間が行毎に異
なる。従って、パネル全体において、例えば画素データ
の内容が壁電荷をセル内に維持する状態、すなわち論理
「１」であっても、行が異なると、セル内部に保持され
た壁電荷及び空間電荷の量が異なることがある。故に、
最初の維持パルスのパルス幅を長くして、第１回目の維
持パルスの印加により生成される電位差を通常よりも長
期に亘り行電極間に作用させることによって、一定の電
位差の下で第１回目の維持放電を完全に終息させて、放
電空間を含む画素セルに残留する電荷量をパネル全体に
亘り一様にするものである。第１回目の維持放電によ
り、セルの電荷量を画素データに応じてほぼ一定量に調
節することによって、パネル全体でむらのない画像表示
をなし得るものである。
に、すなわち第１番目に行電極に印加される維持パルス
ＩＰx は、第２番目以降に印加される維持パルスＩＰy
、ＩＰx ・・・に比してパルス幅を長めに設定してあ
る。この理由を以下に説明する。画素データ及び走査パ
ルスによる画素セルへのデータの書き込みは、第１行目
から第ｎ行目まで順次行われるので、画素データが書き
込まれた後、維持放電行程に入るまでの時間が行毎に異
なる。従って、パネル全体において、例えば画素データ
の内容が壁電荷をセル内に維持する状態、すなわち論理
「１」であっても、行が異なると、セル内部に保持され
た壁電荷及び空間電荷の量が異なることがある。故に、
最初の維持パルスのパルス幅を長くして、第１回目の維
持パルスの印加により生成される電位差を通常よりも長
期に亘り行電極間に作用させることによって、一定の電
位差の下で第１回目の維持放電を完全に終息させて、放
電空間を含む画素セルに残留する電荷量をパネル全体に
亘り一様にするものである。第１回目の維持放電によ
り、セルの電荷量を画素データに応じてほぼ一定量に調
節することによって、パネル全体でむらのない画像表示
をなし得るものである。
【００４５】次に、行電極駆動パルス発生回路１０ａ
は、消去パルスＥＰを行電極Ｘ1 〜Ｘn の夫々に印加す
ることにより、上記維持放電を停止せしめる（維持放電
停止行程）。以上の如く、かかるプラズマディスプレイ
パネルの駆動方法においては、全行電極に一斉に、立ち
上がりが緩やかな波形を有する第１プライミングパルス
を印加して一斉プライミングを実行し、維持放電行程に
おいては第１番目に行電極に印加する維持パルスのパル
ス幅を長く設定することによって、パネルを発光表示す
るようにしている。
は、消去パルスＥＰを行電極Ｘ1 〜Ｘn の夫々に印加す
ることにより、上記維持放電を停止せしめる（維持放電
停止行程）。以上の如く、かかるプラズマディスプレイ
パネルの駆動方法においては、全行電極に一斉に、立ち
上がりが緩やかな波形を有する第１プライミングパルス
を印加して一斉プライミングを実行し、維持放電行程に
おいては第１番目に行電極に印加する維持パルスのパル
ス幅を長く設定することによって、パネルを発光表示す
るようにしている。
【００４６】従って、第１プライミングパルスの波形が
立ち上がりを緩やかにすることによって、プライミング
パルス印加による画素セルの発光輝度を小さく抑えるこ
とができる。また、第１回目の維持パルス印加期間を長
くすることによって、セル内に存在する電荷量が画素デ
ータ毎にパネル全体でほぼ一様になるので、発光表示が
正確になされるのである。
立ち上がりを緩やかにすることによって、プライミング
パルス印加による画素セルの発光輝度を小さく抑えるこ
とができる。また、第１回目の維持パルス印加期間を長
くすることによって、セル内に存在する電荷量が画素デ
ータ毎にパネル全体でほぼ一様になるので、発光表示が
正確になされるのである。
【００４７】尚、上記第４実施例においては、Ｘ、Ｙな
る一対の行電極の片側の電極に正電圧の第２プライミン
グパルスＰＰ、続いて負電圧の走査パルスＳＰを夫々印
加して、これらを行毎にスキャンするようにしている
が、かかる構成に限定されるものではない。図１０及び
図１１は、本発明の第５及び第６の実施例による駆動パ
ルスの印加タイミングを示す図である。
る一対の行電極の片側の電極に正電圧の第２プライミン
グパルスＰＰ、続いて負電圧の走査パルスＳＰを夫々印
加して、これらを行毎にスキャンするようにしている
が、かかる構成に限定されるものではない。図１０及び
図１１は、本発明の第５及び第６の実施例による駆動パ
ルスの印加タイミングを示す図である。
【００４８】かかる図１０及び図１１の実施例において
は、Ｘ、Ｙなる一対の行電極の内、Ｘ電極に負電圧の第
２プライミングパルスＰＰ、続いてＹ電極に負電圧の走
査パルスＳＰを夫々印加してこれらを行毎にスキャンす
るようにしている。尚、図１１においては、画素データ
パルスＤＰ1 〜ＤＰn の印加による画素データ書き込み
が為されている期間にわたり、走査パルスＳＰを印加す
る方の電極、すなわち行電極Ｘを正電圧にオフセットす
るようにしている。
は、Ｘ、Ｙなる一対の行電極の内、Ｘ電極に負電圧の第
２プライミングパルスＰＰ、続いてＹ電極に負電圧の走
査パルスＳＰを夫々印加してこれらを行毎にスキャンす
るようにしている。尚、図１１においては、画素データ
パルスＤＰ1 〜ＤＰn の印加による画素データ書き込み
が為されている期間にわたり、走査パルスＳＰを印加す
る方の電極、すなわち行電極Ｘを正電圧にオフセットす
るようにしている。
【００４９】又、上記図５乃至図７と図９乃至図１１に
示す実施例においては、そのパルス幅が小なる走査パル
ス（選択消去パルス）を用いて、画素セル内に形成され
ている壁電荷を画素データに応じて選択的に消去して、
これにより画素データの書き込みを行うといういわゆる
選択消去方式に適用した実施例を示したが、選択書き込
み方式においても同様に適用できることは言うまでもな
い。
示す実施例においては、そのパルス幅が小なる走査パル
ス（選択消去パルス）を用いて、画素セル内に形成され
ている壁電荷を画素データに応じて選択的に消去して、
これにより画素データの書き込みを行うといういわゆる
選択消去方式に適用した実施例を示したが、選択書き込
み方式においても同様に適用できることは言うまでもな
い。
【００５０】尚、かかる選択書き込み方式の場合は、先
ず、パルス幅の小なる第２プライミングパルス印加によ
り放電せしめて全ての壁電荷を一旦消滅させると共に放
電空間１１４の荷電粒子の数を増大させるのである。か
かる動作により、各行毎に均一なプライミング効果が得
られる。次に、画素データ書込行程において、画素デー
タに応じて選択的に壁電荷が形成される。
ず、パルス幅の小なる第２プライミングパルス印加によ
り放電せしめて全ての壁電荷を一旦消滅させると共に放
電空間１１４の荷電粒子の数を増大させるのである。か
かる動作により、各行毎に均一なプライミング効果が得
られる。次に、画素データ書込行程において、画素デー
タに応じて選択的に壁電荷が形成される。
【００５１】
【発明の効果】以上の如く、本発明によるマトリクス方
式プラズマディスプレイパネルの駆動方法においては、
全行電極に一斉に第１プライミングパルスを印加して一
斉プライミングを実行した後に放電空間内の荷電粒子を
再形成させるための第２プライミングパルス、及び画素
データ書き込みのための走査パルスを連続印加して各行
毎に画素データの書き込みを行うようにしている。かか
る駆動方法によれば、全ての行において、各画素セルの
放電空間内に所望量の荷電粒子が存在する内に画素デー
タ書き込みが為されるので、画素データに対応した所望
電荷量の壁電荷を形成することが出来、正確な表示画像
を得ることが可能となる。
式プラズマディスプレイパネルの駆動方法においては、
全行電極に一斉に第１プライミングパルスを印加して一
斉プライミングを実行した後に放電空間内の荷電粒子を
再形成させるための第２プライミングパルス、及び画素
データ書き込みのための走査パルスを連続印加して各行
毎に画素データの書き込みを行うようにしている。かか
る駆動方法によれば、全ての行において、各画素セルの
放電空間内に所望量の荷電粒子が存在する内に画素デー
タ書き込みが為されるので、画素データに対応した所望
電荷量の壁電荷を形成することが出来、正確な表示画像
を得ることが可能となる。
【図１】マトリクス方式プラズマディスプレイパネルを
含むプラズマディスプレイ装置の概略構成を示す図であ
る。
含むプラズマディスプレイ装置の概略構成を示す図であ
る。
【図２】従来の駆動パルスの印加タイミングを示す図で
ある。
ある。
【図３】プラズマディスプレイ装置の構成を示す図であ
る。
る。
【図４】ＰＤＰ１１の構造を示す図である。
【図５】本発明の駆動方法による駆動パルスの印加タイ
ミングを示す図である。
ミングを示す図である。
【図６】本発明の第２の実施例による駆動パルスの印加
タイミングを示す図である。
タイミングを示す図である。
【図７】本発明の第３の実施例による駆動パルスの印加
タイミングを示す図である。
タイミングを示す図である。
【図８】プラズマディスプレイ装置の駆動装置の一部を
示す構成図である。
示す構成図である。
【図９】本発明の第４の実施例による駆動パルスの印加
タイミングを示す図である。
タイミングを示す図である。
【図１０】本発明の第５の実施例による駆動パルスの印
加タイミングを示す図である。
加タイミングを示す図である。
【図１１】本発明の第６の実施例による駆動パルスの印
加タイミングを示す図である。
加タイミングを示す図である。
１０ 行電極駆動パルス発生回路 １１ ＰＤＰ
Claims (7)
- 【請求項１】 ２本ずつ対となるように配列された複数
の行電極対と前記行電極対に直行する方向に配列され複
数の列電極とからなるマトリクス方式プラズマディスプ
レイパネルの駆動方法であって、 全ての前記行電極対に第１プライミングパルスを同時に
印加して前記行電極対間に放電を励起させる一斉プライ
ミング行程と、 前記行電極対の一方に第２プライミングパルスを印加し
て前記行電極対間に放電を励起せしめた直後に、走査パ
ルスを印加すると同時に前記列電極に画素データパルス
を印加して画素データの書き込みを行う画素データ書込
行程と、 前記行電極対に交互に維持パルスを印加して放電維持を
行う維持放電行程と、 前記行電極対の一方に消去パルスを印加して前記放電維
持を停止させる維持放電停止行程とからなることを特徴
とするマトリクス方式プラズマディスプレイパネルの駆
動方法。 - 【請求項２】 前記画素データ書込行程は、前記行電極
対の一方に第２プライミングパルスを印加して前記行電
極対間に放電を励起せしめた直後に、前記行電極対の他
方に走査パルスを印加すると同時に前記列電極に画素デ
ータパルスを印加して画素データの書き込みを行うこと
を特徴とする請求項１記載のマトリクス方式プラズマデ
ィスプレイパネルの駆動方法。 - 【請求項３】 前記第１プライミングパルスは、前記維
持パルスに比して立ち上がりが緩やかな波形を有するこ
とを特徴とする請求項１及び請求項２記載のマトリクス
方式プラズマディスプレイパネルの駆動方法。 - 【請求項４】 前記維持放電行程において、前記維持パ
ルスは前記プラズマディスプレイパネルの全行電極対に
同時に印加され、第１番目に印加される維持パルスは、
第２番目に印加される維持パルスよりもパルス幅が長い
ことをことを特徴とする請求項１乃至請求項３記載のマ
トリクス方式プラズマディスプレイパネルの駆動方法。 - 【請求項５】 ２本ずつ対となるように配列された複数
の行電極対と前記行電極対に直行する方向に配列され複
数の列電極とからなるマトリクス方式プラズマディスプ
レイパネルの駆動方法であって、 全ての前記行電極対の一方に正電圧の第１プライミング
パルスを印加すると同時に他方に負電圧の第１プライミ
ングパルスを印加して前記行電極対間に放電を励起させ
る初期化行程と、前記行電極対の一方に負電圧の第２プ
ライミングパルスを印加して前記行電極対間に放電を励
起せしめた直後に、前記行電極対の他方に負電圧の走査
パルスを印加すると同時に前記列電極に画素データパル
スを印加して画素データの書き込みを行う画素データ書
込行程と、前記行電極対に交互に正電圧の維持パルスを
印加して放電維持を行う維持放電行程と、前記行電極対
の他方に負電圧の消去パルスを印加して前記放電維持を
停止させる維持放電停止行程とからなり、 前記画素データ書込行程の実行中は前記行電極対の他方
の行電極が正電圧にオフセットされていることを特徴と
するマトリクス方式プラズマディスプレイパネルの駆動
方法。 - 【請求項６】 前記第１プライミングパルスは、前記維
持パルスに比して立ち上がりが緩やかな波形を有するこ
とを特徴とする請求項５記載のマトリクス方式プラズマ
ディスプレイパネルの駆動方法。 - 【請求項７】 前記維持放電行程において、前記維持パ
ルスは前記プラズマディスプレイパネルの全行電極対に
同時に印加され、第１番目に印加される維持パルスは、
第２番目に印加される維持パルスよりもパルス幅が長い
ことをことを特徴とする請求項５及び請求項６記載のマ
トリクス方式プラズマディスプレイパネルの駆動方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP05960096A JP3369395B2 (ja) | 1995-04-17 | 1996-03-15 | マトリクス方式プラズマディスプレイパネルの駆動方法 |
| US08/632,127 US5790087A (en) | 1995-04-17 | 1996-04-15 | Method for driving a matrix type of plasma display panel |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9097795 | 1995-04-17 | ||
| JP7-90977 | 1995-04-17 | ||
| JP05960096A JP3369395B2 (ja) | 1995-04-17 | 1996-03-15 | マトリクス方式プラズマディスプレイパネルの駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH096280A true JPH096280A (ja) | 1997-01-10 |
| JP3369395B2 JP3369395B2 (ja) | 2003-01-20 |
Family
ID=26400651
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP05960096A Expired - Fee Related JP3369395B2 (ja) | 1995-04-17 | 1996-03-15 | マトリクス方式プラズマディスプレイパネルの駆動方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5790087A (ja) |
| JP (1) | JP3369395B2 (ja) |
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6573878B1 (en) | 1999-01-14 | 2003-06-03 | Nec Corporation | Method of driving AC-discharge plasma display panel |
| US6597334B1 (en) | 1998-08-19 | 2003-07-22 | Nec Corporation | Driving method of plasma display panel |
| US6633268B2 (en) | 2001-02-13 | 2003-10-14 | Hitachi, Ltd. | AC-type plasma display apparatus |
| US6680718B2 (en) | 1998-11-20 | 2004-01-20 | Fujitsu Limited | Method for driving a gas-discharge panel |
| US6803888B1 (en) | 1999-03-31 | 2004-10-12 | Nec Corporation | Drive method and drive circuit for plasma display panel |
| US7009585B2 (en) | 1998-06-18 | 2006-03-07 | Fujitsu Limited | Method for driving plasma display panel |
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