JPH09197368A - 液晶表示素子駆動回路 - Google Patents
液晶表示素子駆動回路Info
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- JPH09197368A JPH09197368A JP391996A JP391996A JPH09197368A JP H09197368 A JPH09197368 A JP H09197368A JP 391996 A JP391996 A JP 391996A JP 391996 A JP391996 A JP 391996A JP H09197368 A JPH09197368 A JP H09197368A
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Abstract
(57)【要約】
【課題】 電源の安定化を行い、表示のにじみやむらを
抑え、コントラストアップが図る。 【解決手段】 液晶表示素子駆動回路において、電源供
給用ＩＣの第１抵抗素子Ｒ１、第１抵抗素子Ｒ１と第２
抵抗素子Ｒ２の両端に同一容量のコンデンサＣ１、Ｃ２
を並列接続し、第４抵抗素子と第５抵抗素子の両端、第
５抵抗素子にＣ３、Ｃ４を並列に接続しＣＰＵから表示
情報信号供給されているコモンドライバー及びセグメン
トドライバーに所望レベルの電圧を供給してなるもので
ある。
抑え、コントラストアップが図る。 【解決手段】 液晶表示素子駆動回路において、電源供
給用ＩＣの第１抵抗素子Ｒ１、第１抵抗素子Ｒ１と第２
抵抗素子Ｒ２の両端に同一容量のコンデンサＣ１、Ｃ２
を並列接続し、第４抵抗素子と第５抵抗素子の両端、第
５抵抗素子にＣ３、Ｃ４を並列に接続しＣＰＵから表示
情報信号供給されているコモンドライバー及びセグメン
トドライバーに所望レベルの電圧を供給してなるもので
ある。
Description
【０００１】
【発明の属する技術分野】本発明は、液晶表示素子駆動
回路に関し、特に電池等の小型電源で時分割にて液晶表
示を行う小型電子機器の液晶表示素子駆動回路に関する
ものである。
回路に関し、特に電池等の小型電源で時分割にて液晶表
示を行う小型電子機器の液晶表示素子駆動回路に関する
ものである。
【０００２】
【従来の技術】従来の液晶表示パネルにおける液晶表示
は、セグメント信号にコモン信号を液晶表示素子に加え
ることで、点灯／非点灯を選択し表示しているが、点灯
／非点灯の電位差は微妙であり、表示内容によっては液
晶表示駆動用ＩＣに多くの電流が流れ、電源供給用ＩＣ
からの供給電圧が変動すると、点灯／非点灯のバランス
が崩れ、コントラストが悪くなり、表示品位が落ちてし
まうことがあった。
は、セグメント信号にコモン信号を液晶表示素子に加え
ることで、点灯／非点灯を選択し表示しているが、点灯
／非点灯の電位差は微妙であり、表示内容によっては液
晶表示駆動用ＩＣに多くの電流が流れ、電源供給用ＩＣ
からの供給電圧が変動すると、点灯／非点灯のバランス
が崩れ、コントラストが悪くなり、表示品位が落ちてし
まうことがあった。
【０００３】上記のような従来技術の問題点を改善する
ため、例えば、特開昭６１−２３５８２１号公報に記載
されているように、上記した所謂電源供給用ＩＣの電源
電圧（第１電源）Ｖｄｄを分割する５つの直列に接続さ
れた抵抗素子の第１及び第２の抵抗素子の接続点と、第
４および第５の接続点との間にコンデンサ（１０）を、
また第２及び第３の抵抗素子の接続点と、第３及び第４
の抵抗素子の接続点との間にコンデンサ（１１）をそれ
ぞれ接続した技術が開示されている。
ため、例えば、特開昭６１−２３５８２１号公報に記載
されているように、上記した所謂電源供給用ＩＣの電源
電圧（第１電源）Ｖｄｄを分割する５つの直列に接続さ
れた抵抗素子の第１及び第２の抵抗素子の接続点と、第
４および第５の接続点との間にコンデンサ（１０）を、
また第２及び第３の抵抗素子の接続点と、第３及び第４
の抵抗素子の接続点との間にコンデンサ（１１）をそれ
ぞれ接続した技術が開示されている。
【０００４】
【発明が解決しようとする課題】上述した従来技術で
は、５つの抵抗素子が全て同じ値であればコンデンサ
（１０）には３／５Ｖｄｄの電圧が加えられ、コンデン
サ（１１）には１／５Ｖｄｄの電圧が加えられることに
なり、特に、コンデンサ（１０）にはコンデンサ（１
１）と比較して高い電圧に耐えるコンデンサが必要とな
り、コンデンサ（１１）よりも大きな容量のコンデンサ
が必要となってしまう問題がある。
は、５つの抵抗素子が全て同じ値であればコンデンサ
（１０）には３／５Ｖｄｄの電圧が加えられ、コンデン
サ（１１）には１／５Ｖｄｄの電圧が加えられることに
なり、特に、コンデンサ（１０）にはコンデンサ（１
１）と比較して高い電圧に耐えるコンデンサが必要とな
り、コンデンサ（１１）よりも大きな容量のコンデンサ
が必要となってしまう問題がある。
【０００５】さらに、通常不使用時に液晶に直流電圧が
かからないように電源を切ると同時にコンデンサの電荷
は放電されることになるため、電源投入時にコンデンサ
（１０）を充電するにはコンデンサ（１１）の時より多
くの電流が必要となる問題もある。
かからないように電源を切ると同時にコンデンサの電荷
は放電されることになるため、電源投入時にコンデンサ
（１０）を充電するにはコンデンサ（１１）の時より多
くの電流が必要となる問題もある。
【０００６】また、上述の従来技術のコンデンサの位置
では、第１および第２の抵抗素子の接続点と第４および
第５の抵抗素子の接続点間、並びに、第３の抵抗素子の
両端間の電圧安定が図れるのみである。
では、第１および第２の抵抗素子の接続点と第４および
第５の抵抗素子の接続点間、並びに、第３の抵抗素子の
両端間の電圧安定が図れるのみである。
【０００７】即ち、従来技術では、それぞれコンデンサ
としては容量の大きいものが要求され、コンデンサ自身
の外形が大きくなり、電子機器の小型化、製造コスト及
び省電力化に問題があった。
としては容量の大きいものが要求され、コンデンサ自身
の外形が大きくなり、電子機器の小型化、製造コスト及
び省電力化に問題があった。
【０００８】本発明は、液晶パネルに実際に与えられる
各々の電源間にコンデンサを挿入することにより、より
一層の電源の安定化が行え、表示のにじみやむらを抑
え、コントラストアップが図れることを目的とする。
各々の電源間にコンデンサを挿入することにより、より
一層の電源の安定化が行え、表示のにじみやむらを抑
え、コントラストアップが図れることを目的とする。
【０００９】また、本発明では、基準電位をＧＮＤとＶ
ｅｅの２つにしたことで、コンデンサへの印加電圧をよ
り少なくし、従って、必要とするコンデンサが低容量で
も整流効果を高めることができ、表示品位の確保が行え
るとともに、さらに、小型のコンデンサでよいため、電
子機器の小型化が実現できることを目的とする。
ｅｅの２つにしたことで、コンデンサへの印加電圧をよ
り少なくし、従って、必要とするコンデンサが低容量で
も整流効果を高めることができ、表示品位の確保が行え
るとともに、さらに、小型のコンデンサでよいため、電
子機器の小型化が実現できることを目的とする。
【００１０】
【課題を解決するための手段】本発明は上記課題の解決
を目的としてなされたもので、請求項１記載の発明で
は、少なくとも６種類のレベルの電圧を発生する電源供
給用ＩＣよりコモンドライバーおよびセグメントドライ
バーにそれぞれ所望の電圧を供給し、ＣＰＵより該コモ
ンドライバーおよびセグメントドライバーに表示情報信
号を供給し、該コモンドライバーより液晶表示パネルに
コモン信号を供給し該セグメントドライバーより該液晶
表示パネルにセグメント信号を供給する液晶表示素子駆
動回路において、上記電源供給用ＩＣの直列接続された
第１抵抗素子の両端子間、第１抵抗素子及び第２抵抗素
子とＶｅｅ間、第４抵抗素子及び第５抵抗素子とＧＮＤ
間、第５抵抗素子の両端子間にそれぞれ同一容量のコン
デンサを並列に接続し、上記コモンドライバーおよびセ
グメントドライバーに所望レベルの電圧を供給してなる
ものである。
を目的としてなされたもので、請求項１記載の発明で
は、少なくとも６種類のレベルの電圧を発生する電源供
給用ＩＣよりコモンドライバーおよびセグメントドライ
バーにそれぞれ所望の電圧を供給し、ＣＰＵより該コモ
ンドライバーおよびセグメントドライバーに表示情報信
号を供給し、該コモンドライバーより液晶表示パネルに
コモン信号を供給し該セグメントドライバーより該液晶
表示パネルにセグメント信号を供給する液晶表示素子駆
動回路において、上記電源供給用ＩＣの直列接続された
第１抵抗素子の両端子間、第１抵抗素子及び第２抵抗素
子とＶｅｅ間、第４抵抗素子及び第５抵抗素子とＧＮＤ
間、第５抵抗素子の両端子間にそれぞれ同一容量のコン
デンサを並列に接続し、上記コモンドライバーおよびセ
グメントドライバーに所望レベルの電圧を供給してなる
ものである。
【００１１】また、請求項２記載の発明では、液晶表示
素子駆動回路において、電源供給用ＩＣの直列接続され
た第１抵抗素子の両端子間、第２抵抗素子の両端子間、
第４抵抗素子の両端子間、第５抵抗素子の両端子間にそ
れぞれ同一容量のコンデンサを並列に接続し、コモンド
ライバーおよびセグメントドライバーに所望レベルの電
圧を供給してなるものである。
素子駆動回路において、電源供給用ＩＣの直列接続され
た第１抵抗素子の両端子間、第２抵抗素子の両端子間、
第４抵抗素子の両端子間、第５抵抗素子の両端子間にそ
れぞれ同一容量のコンデンサを並列に接続し、コモンド
ライバーおよびセグメントドライバーに所望レベルの電
圧を供給してなるものである。
【００１２】さらに、請求項３記載の発明では、抵抗素
子に接続されるコンデンサをセラミックコンデンサとし
たものである。
子に接続されるコンデンサをセラミックコンデンサとし
たものである。
【００１３】
【発明の実施の形態】以下、本発明を図をもとに詳細に
説明する。図１は、本発明の液晶表示素子駆動回路のブ
ロック図を示す。図１において、６レベルの電圧Ｖ１か
らＶ６を発生させる電源供給用ＩＣ１よりコモンドライ
バー２、及び、セグメントドライバー３に各々所望の電
源電圧を供給し、ＣＰＵ（中央演算処理装置）４より上
記コモンドライバー２及びセグメントドライバー３に表
示信号を供給する。
説明する。図１は、本発明の液晶表示素子駆動回路のブ
ロック図を示す。図１において、６レベルの電圧Ｖ１か
らＶ６を発生させる電源供給用ＩＣ１よりコモンドライ
バー２、及び、セグメントドライバー３に各々所望の電
源電圧を供給し、ＣＰＵ（中央演算処理装置）４より上
記コモンドライバー２及びセグメントドライバー３に表
示信号を供給する。
【００１４】上記コモンドライバー２で所望レベルの電
源電圧と表示情報信号とで表示波形を形成し、コモン信
号としてＬＣＤ（液晶表示パネル）５に供給し、また、
セグメントドライバー３で所望レベルの電源電圧と表示
情報信号とで表示波形を形成し、セグメント信号として
ＬＣＤ５に供給して、このＬＣＤ５に目的の文字等を表
示する。
源電圧と表示情報信号とで表示波形を形成し、コモン信
号としてＬＣＤ（液晶表示パネル）５に供給し、また、
セグメントドライバー３で所望レベルの電源電圧と表示
情報信号とで表示波形を形成し、セグメント信号として
ＬＣＤ５に供給して、このＬＣＤ５に目的の文字等を表
示する。
【００１５】図２は、請求項１の上記電源供給用ＩＣ１
の抵抗分割部分を示す回路図であり、電源電圧Ｖｅｅの
第１電源とＧＮＤ（アース）の第２電源間に、第１抵抗
素子Ｒ１ないし第５抵抗素子Ｒ５を順次直列接続し、各
抵抗素子Ｒ１ないしＲ５の接続点にコモン非選択レベル
電圧Ｖ２、セグメント非選択レベル電圧Ｖ３、セグメン
ト非選択レベル電圧Ｖ４、及びコモン非選択レベル電圧
Ｖ５を得る。
の抵抗分割部分を示す回路図であり、電源電圧Ｖｅｅの
第１電源とＧＮＤ（アース）の第２電源間に、第１抵抗
素子Ｒ１ないし第５抵抗素子Ｒ５を順次直列接続し、各
抵抗素子Ｒ１ないしＲ５の接続点にコモン非選択レベル
電圧Ｖ２、セグメント非選択レベル電圧Ｖ３、セグメン
ト非選択レベル電圧Ｖ４、及びコモン非選択レベル電圧
Ｖ５を得る。
【００１６】さらに、Ｖ１〜Ｖ６までの電圧を安定させ
る為に、１μＦ程度の平滑用セラミックコンデンサを上
記ＩＣ１の外付けとして第１抵抗素子Ｒ１と並列にＣ
１、第１抵抗素子Ｒ１と第２抵抗素子Ｒ２と並列にＣ
２、第４抵抗素子Ｒ４と第５抵抗素子Ｒ５と並列にＣ
３、および、第５抵抗素子Ｒ５と並列にＣ４を接続す
る。
る為に、１μＦ程度の平滑用セラミックコンデンサを上
記ＩＣ１の外付けとして第１抵抗素子Ｒ１と並列にＣ
１、第１抵抗素子Ｒ１と第２抵抗素子Ｒ２と並列にＣ
２、第４抵抗素子Ｒ４と第５抵抗素子Ｒ５と並列にＣ
３、および、第５抵抗素子Ｒ５と並列にＣ４を接続す
る。
【００１７】また、Ｃｄは入力電圧（電源電圧Ｖｅｅと
ＧＮＤ間）の安定化を計る為の平滑用セラミックコンデ
ンサである。
ＧＮＤ間）の安定化を計る為の平滑用セラミックコンデ
ンサである。
【００１８】図５はセラミックコンデンサのバイアス容
量特性を示すグラフである。
量特性を示すグラフである。
【００１９】このグラフからも明らかな通り、セラミッ
クコンデンサは印加される電圧が高くなる程、実質的な
容量が低下する特性を有している。
クコンデンサは印加される電圧が高くなる程、実質的な
容量が低下する特性を有している。
【００２０】図６は、請求項２の上記電源供給用ＩＣ１
の抵抗分割部分を示す回路図であり、電源電圧Ｖｅｅの
第１電源とＧＮＤ（アース）の第２電源間に、第１抵抗
素子Ｒ１ないし第５抵抗素子Ｒ５を順次直列接続し、各
抵抗素子Ｒ１ないしＲ５の接続点にコモン非選択レベル
電圧Ｖ２、セグメント非選択レベル電圧Ｖ３、セグメン
ト非選択レベル電圧Ｖ４、及びコモン非選択レベル電圧
Ｖ５を得ることは、図２の場合と同じである。
の抵抗分割部分を示す回路図であり、電源電圧Ｖｅｅの
第１電源とＧＮＤ（アース）の第２電源間に、第１抵抗
素子Ｒ１ないし第５抵抗素子Ｒ５を順次直列接続し、各
抵抗素子Ｒ１ないしＲ５の接続点にコモン非選択レベル
電圧Ｖ２、セグメント非選択レベル電圧Ｖ３、セグメン
ト非選択レベル電圧Ｖ４、及びコモン非選択レベル電圧
Ｖ５を得ることは、図２の場合と同じである。
【００２１】さらに、Ｖ１〜Ｖ６までの電圧を安定させ
る為に、１μＦ程度の平滑用セラミックコンデンサを上
記ＩＣ１の外付けとして第１抵抗素子Ｒ１と並列にＣ
１、第２抵抗素子Ｒ２と並列にＣ２、第４抵抗素子Ｒ４
と並列にＣ３、および、第５抵抗素子Ｒ５と並列にＣ４
を接続する。
る為に、１μＦ程度の平滑用セラミックコンデンサを上
記ＩＣ１の外付けとして第１抵抗素子Ｒ１と並列にＣ
１、第２抵抗素子Ｒ２と並列にＣ２、第４抵抗素子Ｒ４
と並列にＣ３、および、第５抵抗素子Ｒ５と並列にＣ４
を接続する。
【００２２】また、Ｃｄは入力電圧（電源電圧Ｖｅｅと
ＧＮＤ間）の安定化を計る為の平滑用セラミックコンデ
ンサである。
ＧＮＤ間）の安定化を計る為の平滑用セラミックコンデ
ンサである。
【００２３】図２、６の両方の構成において電源供給用
ＩＣ１に電圧安定用のコンデンサＣ１、Ｃ２、Ｃ３、お
よび、Ｃ４を挿入しない場合の各電圧波形、セグメント
信号波形、コモン信号波形及びＬＣＤ駆動波形を図３
に、また、コンデンサＣ１、Ｃ２、Ｃ３、および、Ｃ４
を挿入した場合の各電圧波形、セグメント信号波形、コ
モン信号波形及びＬＣＤ駆動波形を図４に示す。
ＩＣ１に電圧安定用のコンデンサＣ１、Ｃ２、Ｃ３、お
よび、Ｃ４を挿入しない場合の各電圧波形、セグメント
信号波形、コモン信号波形及びＬＣＤ駆動波形を図３
に、また、コンデンサＣ１、Ｃ２、Ｃ３、および、Ｃ４
を挿入した場合の各電圧波形、セグメント信号波形、コ
モン信号波形及びＬＣＤ駆動波形を図４に示す。
【００２４】図３のコンデンサが挿入されていない場合
の実験計測データであって、図３（ａ）は電源供給用の
ＩＣからコモンドライバー２、及び、セグメントドライ
バー３に供給される電圧Ｖ１ないしＶ６の波形であり、
電圧Ｖ２ないしＶ５は所望の電圧値を有しているがすべ
て脈流であり、電圧Ｖ６はアース電位の零（０）電圧で
ある。
の実験計測データであって、図３（ａ）は電源供給用の
ＩＣからコモンドライバー２、及び、セグメントドライ
バー３に供給される電圧Ｖ１ないしＶ６の波形であり、
電圧Ｖ２ないしＶ５は所望の電圧値を有しているがすべ
て脈流であり、電圧Ｖ６はアース電位の零（０）電圧で
ある。
【００２５】図３（ｂ）は、セグメント信号の波形であ
り、上記電圧Ｖ１、Ｖ３及びＶ４の電圧レベルに脈流が
混入している。
り、上記電圧Ｖ１、Ｖ３及びＶ４の電圧レベルに脈流が
混入している。
【００２６】図３（ｃ）は、コモン信号の波形であり、
上記電圧Ｖ１、Ｖ２、及び、Ｖ５の電圧レベルに脈流が
混入している。
上記電圧Ｖ１、Ｖ２、及び、Ｖ５の電圧レベルに脈流が
混入している。
【００２７】また、図３（ｄ）は、上記（ｂ）と（ｃ）
を合成した、液晶パネル５を駆動する駆動信号の波形で
あり、Ａ部では２２Ｖ−２０Ｖ間の電位差、Ｂ部では２
４Ｖ−０Ｖ間の電位差、Ｃ部では４Ｖ−２Ｖ間の電位差
が生じるが、変動した電圧となる。
を合成した、液晶パネル５を駆動する駆動信号の波形で
あり、Ａ部では２２Ｖ−２０Ｖ間の電位差、Ｂ部では２
４Ｖ−０Ｖ間の電位差、Ｃ部では４Ｖ−２Ｖ間の電位差
が生じるが、変動した電圧となる。
【００２８】上記ＬＣＤは、セグメント−コモン端子間
に加わる電圧によって点灯したり点灯しなかったりする
が、その電圧が脈流により変動し、非点灯時にもかかわ
らず、非点灯以上の電圧が加わることで薄く点灯する。
に加わる電圧によって点灯したり点灯しなかったりする
が、その電圧が脈流により変動し、非点灯時にもかかわ
らず、非点灯以上の電圧が加わることで薄く点灯する。
【００２９】なお、点灯、非点灯はセグメント波形によ
り選択され、セグメント波形の点線部が点灯時には波形
として加わることになる。
り選択され、セグメント波形の点線部が点灯時には波形
として加わることになる。
【００３０】上記脈流が混入するのは、電圧Ｖ１ないし
Ｖ６が供給されているコモンドライバー２及びセグメン
トドライバー３に接続されているＬＣＤ５の負荷に起因
するためである。
Ｖ６が供給されているコモンドライバー２及びセグメン
トドライバー３に接続されているＬＣＤ５の負荷に起因
するためである。
【００３１】このＬＣＤ５の負荷による影響を小さくす
るために、図２及び図６のごとく電圧安定用のコンデン
サＣ１、Ｃ２、Ｃ３及びＣ４を各々抵抗素子間に挿入す
る。
るために、図２及び図６のごとく電圧安定用のコンデン
サＣ１、Ｃ２、Ｃ３及びＣ４を各々抵抗素子間に挿入す
る。
【００３２】このコンデンサＣ１、Ｃ２、Ｃ３及びＣ４
がノイズを吸収することにより、脈流の混入を防止でき
る。
がノイズを吸収することにより、脈流の混入を防止でき
る。
【００３３】従って、図４の実験計測データが示すよう
に、コンデンサが挿入された場合においては、図４
（ａ）は上記と同様に電源供給ＩＣからコモンドライバ
ー２、及び、セグメントドライバー３に供給される電圧
Ｖ１ないしＶ６の波形であり、電圧Ｖ１ないしＶ５は脈
流のない所望の電圧値を得ることができる。
に、コンデンサが挿入された場合においては、図４
（ａ）は上記と同様に電源供給ＩＣからコモンドライバ
ー２、及び、セグメントドライバー３に供給される電圧
Ｖ１ないしＶ６の波形であり、電圧Ｖ１ないしＶ５は脈
流のない所望の電圧値を得ることができる。
【００３４】尚、電圧Ｖ６はアース電位の零（０）電圧
である。
である。
【００３５】図４（ｂ）は、セグメント信号の波形であ
り、特に、上記電圧Ｖ３及びＶ４の電圧レベルに脈流が
混入していない。
り、特に、上記電圧Ｖ３及びＶ４の電圧レベルに脈流が
混入していない。
【００３６】図４（ｃ）は、コモン信号の波形であり、
特に上記電圧Ｖ２、及びＶ５の電圧レベルには脈流が混
入していない。
特に上記電圧Ｖ２、及びＶ５の電圧レベルには脈流が混
入していない。
【００３７】また、図４（ｄ）は、上記（ｂ）と（ｃ）
を合成した、液晶パネル５を駆動する駆動信号の波形で
あり、Ｄ部では２２Ｖ−２０Ｖ間の電位差、Ｅ部では２
４Ｖ−０Ｖ間の電位差、Ｆ部では４Ｖ−２Ｖ間の電位差
が生じるが、変動のない電圧となる。
を合成した、液晶パネル５を駆動する駆動信号の波形で
あり、Ｄ部では２２Ｖ−２０Ｖ間の電位差、Ｅ部では２
４Ｖ−０Ｖ間の電位差、Ｆ部では４Ｖ−２Ｖ間の電位差
が生じるが、変動のない電圧となる。
【００３８】即ち、電源供給用ＩＣの第１抵抗素子Ｒ
１、第１抵抗素子Ｒ１と第２抵抗素子Ｒ２の両端に同一
容量のコンデンサＣ１とＣ２を並列接続し、第４抵抗素
子と第５抵抗素子の両端、第５抵抗素子にＣ３とＣ４と
を並列に接続した場合も、第１抵抗素子Ｒ１、第２抵抗
素子Ｒ２、第４抵抗素子Ｒ４、第５抵抗素子Ｒ５にそれ
ぞれ並列に同一容量のコンデンサＣ１、Ｃ２、Ｃ３、お
よび、Ｃ４を接続した場合も共に、第２抵抗素子Ｒ２、
第４抵抗素子Ｒ４にて発生する非点灯時に供給される電
位差を一定にすることが出来る。
１、第１抵抗素子Ｒ１と第２抵抗素子Ｒ２の両端に同一
容量のコンデンサＣ１とＣ２を並列接続し、第４抵抗素
子と第５抵抗素子の両端、第５抵抗素子にＣ３とＣ４と
を並列に接続した場合も、第１抵抗素子Ｒ１、第２抵抗
素子Ｒ２、第４抵抗素子Ｒ４、第５抵抗素子Ｒ５にそれ
ぞれ並列に同一容量のコンデンサＣ１、Ｃ２、Ｃ３、お
よび、Ｃ４を接続した場合も共に、第２抵抗素子Ｒ２、
第４抵抗素子Ｒ４にて発生する非点灯時に供給される電
位差を一定にすることが出来る。
【００３９】尚、液晶表示パネル５の点灯、非点灯はセ
グメント信号の波形で選択される。
グメント信号の波形で選択される。
【００４０】
【発明の効果】本発明において、請求項１記載の発明で
は、液晶パネルに実際に与えられる各々の電源間にコン
デンサを挿入することにより、より一層の電源の安定化
が行え、表示のにじみやむらを抑え、コントラストアッ
プが図れる。
は、液晶パネルに実際に与えられる各々の電源間にコン
デンサを挿入することにより、より一層の電源の安定化
が行え、表示のにじみやむらを抑え、コントラストアッ
プが図れる。
【００４１】また、請求項２記載の発明では、液晶パネ
ルに実際に与えられる各々の電源間にコンデンサを挿入
することにより、より一層の電源の安定化が行え、表示
のにじみやむらを抑え、コントラストアップが図れる。
ルに実際に与えられる各々の電源間にコンデンサを挿入
することにより、より一層の電源の安定化が行え、表示
のにじみやむらを抑え、コントラストアップが図れる。
【００４２】また、請求項３記載の発明では、印加され
る電圧が高くなる程実質的な静容量が低下するセラミッ
クコンデンサの特性（図５参照）を活用し、基準電位を
ＧＮＤとＶｅｅ（液晶電源電圧）に２つにすることで、
コンデンサの印加電圧をより少なくし、低容量にて整流
効果を高め、表示品位の確保を可能とする。
る電圧が高くなる程実質的な静容量が低下するセラミッ
クコンデンサの特性（図５参照）を活用し、基準電位を
ＧＮＤとＶｅｅ（液晶電源電圧）に２つにすることで、
コンデンサの印加電圧をより少なくし、低容量にて整流
効果を高め、表示品位の確保を可能とする。
【図１】本発明による液晶表示素子駆動回路の概略ブロ
ック図である。
ック図である。
【図２】本請求項１の回路における電源供給用ＩＣの抵
抗分割部分の回路図である。
抗分割部分の回路図である。
【図３】本回路において、電源供給用ＩＣに電圧安定用
のコンデンサを挿入しない場合のＬＣＤ駆動波形図であ
る。
のコンデンサを挿入しない場合のＬＣＤ駆動波形図であ
る。
【図４】本回路において、電源供給用ＩＣに電圧安定用
のコンデンサを挿入した場合のＬＣＤ駆動波形図であ
る。
のコンデンサを挿入した場合のＬＣＤ駆動波形図であ
る。
【図５】代表的なセラミックコンデンサの印加電圧に対
する実質的な静電容量の特性を示すグラフの図である。
する実質的な静電容量の特性を示すグラフの図である。
【図６】本請求項２の回路における電源供給用ＩＣの抵
抗分割部分の回路図である。
抗分割部分の回路図である。
１ 電源供給用ＩＣ ２ コモンドライバー ３ セグメントドライバー ４ ＣＰＵ（中央演算処理装置） ５ ＬＣＤ（液晶表示パネル）
Claims (3)
- 【請求項１】 電圧レベルの異なる２種の電源間に第１
ないし第５の抵抗素子を順次直列接続し、これら抵抗素
子の抵抗分割により前記２種の電源電圧を含め、少なく
とも６種類のレベルの電圧を発生する電源供給用ＩＣよ
りコモンドライバー及びセグメントドライバーにそれぞ
れ所望の電圧を供給し、ＣＰＵより前記コモンドライバ
ー及び前記セグメントドライバーに表示信号を供給し、
前記コモンドライバーより液晶表示パネルにコモン信号
を供給し、前記セグメントドライバーより液晶表示パネ
ルにセグメント信号を供給する液晶表示素子駆動回路に
おいて、 前記第１抵抗素子の両端、前記第１抵抗素子と前記第２
抵抗素子の両端、前記第４抵抗素子と前記第５抵抗素子
の両端、前記第５抵抗素子の両端にそれぞれコンデンサ
を並列に接続したことを特徴とする液晶表示素子駆動回
路。 - 【請求項２】 電圧レベルの異なる２種の電源間に第１
ないし第５の抵抗素子を順次直列接続し、これら抵抗素
子の抵抗分割により前記２種の電源電圧を含め、少なく
とも６種類のレベルの電圧を発生する電源供給用ＩＣよ
りコモンドライバー及びセグメントドライバーにそれぞ
れ所望の電圧を供給し、ＣＰＵより前記コモンドライバ
ー及び前記セグメントドライバーに表示信号を供給し、
前記コモンドライバーより液晶表示パネルにコモン信号
を供給し、前記セグメントドライバーより液晶表示パネ
ルにセグメント信号を供給する液晶表示素子駆動回路に
おいて、 前記第１抵抗素子の両端、前記第２抵抗素子の両端、前
記第４抵抗素子の両端、前記第５抵抗素子の両端にそれ
ぞれコンデンサを接続しとことを特徴とする液晶表示素
子駆動回路。 - 【請求項３】 前記抵抗素子の両端に接続されるコンデ
ンサが、セラミックコンデンサであることを特徴とする
請求項１または２記載の液晶表示素子駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP391996A JPH09197368A (ja) | 1996-01-12 | 1996-01-12 | 液晶表示素子駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP391996A JPH09197368A (ja) | 1996-01-12 | 1996-01-12 | 液晶表示素子駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09197368A true JPH09197368A (ja) | 1997-07-31 |
Family
ID=11570569
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP391996A Pending JPH09197368A (ja) | 1996-01-12 | 1996-01-12 | 液晶表示素子駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09197368A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001282193A (ja) * | 2000-03-29 | 2001-10-12 | Kyocera Corp | 液晶駆動用電圧発生回路および液晶表示装置 |
| JP2006313306A (ja) * | 2005-05-02 | 2006-11-16 | Samsung Sdi Co Ltd | ガンマ基準電圧発生回路，及びそれを備える平板表示装置 |
| US8659587B2 (en) | 2008-08-01 | 2014-02-25 | Liquavista, B.V. | Electrowetting system |
| US8791891B2 (en) | 2007-07-03 | 2014-07-29 | Liquavista B.V. | Electrowetting system and method for operating |
-
1996
- 1996-01-12 JP JP391996A patent/JPH09197368A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001282193A (ja) * | 2000-03-29 | 2001-10-12 | Kyocera Corp | 液晶駆動用電圧発生回路および液晶表示装置 |
| JP2006313306A (ja) * | 2005-05-02 | 2006-11-16 | Samsung Sdi Co Ltd | ガンマ基準電圧発生回路，及びそれを備える平板表示装置 |
| US7629950B2 (en) | 2005-05-02 | 2009-12-08 | Samsung Mobile Display Co., Ltd. | Gamma reference voltage generating circuit and flat panel display having the same |
| US8791891B2 (en) | 2007-07-03 | 2014-07-29 | Liquavista B.V. | Electrowetting system and method for operating |
| US9052501B2 (en) | 2007-07-03 | 2015-06-09 | Amazon Technologies, Inc. | Electrowetting system and method for operating |
| US8659587B2 (en) | 2008-08-01 | 2014-02-25 | Liquavista, B.V. | Electrowetting system |
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