JPH09154016A - シェーディング補正装置 - Google Patents
シェーディング補正装置Info
- Publication number
- JPH09154016A JPH09154016A JP7312873A JP31287395A JPH09154016A JP H09154016 A JPH09154016 A JP H09154016A JP 7312873 A JP7312873 A JP 7312873A JP 31287395 A JP31287395 A JP 31287395A JP H09154016 A JPH09154016 A JP H09154016A
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Abstract
(57)【要約】
【課題】 シェーディング補正装置において、画像信号
の黒側微調整のみならず白側微調整をも行って、読取り
画像全体の明るさを調整可能とする。 【解決手段】 入力画像信号ＰI のディジタル化に際し
てのＡ／Ｄ変換器２の白側基準レベルＶR として、白基
準プレート情報ＰW により得られた平均レベルＶREF に
対して、乗算器１１にて白側調整値Ｃ２を乗算したもの
を用いる。これにより、白側調整が線形的に可能とな
る。
の黒側微調整のみならず白側微調整をも行って、読取り
画像全体の明るさを調整可能とする。 【解決手段】 入力画像信号ＰI のディジタル化に際し
てのＡ／Ｄ変換器２の白側基準レベルＶR として、白基
準プレート情報ＰW により得られた平均レベルＶREF に
対して、乗算器１１にて白側調整値Ｃ２を乗算したもの
を用いる。これにより、白側調整が線形的に可能とな
る。
Description
【０００１】
【発明の属する技術分野】本発明はシェーディング補正
装置に関し、特に撮像素子から得られる画像情報に対し
てシェーディング補正処理をなすシェーディング補正装
置に関するものである。
装置に関し、特に撮像素子から得られる画像情報に対し
てシェーディング補正処理をなすシェーディング補正装
置に関するものである。
【０００２】
【従来の技術】新聞広告や白黒写真等を光学的に読取
り、これを電気信号に変換してホストコンピュータへ供
給するいわゆるスキャナ装置においては、原稿を忠実に
読取る機能に加えて、暗い原稿やピントボケの写真等も
高品質に仕上げなければならないために、電気的に補正
処理を行う必要があり、シェーディング機能が付加され
ている。
り、これを電気信号に変換してホストコンピュータへ供
給するいわゆるスキャナ装置においては、原稿を忠実に
読取る機能に加えて、暗い原稿やピントボケの写真等も
高品質に仕上げなければならないために、電気的に補正
処理を行う必要があり、シェーディング機能が付加され
ている。
【０００３】図４はシェーディング機能のブロック図で
あり、入力画像信号ＰI と前処理用の基準白プレート情
報ＰW とは２入力セレクタ１にて択一的に導出され、Ａ
／Ｄ変換器２のアナログ入力ＶI となる。このＡ／Ｄ変
換器２は基準入力ＶR へ入力されている基準レベル信号
ＶR を基準としてアナログ入力ＶI のディジタル変換を
行う。
あり、入力画像信号ＰI と前処理用の基準白プレート情
報ＰW とは２入力セレクタ１にて択一的に導出され、Ａ
／Ｄ変換器２のアナログ入力ＶI となる。このＡ／Ｄ変
換器２は基準入力ＶR へ入力されている基準レベル信号
ＶR を基準としてアナログ入力ＶI のディジタル変換を
行う。
【０００４】このディジタル出力ＶO は減算器３の一入
力となり、その他入力である黒側調整値（黒側ドリフト
成分）Ｃ１と減算される。この減算出力はセレクタ４に
より出力画像信号かまたは平均値回路５へ入力される。
力となり、その他入力である黒側調整値（黒側ドリフト
成分）Ｃ１と減算される。この減算出力はセレクタ４に
より出力画像信号かまたは平均値回路５へ入力される。
【０００５】平均値回路５では、入力画像の数ラインに
相当するディジタル信号ＶO の平均値を算出してメモリ
６へ一時記憶する。このメモリ６の出力である平均値は
Ｄ／Ａ変換器７にてアナログに変換され、ローパスフィ
ルタ（ＬＰＦ）８を介してセレクタ９の他入力となって
いる。
相当するディジタル信号ＶO の平均値を算出してメモリ
６へ一時記憶する。このメモリ６の出力である平均値は
Ｄ／Ａ変換器７にてアナログに変換され、ローパスフィ
ルタ（ＬＰＦ）８を介してセレクタ９の他入力となって
いる。
【０００６】ＣＰＵ１０はセレクタ１，４，９の各選択
信号Ｓ１，Ｓ２，Ｓ３を夫々生成すると共に、黒側調整
値Ｃ１をも生成するものである。
信号Ｓ１，Ｓ２，Ｓ３を夫々生成すると共に、黒側調整
値Ｃ１をも生成するものである。
【０００７】かかる構成において、先ず原稿を読取る前
に、Ａ／Ｄ変換器２の基準レベルＶR を決定するための
前処理が行われる。この場合、ＣＰＵ１０により、セレ
クタ１は基準白プレート情報ＰW を選択し、セレクタ４
は減算器３の出力を平均値回路５へ供給する様動作し、
またセレクタ９は基準レベルＶP を選択する様になる。
に、Ａ／Ｄ変換器２の基準レベルＶR を決定するための
前処理が行われる。この場合、ＣＰＵ１０により、セレ
クタ１は基準白プレート情報ＰW を選択し、セレクタ４
は減算器３の出力を平均値回路５へ供給する様動作し、
またセレクタ９は基準レベルＶP を選択する様になる。
【０００８】この状態において、基準白プレート情報Ｐ
W は基準レベルＶP を基準としてＡ／Ｄ変換器２にてデ
ィジタル化され、その出力ＶO はＣＰＵ１０から出力さ
れている黒側調整値Ｃ１と減算され黒ドリフト成分の補
正がなされる。この補正出力は平均値回路５へ入力さ
れ、複数ラインの平均値が算出されメモリ６へ記憶され
る。
W は基準レベルＶP を基準としてＡ／Ｄ変換器２にてデ
ィジタル化され、その出力ＶO はＣＰＵ１０から出力さ
れている黒側調整値Ｃ１と減算され黒ドリフト成分の補
正がなされる。この補正出力は平均値回路５へ入力さ
れ、複数ラインの平均値が算出されメモリ６へ記憶され
る。
【０００９】次に、原稿を読取るのであるが、この時に
は、セレクタ１は入力画像信号ＰIを選択し、セレクタ
４は減算器３の出力を出力画像信号として導出する様動
作し、またセレクタ９はＬＰＦ８の出力を選択する様、
ＣＰＵ１０により制御されることになる。
は、セレクタ１は入力画像信号ＰIを選択し、セレクタ
４は減算器３の出力を出力画像信号として導出する様動
作し、またセレクタ９はＬＰＦ８の出力を選択する様、
ＣＰＵ１０により制御されることになる。
【００１０】従って、読取り原稿の画像入力信号ＰI
は、Ａ／Ｄ変換器２において、メモリ６に記憶されてい
る、前処理時に算出された基準白プレート情報の黒側補
正後の平均値を基準としてディジタル化されることにな
り、結果としてシェーディング補正されたディジタル画
像信号が得られるようになる。
は、Ａ／Ｄ変換器２において、メモリ６に記憶されてい
る、前処理時に算出された基準白プレート情報の黒側補
正後の平均値を基準としてディジタル化されることにな
り、結果としてシェーディング補正されたディジタル画
像信号が得られるようになる。
【００１１】
【発明が解決しようとする課題】従来の図４に示したシ
ェーディング補正装置においては、画像信号の黒側補正
（微調整）を行ってはいるが、白側については何等微調
整を行っていない。従って、読取り画像全体の明るさを
調整できないという欠点がある。
ェーディング補正装置においては、画像信号の黒側補正
（微調整）を行ってはいるが、白側については何等微調
整を行っていない。従って、読取り画像全体の明るさを
調整できないという欠点がある。
【００１２】本発明の目的は、画像信号の黒側補正のみ
ならず白側補正を行うようにして、読取り画像の全体の
明るさを調整可能としたシェーディング補正装置を提供
することである。
ならず白側補正を行うようにして、読取り画像の全体の
明るさを調整可能としたシェーディング補正装置を提供
することである。
【００１３】
【課題を解決するための手段】本発明によれば、基準と
なる白レベル情報を、所定基準レベル情報を基準として
ディジタル変換し、このディジタル出力を黒側調整値に
より補正して白側基準情報を生成し、この生成された白
側基準情報を基準として読取り画像情報をディジタル変
換するようにしたシェーディグ補正装置であって、前記
白側基準情報に対して所定の白側調整値を乗算する乗算
手段を有し、この乗算出力を前記読取り画像情報のディ
ジタル変換の際の基準情報としたことを特徴とするシェ
ーディング補正装置が得られる。
なる白レベル情報を、所定基準レベル情報を基準として
ディジタル変換し、このディジタル出力を黒側調整値に
より補正して白側基準情報を生成し、この生成された白
側基準情報を基準として読取り画像情報をディジタル変
換するようにしたシェーディグ補正装置であって、前記
白側基準情報に対して所定の白側調整値を乗算する乗算
手段を有し、この乗算出力を前記読取り画像情報のディ
ジタル変換の際の基準情報としたことを特徴とするシェ
ーディング補正装置が得られる。
【００１４】
【発明の実施の形態】本発明の作用を述べる。本発明で
は、画像信号の白側を微調整する目的で基準白プレート
を読取り、数ライン分の平均をとった信号と白側の微調
整値Ｃ２との乗算を行う。微調整を乗算とすることでＡ
／Ｄ変換器の基準レベル端子に入力する白側基準信号を
線形に変換することになり、結果的に画像全体の明るさ
を調整することに相当する。
は、画像信号の白側を微調整する目的で基準白プレート
を読取り、数ライン分の平均をとった信号と白側の微調
整値Ｃ２との乗算を行う。微調整を乗算とすることでＡ
／Ｄ変換器の基準レベル端子に入力する白側基準信号を
線形に変換することになり、結果的に画像全体の明るさ
を調整することに相当する。
【００１５】以下、本発明について図面を用いて説明す
る。
る。
【００１６】図１は本発明の実施例のブロック図であ
り、図４と同等部分は同一符号により示されている。図
１において、図４と異なる部分についてのみ述べると、
メモリ６とＤ／Ａ変換器７との間に乗算器１１を設け、
この乗算器１１の一入力にメモリ６の出力を印加し、そ
の他入力にＣＰＵ１０から生成される白側調整値Ｃ２を
印加するものである。
り、図４と同等部分は同一符号により示されている。図
１において、図４と異なる部分についてのみ述べると、
メモリ６とＤ／Ａ変換器７との間に乗算器１１を設け、
この乗算器１１の一入力にメモリ６の出力を印加し、そ
の他入力にＣＰＵ１０から生成される白側調整値Ｃ２を
印加するものである。
【００１７】他の構成については図４の従来例のそれと
同等であるのでその説明は省略する。
同等であるのでその説明は省略する。
【００１８】図１において、前処理段階で得られた白基
準プレート入力ＰW を用いた、Ａ／Ｄ変換器２における
基準レベルＶR を生成する場合、メモリ６に記憶されて
いる数ライン分の平均値をＶREF とし、乗算器１１によ
る基準出力をＶREF ´として説明する。
準プレート入力ＰW を用いた、Ａ／Ｄ変換器２における
基準レベルＶR を生成する場合、メモリ６に記憶されて
いる数ライン分の平均値をＶREF とし、乗算器１１によ
る基準出力をＶREF ´として説明する。
【００１９】一般に、ｎビットのＡ／Ｄ変換器２の出力
ＶO は、入力電圧ＶI と基準電圧ＶR とを用いると、 ＶO ＝２n ×ＶI ／ＶR …（１） と表される。（１）式からも判る様に、ＶO はＶI ／Ｖ
R に比例しており、本発明ではこの原理を用いている。
ＶO は、入力電圧ＶI と基準電圧ＶR とを用いると、 ＶO ＝２n ×ＶI ／ＶR …（１） と表される。（１）式からも判る様に、ＶO はＶI ／Ｖ
R に比例しており、本発明ではこの原理を用いている。
【００２０】すなわち、原稿読取り時に、Ａ／Ｄ変換器
２の基準入力ＶR に入力される白側基準信号ＶR を微調
整する場合には、線形に調整することが必要になる。図
２は白側基準信号が白側調整値Ｃ２で変換される概念を
示したものである。
２の基準入力ＶR に入力される白側基準信号ＶR を微調
整する場合には、線形に調整することが必要になる。図
２は白側基準信号が白側調整値Ｃ２で変換される概念を
示したものである。
【００２１】図２を参照すると、メモリ６より読出され
たＶREF 上の任意の点をｔ０とすると、例えばＶREF ＝
Ｖ（ｔ０）にＣ２を加算した場合には、ＶREF の変化に
注目すると、 ＶREF ´／ＶREF ＝｛Ｖ（ｔ０）＋Ｃ２｝／Ｖ（ｔ０） となって、線形変換とはならない（図２（ａ）参照）。
たＶREF 上の任意の点をｔ０とすると、例えばＶREF ＝
Ｖ（ｔ０）にＣ２を加算した場合には、ＶREF の変化に
注目すると、 ＶREF ´／ＶREF ＝｛Ｖ（ｔ０）＋Ｃ２｝／Ｖ（ｔ０） となって、線形変換とはならない（図２（ａ）参照）。
【００２２】しかしながら、図１の如く乗算器１１を用
いると、 ＶREF ´／ＶREF ＝｛Ｖ（ｔ０）×Ｃ２｝／Ｖ（ｔ０） ＝Ｃ２ となり、ＶREF ´はＶREF を線形変換したことになる
（図２（ｂ）参照）。
いると、 ＶREF ´／ＶREF ＝｛Ｖ（ｔ０）×Ｃ２｝／Ｖ（ｔ０） ＝Ｃ２ となり、ＶREF ´はＶREF を線形変換したことになる
（図２（ｂ）参照）。
【００２３】このとき、Ａ／Ｄ変換器２の出力をＶO ´
とすると、 ＶO ´＝２n ×ＶI ／（ＶR ×Ｃ２） ＝（１／Ｃ２）×ＶO となり、最終的にＶO ´は白側調整値Ｃ２に反比例する
ことになる。
とすると、 ＶO ´＝２n ×ＶI ／（ＶR ×Ｃ２） ＝（１／Ｃ２）×ＶO となり、最終的にＶO ´は白側調整値Ｃ２に反比例する
ことになる。
【００２４】従って、０＜Ｃ２＜１に設定しておけば、
ＶO ´＞ＶO となり、Ａ／Ｄ変換器２の出力画像が引き
伸ばされたことになって、画像が全体的に明るくなるの
である。
ＶO ´＞ＶO となり、Ａ／Ｄ変換器２の出力画像が引き
伸ばされたことになって、画像が全体的に明るくなるの
である。
【００２５】乗算器１１の例としては、図３の構成のも
のを用いることもできる。すなわち、ＳＲＡＭ（スタテ
ィックＲＡＭ）１４を用いたＬＵＴ（ルックアップテー
ブル）構成とすることができる。例えば、０≦ＶREF ≦
１０２３である様なフェージング補正装置であるとする
と、先ず、ＣＰＵ１２からアドレスＡＤＲとして０〜１
０２３番地に、予め補正値Ｃ２と乗算した結果をバッフ
ァ１６を介してＳＲＡＭ１４内に書込んでおく。
のを用いることもできる。すなわち、ＳＲＡＭ（スタテ
ィックＲＡＭ）１４を用いたＬＵＴ（ルックアップテー
ブル）構成とすることができる。例えば、０≦ＶREF ≦
１０２３である様なフェージング補正装置であるとする
と、先ず、ＣＰＵ１２からアドレスＡＤＲとして０〜１
０２３番地に、予め補正値Ｃ２と乗算した結果をバッフ
ァ１６を介してＳＲＡＭ１４内に書込んでおく。
【００２６】実際に乗算器として使用する場合には、セ
レクタ１３にて入力ＶREF を選択してＳＲＡＭ１４のア
ドレスＡＤＲとすることで、ＳＲＡＭ１４から所望の乗
算結果がバッファ１５を介して出力されることになる。
レクタ１３にて入力ＶREF を選択してＳＲＡＭ１４のア
ドレスＡＤＲとすることで、ＳＲＡＭ１４から所望の乗
算結果がバッファ１５を介して出力されることになる。
【００２７】
【発明の効果】叙上の如く、本発明によれば、Ａ／Ｄ変
換器の基準入力である白側基準信号を線形変換すること
で、画像全体の明るさを調整することができるという効
果がある。
換器の基準入力である白側基準信号を線形変換すること
で、画像全体の明るさを調整することができるという効
果がある。
【図１】本発明の実施例のブロック図である。
【図２】白側基準信号が白側調整値Ｃ２で変換される概
念図である。
念図である。
【図３】乗算器の例を示す図である。
【図４】従来のフェージング補正装置の例を示す図であ
る。
る。
１，４，９ セレクタ ２ Ａ／Ｄ変換器 ３ 減算器 ５ 平均値回路 ６ メモリ ７ Ｄ／Ａ変換器 ８ ＬＰＦ １０ ＣＰＵ
Claims (3)
- 【請求項１】 基準となる白レベル情報を、所定基準レ
ベル情報を基準としてディジタル変換し、このディジタ
ル出力を黒側調整値により補正して白側基準情報を生成
し、この生成された白側基準情報を基準として読取り画
像情報をディジタル変換するようにしたシェーディグ補
正装置であって、前記白側基準情報に対して所定の白側
調整値を乗算する乗算手段を有し、この乗算出力を前記
読取り画像情報のディジタル変換の際の基準情報とした
ことを特徴とするシェーディング補正装置。 - 【請求項２】 前記ディジタル変換をなすＡ／Ｄ変換手
段と、このディジタル出力と前記黒側調整値との減算を
なす減算手段と、この減算出力の複数ラインに相当する
情報の平均値を算出して前記白側基準情報とする平均値
手段とを有し、この平均値を前記乗算手段の一入力とす
ることを特徴とする請求項１記載のシェーディング補正
装置。 - 【請求項３】 前記乗算手段は、前記白側基準情報の種
々の各値に対応して前記黒側調整値と対応白側基準情報
の値との乗算結果を予め格納した格納手段を有し、前記
白側基準情報をアドレス入力としてその格納内容を乗算
出力としたことを特徴とする請求項１または２記載のシ
ェーディング補正装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7312873A JPH09154016A (ja) | 1995-11-30 | 1995-11-30 | シェーディング補正装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7312873A JPH09154016A (ja) | 1995-11-30 | 1995-11-30 | シェーディング補正装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09154016A true JPH09154016A (ja) | 1997-06-10 |
Family
ID=18034474
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7312873A Withdrawn JPH09154016A (ja) | 1995-11-30 | 1995-11-30 | シェーディング補正装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09154016A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7027090B2 (en) | 2000-02-03 | 2006-04-11 | Matsushita Electric Industrial Co., Ltd. | Image input device |
-
1995
- 1995-11-30 JP JP7312873A patent/JPH09154016A/ja not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7027090B2 (en) | 2000-02-03 | 2006-04-11 | Matsushita Electric Industrial Co., Ltd. | Image input device |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20030204 |