JPH08203288A - オンボード書込制御装置 - Google Patents
オンボード書込制御装置Info
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- JPH08203288A JPH08203288A JP788095A JP788095A JPH08203288A JP H08203288 A JPH08203288 A JP H08203288A JP 788095 A JP788095 A JP 788095A JP 788095 A JP788095 A JP 788095A JP H08203288 A JPH08203288 A JP H08203288A
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- Japan
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- power supply
- board
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C16/00—Erasable programmable read-only memories
- G11C16/02—Erasable programmable read-only memories electrically programmable
- G11C16/06—Auxiliary circuits, e.g. for writing into memory
-
- G—PHYSICS
- G11—INFORMATION STORAGE
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- G11C16/00—Erasable programmable read-only memories
- G11C16/02—Erasable programmable read-only memories electrically programmable
- G11C16/06—Auxiliary circuits, e.g. for writing into memory
- G11C16/10—Programming or data input circuits
- G11C16/102—External programming circuits, e.g. EPROM programmers; In-circuit programming or reprogramming; EPROM emulators
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- G—PHYSICS
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- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
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- Microcomputers (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】
【目的】ユーザ基板の低コスト化および小型化ならびに
オンボード書込時の操作性改善を図る。 【構成】オンボード書込制御装置のインタフェース部分
を構成するオンボード書込治具１−８はレベル変換回路
１−２０を備え、ユーザ基板上のシステム電源１−４
は、ユーザ基板上の電源出力端子１−６及び電源入力端
子１−１８を介してレベル変換回路１−２０にシステム
電源電圧Ｖｄｄ１を供給している。フラッシュＥＥＰＲ
ＯＭを書き換える場合、ユーザ基板のインタフェース端
子１−５を介してフラッシュＥＥＰＲＯＭを制御するイ
ンタフェース信号の電圧レベルは、レベル変換回路１−
２０により、ユーザ基板上のシステム電源１−４に準じ
た電圧レベルにレベル変換されている。
オンボード書込時の操作性改善を図る。 【構成】オンボード書込制御装置のインタフェース部分
を構成するオンボード書込治具１−８はレベル変換回路
１−２０を備え、ユーザ基板上のシステム電源１−４
は、ユーザ基板上の電源出力端子１−６及び電源入力端
子１−１８を介してレベル変換回路１−２０にシステム
電源電圧Ｖｄｄ１を供給している。フラッシュＥＥＰＲ
ＯＭを書き換える場合、ユーザ基板のインタフェース端
子１−５を介してフラッシュＥＥＰＲＯＭを制御するイ
ンタフェース信号の電圧レベルは、レベル変換回路１−
２０により、ユーザ基板上のシステム電源１−４に準じ
た電圧レベルにレベル変換されている。
Description
【０００１】
【産業上の利用分野】本発明はオンボード書込制御装置
に関し、特に電気的に消去可能なプログラマブルリード
オンリメモリ内蔵のマイクロコンピュータを実装した基
板システムのオンボード書込制御装置に関する。
に関し、特に電気的に消去可能なプログラマブルリード
オンリメモリ内蔵のマイクロコンピュータを実装した基
板システムのオンボード書込制御装置に関する。
【０００２】
【従来の技術】紫外線による消去およびＰＲＯＭライタ
ーによる書込のためにユーザ基板から取り外す必要があ
ったＵＶＰＲＯＭと異なり、電気的に消去および書込可
能なフラッシュＥＥＰＲＯＭは、ユーザ基板に実装した
状態での消去および書込が可能になる。これにより、製
造ラインでのソフトバグ対応，出荷地別ソフト又は調整
データテーブルなどの書込，市場での緊急ソフト書換な
どが可能になり、試作機でソフトデバッグするときハン
ダ付け及び取り外し作業が不要になるなどの利点があ
る。
ーによる書込のためにユーザ基板から取り外す必要があ
ったＵＶＰＲＯＭと異なり、電気的に消去および書込可
能なフラッシュＥＥＰＲＯＭは、ユーザ基板に実装した
状態での消去および書込が可能になる。これにより、製
造ラインでのソフトバグ対応，出荷地別ソフト又は調整
データテーブルなどの書込，市場での緊急ソフト書換な
どが可能になり、試作機でソフトデバッグするときハン
ダ付け及び取り外し作業が不要になるなどの利点があ
る。
【０００３】オンボード書込制御装置は、ユーザ基板上
のマイクロコンピュータに内蔵されたフラッシュＥＥＰ
ＲＯＭを実装状態で書き換えるために用いられている。
たとえば、図３は従来のオンボード書込制御装置とユー
ザシステムとのインタフェース部を示すブロック図であ
る。
のマイクロコンピュータに内蔵されたフラッシュＥＥＰ
ＲＯＭを実装状態で書き換えるために用いられている。
たとえば、図３は従来のオンボード書込制御装置とユー
ザシステムとのインタフェース部を示すブロック図であ
る。
【０００４】図３を参照すると、ユーザシステムを構成
するユーザ基板３−１は、ＣＰＵ及びフラッシュＥＥＰ
ＲＯＭを内蔵したマイクロコンピュータ３−２，このマ
イクロコンピュタ３−１に制御されるユーザ制御ターゲ
ット部３−３，電源電圧Ｖｄｄ１を出力するシステム電
源３−４，フラッシュＥＥＰＲＯＭを書き換えるとき外
部インタフェース信号のレベルに合わせて電源入力端子
３−６に供給される電源電圧Ｖｄｄ２にマイクロコンピ
ュータのＶｄｄ電源端子の電源電圧を切り換えるスイッ
チ３−０などを備えている。
するユーザ基板３−１は、ＣＰＵ及びフラッシュＥＥＰ
ＲＯＭを内蔵したマイクロコンピュータ３−２，このマ
イクロコンピュタ３−１に制御されるユーザ制御ターゲ
ット部３−３，電源電圧Ｖｄｄ１を出力するシステム電
源３−４，フラッシュＥＥＰＲＯＭを書き換えるとき外
部インタフェース信号のレベルに合わせて電源入力端子
３−６に供給される電源電圧Ｖｄｄ２にマイクロコンピ
ュータのＶｄｄ電源端子の電源電圧を切り換えるスイッ
チ３−０などを備えている。
【０００５】ユーザ基板上でユーザシステムが動作中の
場合、マイクロコンピュータ３−２及びユーザ制御ター
ゲット部３−３はシステム電源３−４の電源電圧Ｖｄｄ
１で動作する。
場合、マイクロコンピュータ３−２及びユーザ制御ター
ゲット部３−３はシステム電源３−４の電源電圧Ｖｄｄ
１で動作する。
【０００６】ユーザ基板上のフラッシュＥＥＰＲＯＭを
書き換える場合、マイクロコンピュータのＶｄｄ電源端
子の電源電圧がスイッチ３−０により電源入力端子３−
６に供給される電源電圧Ｖｄｄ２に切り換えられる。
又、マイクロコンピュータ３−２のＶｐｐ電源端子の電
源電圧は電源入力端子３−７を介して供給されている。
このとき、フラッシュＥＥＰＲＯＭの消去モード，書込
モード及び読出モードの設定ならびにアドレスデータ，
書込データ及び読出データの入出力は、インタフェース
端子３−５を介してオンボード書込制御装置により制御
される。
書き換える場合、マイクロコンピュータのＶｄｄ電源端
子の電源電圧がスイッチ３−０により電源入力端子３−
６に供給される電源電圧Ｖｄｄ２に切り換えられる。
又、マイクロコンピュータ３−２のＶｐｐ電源端子の電
源電圧は電源入力端子３−７を介して供給されている。
このとき、フラッシュＥＥＰＲＯＭの消去モード，書込
モード及び読出モードの設定ならびにアドレスデータ，
書込データ及び読出データの入出力は、インタフェース
端子３−５を介してオンボード書込制御装置により制御
される。
【０００７】一方、オンボード書込制御装置のインタフ
ェース部分を構成するオンボード書込治具３−８は、イ
ンタフェース部３−９，コントロール部３−１０，メモ
リ３−１１，電源３−１３及び３−１２などを備えてい
る。
ェース部分を構成するオンボード書込治具３−８は、イ
ンタフェース部３−９，コントロール部３−１０，メモ
リ３−１１，電源３−１３及び３−１２などを備えてい
る。
【０００８】ここで、オンボード書込治具３−８内の電
源として使用されている電源３−１３は、電源出力端子
３−１８を介してユーザ基板に電源電圧Ｖｄｄ２を供給
している。又、電源３−１２は、電源出力端子３−１９
を介してユーザ基板に電源電圧Ｖｐｐを供給している。
源として使用されている電源３−１３は、電源出力端子
３−１８を介してユーザ基板に電源電圧Ｖｄｄ２を供給
している。又、電源３−１２は、電源出力端子３−１９
を介してユーザ基板に電源電圧Ｖｐｐを供給している。
【０００９】フラッシュＥＥＰＲＯＭを書き換える場
合、コントロール部３−１０が、ホストインタフェース
端子３−１４をもつインタフェース部３−９を介してホ
ストコンピュータとのインタフェース信号を送受信し、
メモリ３−１１を制御すると同時に、ユーザ基板のイン
タフェース端子３−５を介してフラッシュＥＥＰＲＯＭ
を制御し、書込モード及び読出モードの設定ならびにア
ドレスデータ，書込データ及び読出データの入出力を行
う。
合、コントロール部３−１０が、ホストインタフェース
端子３−１４をもつインタフェース部３−９を介してホ
ストコンピュータとのインタフェース信号を送受信し、
メモリ３−１１を制御すると同時に、ユーザ基板のイン
タフェース端子３−５を介してフラッシュＥＥＰＲＯＭ
を制御し、書込モード及び読出モードの設定ならびにア
ドレスデータ，書込データ及び読出データの入出力を行
う。
【００１０】
【発明が解決しようとする課題】最近、ハンディタイプ
の小型機器に実装するため、搭載ＩＣパッケージの小型
化および薄型化が要求されると共に、機器のシステム電
源電圧も２〜３ｖが主流となってきている。
の小型機器に実装するため、搭載ＩＣパッケージの小型
化および薄型化が要求されると共に、機器のシステム電
源電圧も２〜３ｖが主流となってきている。
【００１１】しかし、従来のオンボード書込制御装置で
は、フラッシュＥＥＰＲＯＭを実装状態で書き換えると
きに、フラッシュＥＥＰＲＯＭを内蔵するマイクロコン
ピュータ内部の電圧差によるラッチアップを防ぐため、
オンボード書込制御装置側からユーザ基板に出力するイ
ンタフェース信号の電圧に合わせた電源電圧を供給し、
ユーザ基板上でマイクロコンピュータの電源電圧として
システム電源電圧からスイッチ等で切り換えていた。
は、フラッシュＥＥＰＲＯＭを実装状態で書き換えると
きに、フラッシュＥＥＰＲＯＭを内蔵するマイクロコン
ピュータ内部の電圧差によるラッチアップを防ぐため、
オンボード書込制御装置側からユーザ基板に出力するイ
ンタフェース信号の電圧に合わせた電源電圧を供給し、
ユーザ基板上でマイクロコンピュータの電源電圧として
システム電源電圧からスイッチ等で切り換えていた。
【００１２】このため、ユーザ基板のスイッチ及び実装
面積増大によりコスト及び小型化にデメリットを招くの
みならず、オンボード書き込み時に、マイクロコンピュ
ータとユーザ制御ターゲット部との間の電圧差によりラ
ッチアップを発生させ、ユーザ基板を破損させる可能性
もあった。
面積増大によりコスト及び小型化にデメリットを招くの
みならず、オンボード書き込み時に、マイクロコンピュ
ータとユーザ制御ターゲット部との間の電圧差によりラ
ッチアップを発生させ、ユーザ基板を破損させる可能性
もあった。
【００１３】従って、本発明の目的は、ユーザ基板の低
コスト化および小型化ならびにオンボード書込時の操作
性改善を図ることにある。
コスト化および小型化ならびにオンボード書込時の操作
性改善を図ることにある。
【００１４】
【課題を解決するための手段】そのため、本発明による
オンボード書込制御装置は、ユーザ基板上のマイクロコ
ンピュータに内蔵されたフラッシュＥＥＰＲＯＭの書込
動作を制御するオンボード書込制御装置において、前記
ユーザ基板上のシステム電源電圧を入力する電源入力端
子と、前記フラッシュＥＥＰＲＯＭの書込動作を制御す
る各インタフェース信号の電圧レベルを前記電源入力端
子の電源電圧に準じた電圧レベルにレベル変換するレベ
ル変換回路とを備えている。
オンボード書込制御装置は、ユーザ基板上のマイクロコ
ンピュータに内蔵されたフラッシュＥＥＰＲＯＭの書込
動作を制御するオンボード書込制御装置において、前記
ユーザ基板上のシステム電源電圧を入力する電源入力端
子と、前記フラッシュＥＥＰＲＯＭの書込動作を制御す
る各インタフェース信号の電圧レベルを前記電源入力端
子の電源電圧に準じた電圧レベルにレベル変換するレベ
ル変換回路とを備えている。
【００１５】
【実施例】次に、本発明について図面を参照して説明す
る。
る。
【００１６】図１は、本発明のオンボード書込制御装置
の１実施例とユーザシステムとのインタフェース部を示
すブロック図である。
の１実施例とユーザシステムとのインタフェース部を示
すブロック図である。
【００１７】図１を参照すると、本実施例のオンボード
書込制御装置のインタフェース部分を構成するオンボー
ド書込治具１−８は、インタフェース部１−９，コント
ロール部１−１０，メモリ１−１１，電源１−１３及び
１−１２などに加えレベル変換回路１−２０を備えてい
る。
書込制御装置のインタフェース部分を構成するオンボー
ド書込治具１−８は、インタフェース部１−９，コント
ロール部１−１０，メモリ１−１１，電源１−１３及び
１−１２などに加えレベル変換回路１−２０を備えてい
る。
【００１８】ここで、Ｖｄｄ２電源１−１３は、オンボ
ード書込治具１−８内の電源として使用され、Ｖｐｐ電
源１−１２は、電源出力端子１−１９を介してユーザ基
板に電源電圧Ｖｐｐを供給している。又、ユーザ基板上
のシステム電源１−４は、ユーザ基板上の電源出力端子
１−６及び電源入力端子１−１８を介してレベル変換回
路１−２０にシステム電源電圧Ｖｄｄ１を供給してい
る。
ード書込治具１−８内の電源として使用され、Ｖｐｐ電
源１−１２は、電源出力端子１−１９を介してユーザ基
板に電源電圧Ｖｐｐを供給している。又、ユーザ基板上
のシステム電源１−４は、ユーザ基板上の電源出力端子
１−６及び電源入力端子１−１８を介してレベル変換回
路１−２０にシステム電源電圧Ｖｄｄ１を供給してい
る。
【００１９】フラッシュＥＥＰＲＯＭを書き換える場
合、コントロール部１−１０が、ホストインタフェース
端子１−１４をもつインタフェース部１−９を介してホ
ストコンピュータとのインタフェース信号を送受信し、
メモリ１−１１を制御すると同時に、レベル変換回路１
−２０，インタフェース端子１−１７及びユーザ基板の
インタフェース端子１−５を介してフラッシュＥＥＰＲ
ＯＭを制御し、書込モード及び読出モードの設定ならび
にアドレスデータ，書込データ及び読出データの入出力
を行う。
合、コントロール部１−１０が、ホストインタフェース
端子１−１４をもつインタフェース部１−９を介してホ
ストコンピュータとのインタフェース信号を送受信し、
メモリ１−１１を制御すると同時に、レベル変換回路１
−２０，インタフェース端子１−１７及びユーザ基板の
インタフェース端子１−５を介してフラッシュＥＥＰＲ
ＯＭを制御し、書込モード及び読出モードの設定ならび
にアドレスデータ，書込データ及び読出データの入出力
を行う。
【００２０】このとき、ユーザ基板のインタフェース端
子１−５を介してフラッシュＥＥＰＲＯＭを制御するイ
ンタフェース信号の電圧レベルは、レベル変換回路１−
２０により、ユーザ基板上のシステム電源１−４に準じ
た電圧レベルにレベル変換される。反対に、ユーザ基板
からオンボード書込制御装置へ出力された信号の電圧レ
ベルは、レベル変換回路１−２０により、オンボード書
込治具１−８内の電源として使用される電源１−１３に
準じた電圧レベルにレベル変換される。
子１−５を介してフラッシュＥＥＰＲＯＭを制御するイ
ンタフェース信号の電圧レベルは、レベル変換回路１−
２０により、ユーザ基板上のシステム電源１−４に準じ
た電圧レベルにレベル変換される。反対に、ユーザ基板
からオンボード書込制御装置へ出力された信号の電圧レ
ベルは、レベル変換回路１−２０により、オンボード書
込治具１−８内の電源として使用される電源１−１３に
準じた電圧レベルにレベル変換される。
【００２１】図２は、従来のレベル変換回路の１例を示
す回路図であり、図１のレベル変換回路１−２０におい
て、インタフェース信号の種類に応じて複数個使用され
る。
す回路図であり、図１のレベル変換回路１−２０におい
て、インタフェース信号の種類に応じて複数個使用され
る。
【００２２】たとえば、ユーザ基板のインタフェース端
子１−５を介してフラッシュＥＥＰＲＯＭを制御する信
号をレベル変換する場合、コントロール部１−１０から
出力される信号は入力端子２−１に入力される。電源端
子２−２に接続されたゲートは、入力端子２−１に入力
される信号を入力とするインバータであり、オンボード
書込治具１−８内の電源電圧Ｖｄｄ２を電源端子２−２
に供給することにより、入力信号と同振幅の反転信号を
出力する。
子１−５を介してフラッシュＥＥＰＲＯＭを制御する信
号をレベル変換する場合、コントロール部１−１０から
出力される信号は入力端子２−１に入力される。電源端
子２−２に接続されたゲートは、入力端子２−１に入力
される信号を入力とするインバータであり、オンボード
書込治具１−８内の電源電圧Ｖｄｄ２を電源端子２−２
に供給することにより、入力信号と同振幅の反転信号を
出力する。
【００２３】電源端子２−３及び２−４に接続されたゲ
ート回路は、入力端子２−１に入力される入力信号をセ
ット入力とし、その反転信号をリセット入力とするＲＳ
フリップフロップ回路である。ユーザ基板上のシステム
電源電圧Ｖｄｄ１を電源端子２−３及び２−４に供給す
ることにより、システム電源電圧Ｖｄｄ１まで振幅する
レベル変換された信号が出力端子２−５から出力され
る。
ート回路は、入力端子２−１に入力される入力信号をセ
ット入力とし、その反転信号をリセット入力とするＲＳ
フリップフロップ回路である。ユーザ基板上のシステム
電源電圧Ｖｄｄ１を電源端子２−３及び２−４に供給す
ることにより、システム電源電圧Ｖｄｄ１まで振幅する
レベル変換された信号が出力端子２−５から出力され
る。
【００２４】反対に、ユーザ基板からオンボード書込制
御装置へ出力された信号をレベル変換する場合、ユーザ
基板から出力された信号を入力端子２−１に入力し、電
源端子２−２にユーザ基板上のシステム電源電圧Ｖｄｄ
１を供給し、電源端子２−３及び２−４にオンボード書
込治具１−８内の電源電圧Ｖｄｄ２を供給することによ
り、電源電圧Ｖｄｄ２まで振幅するレベル変換された信
号が出力端子２−５から出力される。
御装置へ出力された信号をレベル変換する場合、ユーザ
基板から出力された信号を入力端子２−１に入力し、電
源端子２−２にユーザ基板上のシステム電源電圧Ｖｄｄ
１を供給し、電源端子２−３及び２−４にオンボード書
込治具１−８内の電源電圧Ｖｄｄ２を供給することによ
り、電源電圧Ｖｄｄ２まで振幅するレベル変換された信
号が出力端子２−５から出力される。
【００２５】その他のレベル変換回路、たとえば、入力
線および出力線が共通である双方向バス信号線に使用さ
れる３ステート出力バッファ回路などについては、図２
のレベル変換回路によりレベル変換された信号を入力と
する組み合わせ回路により構成することが出来る。
線および出力線が共通である双方向バス信号線に使用さ
れる３ステート出力バッファ回路などについては、図２
のレベル変換回路によりレベル変換された信号を入力と
する組み合わせ回路により構成することが出来る。
【００２６】これらのレベル変換回路を備えユーザ基板
上のシステム電源電圧が供給されるオンボード書込制御
装置により、ユーザ基板上のシステム電源電圧がオンボ
ード書込制御装置内の電源電圧に依存せず独立に設定可
能となった。
上のシステム電源電圧が供給されるオンボード書込制御
装置により、ユーザ基板上のシステム電源電圧がオンボ
ード書込制御装置内の電源電圧に依存せず独立に設定可
能となった。
【００２７】なお、本実施例ではマイクロコンピュータ
に内蔵されたフラッシュＥＥＰＲＯＭのオンボード書込
動作の制御について説明してきたが、マイクロコンピュ
ータに内蔵されないフラッシュＥＥＰＲＯＭ製品をユー
ザシステムに組み込んだ場合も、本発明のオンボード書
込制御装置を適用することは容易である。
に内蔵されたフラッシュＥＥＰＲＯＭのオンボード書込
動作の制御について説明してきたが、マイクロコンピュ
ータに内蔵されないフラッシュＥＥＰＲＯＭ製品をユー
ザシステムに組み込んだ場合も、本発明のオンボード書
込制御装置を適用することは容易である。
【００２８】
【発明の効果】以上説明したように、本発明によるオン
ボード書込制御装置は、フラッシュＥＥＰＲＯＭの書込
動作を制御する各インタフェース信号の電圧レベルをユ
ーザ基板上のシステム電源電圧に準じた電圧レベルにレ
ベル変換するレベル変換回路を備えているため、ユーザ
基板上のシステム電源電圧がオンボード書込制御装置内
の電源電圧に依存せず独立に設定可能となり、ユーザ基
板のスイッチ及び実装面積を削減することが出来る。
ボード書込制御装置は、フラッシュＥＥＰＲＯＭの書込
動作を制御する各インタフェース信号の電圧レベルをユ
ーザ基板上のシステム電源電圧に準じた電圧レベルにレ
ベル変換するレベル変換回路を備えているため、ユーザ
基板上のシステム電源電圧がオンボード書込制御装置内
の電源電圧に依存せず独立に設定可能となり、ユーザ基
板のスイッチ及び実装面積を削減することが出来る。
【００２９】また、オンボード書き込み時に、マイクロ
コンピュータとユーザ制御ターゲット部との間の電圧差
によるラッチアップ発生がなくなり、ユーザ基板の破損
を防ぐことが出来る等の効果がある。
コンピュータとユーザ制御ターゲット部との間の電圧差
によるラッチアップ発生がなくなり、ユーザ基板の破損
を防ぐことが出来る等の効果がある。
【図１】本発明のオンボード書込制御装置の１実施例と
ユーザシステムとのインタフェース部を示すブロック図
である。
ユーザシステムとのインタフェース部を示すブロック図
である。
【図２】図１で用いられる従来のレベル変換回路の１例
を示す回路図である。
を示す回路図である。
【図３】従来のオンボード書込制御装置の１例とユーザ
システムとのインタフェース部を示すブロック図であ
る。
システムとのインタフェース部を示すブロック図であ
る。
１−１，３−１ ユーザ基板 １−２，３−２ マイクロコンピュータ １−３，３−３ ユーザ制御ターゲット部 １−４，３−４ システム電源 １−５，１−１７，３−５，３−１７ インタフェー
ス端子 １−６，１−１５，１−１６，１−１９，３−１５，３
−１６，３−１８，３−１９ 電源出力端子 １−７，１−１８，３−６，３−７， 電源入力端子 １−８，３−８ オンボード書込治具 １−９，３−９ インタフェース部 １−１０，３−１０ コントロール部 １−１１，３−１１ メモリ １−１２，１−１３，３−１２，３−１３ 電源 １−１４，３−１４ ホストインタフェース端子 １−２０ レベル変換回路 ２−１ 入力端子 ２−２，２−３，２−４ 電源端子 ２−５ 出力端子 ３−０ スイッチ
ス端子 １−６，１−１５，１−１６，１−１９，３−１５，３
−１６，３−１８，３−１９ 電源出力端子 １−７，１−１８，３−６，３−７， 電源入力端子 １−８，３−８ オンボード書込治具 １−９，３−９ インタフェース部 １−１０，３−１０ コントロール部 １−１１，３−１１ メモリ １−１２，１−１３，３−１２，３−１３ 電源 １−１４，３−１４ ホストインタフェース端子 １−２０ レベル変換回路 ２−１ 入力端子 ２−２，２−３，２−４ 電源端子 ２−５ 出力端子 ３−０ スイッチ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 引地 博 神奈川県川崎市中原区小杉町一丁目403番 53 日本電気アイシーマイコンシステム株 式会社内
Claims (1)
- 【請求項１】 ユーザ基板上のマイクロコンピュータに
内蔵されたフラッシュＥＥＰＲＯＭの書込動作を制御す
るオンボード書込制御装置において、 前記ユーザ基板上のシステム電源電圧を入力する電源入
力端子と、前記フラッシュＥＥＰＲＯＭの書込動作を制
御する各インタフェース信号の電圧レベルを前記電源入
力端子の電源電圧に準じた電圧レベルにレベル変換する
レベル変換回路とを備えることを特徴とするオンボード
書込制御装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP788095A JPH08203288A (ja) | 1995-01-23 | 1995-01-23 | オンボード書込制御装置 |
| KR1019960001008A KR100233182B1 (ko) | 1995-01-23 | 1996-01-18 | 마이크로컴퓨터에 내장된 플래쉬 eeprom에 대한 기입장치 및 그 기입방법 |
| US08/589,909 US5694360A (en) | 1995-01-23 | 1996-01-23 | Write to flash EEPROM built in microcomputer |
| DE19602296A DE19602296C2 (de) | 1995-01-23 | 1996-01-23 | Schreibgerät für ein in einen Mikrocomputer eingebautes Flash-EEPROM |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP788095A JPH08203288A (ja) | 1995-01-23 | 1995-01-23 | オンボード書込制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
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