JPH0794957A - 線形特性補償回路 - Google Patents
線形特性補償回路Info
- Publication number
- JPH0794957A JPH0794957A JP25651893A JP25651893A JPH0794957A JP H0794957 A JPH0794957 A JP H0794957A JP 25651893 A JP25651893 A JP 25651893A JP 25651893 A JP25651893 A JP 25651893A JP H0794957 A JPH0794957 A JP H0794957A
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- JP
- Japan
- Prior art keywords
- output
- inverting amplifier
- input
- linear characteristic
- inv1
- Prior art date
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- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
- H03F1/34—Negative-feedback-circuit arrangements with or without positive feedback
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
- H03F1/32—Modifications of amplifiers to reduce non-linear distortion
Abstract
(57)【要約】
【目的】 省電力であるとともに入出力特性を線形性を
補償できかつ、LSI内で実現可能な線形特性補償回路
を提供することを目的とする。 【構成】 奇数段の直列な反転増幅回路と、最終段の反
転増幅回路の出力を初段反転増幅回路の入力にフィード
バックするフィードバックキャパシタンスとによって、
高精度の線形入出力特性を保証し、かつローパス特性の
キャパシタンスおよび一対の平衡レジスタンスとによっ
て発振を抑制するものである。
補償できかつ、LSI内で実現可能な線形特性補償回路
を提供することを目的とする。 【構成】 奇数段の直列な反転増幅回路と、最終段の反
転増幅回路の出力を初段反転増幅回路の入力にフィード
バックするフィードバックキャパシタンスとによって、
高精度の線形入出力特性を保証し、かつローパス特性の
キャパシタンスおよび一対の平衡レジスタンスとによっ
て発振を抑制するものである。
Description
【0001】
【産業上の利用分野】本発明は線形特性補償回路に係
り、特にLSI内においてアナログ電圧入力のレベルを
補償するための線形特性補償回路に関する。
り、特にLSI内においてアナログ電圧入力のレベルを
補償するための線形特性補償回路に関する。
【0002】
【従来技術】コンピュータ科学におけるデジタル技術
は、微細加工技術の進歩にともなって著しい発展を遂げ
てきたが、その設備投資金額は加速度的に増加しつつあ
り、現在アナログ技術が注目されている。そしてアナロ
グデータの形態としては、省電力特性を考慮すれば電圧
であることが好ましく、また出力側の負荷にかかわらず
そのレベルを補償し得る回路をLSI内で実現する必要
がある。
は、微細加工技術の進歩にともなって著しい発展を遂げ
てきたが、その設備投資金額は加速度的に増加しつつあ
り、現在アナログ技術が注目されている。そしてアナロ
グデータの形態としては、省電力特性を考慮すれば電圧
であることが好ましく、また出力側の負荷にかかわらず
そのレベルを補償し得る回路をLSI内で実現する必要
がある。
【0003】
【発明が解決しようとする課題】本発明はこのような従
来のニーズに鑑み創案されたもので、省電力であるとと
もに入出力特性を線形性を補償できかつ、LSI内で実
現可能な線形特性補償回路を提供することを目的とす
る。
来のニーズに鑑み創案されたもので、省電力であるとと
もに入出力特性を線形性を補償できかつ、LSI内で実
現可能な線形特性補償回路を提供することを目的とす
る。
【0004】
【課題を解決するための手段】本発明に係る線形特性補
償回路は、奇数段の直列な反転増幅回路と、最終段の反
転増幅回路の出力を初段反転増幅回路の入力にフィード
バックするフィードバックキャパシタンスとによって、
高精度の線形入出力特性を保証し、かつローパス特性の
キャパシタンスおよび一対の平衡レジスタンスとによっ
て発振を抑制するものである。
償回路は、奇数段の直列な反転増幅回路と、最終段の反
転増幅回路の出力を初段反転増幅回路の入力にフィード
バックするフィードバックキャパシタンスとによって、
高精度の線形入出力特性を保証し、かつローパス特性の
キャパシタンスおよび一対の平衡レジスタンスとによっ
て発振を抑制するものである。
【0005】
【実施例】次にこの発明に係る線形特性補償回路の1実
施例を図面に基づいて説明する。図1において、線形特
性補償回路CIRは直列に接続された3段のインバータ
INV1〜INV3を有し、最終段のインバータINV
3の出力はフィードバックキャパシタンスCfを介して
初段インバータINV1の入力に接続されている。この
ような構成により、INV3の後段の負荷にかかわら
ず、INV1の入力側に接続された入力電圧Vinに等
しい出力電圧VoutがINV3の出力に生じ、その精
度は良好である。ここに入力電圧Vinは入力キャパシ
タンスC1を介してINV1に接続され、電流の発生を
最小限に抑えている。
施例を図面に基づいて説明する。図1において、線形特
性補償回路CIRは直列に接続された3段のインバータ
INV1〜INV3を有し、最終段のインバータINV
3の出力はフィードバックキャパシタンスCfを介して
初段インバータINV1の入力に接続されている。この
ような構成により、INV3の後段の負荷にかかわら
ず、INV1の入力側に接続された入力電圧Vinに等
しい出力電圧VoutがINV3の出力に生じ、その精
度は良好である。ここに入力電圧Vinは入力キャパシ
タンスC1を介してINV1に接続され、電流の発生を
最小限に抑えている。
【0006】一般にLSI内で形成されるインバータは
極めて微小であるため、その出力の遅延がわずかであ
り、比較的低い動作周波数で発振する。そこで、図1に
おいては、最終段インバータINV1の出力をローパス
特性のキャパシタンスCLを介してグランドに接続して
いる。図3はCIRのゲインを、CLを設けない場合
(実線)と設けた場合(破線)について示している。C
Lを設けたことにより、CIRのゲインは高周波領域で
低下する。
極めて微小であるため、その出力の遅延がわずかであ
り、比較的低い動作周波数で発振する。そこで、図1に
おいては、最終段インバータINV1の出力をローパス
特性のキャパシタンスCLを介してグランドに接続して
いる。図3はCIRのゲインを、CLを設けない場合
(実線)と設けた場合(破線)について示している。C
Lを設けたことにより、CIRのゲインは高周波領域で
低下する。
【0007】さらに、CIRには、第2段インバータI
NV2の出力に、一対のレジスタンスRよりなる平衡レ
ジスタンスが接続されている。一方のレジスタンスRは
一端子がINV2の出力に接続されるとともに他端子が
電源に接続されている。また他のレジスタンスは一端子
がINV2の出力に接続されるとともに他端子が接地さ
れている。接地されたレジスタンスRはINV2のオー
プンゲインを低下させ、CIR全体のゲインに対して、
図3の一点鎖線のように全体的にレベルを低下させる。
前記CLおよびこの平衡レジスタンスによって、位相余
裕およびゲイン余裕が確保され、高い周波数領域まで発
振が防止される。
NV2の出力に、一対のレジスタンスRよりなる平衡レ
ジスタンスが接続されている。一方のレジスタンスRは
一端子がINV2の出力に接続されるとともに他端子が
電源に接続されている。また他のレジスタンスは一端子
がINV2の出力に接続されるとともに他端子が接地さ
れている。接地されたレジスタンスRはINV2のオー
プンゲインを低下させ、CIR全体のゲインに対して、
図3の一点鎖線のように全体的にレベルを低下させる。
前記CLおよびこの平衡レジスタンスによって、位相余
裕およびゲイン余裕が確保され、高い周波数領域まで発
振が防止される。
【0008】ここに理論的にはいずれか一方によって発
振を防止することも可能であるが、CLのみの場合には
CLの容量が極めて大きくなり、また平衡レジスタンス
のみの場合には線形特性が劣化するという問題がある。
また一方のレジスタンスRを電源に接続することによっ
て、インバータINV2を構成するpMOSおよびnM
OS両者を流れる電流のバランスが確保され、これらM
OSに対する負荷が軽減される。
振を防止することも可能であるが、CLのみの場合には
CLの容量が極めて大きくなり、また平衡レジスタンス
のみの場合には線形特性が劣化するという問題がある。
また一方のレジスタンスRを電源に接続することによっ
て、インバータINV2を構成するpMOSおよびnM
OS両者を流れる電流のバランスが確保され、これらM
OSに対する負荷が軽減される。
【0009】以上のように、レジスタンスによるゲイン
抑制を行いつつキャパシタンスによるローパス特性を用
いれば、LSI内において、高精度の線形特性を補償し
つつ発振を防止し得る。なお、レジスタンスRを初段イ
ンバータINV1の出力に接続することによってもほぼ
同様の効果を得ることができる。また奇数段のインバー
タを使用すると反転出力が生じることになるが、図2に
示すように、前記CIRと同様の2個の回路CIR1、
CIR2を直列に用いれば、非反転出力が得られる。
抑制を行いつつキャパシタンスによるローパス特性を用
いれば、LSI内において、高精度の線形特性を補償し
つつ発振を防止し得る。なお、レジスタンスRを初段イ
ンバータINV1の出力に接続することによってもほぼ
同様の効果を得ることができる。また奇数段のインバー
タを使用すると反転出力が生じることになるが、図2に
示すように、前記CIRと同様の2個の回路CIR1、
CIR2を直列に用いれば、非反転出力が得られる。
【0010】
【発明の効果】本発明に係る線形特性補償回路は、奇数
段の直列な反転増幅回路と、最終段の反転増幅回路の出
力を初段反転増幅回路の入力にフィードバックするフィ
ードバックキャパシタンスとによって、高精度の線形入
出力特性を保証し、かつローパス特性のキャパシタンス
および一対の平衡レジスタンスとによって発振を抑制す
るので、、省電力であるとともに入出力特性の線形性を
補償できかつ、LSI内で実現可能であるという優れた
効果を有する。
段の直列な反転増幅回路と、最終段の反転増幅回路の出
力を初段反転増幅回路の入力にフィードバックするフィ
ードバックキャパシタンスとによって、高精度の線形入
出力特性を保証し、かつローパス特性のキャパシタンス
および一対の平衡レジスタンスとによって発振を抑制す
るので、、省電力であるとともに入出力特性の線形性を
補償できかつ、LSI内で実現可能であるという優れた
効果を有する。
【図1】本発明に係る線形特性補償回路の1実施例を示
す回路図である。
す回路図である。
【図2】同実施例のゲイン特性を示すグラフである。
【図3】図1の実施例を組合せた実施例を示す回路図で
ある。
ある。
CIR 線形特性補償回路 INV1〜INV6 インバータ Cf フィードバックキャパシタンス Vin 入力電圧 Vout 出力電圧 C1 キャパシタンス CL ローパス性のキャパシタンス R レジスタンス
───────────────────────────────────────────────────── フロントページの続き (72)発明者 大澤 庶 東京都世田谷区北沢3−5−18 鷹山ビル 株式会社鷹山内 (72)発明者 漆畑 晶 東京都世田谷区北沢3−5−18 鷹山ビル 株式会社鷹山内
Claims (5)
- 【請求項1】 奇数段の直列な反転増幅回路と、最終段
の反転増幅回路の出力を初段反転増幅回路の入力にフィ
ードバックするフィードバックキャパシタンスと、最終
段の反転増幅回路の出力に第1端子が接続されかつ第2
端子が接地されたローパス特性のキャパシタンスと、初
段より後で最終段より前の反転増幅器の出力に第1端子
が接続され第2端子が接地されたレジスタンスとを備え
た線形特性補償回路。 - 【請求項2】 レジスタンスの第1端子には、第2のレ
ジスタンスがその第1端子で接続され、その第2端子が
電源に接続されることによって平衡レジスタンスが構成
されていることを特徴とする請求項1記載の線形特性補
償回路。 - 【請求項3】 反転増幅回路の段数は3段であることを
特徴とする請求項1記載の線形特性補償回路。 - 【請求項4】 平衡レジスタンスは最終段より1段前の
反転増幅回路の出力に接続されていることを特徴とする
請求項1記載の線形特性補償回路。 - 【請求項5】 請求項1記載の線形特性補償回路の後段
に同一構成の線形特性補償回路を接続してなる線形特性
補償回路。
Priority Applications (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25651893A JPH0794957A (ja) | 1993-09-20 | 1993-09-20 | 線形特性補償回路 |
US08/262,059 US5666080A (en) | 1993-06-17 | 1994-06-17 | Computational circuit |
CN94115394A CN1117172A (zh) | 1993-06-17 | 1994-09-16 | 计算电路 |
US08/467,827 US5568080A (en) | 1993-06-17 | 1995-06-06 | Computational circuit |
US08/468,762 US5617053A (en) | 1993-06-17 | 1995-06-06 | Computational circuit |
US08/487,154 US5563544A (en) | 1993-06-17 | 1995-06-07 | Computational circuit |
US08/766,875 US5774008A (en) | 1993-04-01 | 1996-12-13 | Computational circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25651893A JPH0794957A (ja) | 1993-09-20 | 1993-09-20 | 線形特性補償回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0794957A true JPH0794957A (ja) | 1995-04-07 |
Family
ID=17293744
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP25651893A Pending JPH0794957A (ja) | 1993-04-01 | 1993-09-20 | 線形特性補償回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0794957A (ja) |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0741366A2 (en) * | 1995-04-26 | 1996-11-06 | Yozan Inc. | Multiplication circuit |
EP0746093A1 (en) * | 1995-05-30 | 1996-12-04 | Sharp Kabushiki Kaisha | Operational amplifier |
EP0797303A3 (en) * | 1996-03-19 | 1998-01-07 | Sharp Kabushiki Kaisha | Inverter circuit and amplifier |
US5737368A (en) * | 1995-09-18 | 1998-04-07 | Sharp Kabushiki Kaisha | Matched filter |
US5751624A (en) * | 1995-09-20 | 1998-05-12 | Sharp Kabushiki Kaisha | Complex number calculation circuit |
US5783961A (en) * | 1995-12-12 | 1998-07-21 | Sharp Kabushiki Kaisha | Inverted amplifying circuit |
US5936463A (en) * | 1996-05-21 | 1999-08-10 | Yozan Inc. | Inverted amplifying circuit |
US5960033A (en) * | 1996-04-02 | 1999-09-28 | Sharp Kabushiki Kaisha | Matched filter |
-
1993
- 1993-09-20 JP JP25651893A patent/JPH0794957A/ja active Pending
Cited By (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0741366A2 (en) * | 1995-04-26 | 1996-11-06 | Yozan Inc. | Multiplication circuit |
EP0741366A3 (en) * | 1995-04-26 | 1998-08-26 | Yozan Inc. | Multiplication circuit |
EP0746093A1 (en) * | 1995-05-30 | 1996-12-04 | Sharp Kabushiki Kaisha | Operational amplifier |
US5737368A (en) * | 1995-09-18 | 1998-04-07 | Sharp Kabushiki Kaisha | Matched filter |
US5751624A (en) * | 1995-09-20 | 1998-05-12 | Sharp Kabushiki Kaisha | Complex number calculation circuit |
US5783961A (en) * | 1995-12-12 | 1998-07-21 | Sharp Kabushiki Kaisha | Inverted amplifying circuit |
EP0779705A3 (en) * | 1995-12-12 | 1998-09-23 | Yozan Inc. | Inverted amplifying circuit |
EP0797303A3 (en) * | 1996-03-19 | 1998-01-07 | Sharp Kabushiki Kaisha | Inverter circuit and amplifier |
US5960033A (en) * | 1996-04-02 | 1999-09-28 | Sharp Kabushiki Kaisha | Matched filter |
US5936463A (en) * | 1996-05-21 | 1999-08-10 | Yozan Inc. | Inverted amplifying circuit |
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