JPH0726973B2 - 速度検出装置 - Google Patents
速度検出装置Info
- Publication number
- JPH0726973B2 JPH0726973B2 JP62143368A JP14336887A JPH0726973B2 JP H0726973 B2 JPH0726973 B2 JP H0726973B2 JP 62143368 A JP62143368 A JP 62143368A JP 14336887 A JP14336887 A JP 14336887A JP H0726973 B2 JPH0726973 B2 JP H0726973B2
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- JP
- Japan
- Prior art keywords
- latch buffer
- scan
- scan pulse
- counter
- pulse
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Control Of Electric Motors In General (AREA)
- Measuring Frequencies, Analyzing Spectra (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明はパルスジェネレータを起動停止が著しく、動作
の再現性が必要な装置に装備した場合でも正しい速度検
出が行なわれるように配慮したデジタル速度検出装置に
関するものである。
の再現性が必要な装置に装備した場合でも正しい速度検
出が行なわれるように配慮したデジタル速度検出装置に
関するものである。
第１図は従来の速度（又は回転数）検出装置のブロック
図を示すもので、１はクロックパルス発生器、２はスキ
ャン時間設定器３によって指定された時間毎にスキャン
パルスP1を送出するDOWNカウンタ、４は電動機等の駆動
源によって駆動されるパルスジェネレータ、５は前記パ
ルスジェネレータ４の回転方向に応じて正又は負のパル
ス信号に変換するパルス波形変換器、６は前記パルス波
形変換器５の出力パルスをカウントするUP・DOWNカウン
タから成るカウンタ、７はスキャンパルスP1が入力する
毎にカウンタ６の内容をラッチするＮラッチバッファ、
８は同じくスキャンパルスP1が入力する毎に前記Ｎラッ
チバッファ７の内容をラッチするＯラッチバッファ、11
はスキャンパルスP1の入力毎にＮラッチバッファとＯラ
ッチバッファから夫々の内容を読み出し、速度（又は回
転数）の演算を行う演算処理装置、10は水晶発振器であ
る。
図を示すもので、１はクロックパルス発生器、２はスキ
ャン時間設定器３によって指定された時間毎にスキャン
パルスP1を送出するDOWNカウンタ、４は電動機等の駆動
源によって駆動されるパルスジェネレータ、５は前記パ
ルスジェネレータ４の回転方向に応じて正又は負のパル
ス信号に変換するパルス波形変換器、６は前記パルス波
形変換器５の出力パルスをカウントするUP・DOWNカウン
タから成るカウンタ、７はスキャンパルスP1が入力する
毎にカウンタ６の内容をラッチするＮラッチバッファ、
８は同じくスキャンパルスP1が入力する毎に前記Ｎラッ
チバッファ７の内容をラッチするＯラッチバッファ、11
はスキャンパルスP1の入力毎にＮラッチバッファとＯラ
ッチバッファから夫々の内容を読み出し、速度（又は回
転数）の演算を行う演算処理装置、10は水晶発振器であ
る。
第２図はタイムチャートを示すもので、本発明はスキャ
ン時間設定器３によって設定された一定周期毎にカウン
タ２からスキャンパルスP1（割込パルス）が送出され、
演算処理装置11においてパルスジェネレータ４の速度
（又は回転数）を演算されるものであるが、スキャンパ
ルス発生器２は設定時間TS毎にスキャンパルスP1を出力
し、再設定される。
ン時間設定器３によって設定された一定周期毎にカウン
タ２からスキャンパルスP1（割込パルス）が送出され、
演算処理装置11においてパルスジェネレータ４の速度
（又は回転数）を演算されるものであるが、スキャンパ
ルス発生器２は設定時間TS毎にスキャンパルスP1を出力
し、再設定される。
Ｎラッチバッファ７はカウンタ６の内容をスキャンパル
スP1のタイミングでラッチする。
スP1のタイミングでラッチする。
例えばＡ点のスキャンパルスでカウンタ６の内容n1がラ
ッチされ、次回のＢ点まではn1のまま保っている。
ッチされ、次回のＢ点まではn1のまま保っている。
同様にＢ点でn2,C点でn3,Dでn4のように変わる。
Ｏラッチバッファ８はＮラッチバッファ７の内容をスキ
ャンパルスP1のタイミングでラッチする。従ってＯラッ
チバッファ８にはＮラッチバッファ７のスキャン前のデ
ータが残ることになる。
ャンパルスP1のタイミングでラッチする。従ってＯラッ
チバッファ８にはＮラッチバッファ７のスキャン前のデ
ータが残ることになる。
演算処理装置11は、スキャンパルスP1が入力（スキャン
割込）する都度第３図のフローチャートに示すような演
算が行なわれる。
割込）する都度第３図のフローチャートに示すような演
算が行なわれる。
即ち次式に示すような速度（又は回転数）Ｎの演算が行
なわれる。
なわれる。
但し、nN:Nラッチバッファの読込値 nO:Oラッチバッファ８の読込値 K:比例定数 TS：スキャン時間 N:パルスジェネレータ４の回転数 〔発明が解決しようとする問題点〕 製品の製造上運転モード（速度制御、トルク制御、位置
制御）の切替を頻繁に行う装置にこの種の速度検出装置
を装備した場合、運転モードの切替時にスキャンの同期
化のため、スキャンパルス発生器２に点線図示のように
同期化要求信号を与えることが有効である。ところが、
一瞬スキャン時間が変化するため、速度検出が不正確と
なり、製品にバラツキが生ずるという問題がある。
制御）の切替を頻繁に行う装置にこの種の速度検出装置
を装備した場合、運転モードの切替時にスキャンの同期
化のため、スキャンパルス発生器２に点線図示のように
同期化要求信号を与えることが有効である。ところが、
一瞬スキャン時間が変化するため、速度検出が不正確と
なり、製品にバラツキが生ずるという問題がある。
これを第４図に示すタイムチャートを使って説明すれば
次の通りである。
次の通りである。
即ち、今第４図に示すように、スキャンパルスのＣとＤ
の間で同期化要求信号P2が与えられたとすると、スキャ
ンパルス発生器２が再セットされ、その時点よりTS後に
スキャンパルスＤが発生することになる。従ってスキャ
ンパルス間隔Ｔは、TSより大きくなる。このようなスキ
ャンの同期化がある場合、速度（又は回転数）Ｎ′は次
式 で表わされ、前記(1)式のＮとは Ｎ≠Ｎ′ の関係にあるので、Ｎ′を制御に使用すると、製造装置
で作られる製品にバラツキが生ずることになる。
の間で同期化要求信号P2が与えられたとすると、スキャ
ンパルス発生器２が再セットされ、その時点よりTS後に
スキャンパルスＤが発生することになる。従ってスキャ
ンパルス間隔Ｔは、TSより大きくなる。このようなスキ
ャンの同期化がある場合、速度（又は回転数）Ｎ′は次
式 で表わされ、前記(1)式のＮとは Ｎ≠Ｎ′ の関係にあるので、Ｎ′を制御に使用すると、製造装置
で作られる製品にバラツキが生ずることになる。
そこで本発明は、同期化要求信号を与える場合でも(1)
式の演算が演算処理装置11において行なわれるようなも
のを提供しようとするものである。
式の演算が演算処理装置11において行なわれるようなも
のを提供しようとするものである。
本発明は上記の問題点を解決するために、前記Ｏラッチ
バッファ８にＮラッチバッファ７の内容をラッチする方
法を採らずに、前記スキャンパルスP1又は同期化要求信
号P2の入力に応じてカウンタ６の内容をラッチするＮ′
ラッチバッファを新たにカウンタ６とＯラッチバッファ
８の間に付加し、同期化要求信号P2が与えられた時でも
Ｏラッチバッファ８にはスキャン設定時間TS分のカウン
タ６の内容分がラッチされるように構成して、演算処理
装置11において(2)式ではなく(1)式の演算が行なわれる
ようにしたものである。
バッファ８にＮラッチバッファ７の内容をラッチする方
法を採らずに、前記スキャンパルスP1又は同期化要求信
号P2の入力に応じてカウンタ６の内容をラッチするＮ′
ラッチバッファを新たにカウンタ６とＯラッチバッファ
８の間に付加し、同期化要求信号P2が与えられた時でも
Ｏラッチバッファ８にはスキャン設定時間TS分のカウン
タ６の内容分がラッチされるように構成して、演算処理
装置11において(2)式ではなく(1)式の演算が行なわれる
ようにしたものである。
第５図は本発明の実施例を示すもので、第１図に示す従
来装置と相違する点は同期化要求信号P2をオア回路OR2
を介してスキャンパルス発生器２に与えるようにしたこ
とと、スキャンパルスP1又は同期化要求信号P2の入力に
応じてカウンタ６の内容をラッチするＮ′ラッチバッフ
ァ９を新たにカウンタ６とＯラッチバッファ８の間に付
加したことである。
来装置と相違する点は同期化要求信号P2をオア回路OR2
を介してスキャンパルス発生器２に与えるようにしたこ
とと、スキャンパルスP1又は同期化要求信号P2の入力に
応じてカウンタ６の内容をラッチするＮ′ラッチバッフ
ァ９を新たにカウンタ６とＯラッチバッファ８の間に付
加したことである。
このように構成すると、同期化要求信号P2を与えた場合
でも。Ｏラッチバッファ８に第１図に示す従来装置と同
様のカウンタ値がラッチされる。
でも。Ｏラッチバッファ８に第１図に示す従来装置と同
様のカウンタ値がラッチされる。
第６図は第５図において各部の信号及びカウンタ値のタ
イムチャートを示すもので、このタイムチャートを参照
し乍ら実施例装置の動作を説明すると次の通りである。
イムチャートを示すもので、このタイムチャートを参照
し乍ら実施例装置の動作を説明すると次の通りである。
スキャンパルス発生器２は第１図に示した従来装置と同
様、一定時間TS毎にスキャンパルスP1を出力している
が、同期化要求信号P2が入力されると両セットされ、そ
の時間からTS後にスキャンパルスを発生しスキャンを同
期化する。
様、一定時間TS毎にスキャンパルスP1を出力している
が、同期化要求信号P2が入力されると両セットされ、そ
の時間からTS後にスキャンパルスを発生しスキャンを同
期化する。
一方Ｎラッチバッファ７は毎スキャンパルス毎にカウン
ト６の内容をラッチし、Ｎ′ラッチバッファ９は毎スキ
ャンパルス又は同期化要求信号のタイミングでカウンタ
６の内容をラッチし、Ｏラッチバッファ８はＮ′ラッチ
バッファ９の内容をスキャンパルス毎にラッチする。
ト６の内容をラッチし、Ｎ′ラッチバッファ９は毎スキ
ャンパルス又は同期化要求信号のタイミングでカウンタ
６の内容をラッチし、Ｏラッチバッファ８はＮ′ラッチ
バッファ９の内容をスキャンパルス毎にラッチする。
そのため、スキャンの時間が延びたCD間のパルスジェネ
レータの回転数は で計算されるので、 第３図の演算フローチャートによる計算 が成立し、スキャンの同期化ある回路においてもパルス
ジェネレータ４の回転数を正しく検出することができる
ことになる。
レータの回転数は で計算されるので、 第３図の演算フローチャートによる計算 が成立し、スキャンの同期化ある回路においてもパルス
ジェネレータ４の回転数を正しく検出することができる
ことになる。
なお、上記の実施例ではパルスジェネレータが正逆転す
る場合のものを例に採って説明したが、一方向回転のみ
の場合はパルス波形変換器を使用しなくともよい。
る場合のものを例に採って説明したが、一方向回転のみ
の場合はパルス波形変換器を使用しなくともよい。
以上のように、本発明によれば同期化要求信号を与える
必要がある装置にこの種のデジタル速度検出装置を適用
した場合でも正確な速度検出が行なわれる効果があり、
運転モードが頻繁に変わるとともに、動作の再現性が必
要な装置に使用する場合のデジタル速度検出装置として
優れたものである。
必要がある装置にこの種のデジタル速度検出装置を適用
した場合でも正確な速度検出が行なわれる効果があり、
運転モードが頻繁に変わるとともに、動作の再現性が必
要な装置に使用する場合のデジタル速度検出装置として
優れたものである。
第１図は従来装置のブロック図、第２図は、第１図にお
ける各部の信号及びカウンタ値のタイムチャート、第３
図は第１図における演算処理装置の演算フローチャー
ト、第４図は第１図に示す従来装置でスキャン同期化を
行った場合の問題を説明するためのタイムチャート、第
５図は本発明の実施例のブロック図、第６図は実施例に
おける各部の信号及びカウンタ値のタイムチャートであ
る。 １……クロックパルス発生器 ２……スキャンパルス発生器 ３……スキャン時間設定器 ４……パルスゼネレータ ５……パルス波形変換器 ６……カウンタ ７……Ｎラッチバッファ ８……Ｏラッチバッファ ９……Ｎ′ラッチバッファ 10……水晶発振器 11……演算処理装置。
ける各部の信号及びカウンタ値のタイムチャート、第３
図は第１図における演算処理装置の演算フローチャー
ト、第４図は第１図に示す従来装置でスキャン同期化を
行った場合の問題を説明するためのタイムチャート、第
５図は本発明の実施例のブロック図、第６図は実施例に
おける各部の信号及びカウンタ値のタイムチャートであ
る。 １……クロックパルス発生器 ２……スキャンパルス発生器 ３……スキャン時間設定器 ４……パルスゼネレータ ５……パルス波形変換器 ６……カウンタ ７……Ｎラッチバッファ ８……Ｏラッチバッファ ９……Ｎ′ラッチバッファ 10……水晶発振器 11……演算処理装置。
Claims (1)
- 【請求項１】クロックパルスを入力信号としてスキャン
パルスを送出し、このスキャンパルスと同期化要求信号
によりセットされるDOWNカウンタと、 パルスジェネレータから送出される出力パルスをカウン
トするカウンタと、 前記スキャンパルスの入力に応じて、前記カウンタの内
容をラッチするＮラッチバッファと、 前記スキャンパルス又は同期化要求信号の入力に応じ
て、前記カウンタの内容をラッチするＮ′ラッチバッフ
ァと、 前記スキャンパルスの入力に応じて前記Ｎ′ラッチバッ
ファの内容をラッチするＯラッチバッファと、 前記ＮラッチバッファとＯラッチバッファの内容を読み
出して速度を演算する演算処理装置を具備したことを特
徴とする速度検出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62143368A JPH0726973B2 (ja) | 1987-06-10 | 1987-06-10 | 速度検出装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62143368A JPH0726973B2 (ja) | 1987-06-10 | 1987-06-10 | 速度検出装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63308567A JPS63308567A (ja) | 1988-12-15 |
| JPH0726973B2 true JPH0726973B2 (ja) | 1995-03-29 |
Family
ID=15337158
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62143368A Expired - Lifetime JPH0726973B2 (ja) | 1987-06-10 | 1987-06-10 | 速度検出装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0726973B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53111768A (en) * | 1977-03-11 | 1978-09-29 | Hitachi Ltd | Frequency detecting system |
-
1987
- 1987-06-10 JP JP62143368A patent/JPH0726973B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63308567A (ja) | 1988-12-15 |
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