JPH07226417A - 半導体装置の構造 - Google Patents
半導体装置の構造Info
- Publication number
- JPH07226417A JPH07226417A JP6018301A JP1830194A JPH07226417A JP H07226417 A JPH07226417 A JP H07226417A JP 6018301 A JP6018301 A JP 6018301A JP 1830194 A JP1830194 A JP 1830194A JP H07226417 A JPH07226417 A JP H07226417A
- Authority
- JP
- Japan
- Prior art keywords
- conductor pattern
- semiconductor chip
- conductor
- semiconductor device
- patterns
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/50—Tape automated bonding [TAB] connectors, i.e. film carriers; Manufacturing methods related thereto
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/50—Tape automated bonding [TAB] connectors, i.e. film carriers; Manufacturing methods related thereto
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Wire Bonding (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】
【目的】 合成樹脂フレキシブルフィルム11の上面
に、複数本の導体パターン12を形成し、この各導体パ
ターン一端のインナーリード12′を、半導体チップ1
4に接続する一方、前記各導体パターン他端のアウター
リード12″に構成して成る半導体装置において、その
高集積化を、大型化を招来することなく、達成する。 【構成】 前記導体パターン12の上面に、一層又は複
数層の導体パターン12aを、各導体パターンの間に絶
縁層20を挟んで積層し、これら積層した各導体パター
ンのうち上層の導体パターン12a一端のインナーリー
ド12a′を、下層の導体パターンのインナーリードよ
りも長くして、半導体チップに接合し、上層の導体パタ
ーン他端のアウターリード12a″を、下層の導体パタ
ーンのアウターリードよりも長くする。
に、複数本の導体パターン12を形成し、この各導体パ
ターン一端のインナーリード12′を、半導体チップ1
4に接続する一方、前記各導体パターン他端のアウター
リード12″に構成して成る半導体装置において、その
高集積化を、大型化を招来することなく、達成する。 【構成】 前記導体パターン12の上面に、一層又は複
数層の導体パターン12aを、各導体パターンの間に絶
縁層20を挟んで積層し、これら積層した各導体パター
ンのうち上層の導体パターン12a一端のインナーリー
ド12a′を、下層の導体パターンのインナーリードよ
りも長くして、半導体チップに接合し、上層の導体パタ
ーン他端のアウターリード12a″を、下層の導体パタ
ーンのアウターリードよりも長くする。
Description
【0001】
【産業上の利用分野】本発明は、半導体チップとこの半
導体チップに対する単数本の導体パターンとから成る半
導体装置を、ポリイミド樹脂等の合成樹脂製フレキシブ
ルフィルムによるテープキャリャを使用して製造するよ
うにしたいわゆるテープキャリャ方式による半導体装置
において、その構造に関するものである。
導体チップに対する単数本の導体パターンとから成る半
導体装置を、ポリイミド樹脂等の合成樹脂製フレキシブ
ルフィルムによるテープキャリャを使用して製造するよ
うにしたいわゆるテープキャリャ方式による半導体装置
において、その構造に関するものである。
【0002】
【従来の技術】従来、この種のテープキャリャ方式によ
って製造される半導体装置は、実開昭52−12266
7号公報等に記載され、且つ、図13及び図14に示す
ように、ポリイミド樹脂等の合成樹脂製フレキシブルフ
ィルム1の上面に、銅等の金属箔による多数本の導体パ
ターン2を接着剤3にて貼着し、この各導体パターン2
の一端部におけるインナーリード2′を、半導体チップ
4に対して、当該半導体チップ4の上面に予め形成され
るバンプ5等にて接合すると言う構造にして、これを、
図15に示すように、プリント基板6の上面に対して、
前記フレキシブルフィルム1及び半導体チップ4を接着
剤7,8にて接着するようにして搭載したのち、前記各
導体パターン2の他端部におけるアウターリード2″
を、前記プリント基板6の上面に予め形成されている各
種配線パターン9の各々に対して接合するようにしてい
る。
って製造される半導体装置は、実開昭52−12266
7号公報等に記載され、且つ、図13及び図14に示す
ように、ポリイミド樹脂等の合成樹脂製フレキシブルフ
ィルム1の上面に、銅等の金属箔による多数本の導体パ
ターン2を接着剤3にて貼着し、この各導体パターン2
の一端部におけるインナーリード2′を、半導体チップ
4に対して、当該半導体チップ4の上面に予め形成され
るバンプ5等にて接合すると言う構造にして、これを、
図15に示すように、プリント基板6の上面に対して、
前記フレキシブルフィルム1及び半導体チップ4を接着
剤7,8にて接着するようにして搭載したのち、前記各
導体パターン2の他端部におけるアウターリード2″
を、前記プリント基板6の上面に予め形成されている各
種配線パターン9の各々に対して接合するようにしてい
る。
【0003】
【発明が解決しようとする課題】ところで、この種の半
導体装置においては、各導体パターン2におけるインナ
ーリード2′を半導体チップ4に対してバンプ5等を介
して接合することのために、当該各インナーリード2′
の相互間におけるピッチ間隔Pを狭くすることには、一
定の限界値が存在するものである。
導体装置においては、各導体パターン2におけるインナ
ーリード2′を半導体チップ4に対してバンプ5等を介
して接合することのために、当該各インナーリード2′
の相互間におけるピッチ間隔Pを狭くすることには、一
定の限界値が存在するものである。
【0004】これに対して、従来における半導体装置で
は、銅等の金属箔による各導体パターン2の各々を、単
層構造にしているから、半導体チップ4における一つの
辺の長さLが決められている場合には、その一つの辺に
接続することのできる導体パターン2の本数を少なくし
なければならず、高集積化の妨げになるのであり、ま
た、高集積化を図ることの導体パターン2の本数を多く
するには、半導体チップ4における一つの辺の長さL
を、大きくしなければならず、半導体チップの大型化、
ひいては、半導体装置の大型化を招来すると言う問題が
あった。
は、銅等の金属箔による各導体パターン2の各々を、単
層構造にしているから、半導体チップ4における一つの
辺の長さLが決められている場合には、その一つの辺に
接続することのできる導体パターン2の本数を少なくし
なければならず、高集積化の妨げになるのであり、ま
た、高集積化を図ることの導体パターン2の本数を多く
するには、半導体チップ4における一つの辺の長さL
を、大きくしなければならず、半導体チップの大型化、
ひいては、半導体装置の大型化を招来すると言う問題が
あった。
【0005】本発明は、この問題を解消できるようにし
た半導体装置の構造を提供することを技術的課題とする
ものである。
た半導体装置の構造を提供することを技術的課題とする
ものである。
【0006】
【課題を解決するための手段】この技術的課題を達成す
るため本発明は、「ポリイミド樹脂等の合成樹脂製フレ
キシブルフィルムの上面に、金属箔による複数本の導体
パターンを形成し、この各導体パターンの一端部におけ
るインナーリードを、半導体チップに接合する一方、前
記各導体パターンにおける他端部をアウターリードに構
成して成る半導体装置において、前記全ての導体パター
ン、又は一部の導体パターンの上面に、同じく金属箔に
よる一層又は複数層の導体パターンを、各導体パターン
の間に絶縁層を挟んで積層し、これら積層した各導体パ
ターンのうち上層の導体パターンにおけるインナーリー
ドを、下層の導体パターンにおけるインナーリードより
も長くして、半導体チップに対してバンプにて接合する
一方、上層の導体パターンの他端部におけるアウターリ
ードを、下層の導体パターンにおけるアウターリードよ
りも長くする。」と言う構成にした。
るため本発明は、「ポリイミド樹脂等の合成樹脂製フレ
キシブルフィルムの上面に、金属箔による複数本の導体
パターンを形成し、この各導体パターンの一端部におけ
るインナーリードを、半導体チップに接合する一方、前
記各導体パターンにおける他端部をアウターリードに構
成して成る半導体装置において、前記全ての導体パター
ン、又は一部の導体パターンの上面に、同じく金属箔に
よる一層又は複数層の導体パターンを、各導体パターン
の間に絶縁層を挟んで積層し、これら積層した各導体パ
ターンのうち上層の導体パターンにおけるインナーリー
ドを、下層の導体パターンにおけるインナーリードより
も長くして、半導体チップに対してバンプにて接合する
一方、上層の導体パターンの他端部におけるアウターリ
ードを、下層の導体パターンにおけるアウターリードよ
りも長くする。」と言う構成にした。
【0007】
【作 用】このように構成することにより、全ての導
体パターンにおけるインナーリード及びアウターリード
の各々を、半導体チップ及びプリント基板に接合するこ
とができる形態のもとで、全部又は一部の導体パターン
を、少なくとも二層以上の多層構造にすることができる
から、半導体チップにおける一つの辺に配設することが
できる導体パターンの本数を、従来のように、半導体チ
ップにおける一つの辺の長さを大きくすることなく、大
幅に増大できるのである。
体パターンにおけるインナーリード及びアウターリード
の各々を、半導体チップ及びプリント基板に接合するこ
とができる形態のもとで、全部又は一部の導体パターン
を、少なくとも二層以上の多層構造にすることができる
から、半導体チップにおける一つの辺に配設することが
できる導体パターンの本数を、従来のように、半導体チ
ップにおける一つの辺の長さを大きくすることなく、大
幅に増大できるのである。
【0008】
【発明の効果】従って、本発明によると、テープキャリ
ャ方式によって製造される半導体装置の高集積化を、そ
の半導体チップの大型化を招来することなく、確実に達
成できる効果を有する。
ャ方式によって製造される半導体装置の高集積化を、そ
の半導体チップの大型化を招来することなく、確実に達
成できる効果を有する。
【0009】
【実施例】以下、本発明の実施例を、図1〜図3の図面
について説明する。この図において符号11は、ポリイ
ミド樹脂等の合成樹脂製のフレキシブルフィルムを示
し、このフレキシブルフィルム11は、半導体チップ1
4の周囲を囲うようにリング状に構成され、その上面に
は、銅等の金属箔による多数本の第1導体パターン12
が、接着剤13による接着にて形成されている一方、こ
のリング状フレキシブルフィルム11の内部に、前記半
導体チップ14を配設する。
について説明する。この図において符号11は、ポリイ
ミド樹脂等の合成樹脂製のフレキシブルフィルムを示
し、このフレキシブルフィルム11は、半導体チップ1
4の周囲を囲うようにリング状に構成され、その上面に
は、銅等の金属箔による多数本の第1導体パターン12
が、接着剤13による接着にて形成されている一方、こ
のリング状フレキシブルフィルム11の内部に、前記半
導体チップ14を配設する。
【0010】前記各第1導体パターン12の一端部にお
けるインナーリード12′を、フレキシブルフィルム1
1の内周面よりも適宜寸法S1だけ内側に突出して、こ
のインナーリード12′を、前記半導体チップ14に対
して、当該半導体チップ14の上面に予め形成した第1
バンプ15にて電気的に接合する一方、この各第1導体
パターン12の他端部におけるアウターリード12″
は、前記フレキシブルフィルム11の外周面より適宜寸
法W1だけ外側に突出する。
けるインナーリード12′を、フレキシブルフィルム1
1の内周面よりも適宜寸法S1だけ内側に突出して、こ
のインナーリード12′を、前記半導体チップ14に対
して、当該半導体チップ14の上面に予め形成した第1
バンプ15にて電気的に接合する一方、この各第1導体
パターン12の他端部におけるアウターリード12″
は、前記フレキシブルフィルム11の外周面より適宜寸
法W1だけ外側に突出する。
【0011】そして、前記各第1導体パターン12の上
面に、同じく銅等の金属箔による第2導体パターン12
aを、当該第2導体パターン12aと前記第1導体パタ
ーン12との間にポリイミド樹脂等の絶縁層20を挟ん
で積層し、この第2導体パターン12aの一端部におけ
るインナーリード12a′を、当該第2導体パターン1
2aよりも下層の第1導体パターン12におけるインナ
ーリード12′よりも長い寸法S2だけ内側に突出し
て、このインナーリード12a′を、前記半導体チップ
14に対して、当該半導体チップ14の上面のうち前記
第1バンプ15よりも内側に予め形成されている第2バ
ンプ15aにて電気的に接合する。
面に、同じく銅等の金属箔による第2導体パターン12
aを、当該第2導体パターン12aと前記第1導体パタ
ーン12との間にポリイミド樹脂等の絶縁層20を挟ん
で積層し、この第2導体パターン12aの一端部におけ
るインナーリード12a′を、当該第2導体パターン1
2aよりも下層の第1導体パターン12におけるインナ
ーリード12′よりも長い寸法S2だけ内側に突出し
て、このインナーリード12a′を、前記半導体チップ
14に対して、当該半導体チップ14の上面のうち前記
第1バンプ15よりも内側に予め形成されている第2バ
ンプ15aにて電気的に接合する。
【0012】更に、前記各第2導体パターン12aの他
端部におけるアウターリード12a″を、当該第2導体
パターン12aよりも下層の第1導体パターン12にお
けるアウターリード12″よりも長い寸法W2だけ外側
に延長した構成にする。そして、このように構成した半
導体装置は、図3に示すように、プリント基板16の上
面に対して、前記フレキシブルフィルム11及び半導体
チップ14を接着剤17,18にて接着するようにして
搭載したのち、前記各第1導体パターン12の他端部に
おけるアウターリード12″及び、各第2導体パターン
12aの他端部におけるアウターリード12a″を、前
記プリント基板16の上面に予め形成されている各種の
第1配線パターン19と第2配線パターン19aとの各
々に対して電気的に接合するのである。
端部におけるアウターリード12a″を、当該第2導体
パターン12aよりも下層の第1導体パターン12にお
けるアウターリード12″よりも長い寸法W2だけ外側
に延長した構成にする。そして、このように構成した半
導体装置は、図3に示すように、プリント基板16の上
面に対して、前記フレキシブルフィルム11及び半導体
チップ14を接着剤17,18にて接着するようにして
搭載したのち、前記各第1導体パターン12の他端部に
おけるアウターリード12″及び、各第2導体パターン
12aの他端部におけるアウターリード12a″を、前
記プリント基板16の上面に予め形成されている各種の
第1配線パターン19と第2配線パターン19aとの各
々に対して電気的に接合するのである。
【0013】この構成により、下層の第1導体パターン
12と、上層の第2導体パターン12aとを、これらの
インナーリード12′12a′及びアウターリード1
2″12a″の各々を、半導体チップ14における第1
バンプ15及び第2バンプ15aとプリント基板16に
おける第1配線パターン19及び第2配線パターン19
aに対して接合することができる形態のもとで、二層構
造にすることができるから、半導体チップ14における
一つの辺に配設することができる導体パターンの本数
を、従来のように、半導体チップにおける一つの辺の長
さLを大きくすることなく、二倍に増大できるのであ
る。
12と、上層の第2導体パターン12aとを、これらの
インナーリード12′12a′及びアウターリード1
2″12a″の各々を、半導体チップ14における第1
バンプ15及び第2バンプ15aとプリント基板16に
おける第1配線パターン19及び第2配線パターン19
aに対して接合することができる形態のもとで、二層構
造にすることができるから、半導体チップ14における
一つの辺に配設することができる導体パターンの本数
を、従来のように、半導体チップにおける一つの辺の長
さLを大きくすることなく、二倍に増大できるのであ
る。
【0014】なお、前記実施例は、下層の第1導体パタ
ーン12と上層の第2導体パターン12aとの二層構造
にした場合を示したが、本発明は、この二層構造に限ら
ず、図4に示すように、下層の第1導体パターン12
と、これに絶縁層20を挟んで積層した中間層の第2導
体パターン12aと、更に、これに絶縁層20aを挟ん
で積層した上層の第3導体パターン12bとの三層構造
にするとか、或いは、同様にして四層構造にしても良
く、このように三層以上の多層構造することにより、半
導体チップにおける一辺に配設することができる導体パ
ターンの本数を更に増大できるのである。
ーン12と上層の第2導体パターン12aとの二層構造
にした場合を示したが、本発明は、この二層構造に限ら
ず、図4に示すように、下層の第1導体パターン12
と、これに絶縁層20を挟んで積層した中間層の第2導
体パターン12aと、更に、これに絶縁層20aを挟ん
で積層した上層の第3導体パターン12bとの三層構造
にするとか、或いは、同様にして四層構造にしても良
く、このように三層以上の多層構造することにより、半
導体チップにおける一辺に配設することができる導体パ
ターンの本数を更に増大できるのである。
【0015】また、前記実施例のように、半導体チップ
の周囲を囲う全ての導体パターンを、二層以上の多層構
造にすることに代えて、半導体チップの周囲を囲う全て
の導体パターンのうち、任意の導体パターンのみを二層
以上の多層構造にするように構成しても良いのである。
ところで、前記した半導体装置は、以下に述べるよう
に、テープキャリャ方式によって製造することができ
る。
の周囲を囲う全ての導体パターンを、二層以上の多層構
造にすることに代えて、半導体チップの周囲を囲う全て
の導体パターンのうち、任意の導体パターンのみを二層
以上の多層構造にするように構成しても良いのである。
ところで、前記した半導体装置は、以下に述べるよう
に、テープキャリャ方式によって製造することができ
る。
【0016】すなわち、図5に示すようなポリイミド樹
脂等の合成樹脂製のテープキャリャAを使用し、このテ
ープキャリャAを、その長手方向に移送する途中におい
て、先づ、図6及び図7に示すように、半導体チップ1
4を挿入するための抜き孔A1と、リング状のフレキシ
ブルフィルム11を形成するための四つの抜き孔A2と
を打ち抜く。なお、前記フレキシブルフィルム11にお
ける四隅部には、当該フレキシブルフィルム11に対す
る吊りリードA3が設けられている。
脂等の合成樹脂製のテープキャリャAを使用し、このテ
ープキャリャAを、その長手方向に移送する途中におい
て、先づ、図6及び図7に示すように、半導体チップ1
4を挿入するための抜き孔A1と、リング状のフレキシ
ブルフィルム11を形成するための四つの抜き孔A2と
を打ち抜く。なお、前記フレキシブルフィルム11にお
ける四隅部には、当該フレキシブルフィルム11に対す
る吊りリードA3が設けられている。
【0017】次いで、前記テープキャリャ型Aの上面
に、図8に示すように、銅等の金属箔による第1導体パ
ターン12を接着剤13に貼り合わせ、この第1導体パ
ターン12の上面に、図9に示すように、液状ポリイミ
ド樹脂を塗布して乾燥することによって、絶縁層20を
形成したのち、この絶縁層20の上面に、同じく銅等の
金属箔による第2導体パターン12aを貼り合わせる。
に、図8に示すように、銅等の金属箔による第1導体パ
ターン12を接着剤13に貼り合わせ、この第1導体パ
ターン12の上面に、図9に示すように、液状ポリイミ
ド樹脂を塗布して乾燥することによって、絶縁層20を
形成したのち、この絶縁層20の上面に、同じく銅等の
金属箔による第2導体パターン12aを貼り合わせる。
【0018】そして、前記テープキャリャAに対する従
来から良く知られたフォトエッチング法によって、前記
第1導体パターン12に、図10に示すように、フレキ
シブルフィルム11の内側へのインナーリード12′
と、フレキシブルフィルム11の外側へのアウターリー
ド12″とを形成すると共に、前記第2導体パターン1
2aに、図11に示すように、フレキシブルフィルム1
1の内側へのインナーリード12a′を形成する。
来から良く知られたフォトエッチング法によって、前記
第1導体パターン12に、図10に示すように、フレキ
シブルフィルム11の内側へのインナーリード12′
と、フレキシブルフィルム11の外側へのアウターリー
ド12″とを形成すると共に、前記第2導体パターン1
2aに、図11に示すように、フレキシブルフィルム1
1の内側へのインナーリード12a′を形成する。
【0019】そして、前記第2導体パターン12aのう
ちテープキャリャAにおける四つの抜き孔A2の部分
を、図12に示すように、フレキシブルフィルム11の
外側にアウターリード12a″を残して、切断線Bに沿
って打ち抜き切断する(なお、この打ち抜き切断に際し
ては、前記フレキシブルフィルム11に対する各吊りリ
ードA3も同時に打ち抜き切断する)ことにより、図1
に示すような半導体装置を得ることができる。
ちテープキャリャAにおける四つの抜き孔A2の部分
を、図12に示すように、フレキシブルフィルム11の
外側にアウターリード12a″を残して、切断線Bに沿
って打ち抜き切断する(なお、この打ち抜き切断に際し
ては、前記フレキシブルフィルム11に対する各吊りリ
ードA3も同時に打ち抜き切断する)ことにより、図1
に示すような半導体装置を得ることができる。
【図1】本発明の第1実施例による半導体装置の斜視図
である。
である。
【図2】図1のII−II視拡大断面図である。
【図3】前記第1実施例による半導体装置をプリント基
板に搭載したときの拡大断面図である。
板に搭載したときの拡大断面図である。
【図4】本発明の第2実施例による半導体装置の拡大断
面図である。
面図である。
【図5】本発明の半導体装置の使用するテープキャリャ
の斜視図である。
の斜視図である。
【図6】前記テープキャリャに抜き孔を穿設したときの
斜視図である。
斜視図である。
【図7】図6のVII −VII 視拡大断面図である。
【図8】前記テープキャリャに第1導体パターンを貼り
合わせたときの拡大断面図である。
合わせたときの拡大断面図である。
【図9】前記テープキャリャに第2導体パターンを貼り
合わせたときの拡大断面図である。
合わせたときの拡大断面図である。
【図10】前記第1導体パターンにインナーリードとア
ウターリードとを形成したときの拡大断面図である。
ウターリードとを形成したときの拡大断面図である。
【図11】前記第2導体パターンにインナーリードを形
成したときの拡大断面図である。
成したときの拡大断面図である。
【図12】テープキャリャから半導体装置を打ち抜き切
断した状態の拡大断面図である。
断した状態の拡大断面図である。
【図13】従来における半導体装置の斜視図である。
【図14】図13のXIV −XIV 視拡大断面図である。
【図15】前記従来の半導体装置をプリント基板に搭載
したときの拡大断面図である。
したときの拡大断面図である。
A テープキャリャ 11 フレキシブルフィルム 12 第1導体パターン 12a 第2導体パターン 12′,12a′ インナーリード 12″,12a″ アウターリード 13 接着剤 14 半導体チップ 15,15a バンプ 20 絶縁層
Claims (1)
- 【請求項1】ポリイミド樹脂等の合成樹脂製フレキシブ
ルフィルムの上面に、金属箔による複数本の導体パター
ンを形成し、この各導体パターンの一端部におけるイン
ナーリードを、半導体チップに接続する一方、前記各導
体パターンにおける他端部をアウターリードに構成して
成る半導体装置において、前記全ての導体パターン、又
は一部の導体パターンの上面に、同じく金属箔による一
層又は複数層の導体パターンを、各導体パターンの間に
絶縁層を挟んで積層し、これら積層した各導体パターン
のうち上層の導体パターンにおけるインナーリードを、
下層の導体パターンにおけるインナーリードよりも長く
して、半導体チップに接合する一方、上層の導体パター
ンの他端部におけるアウターリードを、下層の導体パタ
ーンにおけるアウターリードよりも長くしたことを特徴
とする半導体装置の構造。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP01830194A JP3561284B2 (ja) | 1994-02-15 | 1994-02-15 | 半導体装置の構造 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP01830194A JP3561284B2 (ja) | 1994-02-15 | 1994-02-15 | 半導体装置の構造 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH07226417A true JPH07226417A (ja) | 1995-08-22 |
JP3561284B2 JP3561284B2 (ja) | 2004-09-02 |
Family
ID=11967795
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP01830194A Expired - Fee Related JP3561284B2 (ja) | 1994-02-15 | 1994-02-15 | 半導体装置の構造 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3561284B2 (ja) |
-
1994
- 1994-02-15 JP JP01830194A patent/JP3561284B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP3561284B2 (ja) | 2004-09-02 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4812421A (en) | Tab-type semiconductor process | |
US6476331B1 (en) | Printed circuit board for semiconductor package and method for manufacturing the same | |
JPH0697225A (ja) | 半導体装置 | |
KR970077556A (ko) | 적층형 반도체 패키지 | |
JPH01280337A (ja) | 半導体集積回路装置 | |
EP0598497B1 (en) | Multi-layer lead frame for a semiconductor device | |
JP3512331B2 (ja) | 半導体装置のプラスチックパッケージ | |
US6080604A (en) | Semiconductor device having tab-leads and a fabrication method thereof | |
JPH07226417A (ja) | 半導体装置の構造 | |
JPS6125215B2 (ja) | ||
JPH05291347A (ja) | 高周波用tab−icの実装構造 | |
JPH0142500B2 (ja) | ||
JP2868779B2 (ja) | Tab用テープ | |
JPH0278253A (ja) | 多層プラスチックチップキャリア | |
JP4176283B2 (ja) | 可撓性微細多層回路基板の製造法 | |
JP2766361B2 (ja) | 半導体装置 | |
JPH0817861A (ja) | Tabテープを用いたチップ型電子部品 | |
JPH0425144A (ja) | 3層tab用テープを用いた半導体装置及び3層tab用テープの製造方法 | |
JPH04226045A (ja) | フィルムキャリア回路基板及びその製造方法 | |
JPH057071A (ja) | 面実装用多層型配線板 | |
JP2843401B2 (ja) | 多層構造配線基板 | |
JPH1126504A (ja) | フィルム・キャリア半導体装置 | |
JPH10214917A (ja) | 半導体装置及び半導体装置の製造方法並びに配線基板 | |
JPH0227837B2 (ja) | Tasopurintobannohaisenpataankozo | |
JPH06120624A (ja) | 微細多層配線板構造 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040216 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20040528 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
LAPS | Cancellation because of no payment of annual fees |