JPH07191841A - コンピュータのプログラム更新方法 - Google Patents
コンピュータのプログラム更新方法Info
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- JPH07191841A JPH07191841A JP5332084A JP33208493A JPH07191841A JP H07191841 A JPH07191841 A JP H07191841A JP 5332084 A JP5332084 A JP 5332084A JP 33208493 A JP33208493 A JP 33208493A JP H07191841 A JPH07191841 A JP H07191841A
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- program
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Abstract
(57)【要約】
【目的】サブＣＰＵのプログラム更新のために必要なロ
ーダ等の付属プログラムや構造を簡素化する。 【構成】 メイン中央処理部２と少なくとも一のサブ中
央処理部３とを有するコンピュータ１のプログラム更新
方法であって、Ｉ／Ｏ６を介してメイン中央処理部２か
ら送られてきた指令によりサブ中央処理部３の動作を停
止する。続いて、メイン中央処理部２から該サブ中央処
理部３用の書替え可能不揮発性ＲＯＭ５にアクセスする
ことによって、該ＲＯＭ５内のプログラムを外部から挿
入したＩＣカード８に格納された更新プログラムと書き
替える。
ーダ等の付属プログラムや構造を簡素化する。 【構成】 メイン中央処理部２と少なくとも一のサブ中
央処理部３とを有するコンピュータ１のプログラム更新
方法であって、Ｉ／Ｏ６を介してメイン中央処理部２か
ら送られてきた指令によりサブ中央処理部３の動作を停
止する。続いて、メイン中央処理部２から該サブ中央処
理部３用の書替え可能不揮発性ＲＯＭ５にアクセスする
ことによって、該ＲＯＭ５内のプログラムを外部から挿
入したＩＣカード８に格納された更新プログラムと書き
替える。
Description
【０００１】
【産業上の利用分野】本発明は、メイン中央処理部と少
なくとも一のサブ中央処理部とを有するコンピュータの
プログラム更新方法に関し、特にサブ中央処理部に対す
るプログラムの更新を簡易にしたコンピュータのプログ
ラム更新方法に関する。
なくとも一のサブ中央処理部とを有するコンピュータの
プログラム更新方法に関し、特にサブ中央処理部に対す
るプログラムの更新を簡易にしたコンピュータのプログ
ラム更新方法に関する。
【０００２】
【従来の技術】従来、コンピュータのＲＯＭ(Read Only
Memory)に格納されたプログラムを更新するには、該Ｒ
ＯＭをデバイスごと新しいものと交換するのが一般的で
あったが、最近、オンボード上で書替え可能な不揮発性
のＲＯＭ（フラッシュメモリ）が安価に入手できるよう
になったことから、プログラムの更新もオンボード上で
行えるようになってきた。
Memory)に格納されたプログラムを更新するには、該Ｒ
ＯＭをデバイスごと新しいものと交換するのが一般的で
あったが、最近、オンボード上で書替え可能な不揮発性
のＲＯＭ（フラッシュメモリ）が安価に入手できるよう
になったことから、プログラムの更新もオンボード上で
行えるようになってきた。
【０００３】すなわち、単一の中央処理部（以下、ＣＰ
Ｕということもある）１１を内蔵したコンピュータ１０
の場合は、例えば図４に示すように、更新プログラムを
ＩＣカード１２によって供給し、ＣＰＵ１１がＩＣカー
ド１２内の更新プログラムを読み出して、ＲＯＭ（フラ
ッシュメモリ）１３に格納されていたプログラムを該更
新プログラムと書き替える。なお、かかるプログラムロ
ードを行うためのプログラム（すなわち、ローダ）の格
納場所としては、ＲＯＭ内の格納エリア、別に設けたＲ
ＯＭ、ＩＣカード内等がある。
Ｕということもある）１１を内蔵したコンピュータ１０
の場合は、例えば図４に示すように、更新プログラムを
ＩＣカード１２によって供給し、ＣＰＵ１１がＩＣカー
ド１２内の更新プログラムを読み出して、ＲＯＭ（フラ
ッシュメモリ）１３に格納されていたプログラムを該更
新プログラムと書き替える。なお、かかるプログラムロ
ードを行うためのプログラム（すなわち、ローダ）の格
納場所としては、ＲＯＭ内の格納エリア、別に設けたＲ
ＯＭ、ＩＣカード内等がある。
【０００４】また、一のメインＣＰＵ２１及び一又は複
数のサブＣＰＵ２２を有するコンピュータ２０の場合
は、例えば図５に示すように、コンピュータ２０内にデ
ータ交換用のメモリ（ＤＰＲ：Dual Ports RAM）２３を
設け、このＤＰＲ２３を介してサブＣＰＵ用ＲＯＭ（フ
ラッシュメモリ）２４内のプログラムをＩＣカード２５
に格納されていた更新プログラムと書き替える。この書
替え制御はサブＣＰＵ２２がローダに基づいて行ってい
た。なお、メインＣＰＵ用ＲＯＭ（フラッシュメモリ
等）２６内のプログラムの更新については、上記単一の
ＣＰＵ１１を備えたコンピュータ１０の場合と同じであ
る。
数のサブＣＰＵ２２を有するコンピュータ２０の場合
は、例えば図５に示すように、コンピュータ２０内にデ
ータ交換用のメモリ（ＤＰＲ：Dual Ports RAM）２３を
設け、このＤＰＲ２３を介してサブＣＰＵ用ＲＯＭ（フ
ラッシュメモリ）２４内のプログラムをＩＣカード２５
に格納されていた更新プログラムと書き替える。この書
替え制御はサブＣＰＵ２２がローダに基づいて行ってい
た。なお、メインＣＰＵ用ＲＯＭ（フラッシュメモリ
等）２６内のプログラムの更新については、上記単一の
ＣＰＵ１１を備えたコンピュータ１０の場合と同じであ
る。
【０００５】
【発明が解決しようとする課題】上述した従来のプログ
ラム更新方法のうち、特に一のメインＣＰＵに加え、一
又は複数のサブＣＰＵを有するコンピュータの場合、次
のような問題があった。すなわち、メインＣＰＵ及びサ
ブＣＰＵはそれぞれ独自にプログラムの更新動作を行う
ため、それぞれにプログラムの更新に必要なローダやそ
れを格納しておく回路等、多くの付属プログラムや構造
を必要としていた。。本発明はこのような事情に鑑みて
なされたもので、特にサブＣＰＵのプログラム更新のた
めに必要な付属プログラムや構造を簡素化できるコンピ
ュータのプログラム更新方法の提供を目的とする。
ラム更新方法のうち、特に一のメインＣＰＵに加え、一
又は複数のサブＣＰＵを有するコンピュータの場合、次
のような問題があった。すなわち、メインＣＰＵ及びサ
ブＣＰＵはそれぞれ独自にプログラムの更新動作を行う
ため、それぞれにプログラムの更新に必要なローダやそ
れを格納しておく回路等、多くの付属プログラムや構造
を必要としていた。。本発明はこのような事情に鑑みて
なされたもので、特にサブＣＰＵのプログラム更新のた
めに必要な付属プログラムや構造を簡素化できるコンピ
ュータのプログラム更新方法の提供を目的とする。
【０００６】
【課題を解決するための手段】上記目的を達成するため
に本発明方法は、メイン中央処理部と少なくとも一のサ
ブ中央処理部とを有するコンピュータのプログラム更新
方法であって、Ｉ／Ｏを介してメイン中央処理部から送
られてきた指令によりサブ中央処理部の動作制御を行う
とともに、メイン中央処理部から該サブ中央処理装置用
の書替え可能不揮発性ＲＯＭにアクセスすることによっ
て、該ＲＯＭ内のプログラムを外部から挿入したＩＣカ
ードに格納された更新プログラムと書き替えることを特
徴としている。
に本発明方法は、メイン中央処理部と少なくとも一のサ
ブ中央処理部とを有するコンピュータのプログラム更新
方法であって、Ｉ／Ｏを介してメイン中央処理部から送
られてきた指令によりサブ中央処理部の動作制御を行う
とともに、メイン中央処理部から該サブ中央処理装置用
の書替え可能不揮発性ＲＯＭにアクセスすることによっ
て、該ＲＯＭ内のプログラムを外部から挿入したＩＣカ
ードに格納された更新プログラムと書き替えることを特
徴としている。
【０００７】また、上記の発明方法において、ＩＣカー
ドのデータフォーマットにおけるヘッダ部に、各サブ中
央処理部に対応して識別コード、更新日付け及び更新バ
ージョンを含めるとともに、各サブ中央処理部用の書替
え可能不揮発性ＲＯＭに格納した更新プログラムのデー
タ部にもそれぞれ更新日付け及び更新バージョンを含め
ておき、メイン中央処理部が前記識別コードに基づいて
プログラムの更新を行うサブ中央処理部の動作制御を行
うとともに、同サブ中央処理部用の書替え可能不揮発性
ＲＯＭ内に格納してあるプログラムの更新日付け及び更
新バージョンと、ＩＣカード内の該サブ中央処理部用更
新プログラムの更新日付け及び更新バージョンとを比較
し、ＩＣカード内のものの方が新しい場合に、プログラ
ムの更新を実行するようにしてもよい。さらに、ＩＣカ
ードの読取部への挿入を検出することにより、メイン中
央処理部が自動的にプログラムの更新制御を行うように
してもよい。
ドのデータフォーマットにおけるヘッダ部に、各サブ中
央処理部に対応して識別コード、更新日付け及び更新バ
ージョンを含めるとともに、各サブ中央処理部用の書替
え可能不揮発性ＲＯＭに格納した更新プログラムのデー
タ部にもそれぞれ更新日付け及び更新バージョンを含め
ておき、メイン中央処理部が前記識別コードに基づいて
プログラムの更新を行うサブ中央処理部の動作制御を行
うとともに、同サブ中央処理部用の書替え可能不揮発性
ＲＯＭ内に格納してあるプログラムの更新日付け及び更
新バージョンと、ＩＣカード内の該サブ中央処理部用更
新プログラムの更新日付け及び更新バージョンとを比較
し、ＩＣカード内のものの方が新しい場合に、プログラ
ムの更新を実行するようにしてもよい。さらに、ＩＣカ
ードの読取部への挿入を検出することにより、メイン中
央処理部が自動的にプログラムの更新制御を行うように
してもよい。
【０００８】
【作用】上記本発明方法は、サブ中央処理部のプログラ
ムの更新をメイン中央処理部によって処理するため、サ
ブ中央処理部にはプログラムの更新に必要なローダやそ
れを格納しておく回路等の付属プログラム，構造を必要
としない。
ムの更新をメイン中央処理部によって処理するため、サ
ブ中央処理部にはプログラムの更新に必要なローダやそ
れを格納しておく回路等の付属プログラム，構造を必要
としない。
【０００９】また、ＩＣカードと更新の対象となったＲ
ＯＭにそれぞれ格納されたプログラムの更新日付け，更
新バージョンを比較することによって、常に最新のプロ
グラムに更新することができる。例えば、ＲＯＭ内のプ
ログラムの更新日付け，更新バージョンの方が新規な場
合には、その更新動作は実行されず、ＲＯＭは既に格納
されているプログラムを保持する。さらに、ＩＣカード
が読取部に挿入されているとき、自動的にメイン中央処
理部がプログラム更新モードとなるようにしておけば、
プログラム更新モードへの切換操作を省略することがで
きる。
ＯＭにそれぞれ格納されたプログラムの更新日付け，更
新バージョンを比較することによって、常に最新のプロ
グラムに更新することができる。例えば、ＲＯＭ内のプ
ログラムの更新日付け，更新バージョンの方が新規な場
合には、その更新動作は実行されず、ＲＯＭは既に格納
されているプログラムを保持する。さらに、ＩＣカード
が読取部に挿入されているとき、自動的にメイン中央処
理部がプログラム更新モードとなるようにしておけば、
プログラム更新モードへの切換操作を省略することがで
きる。
【００１０】
【実施例】以下、本発明の一実施例について図面を参照
して説明する。図１は本発明の実施例に係るプログラム
更新方法を実施するのに好適なコンピュータの構成例を
示すブロック図である。同図では、メインＣＰＵ２とサ
ブＣＰＵ３とをそれぞれ１個づつ備えた構成例を示して
いる。コンピュータ１内には、メインＣＰＵ２のプログ
ラム格納用ＲＯＭ４とサブＣＰＵ３のプログラム格納用
ＲＯＭ５が設けてあり、メインＣＰＵ２はそれぞれのＲ
ＯＭ４，５に直接アクセスできるようになっている。各
ＲＯＭ４，５ともフラッシュメモリのような書替え可能
な不揮発性ＲＯＭを使用することが好ましい。ただし、
本発明方法を実施する限りにおいては、メインＣＰＵ２
のプログラム格納用ＲＯＭ４はこれに限定されるもので
はない。
して説明する。図１は本発明の実施例に係るプログラム
更新方法を実施するのに好適なコンピュータの構成例を
示すブロック図である。同図では、メインＣＰＵ２とサ
ブＣＰＵ３とをそれぞれ１個づつ備えた構成例を示して
いる。コンピュータ１内には、メインＣＰＵ２のプログ
ラム格納用ＲＯＭ４とサブＣＰＵ３のプログラム格納用
ＲＯＭ５が設けてあり、メインＣＰＵ２はそれぞれのＲ
ＯＭ４，５に直接アクセスできるようになっている。各
ＲＯＭ４，５ともフラッシュメモリのような書替え可能
な不揮発性ＲＯＭを使用することが好ましい。ただし、
本発明方法を実施する限りにおいては、メインＣＰＵ２
のプログラム格納用ＲＯＭ４はこれに限定されるもので
はない。
【００１１】また、メインＣＰＵ２は、Ｉ／Ｏ(Input/O
utput)６を介してサブＣＰＵ３に動作停止指令を発する
ことができるようになっている。さらに、コンピュータ
１にはＩＣカード読出部７が設けてあり、ここで読み出
したＩＣカード８内の更新プログラムをメインＣＰＵ２
を介してサブＣＰＵ３のプログラム格納用ＲＯＭ５に書
き込む構成となっている。
utput)６を介してサブＣＰＵ３に動作停止指令を発する
ことができるようになっている。さらに、コンピュータ
１にはＩＣカード読出部７が設けてあり、ここで読み出
したＩＣカード８内の更新プログラムをメインＣＰＵ２
を介してサブＣＰＵ３のプログラム格納用ＲＯＭ５に書
き込む構成となっている。
【００１２】ＩＣカード読出部７には、ＩＣカード８の
挿入を検出するＩＣカード検出器９が付設してあり、該
読出部７にＩＣカード８が挿入された状態にあるとき、
その旨をメインＣＰＵ２に知らせる。ＩＣカード検出器
９としては、例えばマイクロスイッチなどの接触センサ
や光センサなどの非接触センサを使用できる。メインＣ
ＰＵ２は、ＩＣカード検出器９からの検出信号を入力
し、ＩＣカードの挿入状態を確認したとき、自動的にプ
ログラム更新モードに切り替わるようにプログラムされ
ている。なお、かかるプログラム更新モードへの自動切
換は、単一のＣＰＵのみを有するコンピュータのプログ
ラム更新方法にも有効である。
挿入を検出するＩＣカード検出器９が付設してあり、該
読出部７にＩＣカード８が挿入された状態にあるとき、
その旨をメインＣＰＵ２に知らせる。ＩＣカード検出器
９としては、例えばマイクロスイッチなどの接触センサ
や光センサなどの非接触センサを使用できる。メインＣ
ＰＵ２は、ＩＣカード検出器９からの検出信号を入力
し、ＩＣカードの挿入状態を確認したとき、自動的にプ
ログラム更新モードに切り替わるようにプログラムされ
ている。なお、かかるプログラム更新モードへの自動切
換は、単一のＣＰＵのみを有するコンピュータのプログ
ラム更新方法にも有効である。
【００１３】図２は本実施例のプログラム更新方法で使
用するＩＣカード８の内容例を示す構成図である。ＩＣ
カード８内には、更新の対象となり得る各ＣＰＵに対応
して、ヘッダ部ＨＤＲ 0，ＨＤＲ 1〜ＨＤＲ n（但し、
0はメインＣＰＵ２を指し、ｎはサブＣＰＵ３の数を示
す。以下同じ）と、更新プログラム部ＰＲＧ0,ＮＰＤ1
〜ＮＰＤnが格納してある。
用するＩＣカード８の内容例を示す構成図である。ＩＣ
カード８内には、更新の対象となり得る各ＣＰＵに対応
して、ヘッダ部ＨＤＲ 0，ＨＤＲ 1〜ＨＤＲ n（但し、
0はメインＣＰＵ２を指し、ｎはサブＣＰＵ３の数を示
す。以下同じ）と、更新プログラム部ＰＲＧ0,ＮＰＤ1
〜ＮＰＤnが格納してある。
【００１４】ヘッダ部の内容をさらに詳しく説明する
と、図３に示すように、ヘッダ部ＨＤＲには、該更新プ
ログラムがどのＣＰＵのものなのか識別するための識別
コード：ＩＤ、該更新プログラムを更新した日付け：Ｄ
ＡＴＥ、更新プログラムのバージョン：ＶＥＲ、該更新
プログラムが格納されているアドレスを示すアドレス指
示部：ＳＴＲＰと該更新プログラムのバイト数を示すバ
イト指示部：ＬＮＧＳを含んでいる。さらに、更新プロ
グラム部ＰＲＧには、図２に示すように該更新プログラ
ムを更新した日付け：ＤＡＴＥ、該更新プログラムのバ
ージョン：ＶＥＲが書き込まれている。
と、図３に示すように、ヘッダ部ＨＤＲには、該更新プ
ログラムがどのＣＰＵのものなのか識別するための識別
コード：ＩＤ、該更新プログラムを更新した日付け：Ｄ
ＡＴＥ、更新プログラムのバージョン：ＶＥＲ、該更新
プログラムが格納されているアドレスを示すアドレス指
示部：ＳＴＲＰと該更新プログラムのバイト数を示すバ
イト指示部：ＬＮＧＳを含んでいる。さらに、更新プロ
グラム部ＰＲＧには、図２に示すように該更新プログラ
ムを更新した日付け：ＤＡＴＥ、該更新プログラムのバ
ージョン：ＶＥＲが書き込まれている。
【００１５】次に、上述したコンピュータ１及びＩＣカ
ード８を使用しての本実施例のプログラム更新方法を説
明する。更新プログラムを格納したＩＣカード８をＩＣ
カード読出部７に挿入すると、ＩＣカード検出器９がこ
れを検出してメインＣＰＵ２に検出信号を出力する。メ
インＣＰＵ２は、ＩＣカード検出器９からの検出信号に
より、ＩＣカード８が挿入されたことを確認すると、自
動的にプログラム更新モードに切り替わる。プログラム
更新モードは、ＩＣカード８が挿入状態にある間継続し
て維持され、ＩＣカード８の抜き出しとともに終了す
る。
ード８を使用しての本実施例のプログラム更新方法を説
明する。更新プログラムを格納したＩＣカード８をＩＣ
カード読出部７に挿入すると、ＩＣカード検出器９がこ
れを検出してメインＣＰＵ２に検出信号を出力する。メ
インＣＰＵ２は、ＩＣカード検出器９からの検出信号に
より、ＩＣカード８が挿入されたことを確認すると、自
動的にプログラム更新モードに切り替わる。プログラム
更新モードは、ＩＣカード８が挿入状態にある間継続し
て維持され、ＩＣカード８の抜き出しとともに終了す
る。
【００１６】このように、ＩＣカード８の挿入，抜き出
し操作に連動して、メインＣＰＵ２を自動的にプログラ
ム更新モードへ切り換え、そして終了する方法とすれ
ば、モードの切換操作を人手で行う必要がなく、操作の
簡略化を実現できる。プログラム更新モードに切り変わ
ったメインＣＰＵ２は、ＩＣカード読出部７に指令を発
してＩＣカード８の読み出しを実行させる。そして、Ｉ
Ｃカード８から読み出したデータのうち、ヘッダ部：Ｈ
ＤＲ内の識別コード：ＩＤを参照して、更新すべきサブ
ＣＰＵ３を確認し、そのサブＣＰＵ３をＩ／Ｏを介して
動作停止状態とする。なお、更新すべきサブＣＰＵ３が
複数あった場合には、１台づつ順次プログラムの更新を
行っていく。
し操作に連動して、メインＣＰＵ２を自動的にプログラ
ム更新モードへ切り換え、そして終了する方法とすれ
ば、モードの切換操作を人手で行う必要がなく、操作の
簡略化を実現できる。プログラム更新モードに切り変わ
ったメインＣＰＵ２は、ＩＣカード読出部７に指令を発
してＩＣカード８の読み出しを実行させる。そして、Ｉ
Ｃカード８から読み出したデータのうち、ヘッダ部：Ｈ
ＤＲ内の識別コード：ＩＤを参照して、更新すべきサブ
ＣＰＵ３を確認し、そのサブＣＰＵ３をＩ／Ｏを介して
動作停止状態とする。なお、更新すべきサブＣＰＵ３が
複数あった場合には、１台づつ順次プログラムの更新を
行っていく。
【００１７】次いで、メインＣＰＵ２は更新すべきサブ
ＣＰＵ３のプログラム格納用ＲＯＭ５にアクセスし、該
ＲＯＭ５内に格納されているプログラムの更新日付け：
ＤＡＴＥ及び更新バージョン：ＶＥＲを、ＩＣカードか
ら読み出したデータのヘッダ部：ＨＤＲ内の更新日付け
ＤＡＴＥ及び更新バージョン：ＶＥＲと対比して、ヘッ
ダ部：ＨＤＲ内のものの方が新しい場合に、ＩＣカード
から読み出したプログラムの書替えを実行する。ＲＯＭ
５内に格納されているプログラムの方が新しい場合に
は、旧バージョンのプログラムに書き替えることもない
ので、そのＲＯＭ５への書替えは行わないままそのプロ
グラムの更新動作を終了する。
ＣＰＵ３のプログラム格納用ＲＯＭ５にアクセスし、該
ＲＯＭ５内に格納されているプログラムの更新日付け：
ＤＡＴＥ及び更新バージョン：ＶＥＲを、ＩＣカードか
ら読み出したデータのヘッダ部：ＨＤＲ内の更新日付け
ＤＡＴＥ及び更新バージョン：ＶＥＲと対比して、ヘッ
ダ部：ＨＤＲ内のものの方が新しい場合に、ＩＣカード
から読み出したプログラムの書替えを実行する。ＲＯＭ
５内に格納されているプログラムの方が新しい場合に
は、旧バージョンのプログラムに書き替えることもない
ので、そのＲＯＭ５への書替えは行わないままそのプロ
グラムの更新動作を終了する。
【００１８】プログラムの書替えは、メインＣＰＵ２を
介してサブＣＰＵ３のプログラム格納用ＲＯＭ５にアク
セスして行う。したがって、メインＣＰＵ２にのみプロ
グラム更新に必要なローダを用意しておけばよく、サブ
ＣＰＵ３はローダを必要としないため、プログラム更新
のために必要な付属プログラムや構造を簡素化できる。
介してサブＣＰＵ３のプログラム格納用ＲＯＭ５にアク
セスして行う。したがって、メインＣＰＵ２にのみプロ
グラム更新に必要なローダを用意しておけばよく、サブ
ＣＰＵ３はローダを必要としないため、プログラム更新
のために必要な付属プログラムや構造を簡素化できる。
【００１９】プログラムの書替えは、ＩＣカード８から
読み出したデータのアドレス指示部：ＳＴＲＰが指し示
す更新プログラムのアドレスから、バイト指示部：ＬＮ
ＧＳに示されたバイト数をサブＣＰＵ３のプログラム格
納用ＲＯＭ５へ書き込むことにより行う。
読み出したデータのアドレス指示部：ＳＴＲＰが指し示
す更新プログラムのアドレスから、バイト指示部：ＬＮ
ＧＳに示されたバイト数をサブＣＰＵ３のプログラム格
納用ＲＯＭ５へ書き込むことにより行う。
【００２０】このようにして一のサブＣＰＵ３に対する
プログラムの更新が終了したら、メインＣＰＵ２がＩ／
Ｏ６を介して該サブＣＰＵ３の動作停止状態を解除し、
他に更新すべきサブＣＰＵがある場合は、続けて次のサ
ブＣＰＵの更新動作に移行する。ただし、識別コード：
ＩＤが、例えば９９のごとくシステムにあり得ない番号
を示していたときは、ＨＤＲ部の終了を終了とみなしロ
ード動作を終える。
プログラムの更新が終了したら、メインＣＰＵ２がＩ／
Ｏ６を介して該サブＣＰＵ３の動作停止状態を解除し、
他に更新すべきサブＣＰＵがある場合は、続けて次のサ
ブＣＰＵの更新動作に移行する。ただし、識別コード：
ＩＤが、例えば９９のごとくシステムにあり得ない番号
を示していたときは、ＨＤＲ部の終了を終了とみなしロ
ード動作を終える。
【００２１】一方、次に更新すべきサブＣＰＵがない場
合でも、ＩＣカード８がＩＣカード読出部７から引き抜
かれない間は、無限ループの無効動作を続ける。すなわ
ち、プログラム更新モードは、ＩＣカード８の引き抜き
をメインＣＰＵ２が確認したとき初めて解除される。
合でも、ＩＣカード８がＩＣカード読出部７から引き抜
かれない間は、無限ループの無効動作を続ける。すなわ
ち、プログラム更新モードは、ＩＣカード８の引き抜き
をメインＣＰＵ２が確認したとき初めて解除される。
【００２２】なお、本発明は上述した実施例に限定され
るものではなく、本発明の技術的思想に含まれる範囲内
で種々の変形又は応用が可能である。
るものではなく、本発明の技術的思想に含まれる範囲内
で種々の変形又は応用が可能である。
【００２３】
【発明の効果】以上説明したように、本発明によればサ
ブ中央処理部についてプログラムの更新に必要なローダ
やそれを格納しておく回路等の付属プログラム，構造等
を必要としないので、コンピュータ全体のプログラムや
構造の簡素化を図ることができる。
ブ中央処理部についてプログラムの更新に必要なローダ
やそれを格納しておく回路等の付属プログラム，構造等
を必要としないので、コンピュータ全体のプログラムや
構造の簡素化を図ることができる。
【００２４】また、ＩＣカードと更新の対象となったＲ
ＯＭにそれぞれ格納したプログラムに更新日付け，更新
バージョンを含ませ、これらを比較して常に新しいのプ
ログラムにのみ更新するようにすれば、旧バージョンの
プログラムを格納してあるＩＣカードを間違って挿入し
てた場合の不都合を取り除くことができる。
ＯＭにそれぞれ格納したプログラムに更新日付け，更新
バージョンを含ませ、これらを比較して常に新しいのプ
ログラムにのみ更新するようにすれば、旧バージョンの
プログラムを格納してあるＩＣカードを間違って挿入し
てた場合の不都合を取り除くことができる。
【００２５】さらに、ＩＣカードが読取部に挿入されて
いるとき、自動的にメイン中央処理部がプログラム更新
モードとなるようにしておけば、プログラム更新モード
への切換操作を省略して操作の簡素化を図ることができ
る。
いるとき、自動的にメイン中央処理部がプログラム更新
モードとなるようにしておけば、プログラム更新モード
への切換操作を省略して操作の簡素化を図ることができ
る。
【図１】本発明の実施例に係るプログラム更新方法を実
施するのに好適なコンピュータの構成例を示すブロック
図である。
施するのに好適なコンピュータの構成例を示すブロック
図である。
【図２】同じくＩＣカードの内容例を示す構成図であ
る。
る。
【図３】同ＩＣカードに格納されたデータのヘッダ部の
フォーマット例を示す構成図である。
フォーマット例を示す構成図である。
【図４】従来例を説明するためのブロック構成図であ
る。
る。
【図５】他の従来例を説明するためのブロック構成図で
ある。
ある。
１：コンピュータ ２：メインＣＰＵ ３サブＣＰＵ ４：メインＣＰＵのプログラム格納用ＲＯＭ ５：サブＣＰＵのプログラム格納用ＲＯＭ ６：Ｉ／Ｏ ７：ＩＣカード読出部 ８：ＩＣカード ９：ＩＣカード検出器
Claims (3)
- 【請求項１】 メイン中央処理部と少なくとも一のサブ
中央処理部とを有するコンピュータのプログラム更新方
法であって、Ｉ／Ｏを介して前記メイン中央処理部から
送られてきた指令により前記サブ中央処理部の動作制御
を行うとともに、前記メイン中央処理部から該サブ中央
処理部用の書替え可能不揮発性ＲＯＭにアクセスするこ
とによって、該ＲＯＭ内のプログラムを外部から挿入し
たＩＣカードに格納された更新プログラムと書き替える
ことを特徴としたコンピュータのプログラム更新方法。 - 【請求項２】 前記ＩＣカードのデータフォーマットに
おけるヘッダ部に、前記各サブ中央処理部に対応して識
別コード、更新日付け及び更新バージョンを含めるとと
もに、前記各サブ中央処理部用の書替え可能不揮発性Ｒ
ＯＭに格納した更新プログラムのデータ部にもそれぞれ
更新日付け及び更新バージョンを含めておき、前記メイ
ン中央処理部が前記識別コードに基づいてプログラムの
更新を行うサブ中央処理部の動作制御を行うとともに、
同サブ中央処理部用の書替え可能不揮発性ＲＯＭ内に格
納してあるプログラムの更新日付け及び更新バージョン
と、前記ＩＣカード内の該サブ中央処理部用更新プログ
ラムの更新日付け及び更新バージョンとを比較し、ＩＣ
カード内のものの方が新しい場合に、プログラムの書替
えを実行することを特徴とした請求項１記載のコンピュ
ータのプログラム更新方法。 - 【請求項３】 前記ＩＣカードの読取部への挿入を検出
することにより、前記メイン中央処理部が自動的にプロ
グラムの更新制御を行うことを特徴とした請求項１又は
２記載のコンピュータのプログラム更新方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5332084A JPH07191841A (ja) | 1993-12-27 | 1993-12-27 | コンピュータのプログラム更新方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5332084A JPH07191841A (ja) | 1993-12-27 | 1993-12-27 | コンピュータのプログラム更新方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07191841A true JPH07191841A (ja) | 1995-07-28 |
Family
ID=18250972
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5332084A Pending JPH07191841A (ja) | 1993-12-27 | 1993-12-27 | コンピュータのプログラム更新方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07191841A (ja) |
Cited By (11)
| Publication number | Priority date | Publication date | Assignee | Title |
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-
1993
- 1993-12-27 JP JP5332084A patent/JPH07191841A/ja active Pending
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