JPH07168539A - 液晶ディスプレイ装置 - Google Patents
液晶ディスプレイ装置Info
- Publication number
- JPH07168539A JPH07168539A JP5313251A JP31325193A JPH07168539A JP H07168539 A JPH07168539 A JP H07168539A JP 5313251 A JP5313251 A JP 5313251A JP 31325193 A JP31325193 A JP 31325193A JP H07168539 A JPH07168539 A JP H07168539A
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- JP
- Japan
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- input
- liquid crystal
- character
- crystal display
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- Pending
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- Liquid Crystal Display Device Control (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】
【目的】 キャラクタ表示とグラフィック表示とを同時
に行った時にもアトリビュート機能を使用できる液晶デ
ィスプレイ装置を提供する。 【構成】 表示制御回路１からのアドレス信号ＡＤとラ
スタアドレス信号ＲＡに基づいて、アトリビュートデー
タＲＡＭ２、グラフィックデータＲＡＭ４、キャラクタ
ジェネレータＲＯＭからアトリビュートデータ、グラフ
ィックデータ、キャラクタデータを読み出す。アトリビ
ュートデータは表示制御回路１の第１の入力端子ＵＤに
入力される。グラフィックデータ、キャラクタデータ
は、スイッチ回路７、８、並びに論理和回路９を介して
表示制御回路１の第２の入力端子ＬＤに入力される。表
示制御回路１は、これら入力されたデータに対応する表
示を液晶ディスプレイ上に行う。
に行った時にもアトリビュート機能を使用できる液晶デ
ィスプレイ装置を提供する。 【構成】 表示制御回路１からのアドレス信号ＡＤとラ
スタアドレス信号ＲＡに基づいて、アトリビュートデー
タＲＡＭ２、グラフィックデータＲＡＭ４、キャラクタ
ジェネレータＲＯＭからアトリビュートデータ、グラフ
ィックデータ、キャラクタデータを読み出す。アトリビ
ュートデータは表示制御回路１の第１の入力端子ＵＤに
入力される。グラフィックデータ、キャラクタデータ
は、スイッチ回路７、８、並びに論理和回路９を介して
表示制御回路１の第２の入力端子ＬＤに入力される。表
示制御回路１は、これら入力されたデータに対応する表
示を液晶ディスプレイ上に行う。
Description
【０００１】
【産業上の利用分野】本発明は、液晶ディスプレイ装置
に関し、特に単純マトリックス方式で表示を行うドット
マトリックス液晶ディスプレイを有してなる液晶ディス
プレイ装置に関するものである。
に関し、特に単純マトリックス方式で表示を行うドット
マトリックス液晶ディスプレイを有してなる液晶ディス
プレイ装置に関するものである。
【０００２】
【従来の技術】ドットマトリックス液晶ディスプレイを
備えて構成される液晶ディスプレイ装置では、所定の表
示制御回路から出力されるアドレスやラスタデータに基
づいて、アトリビュートデータが記憶されたアトリビュ
ートデータＲＡＭ、グラフィックスデータが記憶された
グラフィックデータＲＡＭ、キャラクタデータが記憶さ
れたキャラクタデータＲＡＭからアトリビュートデー
タ、グラフィックデータ、キャラクタデータなどを読み
出し、これらデータを表示制御回路に入力し、表示制御
回路により液晶ディスプレイ上の表示制御を行う構成と
している。尚、アトリビュートデータとは、液晶ディス
プレイ上における文字のブリンクや反転あるいはカーソ
ル表示などのためのデータをいう。
備えて構成される液晶ディスプレイ装置では、所定の表
示制御回路から出力されるアドレスやラスタデータに基
づいて、アトリビュートデータが記憶されたアトリビュ
ートデータＲＡＭ、グラフィックスデータが記憶された
グラフィックデータＲＡＭ、キャラクタデータが記憶さ
れたキャラクタデータＲＡＭからアトリビュートデー
タ、グラフィックデータ、キャラクタデータなどを読み
出し、これらデータを表示制御回路に入力し、表示制御
回路により液晶ディスプレイ上の表示制御を行う構成と
している。尚、アトリビュートデータとは、液晶ディス
プレイ上における文字のブリンクや反転あるいはカーソ
ル表示などのためのデータをいう。
【０００３】上記の表示制御回路は、ＩＣ化されたもの
が一般的に用いられており、また上記のように読み出さ
れたデータは、この表示制御回路（表示制御ＩＣ）の２
つの入力端子に入力される。この場合、表示制御回路で
は、これら２つの入力端子から入力された２つのデータ
に基づいて液晶ディスプレイ上に所望の表示を行うよう
にしている。そして従来の液晶ディスプレイ装置では、
一方の入力端子にアトリビュートデータとグラフィック
データとのいずれかを選択して入力し、また他方の入力
端子にはキャラクタデータを入力している。一方の入力
端子におけるアトリビュートデータないしグラフィック
データの選択は、表示制御回路における設定によって行
なわれ、液晶ディスプレイにおける表示は、キャラクタ
表示とアトリビュート機能のモードと、キャラクタ表示
とグラフィック表示のモードのいずれかが選択される。
が一般的に用いられており、また上記のように読み出さ
れたデータは、この表示制御回路（表示制御ＩＣ）の２
つの入力端子に入力される。この場合、表示制御回路で
は、これら２つの入力端子から入力された２つのデータ
に基づいて液晶ディスプレイ上に所望の表示を行うよう
にしている。そして従来の液晶ディスプレイ装置では、
一方の入力端子にアトリビュートデータとグラフィック
データとのいずれかを選択して入力し、また他方の入力
端子にはキャラクタデータを入力している。一方の入力
端子におけるアトリビュートデータないしグラフィック
データの選択は、表示制御回路における設定によって行
なわれ、液晶ディスプレイにおける表示は、キャラクタ
表示とアトリビュート機能のモードと、キャラクタ表示
とグラフィック表示のモードのいずれかが選択される。
【０００４】
【発明が解決しようとする課題】しかしながら従来の液
晶ディスプレイ装置では、上記の通りキャラクタ表示と
アトリビュート機能のモードと、キャラクタ表示とグラ
フィック表示のモードのいずれかを選択する必要があ
る。このため、キャラクタ表示とグラフィック表示のモ
ードではアトリビュート機能が使用できなくなってしま
う。また逆に、キャラクタ表示とアトリビュート機能の
モードでは、グラフィック表示が行えないという問題が
あった。
晶ディスプレイ装置では、上記の通りキャラクタ表示と
アトリビュート機能のモードと、キャラクタ表示とグラ
フィック表示のモードのいずれかを選択する必要があ
る。このため、キャラクタ表示とグラフィック表示のモ
ードではアトリビュート機能が使用できなくなってしま
う。また逆に、キャラクタ表示とアトリビュート機能の
モードでは、グラフィック表示が行えないという問題が
あった。
【０００５】本発明の目的は、上記の問題を解決し、キ
ャラクタ表示とグラフィック表示とを同時に行った時に
もアトリビュート機能を使用することができる、液晶デ
ィスプレイ装置を提供することにある。
ャラクタ表示とグラフィック表示とを同時に行った時に
もアトリビュート機能を使用することができる、液晶デ
ィスプレイ装置を提供することにある。
【０００６】
【課題を解決するための手段】本発明の液晶ディスプレ
イ装置は、アトリビュートデータ記憶手段と、グラフィ
ックデータ記憶手段と、キャラクタデータ記憶手段とを
有し、液晶ディスプレイの表示制御回路の第１の出力端
子から出力されたアドレスデータ並びに第２の出力端子
から出力されたラスタアドレスデータに基づいて、前記
アトリビュートデータ、前記グラフィックデータ、並び
に前記キャラクタデータを読み出しこれらを前記表示制
御回路の第１のデータ入力端子あるいは第２のデータ入
力端子に入力し、前記表示制御回路はこれら入力された
データに基づいて液晶ディスプレイ上に所望のデータ表
示をする液晶ディスプレイ装置において、前記表示制御
回路の第１の入力端子に前記アトリビュートデータを入
力し、前記第２の入力端子に前記グラフィックデータと
前記キャラクタデータとをこれらの論理和回路、または
排他的論理和回路を介して入力するようにした。
イ装置は、アトリビュートデータ記憶手段と、グラフィ
ックデータ記憶手段と、キャラクタデータ記憶手段とを
有し、液晶ディスプレイの表示制御回路の第１の出力端
子から出力されたアドレスデータ並びに第２の出力端子
から出力されたラスタアドレスデータに基づいて、前記
アトリビュートデータ、前記グラフィックデータ、並び
に前記キャラクタデータを読み出しこれらを前記表示制
御回路の第１のデータ入力端子あるいは第２のデータ入
力端子に入力し、前記表示制御回路はこれら入力された
データに基づいて液晶ディスプレイ上に所望のデータ表
示をする液晶ディスプレイ装置において、前記表示制御
回路の第１の入力端子に前記アトリビュートデータを入
力し、前記第２の入力端子に前記グラフィックデータと
前記キャラクタデータとをこれらの論理和回路、または
排他的論理和回路を介して入力するようにした。
【０００７】また前記グラフィックデータ並びに前記キ
ャラクタデータの前記論理和回路、または前記排他的論
理和回路への入力を有効、あるいは無効とするスイッチ
回路を設けた。
ャラクタデータの前記論理和回路、または前記排他的論
理和回路への入力を有効、あるいは無効とするスイッチ
回路を設けた。
【０００８】
【作用】上記のように表示制御回路の第１の入力端子に
アトリビュートデータを入力し、また第２の入力端子に
はグラフィックデータをキャラクタデータとを論理和ま
たは排他的論理和して入力することで、液晶ディスプレ
イ上にキャラクタ表示とグラフィックス表示を同時に行
う場合でもアトリビュート機能を使用することができ
る。
アトリビュートデータを入力し、また第２の入力端子に
はグラフィックデータをキャラクタデータとを論理和ま
たは排他的論理和して入力することで、液晶ディスプレ
イ上にキャラクタ表示とグラフィックス表示を同時に行
う場合でもアトリビュート機能を使用することができ
る。
【０００９】また上記のようなスイッチ回路を設けるこ
とで、第２の入力端子へのグラフィックデータないしキ
ャラクタデータの入力の有効、無効を選択することがで
き、同一のアドレス上にグラフィックスデータとキャラ
クタデータを同時に表示する場合における表示データの
選択が行える。
とで、第２の入力端子へのグラフィックデータないしキ
ャラクタデータの入力の有効、無効を選択することがで
き、同一のアドレス上にグラフィックスデータとキャラ
クタデータを同時に表示する場合における表示データの
選択が行える。
【００１０】
【実施例】図１に本発明の実施例の液晶ディスプレイ装
置を示した。この液晶ディスプレイ装置は、表示制御回
路１、アトリビュートデータＲＡＭ２、アドレス変換回
路３、グラフィックデータＲＡＭ４、キャラクタデータ
ＲＡＭ５、キャラクタジェネレータＲＯＭ６、スイッチ
回路７、８、並びに論理和回路９から構成される。アト
リビュートデータＲＡＭ２、アドレス変換回路３、グラ
フィックデータＲＡＭ４、キャラクタデータＲＡＭ５、
キャラクタジェネレータＲＯＭ６、スイッチ回路７、
８、論理和回路９などは、表示制御回路１の駆動回路を
構成する。
置を示した。この液晶ディスプレイ装置は、表示制御回
路１、アトリビュートデータＲＡＭ２、アドレス変換回
路３、グラフィックデータＲＡＭ４、キャラクタデータ
ＲＡＭ５、キャラクタジェネレータＲＯＭ６、スイッチ
回路７、８、並びに論理和回路９から構成される。アト
リビュートデータＲＡＭ２、アドレス変換回路３、グラ
フィックデータＲＡＭ４、キャラクタデータＲＡＭ５、
キャラクタジェネレータＲＯＭ６、スイッチ回路７、
８、論理和回路９などは、表示制御回路１の駆動回路を
構成する。
【００１１】表示制御回路１は、２つの出力端子である
アドレス端子ＡＤ、ラスタアドレス端子ＲＡ、並びに２
つの入力端子である第１の入力端子（データ上位の入力
端子）ＵＤ、第２の入力端子（データ下位の入力端子）
ＬＤを有している。尚、後述するように、第１の入力端
子ＵＤにはデータ上位（データ上位ビット）が、また第
２の入力端子ＬＤにはデータ下位（データ下位ビット）
が、それぞれ入力される。更に、図示は省略したが、表
示制御回路１には更に液晶ディスプレイが接続されてい
る。また表示制御回路１は、通常は、ＩＣ化されて表示
制御ＩＣとしたものが用いられる。
アドレス端子ＡＤ、ラスタアドレス端子ＲＡ、並びに２
つの入力端子である第１の入力端子（データ上位の入力
端子）ＵＤ、第２の入力端子（データ下位の入力端子）
ＬＤを有している。尚、後述するように、第１の入力端
子ＵＤにはデータ上位（データ上位ビット）が、また第
２の入力端子ＬＤにはデータ下位（データ下位ビット）
が、それぞれ入力される。更に、図示は省略したが、表
示制御回路１には更に液晶ディスプレイが接続されてい
る。また表示制御回路１は、通常は、ＩＣ化されて表示
制御ＩＣとしたものが用いられる。
【００１２】アドレス端子ＡＤからの出力であるアドレ
ス信号は、アトリビュートデータＲＡＭ２、アドレス変
換回路３、並びにキャラクタデータＲＡＭ５にそれぞれ
入力される。またラスタアドレス端子ＲＡからの出力で
あるラスタアドレス信号は、アドレス変換回路３、並び
にキャラクタジェネレータＲＯＭにそれぞれ入力され
る。そして、表示制御回路１は、アドレス信号によりキ
ャラクタアドレス（文字位置）を指示し、同時にラスタ
アドレス信号により同アドレスにおけるビット位置をバ
イト単位で指示する。ここで、アドレスとラスタアドレ
スの関係は図２に示した通りであり、図示した例では１
つのアドレスは１６個のラスタアドレスから構成され
る。
ス信号は、アトリビュートデータＲＡＭ２、アドレス変
換回路３、並びにキャラクタデータＲＡＭ５にそれぞれ
入力される。またラスタアドレス端子ＲＡからの出力で
あるラスタアドレス信号は、アドレス変換回路３、並び
にキャラクタジェネレータＲＯＭにそれぞれ入力され
る。そして、表示制御回路１は、アドレス信号によりキ
ャラクタアドレス（文字位置）を指示し、同時にラスタ
アドレス信号により同アドレスにおけるビット位置をバ
イト単位で指示する。ここで、アドレスとラスタアドレ
スの関係は図２に示した通りであり、図示した例では１
つのアドレスは１６個のラスタアドレスから構成され
る。
【００１３】アトリビュートデータＲＡＭ２、グラフィ
ックデータＲＡＭ４、並びにキャラクタデータＲＡＭ５
にはそれぞれ、図示しない例えばＣＰＵ（中央処理装
置）により転送された液晶ディスプレイの画面の全アド
レスに対応するアトリビュートデータ、グラフィックデ
ータ、キャラクタデータ（テキストデータ）がそれぞれ
記憶・保持されている。そして、アトリビュートデータ
ＲＡＭ２は、表示制御回路１からのアドレス信号によ
り、このアドレス信号に対応するアドレスのアトリビュ
ートデータを第１のデータ端子ＵＤに出力する。
ックデータＲＡＭ４、並びにキャラクタデータＲＡＭ５
にはそれぞれ、図示しない例えばＣＰＵ（中央処理装
置）により転送された液晶ディスプレイの画面の全アド
レスに対応するアトリビュートデータ、グラフィックデ
ータ、キャラクタデータ（テキストデータ）がそれぞれ
記憶・保持されている。そして、アトリビュートデータ
ＲＡＭ２は、表示制御回路１からのアドレス信号によ
り、このアドレス信号に対応するアドレスのアトリビュ
ートデータを第１のデータ端子ＵＤに出力する。
【００１４】アドレス変換回路３は、上記のようにアド
レス信号とラスタアドレス信号を入力し、アドレス信号
により指示されたキャラクタアドレスにおけるビット位
置をバイト単位でグラフィックデータＲＡＭ４が出力す
るように指示するものである。またキャラクタデータＲ
ＡＭ５は、入力されたアドレス信号ＡＤに対応するアド
レスにおけるキャラクタコードをキャラクタジェネレー
タＲＯＭ６に出力する。キャラクタジェネレータＲＯＭ
６にはキャラクタコードに対応する文字データが記憶さ
れている。そして、キャラクタデータＲＡＭ５から入力
されたキャラクタコードに対応する文字データを、表示
制御回路１から入力されたラスタアドレス信号に従って
バイト単位で出力する。
レス信号とラスタアドレス信号を入力し、アドレス信号
により指示されたキャラクタアドレスにおけるビット位
置をバイト単位でグラフィックデータＲＡＭ４が出力す
るように指示するものである。またキャラクタデータＲ
ＡＭ５は、入力されたアドレス信号ＡＤに対応するアド
レスにおけるキャラクタコードをキャラクタジェネレー
タＲＯＭ６に出力する。キャラクタジェネレータＲＯＭ
６にはキャラクタコードに対応する文字データが記憶さ
れている。そして、キャラクタデータＲＡＭ５から入力
されたキャラクタコードに対応する文字データを、表示
制御回路１から入力されたラスタアドレス信号に従って
バイト単位で出力する。
【００１５】スイッチ回路７、８は、図示しない例えば
ＣＰＵからの指令信号により動作し、グラフィックデー
タＲＡＭ４からのグラフィックデータ、あるいはキャラ
クタジェネレータＲＯＭ６からのキャラクタデータの論
理和回路９への入力をＯＮ、ＯＦＦする。これらスイッ
チ回路７、８と論理和回路９の具体的な構成を図３に例
示した。図３において、スイッチ回路７、８はＩＣ化さ
れており、各ＩＣの図のいて最下の端子にＣＰＵからの
指令信号が入力される。そしてこの指令信号によりスイ
ッチ回路７、８がＯＮした場合には、グラフィックデー
タ、キャラクタデータが論理和回路９に入力される。ま
たスイッチ回路７、８がＯＦＦの場合には、これらの回
路はプルダウンとなる。即ち論理和回路９への信号線が
論理和回路９側にある抵抗を通して接地された状態とな
り、入力信号断となって論理和回路９への出力がＬ出力
（０データ）となる。
ＣＰＵからの指令信号により動作し、グラフィックデー
タＲＡＭ４からのグラフィックデータ、あるいはキャラ
クタジェネレータＲＯＭ６からのキャラクタデータの論
理和回路９への入力をＯＮ、ＯＦＦする。これらスイッ
チ回路７、８と論理和回路９の具体的な構成を図３に例
示した。図３において、スイッチ回路７、８はＩＣ化さ
れており、各ＩＣの図のいて最下の端子にＣＰＵからの
指令信号が入力される。そしてこの指令信号によりスイ
ッチ回路７、８がＯＮした場合には、グラフィックデー
タ、キャラクタデータが論理和回路９に入力される。ま
たスイッチ回路７、８がＯＦＦの場合には、これらの回
路はプルダウンとなる。即ち論理和回路９への信号線が
論理和回路９側にある抵抗を通して接地された状態とな
り、入力信号断となって論理和回路９への出力がＬ出力
（０データ）となる。
【００１６】この実施例の液晶ディスプレイ装置の動作
は次の通りである。
は次の通りである。
【００１７】表示制御回路１からは液晶ディスプレイ上
におけるキャラクタ単位での表示位置を示す上記のアド
レス信号ＡＤと、キャラクタ内のアドレスをラスタアド
レスで示すラスタアドレス信号ＲＡが出力される。する
と、アトリビュートデータＲＡＭ２からは、対応するア
ドレスにおけるアトリビュートデータが表示制御回路１
の第１の入力端子ＵＤに入力される。
におけるキャラクタ単位での表示位置を示す上記のアド
レス信号ＡＤと、キャラクタ内のアドレスをラスタアド
レスで示すラスタアドレス信号ＲＡが出力される。する
と、アトリビュートデータＲＡＭ２からは、対応するア
ドレスにおけるアトリビュートデータが表示制御回路１
の第１の入力端子ＵＤに入力される。
【００１８】同時に、グラフィックデータＲＡＭからは
対応するアドレスにおけるグラフィックデータが、キャ
ラクタジェネレータ６からは対応するアドレスにおける
キャラクタデータがそれぞれ出力され、またこれらのデ
ータは、スイッチ回路７、８を介して論理和回路９に入
力され、論理和回路９から表示制御回路１の第２の入力
端子ＬＤには、グラフィックデータとキャラクタデータ
との論理和のデータが入力される。そして、表示制御回
路１は、液晶ディスプレイ上の対応するアドレスにこれ
ら入力された２つのデータに基づいた表示を行う。そし
てこの実施例の液晶ディスプレイ装置によれば、キャラ
クタ表示とグラフィックス表示を同時に行った場合でも
アトリビュート機能を使用することができる。
対応するアドレスにおけるグラフィックデータが、キャ
ラクタジェネレータ６からは対応するアドレスにおける
キャラクタデータがそれぞれ出力され、またこれらのデ
ータは、スイッチ回路７、８を介して論理和回路９に入
力され、論理和回路９から表示制御回路１の第２の入力
端子ＬＤには、グラフィックデータとキャラクタデータ
との論理和のデータが入力される。そして、表示制御回
路１は、液晶ディスプレイ上の対応するアドレスにこれ
ら入力された２つのデータに基づいた表示を行う。そし
てこの実施例の液晶ディスプレイ装置によれば、キャラ
クタ表示とグラフィックス表示を同時に行った場合でも
アトリビュート機能を使用することができる。
【００１９】ここで、液晶ディスプレイ上にキャラクタ
のみを表示する場合は、キャラクタデータ側のスイッチ
回路８のみをＯＮとすれば良い。そうすれば、グラフィ
ックデータ側のスイッチ回路７はプルダウンにより
「０」となるため、論理和回路９にはキャラクタデータ
だけが入力される。逆にグラフィックデータのみを液晶
ディスプレイ上に表示するときは、グラフィックデータ
側のスイッチ回路７のみをＯＮとすることで、同様にグ
ラフィックデータのみが有効になる。また両方のスイッ
チ回路７、８をＯＮすれば、キャラクタデータとグラフ
ィックデータが論理和回路に出力され、液晶ディスプレ
イ上には両データが同時に表示される。更に両方のスイ
ッチ回路７、８をＯＦＦすれば、表示データが「０」に
なり、液晶ディスプレイ上の表示がＯＦＦとなる。
のみを表示する場合は、キャラクタデータ側のスイッチ
回路８のみをＯＮとすれば良い。そうすれば、グラフィ
ックデータ側のスイッチ回路７はプルダウンにより
「０」となるため、論理和回路９にはキャラクタデータ
だけが入力される。逆にグラフィックデータのみを液晶
ディスプレイ上に表示するときは、グラフィックデータ
側のスイッチ回路７のみをＯＮとすることで、同様にグ
ラフィックデータのみが有効になる。また両方のスイッ
チ回路７、８をＯＮすれば、キャラクタデータとグラフ
ィックデータが論理和回路に出力され、液晶ディスプレ
イ上には両データが同時に表示される。更に両方のスイ
ッチ回路７、８をＯＦＦすれば、表示データが「０」に
なり、液晶ディスプレイ上の表示がＯＦＦとなる。
【００２０】以上はスイッチ回路７、８を論理和回路９
を介して表示制御回路１の第２の入力端子ＬＤに入力す
る構成としたが、論理和回路９に代えて排他的論理和回
路を用いても同様な効果が得られることは明らかであ
る。尚、このように排他的論理和回路を用いる場合にお
いて、同一アドレス上にグラフィックスデータとキャラ
クタデータを同時に表示する場合には、上記のようなス
イッチ回路７、８のＯＮ、ＯＦＦ制御により、同アドレ
スに表示すべきデータを選択すれば良い。
を介して表示制御回路１の第２の入力端子ＬＤに入力す
る構成としたが、論理和回路９に代えて排他的論理和回
路を用いても同様な効果が得られることは明らかであ
る。尚、このように排他的論理和回路を用いる場合にお
いて、同一アドレス上にグラフィックスデータとキャラ
クタデータを同時に表示する場合には、上記のようなス
イッチ回路７、８のＯＮ、ＯＦＦ制御により、同アドレ
スに表示すべきデータを選択すれば良い。
【００２１】
【発明の効果】本発明では、表示制御回路の第１の入力
端子にアトリビュートデータを入力し、また第２の入力
端子にはグラフィックデータをキャラクタデータとを論
理和または排他的論理和して入力する構成としたので、
液晶ディスプレイ上にキャラクタ表示とグラフィック表
示とを同時に行った時にもアトリビュート機能を使用す
ることができる。同様に、キャラクタ表示とアトリビュ
ート機能を使用した時にもグラフィック表示を行うこと
ができるという効果がある。
端子にアトリビュートデータを入力し、また第２の入力
端子にはグラフィックデータをキャラクタデータとを論
理和または排他的論理和して入力する構成としたので、
液晶ディスプレイ上にキャラクタ表示とグラフィック表
示とを同時に行った時にもアトリビュート機能を使用す
ることができる。同様に、キャラクタ表示とアトリビュ
ート機能を使用した時にもグラフィック表示を行うこと
ができるという効果がある。
【図１】本発明の実施例の液晶ディスプレイ装置を示し
たブロック図である。
たブロック図である。
【図２】アドレスとラスタアドレスの関係を示した説明
図である。
図である。
【図３】実施例におけるスイッチ回路と論理和回路の具
体的な構成を示した回路図である。
体的な構成を示した回路図である。
１ 表示制御回路 ２ アトリビュートデータＲＡＭ ３ アドレス変換回路 ４ グラフィックデータＲＡＭ ５ キャラクタデータＲＡＭ ６ キャラクタジェネレータＲＯＭ ７、８ スイッチ回路 ９ 論理和回路
Claims (4)
- 【請求項１】 アトリビュートデータ記憶手段と、グラ
フィックデータ記憶手段と、キャラクタデータ記憶手段
とを有し、液晶ディスプレイの表示制御回路の第１の出
力端子から出力されたアドレスデータ並びに第２の出力
端子から出力されたラスタアドレスデータに基づいて、
前記アトリビュートデータ、前記グラフィックデータ、
並びに前記キャラクタデータを読み出しこれらを前記表
示制御回路の第１のデータ入力端子あるいは第２のデー
タ入力端子に入力し、前記表示制御回路はこれら入力さ
れたデータに基づいて液晶ディスプレイ上に所望のデー
タ表示をする液晶ディスプレイ装置において、 前記表示制御回路の第１の入力端子に前記アトリビュー
トデータを入力し、前記第２の入力端子に前記グラフィ
ックデータと前記キャラクタデータとをこれらの論理和
回路を介して入力した、ことを特徴とする液晶ディスプ
レイ装置。 - 【請求項２】 前記グラフィックデータ並びに前記キャ
ラクタデータの前記論理和回路への入力を有効、あるい
は無効とするスイッチ回路を設けた、ことを特徴とする
請求項１記載の液晶ディスプレイ装置。 - 【請求項３】 アトリビュートデータ記憶手段と、グラ
フィックデータ記憶手段と、キャラクタデータ記憶手段
とを有し、液晶ディスプレイの表示制御回路の第１の出
力端子から出力されたアドレスデータ並びに第２の出力
端子から出力されたラスタアドレスデータに基づいて、
前記アトリビュートデータ、前記グラフィックデータ、
並びに前記キャラクタデータを読み出しこれらを前記表
示制御回路の第１のデータ入力端子あるいは第２のデー
タ入力端子に入力し、前記表示制御回路はこれら入力さ
れたデータに基づいて液晶ディスプレイ上に所望のデー
タ表示をする液晶ディスプレイ装置において、 前記表示制御回路の第１の入力端子に前記アトリビュー
トデータを入力し、前記第２の入力端子に前記グラフィ
ックデータと前記キャラクタデータとをこれらの排他的
論理和回路を介して入力した、ことを特徴とする液晶デ
ィスプレイ装置。 - 【請求項４】 前記グラフィックデータ、並びに前記キ
ャラクタデータの前記排他的論理和回路への入力を有
効、あるいは無効とするスイッチ回路を設けた、ことを
特徴とする請求項３記載の液晶ディスプレイ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5313251A JPH07168539A (ja) | 1993-12-14 | 1993-12-14 | 液晶ディスプレイ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5313251A JPH07168539A (ja) | 1993-12-14 | 1993-12-14 | 液晶ディスプレイ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07168539A true JPH07168539A (ja) | 1995-07-04 |
Family
ID=18038952
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5313251A Pending JPH07168539A (ja) | 1993-12-14 | 1993-12-14 | 液晶ディスプレイ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07168539A (ja) |
-
1993
- 1993-12-14 JP JP5313251A patent/JPH07168539A/ja active Pending
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