JPH07161731A - 狭禁止帯幅特性を有する炭素ドーピング・シリコン半導体デバイスとその方法 - Google Patents
狭禁止帯幅特性を有する炭素ドーピング・シリコン半導体デバイスとその方法Info
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- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 title claims abstract description 82
- 229910052710 silicon Inorganic materials 0.000 title claims abstract description 81
- 239000010703 silicon Substances 0.000 title claims abstract description 81
- 239000004065 semiconductor Substances 0.000 title claims abstract description 62
- 238000000034 method Methods 0.000 title claims description 30
- 229910052799 carbon Inorganic materials 0.000 claims abstract description 63
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 claims abstract description 62
- 239000002019 doping agent Substances 0.000 claims abstract description 16
- 239000007943 implant Substances 0.000 claims description 18
- 238000005468 ion implantation Methods 0.000 claims description 9
- 238000006467 substitution reaction Methods 0.000 claims description 6
- 238000000137 annealing Methods 0.000 claims description 5
- 238000002347 injection Methods 0.000 claims description 5
- 239000007924 injection Substances 0.000 claims description 5
- 239000007790 solid phase Substances 0.000 claims description 4
- 229910021420 polycrystalline silicon Inorganic materials 0.000 abstract description 15
- 230000007547 defect Effects 0.000 abstract description 7
- 230000015572 biosynthetic process Effects 0.000 abstract description 4
- 229910021480 group 4 element Inorganic materials 0.000 abstract description 4
- 230000035945 sensitivity Effects 0.000 abstract 1
- 239000000758 substrate Substances 0.000 description 22
- 125000004429 atom Chemical group 0.000 description 18
- 238000002513 implantation Methods 0.000 description 15
- 229910052732 germanium Inorganic materials 0.000 description 11
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 description 11
- 150000004767 nitrides Chemical class 0.000 description 10
- 238000005229 chemical vapour deposition Methods 0.000 description 7
- 238000000151 deposition Methods 0.000 description 6
- 238000004519 manufacturing process Methods 0.000 description 5
- 230000008021 deposition Effects 0.000 description 4
- 238000001465 metallisation Methods 0.000 description 4
- 229910010271 silicon carbide Inorganic materials 0.000 description 4
- 238000005280 amorphization Methods 0.000 description 3
- 229910052785 arsenic Inorganic materials 0.000 description 3
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 3
- 238000005530 etching Methods 0.000 description 3
- 238000000206 photolithography Methods 0.000 description 3
- 238000012545 processing Methods 0.000 description 3
- 238000004151 rapid thermal annealing Methods 0.000 description 3
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 2
- CURLTUGMZLYLDI-UHFFFAOYSA-N Carbon dioxide Chemical compound O=C=O CURLTUGMZLYLDI-UHFFFAOYSA-N 0.000 description 2
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 2
- 229910018540 Si C Inorganic materials 0.000 description 2
- KCFIHQSTJSCCBR-UHFFFAOYSA-N [C].[Ge] Chemical compound [C].[Ge] KCFIHQSTJSCCBR-UHFFFAOYSA-N 0.000 description 2
- 229910052796 boron Inorganic materials 0.000 description 2
- 230000005465 channeling Effects 0.000 description 2
- 238000002329 infrared spectrum Methods 0.000 description 2
- 238000010884 ion-beam technique Methods 0.000 description 2
- 229910052751 metal Inorganic materials 0.000 description 2
- 239000002184 metal Substances 0.000 description 2
- 229910052698 phosphorus Inorganic materials 0.000 description 2
- 239000011574 phosphorus Substances 0.000 description 2
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Chemical compound [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 2
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 description 2
- ZXEYZECDXFPJRJ-UHFFFAOYSA-N $l^{3}-silane;platinum Chemical compound [SiH3].[Pt] ZXEYZECDXFPJRJ-UHFFFAOYSA-N 0.000 description 1
- FIPWRIJSWJWJAI-UHFFFAOYSA-N Butyl carbitol 6-propylpiperonyl ether Chemical compound C1=C(CCC)C(COCCOCCOCCCC)=CC2=C1OCO2 FIPWRIJSWJWJAI-UHFFFAOYSA-N 0.000 description 1
- 239000002253 acid Substances 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 125000004432 carbon atom Chemical group C* 0.000 description 1
- 229910002092 carbon dioxide Inorganic materials 0.000 description 1
- 239000001569 carbon dioxide Substances 0.000 description 1
- -1 carbon ion Chemical class 0.000 description 1
- 238000005094 computer simulation Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 229910021478 group 5 element Inorganic materials 0.000 description 1
- 230000002779 inactivation Effects 0.000 description 1
- 238000010348 incorporation Methods 0.000 description 1
- 238000011835 investigation Methods 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 230000000873 masking effect Effects 0.000 description 1
- 238000001451 molecular beam epitaxy Methods 0.000 description 1
- 238000002161 passivation Methods 0.000 description 1
- 229920002120 photoresistant polymer Polymers 0.000 description 1
- 229910052697 platinum Inorganic materials 0.000 description 1
- 229910021339 platinum silicide Inorganic materials 0.000 description 1
- 238000007517 polishing process Methods 0.000 description 1
- 239000002244 precipitate Substances 0.000 description 1
- 238000001953 recrystallisation Methods 0.000 description 1
- 238000012552 review Methods 0.000 description 1
- 239000002210 silicon-based material Substances 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
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- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/16—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic Table
- H01L29/161—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic Table including two or more of the elements provided for in group H01L29/16, e.g. alloys
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Abstract
(57)【要約】
【目的】 シリコンと炭素がドーピングされたシリコン
からなる半導体デバイスが提供される。 【構成】 シリコンに比べて禁止帯幅特性の狭いIV−
IV半導体デバイス21、41と、その形成方法であ
る。0.5%ないし1.1%の置換濃度で炭素をシリコ
ン内に組み込むことにより、シリコンに比べ禁止帯幅が
狭く結晶性が良い半導体デバイス21,41が実現され
る。半導体デバイス21,41は、狭禁止帯幅領域を用
いる半導体ヘテロ接合デバイスに適している。
からなる半導体デバイスが提供される。 【構成】 シリコンに比べて禁止帯幅特性の狭いIV−
IV半導体デバイス21、41と、その形成方法であ
る。0.5%ないし1.1%の置換濃度で炭素をシリコ
ン内に組み込むことにより、シリコンに比べ禁止帯幅が
狭く結晶性が良い半導体デバイス21,41が実現され
る。半導体デバイス21,41は、狭禁止帯幅領域を用
いる半導体ヘテロ接合デバイスに適している。
Description
【0001】
【産業上の利用分野】本発明は一般に、ヘテロ接合半導
体デバイスに関し、さらに詳しくはシリコンと炭素がド
ーピングされたシリコンからなる半導体デバイスに関す
る。
体デバイスに関し、さらに詳しくはシリコンと炭素がド
ーピングされたシリコンからなる半導体デバイスに関す
る。
【0002】
【従来の技術】少なくとも2個のIV群元素,シリコ
ン,ゲルマニウムおよび炭素で構成される半導体ヘテロ
接合デバイスは、広く報告されている。特定の用途にお
いては、IV群元素を用いるヘテロ接合デバイスは、た
とえばIII群元素およびV群元素を用いるヘテロ接合
デバイスよりも好ましい。これはIV元素で構成される
ヘテロ接合デバイスのほうが費用効果が良いためであ
る。
ン,ゲルマニウムおよび炭素で構成される半導体ヘテロ
接合デバイスは、広く報告されている。特定の用途にお
いては、IV群元素を用いるヘテロ接合デバイスは、た
とえばIII群元素およびV群元素を用いるヘテロ接合
デバイスよりも好ましい。これはIV元素で構成される
ヘテロ接合デバイスのほうが費用効果が良いためであ
る。
【0003】設計者は通常、シリコンに炭素を加えて、
シリコンに比べ禁止帯の幅が広いデバイスを作成してき
た。禁止帯の幅は、シリコン材料内の炭素濃度を可変す
ることによって変える。たとえば、シリコンに炭素を加
えてHBTデバイス内に禁止帯幅が広げられたエミッタ
領域を形成している。炭化シリコンは、炭素が高濃度に
ドーピングされた(>40%炭素)シリコンの広く用い
られている形であり、摂氏25度で1.12eVという
シリコンの禁止帯幅に比べて2.2eVないし3.3e
Vの禁止帯幅を有する。
シリコンに比べ禁止帯の幅が広いデバイスを作成してき
た。禁止帯の幅は、シリコン材料内の炭素濃度を可変す
ることによって変える。たとえば、シリコンに炭素を加
えてHBTデバイス内に禁止帯幅が広げられたエミッタ
領域を形成している。炭化シリコンは、炭素が高濃度に
ドーピングされた(>40%炭素)シリコンの広く用い
られている形であり、摂氏25度で1.12eVという
シリコンの禁止帯幅に比べて2.2eVないし3.3e
Vの禁止帯幅を有する。
【0004】設計者はまた、HBTデバイス内で禁止帯
幅の広いエミッタ領域のために、ゲルマニウム−炭素が
ドーピングされたシリコンも用いてきた。ゲルマニウム
−炭素がドーピングされたシリコン・デバイスには、質
の良い半導体層を設けるために、ゲルマニウムと炭素と
いう2つの元素の濃度を生産者が制御しなければならな
いという欠点がある。
幅の広いエミッタ領域のために、ゲルマニウム−炭素が
ドーピングされたシリコンも用いてきた。ゲルマニウム
−炭素がドーピングされたシリコン・デバイスには、質
の良い半導体層を設けるために、ゲルマニウムと炭素と
いう2つの元素の濃度を生産者が制御しなければならな
いという欠点がある。
【0005】シリコンに比べて狭い禁止帯幅をもつシリ
コンを提供するには、設計者はシリコンにゲルマニウム
を加えるのが普通である。しかし、ゲルマニウムをドー
ピングしたシリコンにはいくつかの欠点がある。たとえ
ば、禁止帯幅を充分に狭くするためには、通常8%超の
ゲルマニウムという比較的高い濃度を用いなければなら
ない。禁止帯幅を狭くするためには高濃度のゲルマニウ
ムが必要になるので、ゲルマニウムをドーピングしたシ
リコン・デバイスは、不適合の結晶転位などの結晶性欠
陥に対して敏感である。このような結晶性欠陥により、
禁止帯幅を狭めたデバイスを生産する能力は大きな制約
を受ける。
コンを提供するには、設計者はシリコンにゲルマニウム
を加えるのが普通である。しかし、ゲルマニウムをドー
ピングしたシリコンにはいくつかの欠点がある。たとえ
ば、禁止帯幅を充分に狭くするためには、通常8%超の
ゲルマニウムという比較的高い濃度を用いなければなら
ない。禁止帯幅を狭くするためには高濃度のゲルマニウ
ムが必要になるので、ゲルマニウムをドーピングしたシ
リコン・デバイスは、不適合の結晶転位などの結晶性欠
陥に対して敏感である。このような結晶性欠陥により、
禁止帯幅を狭めたデバイスを生産する能力は大きな制約
を受ける。
【0006】さらに、ゲルマニウムをドーピングしたシ
リコン層を製造するために用いられる工程はコストがか
かる。分子線エピタキシャル付着または従来のエピタキ
シャル付着などの化学蒸着(CVD:chemical vapor d
eposition )法が、ゲルマニウムをドーピングしたシリ
コン層形成のために通常用いられる。このCVD法は、
大きな資本投資を必要とし、処理量は少ない。またゲル
マニウムをドーピングしたシリコン層を選択的に付着さ
せるためにCVD法を用いると、かなりの前付着処理が
必要になり、そのために製造コストがさらに高くなる。
このように製造コストが増大することによって、ヘテロ
接合デバイスと非ヘテロ接合デバイスとを同一のモノリ
シック集積回路内に組み込む能力が制約を受ける。
リコン層を製造するために用いられる工程はコストがか
かる。分子線エピタキシャル付着または従来のエピタキ
シャル付着などの化学蒸着(CVD:chemical vapor d
eposition )法が、ゲルマニウムをドーピングしたシリ
コン層形成のために通常用いられる。このCVD法は、
大きな資本投資を必要とし、処理量は少ない。またゲル
マニウムをドーピングしたシリコン層を選択的に付着さ
せるためにCVD法を用いると、かなりの前付着処理が
必要になり、そのために製造コストがさらに高くなる。
このように製造コストが増大することによって、ヘテロ
接合デバイスと非ヘテロ接合デバイスとを同一のモノリ
シック集積回路内に組み込む能力が制約を受ける。
【0007】シリコンにゲルマニウムをドーピングする
にはイオン注入が用いられてきたが、狭禁止帯幅特性を
実現するには大量のゲルマニウム注入量が必要である。
大量のゲルマニウム注入量は、かなりの注入時間を必要
とし、その結果シリコン格子に大きな損傷を与えて、再
結晶化と欠陥の減少を困難にする。
にはイオン注入が用いられてきたが、狭禁止帯幅特性を
実現するには大量のゲルマニウム注入量が必要である。
大量のゲルマニウム注入量は、かなりの注入時間を必要
とし、その結果シリコン格子に大きな損傷を与えて、再
結晶化と欠陥の減少を困難にする。
【0008】
【発明が解決しようとする課題】そのため、シリコンに
比べて禁止帯幅が狭く、比較的低濃度のIV群元素を用
いて禁止帯幅を狭め、欠陥形成に対する感受性がより低
く、費用効果の良い製造技術を用いて選択的に形成する
ことができるIV−IV半導体ヘテロ接合デバイスが必
要である。
比べて禁止帯幅が狭く、比較的低濃度のIV群元素を用
いて禁止帯幅を狭め、欠陥形成に対する感受性がより低
く、費用効果の良い製造技術を用いて選択的に形成する
ことができるIV−IV半導体ヘテロ接合デバイスが必
要である。
【0009】
【課題を解決するための手段】簡単に述べると、シリコ
ンに比べて狭い禁止帯幅特性を有する炭素ドーピング・
シリコン半導体デバイスであって、実質的にシリコンか
らなる第1結晶性半導体層と、実質的に炭素がドーピン
グされたシリコンからなる第2結晶性半導体層とによっ
て構成される半導体デバイスが提供される。第1層およ
び第2層が、ヘテロ接合を形成する。炭素は、炭素ドー
ピング・シリコン層内に、0.5%ないし1.1%の炭
素置換濃度で存在する。
ンに比べて狭い禁止帯幅特性を有する炭素ドーピング・
シリコン半導体デバイスであって、実質的にシリコンか
らなる第1結晶性半導体層と、実質的に炭素がドーピン
グされたシリコンからなる第2結晶性半導体層とによっ
て構成される半導体デバイスが提供される。第1層およ
び第2層が、ヘテロ接合を形成する。炭素は、炭素ドー
ピング・シリコン層内に、0.5%ないし1.1%の炭
素置換濃度で存在する。
【0010】炭素がドーピングされたシリコン半導体デ
バイスの作成方法も提供される。この方法は、実質的に
シリコンからなる第1導電型の第1半導体層を設ける段
階と、実質的にシリコンからなる第2導電型の第2半導
体層を第1半導体層上に形成する段階と、0.5%ない
し1.1%の置換濃度で第2半導体層内に炭素を組み込
む段階と、実質的にシリコンからなる第1導電型の第3
半導体層を第2半導体層上に形成する段階とによって構
成される。第1半導体層がコレクタ領域を形成し、第2
半導体領域がベース領域を形成し、第3半導体層がエミ
ッタ領域を形成する。
バイスの作成方法も提供される。この方法は、実質的に
シリコンからなる第1導電型の第1半導体層を設ける段
階と、実質的にシリコンからなる第2導電型の第2半導
体層を第1半導体層上に形成する段階と、0.5%ない
し1.1%の置換濃度で第2半導体層内に炭素を組み込
む段階と、実質的にシリコンからなる第1導電型の第3
半導体層を第2半導体層上に形成する段階とによって構
成される。第1半導体層がコレクタ領域を形成し、第2
半導体領域がベース領域を形成し、第3半導体層がエミ
ッタ領域を形成する。
【0011】
【実施例】一般に、本発明はIV−IV半導体ヘテロ接
合デバイスと、炭素がドーピングされたシリコンを用い
てシリコンに比べて狭い禁止帯幅を作成する方法とを提
供する。コンピュータ・モデリング法を用いた理論的研
究により、低濃度から中濃度(1.6%超の炭素)の炭
素濃度においては、炭素がドーピングされたシリコン
は、シリコンを置換格子場内に置くと、純粋なシリコン
に比べて狭い禁止帯幅を示すことがわかっている。Demk
ov, Alexander 他,「Theoretical Investigation of R
andom Si-C Alloys 」(Physical Review B, 48, 2207
(1993))狭禁止帯幅特性は炭素とシリコンとの間の共有
結合半径の差(炭素が3.57オングストローム,シリ
コンが5.43オングストローム)のために起こると思
われている。シリコン格子内に炭素が置換して存在する
と、共有結合半径の差によって炭素原子の周りに格子の
歪が起こる。この歪の存在により歪のないシリコンのエ
ネルギ・レベルの縮退(degeneracy)がなくなるので、
禁止帯幅が小さくなる。禁止帯幅を狭めるような歪が起
こるためには、炭素をシリコン格子内に置換的に組み込
まねばならない。
合デバイスと、炭素がドーピングされたシリコンを用い
てシリコンに比べて狭い禁止帯幅を作成する方法とを提
供する。コンピュータ・モデリング法を用いた理論的研
究により、低濃度から中濃度(1.6%超の炭素)の炭
素濃度においては、炭素がドーピングされたシリコン
は、シリコンを置換格子場内に置くと、純粋なシリコン
に比べて狭い禁止帯幅を示すことがわかっている。Demk
ov, Alexander 他,「Theoretical Investigation of R
andom Si-C Alloys 」(Physical Review B, 48, 2207
(1993))狭禁止帯幅特性は炭素とシリコンとの間の共有
結合半径の差(炭素が3.57オングストローム,シリ
コンが5.43オングストローム)のために起こると思
われている。シリコン格子内に炭素が置換して存在する
と、共有結合半径の差によって炭素原子の周りに格子の
歪が起こる。この歪の存在により歪のないシリコンのエ
ネルギ・レベルの縮退(degeneracy)がなくなるので、
禁止帯幅が小さくなる。禁止帯幅を狭めるような歪が起
こるためには、炭素をシリコン格子内に置換的に組み込
まねばならない。
【0012】本発明は、図1および図2を参考にする
と、さらによく説明することができる。図1から明かな
ように、シリコン内の炭素濃度が小さい(1.5%未満
の炭素濃度)ときに狭禁止帯幅特性が見られる。図1に
示されるような狭禁止帯幅特性を実現するために、ダイ
オード・デバイスが従来の半導体処理技術を用いて製造
された。図2は、ダイオード・デバイス21の拡大断面
図である。ダイオード・デバイス21は、p型シリコン
基板22,炭素がドーピングされたシリコン領域23,
n型領域24,n型多結晶シリコン層29,陰極金属接
触31および陽極金属接触32で構成される。ダイオー
ド・デバイス21は、たとえば酸化物層26,窒化物層
27および酸化物層28などの従来の不活性化(パッシ
ベーション)層を用いて不活性化される。
と、さらによく説明することができる。図1から明かな
ように、シリコン内の炭素濃度が小さい(1.5%未満
の炭素濃度)ときに狭禁止帯幅特性が見られる。図1に
示されるような狭禁止帯幅特性を実現するために、ダイ
オード・デバイスが従来の半導体処理技術を用いて製造
された。図2は、ダイオード・デバイス21の拡大断面
図である。ダイオード・デバイス21は、p型シリコン
基板22,炭素がドーピングされたシリコン領域23,
n型領域24,n型多結晶シリコン層29,陰極金属接
触31および陽極金属接触32で構成される。ダイオー
ド・デバイス21は、たとえば酸化物層26,窒化物層
27および酸化物層28などの従来の不活性化(パッシ
ベーション)層を用いて不活性化される。
【0013】複数のダイオード・デバイス21が、約
2.0E17atoms/cm3 のホウ素ドーパント(ドーピン
グ剤)濃度をもついくつかのp型<100>シリコン基
板22上に構築される。基板22は、たとえば酸化物層
26,窒化物層27および酸化物層28を用いて不活性
化される。酸化物層26は、約400オングストローム
の成長酸化物であり、窒化物層27は約1000オング
ストロームの被付着窒化物であり、酸化物層28は約2
000オングストロームの被付着酸化物である。酸化物
層28と窒化物層27とを貫通する開口部をエッチング
するために、従来のフォトリソグラフィおよびエッチン
グ法が用いられるが、酸化物層26はエッチングされな
いままで残る。次に酸化物層26を通り基板22内に炭
素がイオン注入される。炭素のイオン注入量は、3.5
E15,7.0E15および8.75E15atoms/cm2
であり、注入エネルギは25keVである。シリコン格
子内の炭素のチャネリングを防ぐために、基板22は炭
素注入中は、入射イオン・ビームの方向に対して約7度
に維持される。
2.0E17atoms/cm3 のホウ素ドーパント(ドーピン
グ剤)濃度をもついくつかのp型<100>シリコン基
板22上に構築される。基板22は、たとえば酸化物層
26,窒化物層27および酸化物層28を用いて不活性
化される。酸化物層26は、約400オングストローム
の成長酸化物であり、窒化物層27は約1000オング
ストロームの被付着窒化物であり、酸化物層28は約2
000オングストロームの被付着酸化物である。酸化物
層28と窒化物層27とを貫通する開口部をエッチング
するために、従来のフォトリソグラフィおよびエッチン
グ法が用いられるが、酸化物層26はエッチングされな
いままで残る。次に酸化物層26を通り基板22内に炭
素がイオン注入される。炭素のイオン注入量は、3.5
E15,7.0E15および8.75E15atoms/cm2
であり、注入エネルギは25keVである。シリコン格
子内の炭素のチャネリングを防ぐために、基板22は炭
素注入中は、入射イオン・ビームの方向に対して約7度
に維持される。
【0014】次に酸化物層26が開口部からエッチング
され、基板22は、約4.05E15atoms/cm2 の注入
量と、25keVの注入エネルギでシリコン(29Si
+)注入物からなる非結晶化後注入を受ける。非結晶化
後注入は任意であるが、非結晶化後注入によって狭禁止
帯幅化が進むので、実施することが好ましい。次に基板
22は、N2 などの不活性雰囲気内で30分間摂氏70
0度のアニーリングを受け、イオン注入された領域の固
相エピタキシャル(SPE)再成長を誘導して、炭素が
ドーピングされたシリコン領域23が形成される。
され、基板22は、約4.05E15atoms/cm2 の注入
量と、25keVの注入エネルギでシリコン(29Si
+)注入物からなる非結晶化後注入を受ける。非結晶化
後注入は任意であるが、非結晶化後注入によって狭禁止
帯幅化が進むので、実施することが好ましい。次に基板
22は、N2 などの不活性雰囲気内で30分間摂氏70
0度のアニーリングを受け、イオン注入された領域の固
相エピタキシャル(SPE)再成長を誘導して、炭素が
ドーピングされたシリコン領域23が形成される。
【0015】次に、従来の化学蒸着法を用いて未ドーピ
ングの多結晶シリコンを基板22に付着する。次に、約
8.0E15atoms/cm2 の注入量と、60keVの注入
エネルギでヒ素を未ドーピングの多結晶シリコン層に注
入する。次に、従来のフォトリソグラフィおよびエッチ
ング法を用いて、多結晶シリコンをパターニングする。
この後、基板22は約30秒間、摂氏1000度の高速
熱アニーリング(RTA:rapid thermal anneal)を受
け、n型多結晶シリコン層29とn型領域24とが形成
される。従来の処理技術を用いて、陰極接触31と陽極
接触32とを形成するとダイオード21が完成する。
ングの多結晶シリコンを基板22に付着する。次に、約
8.0E15atoms/cm2 の注入量と、60keVの注入
エネルギでヒ素を未ドーピングの多結晶シリコン層に注
入する。次に、従来のフォトリソグラフィおよびエッチ
ング法を用いて、多結晶シリコンをパターニングする。
この後、基板22は約30秒間、摂氏1000度の高速
熱アニーリング(RTA:rapid thermal anneal)を受
け、n型多結晶シリコン層29とn型領域24とが形成
される。従来の処理技術を用いて、陰極接触31と陽極
接触32とを形成するとダイオード21が完成する。
【0016】ダイオード・デバイス21の順方向バイア
ス特性から得た電気的データを用いて、図1の禁止帯幅
データを計算する。SPEおよびRTA処理の後では、
3.5E15,7.0E15および8.75E15atom
s/cm2 の注入量は、それぞれ0.53%,1.10%お
よび1.33%の置換炭素濃度に対応する。図1の禁止
帯幅データは、非結晶化後シリコン注入を行ったダイオ
ード・デバイス21に関するものである。このデータ
は、最大の狭禁止帯幅化が0.5%ないし1.1%の炭
素濃度で起こることを示している。
ス特性から得た電気的データを用いて、図1の禁止帯幅
データを計算する。SPEおよびRTA処理の後では、
3.5E15,7.0E15および8.75E15atom
s/cm2 の注入量は、それぞれ0.53%,1.10%お
よび1.33%の置換炭素濃度に対応する。図1の禁止
帯幅データは、非結晶化後シリコン注入を行ったダイオ
ード・デバイス21に関するものである。このデータ
は、最大の狭禁止帯幅化が0.5%ないし1.1%の炭
素濃度で起こることを示している。
【0017】比較として、ゲルマニウムをドーピングし
たシリコン・デバイスにおける同等の狭禁止帯幅化を得
るには20%超のゲルマニウムが必要である。同等の狭
禁止帯幅化を実現するために必要な炭素の量が少ないの
で、炭素をドーピングしたシリコン・デバイスのほうが
結晶性欠陥に対する感受性が低い。さらにシリコン内で
20%のゲルマニウムを得るために必要なゲルマニウム
注入量は、かなりの注入時間を要し、そのために処理量
に影響を与える。
たシリコン・デバイスにおける同等の狭禁止帯幅化を得
るには20%超のゲルマニウムが必要である。同等の狭
禁止帯幅化を実現するために必要な炭素の量が少ないの
で、炭素をドーピングしたシリコン・デバイスのほうが
結晶性欠陥に対する感受性が低い。さらにシリコン内で
20%のゲルマニウムを得るために必要なゲルマニウム
注入量は、かなりの注入時間を要し、そのために処理量
に影響を与える。
【0018】図3は、5.25E15,7.0E15お
よび8.75E15atoms/cm2 の炭素注入量と非結晶化
後シリコン注入を受ける基板22からの透過赤外線スペ
クトルを示す。606〜607cm-1に位置するシリコ
ン内の置換炭素の局部振動モード(LVM:local vibr
ation mode)によるピークは、5.25E15atoms/cm
2 で最大値に達して、7.0E15atoms/cm2 で多少減
少し、8.75E15atoms/cm2 ではさらに減少する。
約750cm-1におけるピークは、炭素注入量が5.2
5E15から8.75E15atoms/cm2 に増大すると、
大きくなる。750cm-1の別のピークはSi−C(伸
縮)振動に割り当てられ、これは炭素が沈降して炭化シ
リコンを形成することを示す。このデータは、最大の炭
素の置換組み込みが、5.25E15atoms/cm2 の炭素
注入量−−これは約0.8%の炭素濃度に相当する−−
で起こることを示す。このように、最大の格子歪と、狭
禁止帯幅化とは約0.8%の炭素濃度で起こる。さらに
5.25E15までの炭素注入量と非結晶化後シリコン
注入を受ける基板22が、最良の結晶性質を示す。
よび8.75E15atoms/cm2 の炭素注入量と非結晶化
後シリコン注入を受ける基板22からの透過赤外線スペ
クトルを示す。606〜607cm-1に位置するシリコ
ン内の置換炭素の局部振動モード(LVM:local vibr
ation mode)によるピークは、5.25E15atoms/cm
2 で最大値に達して、7.0E15atoms/cm2 で多少減
少し、8.75E15atoms/cm2 ではさらに減少する。
約750cm-1におけるピークは、炭素注入量が5.2
5E15から8.75E15atoms/cm2 に増大すると、
大きくなる。750cm-1の別のピークはSi−C(伸
縮)振動に割り当てられ、これは炭素が沈降して炭化シ
リコンを形成することを示す。このデータは、最大の炭
素の置換組み込みが、5.25E15atoms/cm2 の炭素
注入量−−これは約0.8%の炭素濃度に相当する−−
で起こることを示す。このように、最大の格子歪と、狭
禁止帯幅化とは約0.8%の炭素濃度で起こる。さらに
5.25E15までの炭素注入量と非結晶化後シリコン
注入を受ける基板22が、最良の結晶性質を示す。
【0019】本発明による禁止帯幅が狭められた炭素ド
ーピング・シリコン構造は、ヘテロ接合バイポーラ・ト
ランジスタ(HBT:heterojunction bipolar transis
torなどの半導体デバイスに用いることができる。狭禁
止帯幅化した炭素ドーピング・シリコンは、HBTデバ
イスのベース領域として適している。
ーピング・シリコン構造は、ヘテロ接合バイポーラ・ト
ランジスタ(HBT:heterojunction bipolar transis
torなどの半導体デバイスに用いることができる。狭禁
止帯幅化した炭素ドーピング・シリコンは、HBTデバ
イスのベース領域として適している。
【0020】図4は、本発明によるHBTデバイス41
の拡大断面図である。HBTデバイス41は、コレクタ
領域43を形成するn型エピタキシャル層を有するn型
半導体基板42で構成される。禁止帯幅が狭まったベー
ス領域44は、0.5%ないし1.1%の炭素濃度で置
換組み込みされた炭素を有するp型エピタキシャル層で
あり、0.8%の炭素濃度が好ましい。HBT41は、
従来の不活性化法を用いて不活性化される。たとえば、
HBT41は、酸化物層46,窒化物層47および酸化
物層48で不活性化される。n型多結晶シリコン層49
は、エミッタ領域51のドーパント源となる。ベース接
触52,エミッタ接触53およびコレクタ接触54は、
HBT41に対するオーミック接触となる。
の拡大断面図である。HBTデバイス41は、コレクタ
領域43を形成するn型エピタキシャル層を有するn型
半導体基板42で構成される。禁止帯幅が狭まったベー
ス領域44は、0.5%ないし1.1%の炭素濃度で置
換組み込みされた炭素を有するp型エピタキシャル層で
あり、0.8%の炭素濃度が好ましい。HBT41は、
従来の不活性化法を用いて不活性化される。たとえば、
HBT41は、酸化物層46,窒化物層47および酸化
物層48で不活性化される。n型多結晶シリコン層49
は、エミッタ領域51のドーパント源となる。ベース接
触52,エミッタ接触53およびコレクタ接触54は、
HBT41に対するオーミック接触となる。
【0021】狭禁止帯幅のベース領域44を有するHB
T41は、禁止帯幅が広いコレクタ領域43およびエミ
ッタ領域51と共に、従来のバイポーラ・トランジスタ
・デバイスと比べて改善されたデバイス性能を有するバ
イポーラ・トランジスタとなる。たとえば、HBT41
はその禁止帯幅構造のために、エミッタ効率が高く、ベ
ース抵抗が低く、エミッタ電流の密集が少なく、周波数
応答が広く、動作温度範囲が広い。
T41は、禁止帯幅が広いコレクタ領域43およびエミ
ッタ領域51と共に、従来のバイポーラ・トランジスタ
・デバイスと比べて改善されたデバイス性能を有するバ
イポーラ・トランジスタとなる。たとえば、HBT41
はその禁止帯幅構造のために、エミッタ効率が高く、ベ
ース抵抗が低く、エミッタ電流の密集が少なく、周波数
応答が広く、動作温度範囲が広い。
【0022】狭禁止帯幅のベース領域44を有するHB
T41は、次の要領で作成される。基板42は、たとえ
ば1.0E18atoms/cm3 超のドーパント濃度において
ヒ素でドーピングされた、好ましくは<100>配向を
もつn型基板である。コレクタ領域43は、たとえば従
来のエピタキシャル成長法で形成することができる。コ
レクタ領域43は、1.0E16ないし1.0E18at
oms/cm3 度のドーパント濃度においてヒ素などのn型ド
ーパントでドーピングされ、その用途により0.4ミク
ロン程度またはそれ以上の厚みを持つ。
T41は、次の要領で作成される。基板42は、たとえ
ば1.0E18atoms/cm3 超のドーパント濃度において
ヒ素でドーピングされた、好ましくは<100>配向を
もつn型基板である。コレクタ領域43は、たとえば従
来のエピタキシャル成長法で形成することができる。コ
レクタ領域43は、1.0E16ないし1.0E18at
oms/cm3 度のドーパント濃度においてヒ素などのn型ド
ーパントでドーピングされ、その用途により0.4ミク
ロン程度またはそれ以上の厚みを持つ。
【0023】狭禁止帯幅のベース領域44を形成するに
は、たとえば従来のエピタキシャル成長法で、p型層を
コレクタ43上に形成する。ベース領域44は、1.0
E18ないし1.0E19atoms/cm3 程度のドーパント
濃度でホウ素でドーピングされ、0.08ミクロン程度
の厚みである。次にHBT41は、たとえば400オン
グストロームの酸化物46,次に約1000オングスト
ロームの被付着窒化物、次に約2000オングストロー
ムの被付着酸化物48により不活性化される。付着され
た酸化物48と窒化物47は、従来のフォトリソグラフ
ィ技術を用いてパターニングされ、酸化物層46までエ
ッチングされ開口部を形成する。酸化物層46を用い
て、HBT41の不活性化と炭素注入のための開口部内
でのスクリーン酸化物の形成の両方を行う。
は、たとえば従来のエピタキシャル成長法で、p型層を
コレクタ43上に形成する。ベース領域44は、1.0
E18ないし1.0E19atoms/cm3 程度のドーパント
濃度でホウ素でドーピングされ、0.08ミクロン程度
の厚みである。次にHBT41は、たとえば400オン
グストロームの酸化物46,次に約1000オングスト
ロームの被付着窒化物、次に約2000オングストロー
ムの被付着酸化物48により不活性化される。付着され
た酸化物48と窒化物47は、従来のフォトリソグラフ
ィ技術を用いてパターニングされ、酸化物層46までエ
ッチングされ開口部を形成する。酸化物層46を用い
て、HBT41の不活性化と炭素注入のための開口部内
でのスクリーン酸化物の形成の両方を行う。
【0024】ベース領域44内に狭禁止帯幅特性を得る
ために、3.0E15ないし7.0E15atoms/cm2 の
注入量範囲で、開口部と酸化物層46とを通って炭素を
ベース領域44内にイオン注入するが、好ましい注入量
は5.25E15atoms/cm2,注入エネルギは約25k
eVである。注入エネルギは、酸化物層26の厚みに応
じて上下に調整してもよい。二酸化炭素などの炭素源が
炭素注入に適している。シリコン格子内での炭素イオン
のチャネリングを避けるために、基板42は、炭素の注
入中は入射イオン・ビーム方向に対し約7度に維持され
る。
ために、3.0E15ないし7.0E15atoms/cm2 の
注入量範囲で、開口部と酸化物層46とを通って炭素を
ベース領域44内にイオン注入するが、好ましい注入量
は5.25E15atoms/cm2,注入エネルギは約25k
eVである。注入エネルギは、酸化物層26の厚みに応
じて上下に調整してもよい。二酸化炭素などの炭素源が
炭素注入に適している。シリコン格子内での炭素イオン
のチャネリングを避けるために、基板42は、炭素の注
入中は入射イオン・ビーム方向に対し約7度に維持され
る。
【0025】たとえば、化学蒸着または分子線エピタキ
シなどの他の方法を用いて炭素をドーピングしたシリコ
ンのベース領域44を形成することもできるが、イオン
注入はドーパント濃度の制御性が優れており、良好な処
理量を示すので、炭素イオン注入が好ましい。さらに、
イオン注入は注入前の処理段階を最小限に抑えながら選
択的炭素ドーピングをすることができる。たとえばヘテ
ロ接合と非ヘテロ接合のデバイスを両方とも組み込むモ
ノリシック集積デバイスにおいて、酸化物または厚いフ
ォトレジストなどのマスキング層をイオン注入中に用い
て選択的炭素ドーピングを行ってもよい。
シなどの他の方法を用いて炭素をドーピングしたシリコ
ンのベース領域44を形成することもできるが、イオン
注入はドーパント濃度の制御性が優れており、良好な処
理量を示すので、炭素イオン注入が好ましい。さらに、
イオン注入は注入前の処理段階を最小限に抑えながら選
択的炭素ドーピングをすることができる。たとえばヘテ
ロ接合と非ヘテロ接合のデバイスを両方とも組み込むモ
ノリシック集積デバイスにおいて、酸化物または厚いフ
ォトレジストなどのマスキング層をイオン注入中に用い
て選択的炭素ドーピングを行ってもよい。
【0026】炭素注入の後で、酸化物層46を、たとえ
ば緩衝HF酸を用いて開口部から除去する。次に、1.
0E15ないし1.0E16atoms/cm2 の注入量−−
4.0E15atoms/cm2 の注入量が好ましい−−で、2
5ないし60keVの注入エネルギ−−25keVの注
入エネルギが好ましい−−で開口部を通ってシリコンを
ベース領域44内にドーピングする。シリコン格子の再
結晶化を行い、シリコン格子内に炭素を置換的に組み込
むために、次に基板42には固相エピタキシャル再成長
過程を行う。この過程は、N2 などの不活性雰囲気内
で、約30分間摂氏700度のアニーリングを行う。
ば緩衝HF酸を用いて開口部から除去する。次に、1.
0E15ないし1.0E16atoms/cm2 の注入量−−
4.0E15atoms/cm2 の注入量が好ましい−−で、2
5ないし60keVの注入エネルギ−−25keVの注
入エネルギが好ましい−−で開口部を通ってシリコンを
ベース領域44内にドーピングする。シリコン格子の再
結晶化を行い、シリコン格子内に炭素を置換的に組み込
むために、次に基板42には固相エピタキシャル再成長
過程を行う。この過程は、N2 などの不活性雰囲気内
で、約30分間摂氏700度のアニーリングを行う。
【0027】次に従来の化学蒸着法を用いて多結晶シリ
コン層49を付着する。多結晶シリコン層49は300
0オングストローム程度の厚みをもち、付着中にドーピ
ングするか、またはドーピングしない。多結晶シリコン
層49が未ドーピングの場合は、n型ドーパント−−好
ましくはリン−−を多結晶シリコン層49内にイオン注
入する。1.0E15ないし1.0E16atoms/cm2 の
注入量を用いることができ、8.0E15atoms/cm2 の
注入量が好ましい。20ないし60keVの注入エネル
ギを用いることができ、30keVのエネルギが好まし
い。次に多結晶シリコン層49が従来の技術を用いてエ
ッチングされ、図4に示されるパターンのような所望の
パターンを形成する。次に、たとえば摂氏925度で3
0秒間の高速熱アニール・システムを用いて基板42が
アニーリングされる。このアニール段階により、リンが
多結晶シリコン層49,基板42の外に拡散されて、エ
ミッタ領域51を形成する。アニール段階後の多結晶シ
リコン層49とエミッタ領域51との界面のリン表面濃
度は約1.0E19atoms/cm3 である。
コン層49を付着する。多結晶シリコン層49は300
0オングストローム程度の厚みをもち、付着中にドーピ
ングするか、またはドーピングしない。多結晶シリコン
層49が未ドーピングの場合は、n型ドーパント−−好
ましくはリン−−を多結晶シリコン層49内にイオン注
入する。1.0E15ないし1.0E16atoms/cm2 の
注入量を用いることができ、8.0E15atoms/cm2 の
注入量が好ましい。20ないし60keVの注入エネル
ギを用いることができ、30keVのエネルギが好まし
い。次に多結晶シリコン層49が従来の技術を用いてエ
ッチングされ、図4に示されるパターンのような所望の
パターンを形成する。次に、たとえば摂氏925度で3
0秒間の高速熱アニール・システムを用いて基板42が
アニーリングされる。このアニール段階により、リンが
多結晶シリコン層49,基板42の外に拡散されて、エ
ミッタ領域51を形成する。アニール段階後の多結晶シ
リコン層49とエミッタ領域51との界面のリン表面濃
度は約1.0E19atoms/cm3 である。
【0028】次に、従来のフォトリソグラフィおよびエ
ッチング法を用いて、付着された酸化物48,窒化物層
47および酸化物層46がパターニングされ、ベース接
触開口部が形成される。プラチナなどの接触金属被覆層
が、従来の金属被覆付着法を用いて、基板42の上面に
付着され、アニーリングされ、エッチングされてケイ化
プラチナ・ベース接触52およびエミッタ接触53が形
成される。次に、従来の金属被覆法を用いて、金などの
接触金属被覆を基板42の底面に付着して、コレクタ接
触54を形成してHBT41を完成する。コレクタ接触
54を付着する前に、たとえば背面研磨過程を用いて、
任意で基板42を薄くしてもよい。
ッチング法を用いて、付着された酸化物48,窒化物層
47および酸化物層46がパターニングされ、ベース接
触開口部が形成される。プラチナなどの接触金属被覆層
が、従来の金属被覆付着法を用いて、基板42の上面に
付着され、アニーリングされ、エッチングされてケイ化
プラチナ・ベース接触52およびエミッタ接触53が形
成される。次に、従来の金属被覆法を用いて、金などの
接触金属被覆を基板42の底面に付着して、コレクタ接
触54を形成してHBT41を完成する。コレクタ接触
54を付着する前に、たとえば背面研磨過程を用いて、
任意で基板42を薄くしてもよい。
【0029】以上、シリコンに比べて狭い禁止帯幅特性
を有する、炭素がドーピングされたシリコンで構成され
るIV−IVヘテロ接合半導体デバイスとその作成方法
とが提供されたことが理解頂けよう。この炭素ドーピン
グ・シリコンのヘテロ接合デバイスは、低濃度の炭素を
用いて禁止帯幅を狭め、そのために結晶性欠陥の形成に
対する感受性が低い。また、ヘテロ接合デバイスは、費
用効果の良いイオン注入および固相エピタキシャル再成
長過程の技術を用いて形成することができる。さらに、
イオン注入過程の技術を用いて禁止帯幅の狭いデバイス
を設けることができるので、費用効果の良い方法で、禁
止帯幅の狭いデバイスを同一のモノリシック集積回路内
に非ヘテロ接合デバイスとを選択的に一体化することが
できる。
を有する、炭素がドーピングされたシリコンで構成され
るIV−IVヘテロ接合半導体デバイスとその作成方法
とが提供されたことが理解頂けよう。この炭素ドーピン
グ・シリコンのヘテロ接合デバイスは、低濃度の炭素を
用いて禁止帯幅を狭め、そのために結晶性欠陥の形成に
対する感受性が低い。また、ヘテロ接合デバイスは、費
用効果の良いイオン注入および固相エピタキシャル再成
長過程の技術を用いて形成することができる。さらに、
イオン注入過程の技術を用いて禁止帯幅の狭いデバイス
を設けることができるので、費用効果の良い方法で、禁
止帯幅の狭いデバイスを同一のモノリシック集積回路内
に非ヘテロ接合デバイスとを選択的に一体化することが
できる。
【図1】本発明による炭素がドーピングされたシリコン
内の低レベルの炭素濃度の関数としての禁止帯幅のグラ
フである。
内の低レベルの炭素濃度の関数としての禁止帯幅のグラ
フである。
【図2】図1の禁止帯幅データを作成するために用いら
れる実施例の拡大図である。
れる実施例の拡大図である。
【図3】本発明による炭素がドーピングされたシリコン
に関する透過赤外線スペクトルのグラフである。
に関する透過赤外線スペクトルのグラフである。
【図4】本発明の実施例の拡大断面図である。
【符号の説明】 41 半導体デバイス 42 基板 43 コレクタ領域 44 ベース領域 46,48 酸化物層 47 窒化物層 49 多結晶シリコン層 51 エミッタ領域 52 ベース接触 53 エミッタ接触 54 コレクタ接触
フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 FI 技術表示箇所 H01L 29/205 29/861 H01L 21/265 W 29/205 29/91 H
Claims (5)
- 【請求項1】 狭禁止帯幅特性を有する炭素ドーピング
・シリコン半導体デバイス(21,41)であって:実
質的にシリコンからなる第1結晶性半導体層(22,4
3);および実質的にシリコンと狭禁止帯幅特性を与え
るためのドーパントとからなる第2結晶性半導体層(2
3,44)であって、禁止帯幅を狭くする前記ドーパン
トが必ず炭素で構成され、前記第1結晶性半導体層(2
2,43)と前記第2半導体層(22,43)とが第1
ヘテロ接合を形成し、炭素は前記第2結晶性半導体層
(23,44)において1.1%未満の置換濃度で存在
する第2結晶性半導体層(23,44);によって構成
されることを特徴とするデバイス。 - 【請求項2】 実質的にシリコンからなる第1導電型の
第1半導体層(43);実質的にシリコンと、シリコン
に比べて狭い禁止帯幅を与えるためのドーパントとから
なる第2導電型の第2半導体層(44)であって、禁止
帯幅を狭くする前記ドーパントが必ず炭素で構成され、
炭素は前記第2半導体層において1.1%未満の置換濃
度で存在する第2半導体層(44);および実質的にシ
リコンからなる第1導電型の第3半導体層(43)であ
って、前記第2層(44)が前記第1層(43)と前記
第3層(51)との間にあり、前記第1層(43)がコ
レクタ領域を、前記第2層(44)がベース領域を、前
記第3層(51)がエミッタ領域を形成する第3半導体
層(51);によって構成されることを特徴とする半導
体ヘテロ接合構造(41)。 - 【請求項3】 狭禁止帯幅特性を有する炭素ドーピング
・シリコン半導体デバイス(21,41)を形成する方
法であって:実質的にシリコンからなり、第1表面を有
する第1結晶性半導体層(22,43)を設ける段階;
および前記第1表面上に第2結晶性半導体層(23,4
4)を形成する段階であって、前記第2結晶性半導体層
(23,44)が実質的にシリコンと、狭禁止帯幅を与
えるためのドーパントとからなり、狭禁止帯幅を与える
前記ドーパントは必ず炭素で構成され、炭素が前記第2
結晶性半導体層(23,44)において1.1%未満の
置換濃度で存在する段階;によって構成されることを特
徴とする方法。 - 【請求項4】 第2結晶性半導体層(23,44)を形
成する前記段階が:実質的にシリコンからなる前記第2
結晶性半導体層(23,44)を前記第1表面上に形成
する段階;前記第2結晶性半導体層(23,44)内
に、7.0E15atoms/cm2 での炭素注入量で、炭素を
イオン注入する段階;および不活性雰囲気内で前記第2
結晶性半導体層(23,44)をアニーリングして、第
2結晶性半導体層(23,44)の固相エピタキシャル
再成長を発生して、前記第2結晶性半導体層(23,4
4)内に炭素を置換的に組み込む段階;によって構成さ
れる請求項3記載の方法。 - 【請求項5】 炭素をイオン注入する前記段階の前に薄
い酸化物を形成する段階;および第2結晶性半導体層
(23,44)をアニーリングする前記段階の前に、前
記第2結晶性半導体層(23,44)内に、1.0E1
5ないし1.0E16atoms/cm2 のイオン注入量でシリ
コンをイオン注入する段階;によってさらに構成される
請求項4記載の方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US131541 | 1993-10-05 | ||
US08/131,541 US5360986A (en) | 1993-10-05 | 1993-10-05 | Carbon doped silicon semiconductor device having a narrowed bandgap characteristic and method |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH07161731A true JPH07161731A (ja) | 1995-06-23 |
Family
ID=22449898
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6259712A Pending JPH07161731A (ja) | 1993-10-05 | 1994-09-30 | 狭禁止帯幅特性を有する炭素ドーピング・シリコン半導体デバイスとその方法 |
Country Status (4)
Country | Link |
---|---|
US (2) | US5360986A (ja) |
EP (1) | EP0646969A3 (ja) |
JP (1) | JPH07161731A (ja) |
KR (1) | KR100296211B1 (ja) |
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