JPH0715620A - 水平同期回路 - Google Patents
水平同期回路Info
- Publication number
- JPH0715620A JPH0715620A JP5184497A JP18449793A JPH0715620A JP H0715620 A JPH0715620 A JP H0715620A JP 5184497 A JP5184497 A JP 5184497A JP 18449793 A JP18449793 A JP 18449793A JP H0715620 A JPH0715620 A JP H0715620A
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- JP
- Japan
- Prior art keywords
- circuit
- loop gain
- horizontal
- horizontal synchronizing
- pulse
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Abstract
(57)【要約】
【目的】 ＴＶ移動受信時等において生じる水平同期の
ジッタを最小限に抑えるための水平同期回路を提供する
ことである。 【構成】 水平同期信号が入力されるＰＬＬ回路におい
て、ＬＰＦ３２とＶＣＯ３４との間に、ループゲイン減
衰器３３を挿入する。この減衰器３３によりＰＬＬ回路
のＤＣループゲインを下げて、水平同期の乱れにより生
ずる画像歪みを低減させる。
ジッタを最小限に抑えるための水平同期回路を提供する
ことである。 【構成】 水平同期信号が入力されるＰＬＬ回路におい
て、ＬＰＦ３２とＶＣＯ３４との間に、ループゲイン減
衰器３３を挿入する。この減衰器３３によりＰＬＬ回路
のＤＣループゲインを下げて、水平同期の乱れにより生
ずる画像歪みを低減させる。
Description
【０００１】
【産業上の利用分野】本発明はテレビジョン受像機の水
平同期回路に関する。
平同期回路に関する。
【０００２】
【従来の技術】図４は従来の一般的なテレビジョン受像
機の水平同期回路を示す。図４において、入力端子１か
らの受信映像検波信号を同期分離回路２に加え、そこ
で、同期信号を分離する。同期分離回路２で分離された
水平同期信号と、後述する水平ドライブ回路５からフィ
ードバックされた信号（一般的には鋸波信号）とによ
り、水平ＡＦＣ（自動周波数制御）回路３において、水
平発振回路４の制御電圧を作る。この制御電圧により水
平発振回路４の発振周波数を制御する。水平発振回路４
からは、水平発振回路４で発生したクロックを分周した
ｆH（ｆHは１水平走査期間）周期のパルスを出力し、水
平ドライブ回路５に送る。水平ドライブ回路５では、水
平偏向コイル６をドライブするために必要な波形を作
る。ただし、水平ドライブ回路５は、ＡＦＣ回路３にフ
ィードバックする鋸波信号を作るための積分回路を含ん
でいる。
機の水平同期回路を示す。図４において、入力端子１か
らの受信映像検波信号を同期分離回路２に加え、そこ
で、同期信号を分離する。同期分離回路２で分離された
水平同期信号と、後述する水平ドライブ回路５からフィ
ードバックされた信号（一般的には鋸波信号）とによ
り、水平ＡＦＣ（自動周波数制御）回路３において、水
平発振回路４の制御電圧を作る。この制御電圧により水
平発振回路４の発振周波数を制御する。水平発振回路４
からは、水平発振回路４で発生したクロックを分周した
ｆH（ｆHは１水平走査期間）周期のパルスを出力し、水
平ドライブ回路５に送る。水平ドライブ回路５では、水
平偏向コイル６をドライブするために必要な波形を作
る。ただし、水平ドライブ回路５は、ＡＦＣ回路３にフ
ィードバックする鋸波信号を作るための積分回路を含ん
でいる。
【０００３】図４において、受信映像検波信号にゴース
トやノイズがなく、シンクチップクランプされた状態で
は、各部の波形は図５のようになる。すなわち、図５の
（ａ）は受信映像信号の波形図、（ｂ）は同期分離回路
２からの水平同期信号の波形図、（ｃ）は水平発振回路
４からの所定周期のパルスの波形図、（ｄ）は水平ドラ
イブ回路５の水平ドライブパルスの波形図である。一
方、受信映像信号にゴーストやノイズが含まれると、図
５（ａ）〜（ｄ）の波形は図７（ａ）〜（ｄ）の波形と
なる。
トやノイズがなく、シンクチップクランプされた状態で
は、各部の波形は図５のようになる。すなわち、図５の
（ａ）は受信映像信号の波形図、（ｂ）は同期分離回路
２からの水平同期信号の波形図、（ｃ）は水平発振回路
４からの所定周期のパルスの波形図、（ｄ）は水平ドラ
イブ回路５の水平ドライブパルスの波形図である。一
方、受信映像信号にゴーストやノイズが含まれると、図
５（ａ）〜（ｄ）の波形は図７（ａ）〜（ｄ）の波形と
なる。
【０００４】図５の状態では、（ｄ）の水平ドライブパ
ルスの位相は（ａ）および（ｂ）の水平同期パルスの位
相と一致しており、受像機では、図８（ｂ）に示すよう
に、画像の歪みのない水平方向に安定した画像が得られ
るが、図７の状態では、（ｄ）の位相は、（ａ）および
（ｂ）の水平同期信号の位相とずれを生じ、図８（ａ）
のような画像の歪みを生ずる。
ルスの位相は（ａ）および（ｂ）の水平同期パルスの位
相と一致しており、受像機では、図８（ｂ）に示すよう
に、画像の歪みのない水平方向に安定した画像が得られ
るが、図７の状態では、（ｄ）の位相は、（ａ）および
（ｂ）の水平同期信号の位相とずれを生じ、図８（ａ）
のような画像の歪みを生ずる。
【０００５】そこで本発明者は、先にこのような受信電
界強度レベルの低下やゴーストやノイズ等の混入による
画像歪みを補正し、受信状態の悪条件下でも歪みのない
安定した再生画面を得ることができるテレビジョン受像
機の水平同期回路を、特願平２−１９９７０５号（特開
平４−８４５６７号）で提案した。
界強度レベルの低下やゴーストやノイズ等の混入による
画像歪みを補正し、受信状態の悪条件下でも歪みのない
安定した再生画面を得ることができるテレビジョン受像
機の水平同期回路を、特願平２−１９９７０５号（特開
平４−８４５６７号）で提案した。
【０００６】従来の受像機の前記した水平ＡＦＣ回路も
ＰＬＬ回路の一種であるが、特に水平ＡＦＣ回路のルー
プゲインは非常に高く設定されており、入力信号（図２
中の同期分離回路２から出力される分離された水平同期
信号）に対する追従性はよいが、このことはかえって逆
にノイズに対する悪影響を及ぼす。これを解決するため
前記水平同期回路では上記水平ＡＦＣ回路とは別にＰＬ
Ｌ回路を付加し、ノイズに対する安定性を向上させるよ
うにしている。図６は前記テレビジョン受像機の水平同
期回路の構成図で、７はパルス発生回路、８はコンパレ
ータ、９はループフィルタ、１０は電圧制御発振回路
（ＶＣＯ）、１１はタイミング発生回路である。
ＰＬＬ回路の一種であるが、特に水平ＡＦＣ回路のルー
プゲインは非常に高く設定されており、入力信号（図２
中の同期分離回路２から出力される分離された水平同期
信号）に対する追従性はよいが、このことはかえって逆
にノイズに対する悪影響を及ぼす。これを解決するため
前記水平同期回路では上記水平ＡＦＣ回路とは別にＰＬ
Ｌ回路を付加し、ノイズに対する安定性を向上させるよ
うにしている。図６は前記テレビジョン受像機の水平同
期回路の構成図で、７はパルス発生回路、８はコンパレ
ータ、９はループフィルタ、１０は電圧制御発振回路
（ＶＣＯ）、１１はタイミング発生回路である。
【０００７】図４と同じ番号のものは同じ構成のもので
ある。水平発振回路４から出力された周期ｆHのパルス
をパルス発生回路７に入力する。パルス発生回路７から
は図７（ｄ）に示す波形のパルスを出力する。一方、タ
イミングパルス発生回路１１では、図７（ｄ’）に示す
波形のパルスが作られる。
ある。水平発振回路４から出力された周期ｆHのパルス
をパルス発生回路７に入力する。パルス発生回路７から
は図７（ｄ）に示す波形のパルスを出力する。一方、タ
イミングパルス発生回路１１では、図７（ｄ’）に示す
波形のパルスが作られる。
【０００８】図７（ｄ）と（ｄ’）に示す波形のパルス
をコンパレータ８に入力し、それらを比較してループフ
ィルタ９に出力する。ループフィルタ９の出力電圧は、
図７（ｄ）と（ｄ’）のパルスの位相差に応じて変化
し、電圧制御発振回路１０に入力される。この電圧制御
発振回路１０では、この位相差に応じた制御電圧により
発振周波数が変化する。発振回路１０の出力は４ｆ
SC（１４．３１８ＭHz）のクロックであり、このクロッ
クを基に、タイミング回路１１で水平および垂直同期の
パルスを作り、垂直同期の信号を垂直同期回路へ、水平
同期のパルスを水平ドライブ回路５へ送る。このように
して作られた水平ドライブパルスは図７（ｅ）のように
なり、従来方式の水平ドライブパルス（図７（ｄ）に相
当）に比べ安定した水平同期信号に対する位相ずれが補
正され、図８（ｂ）のような歪みのない画像が得られ
る。
をコンパレータ８に入力し、それらを比較してループフ
ィルタ９に出力する。ループフィルタ９の出力電圧は、
図７（ｄ）と（ｄ’）のパルスの位相差に応じて変化
し、電圧制御発振回路１０に入力される。この電圧制御
発振回路１０では、この位相差に応じた制御電圧により
発振周波数が変化する。発振回路１０の出力は４ｆ
SC（１４．３１８ＭHz）のクロックであり、このクロッ
クを基に、タイミング回路１１で水平および垂直同期の
パルスを作り、垂直同期の信号を垂直同期回路へ、水平
同期のパルスを水平ドライブ回路５へ送る。このように
して作られた水平ドライブパルスは図７（ｅ）のように
なり、従来方式の水平ドライブパルス（図７（ｄ）に相
当）に比べ安定した水平同期信号に対する位相ずれが補
正され、図８（ｂ）のような歪みのない画像が得られ
る。
【０００９】なお、図に示す例では、水平発振回路４と
コンパレータ８との間にパルス発生回路７を設け、図７
（ｃ）のパルスを図７（ｄ）に変換させた場合を示した
が、直接、図７（ｃ）のパルスをコンパレータ８に入力
することも可能である。この場合、タイミング発生回路
１１からコンパレータ８に入力する波形も図７（ｃ）と
同様、デューティ比５０％としなければならない。
コンパレータ８との間にパルス発生回路７を設け、図７
（ｃ）のパルスを図７（ｄ）に変換させた場合を示した
が、直接、図７（ｃ）のパルスをコンパレータ８に入力
することも可能である。この場合、タイミング発生回路
１１からコンパレータ８に入力する波形も図７（ｃ）と
同様、デューティ比５０％としなければならない。
【００１０】
【発明が解決しようとする課題】さて、一般にＰＬＬ回
路の安定性能と定常特性は相反する関係にあり、ロック
アップタイムを速くしようとすると雑音特性が広がり定
常時の特性が劣化する。これを改善するために従来は図
９に示すような「２モードＰＬＬ」と呼ばれる方法が用
いられていた。同図において、２０は位相比較器、２１
は直交位相検波器、２２および２３は搬送波除去ＬＰＦ
（ローパスフィルタ）、２４は直流増幅器、２５はモー
ドスイッチ、２６は２モードループフィルタ、２７はＶ
ＣＯ（電圧制御型発振器）、２８は−９０°移相回路で
ある。
路の安定性能と定常特性は相反する関係にあり、ロック
アップタイムを速くしようとすると雑音特性が広がり定
常時の特性が劣化する。これを改善するために従来は図
９に示すような「２モードＰＬＬ」と呼ばれる方法が用
いられていた。同図において、２０は位相比較器、２１
は直交位相検波器、２２および２３は搬送波除去ＬＰＦ
（ローパスフィルタ）、２４は直流増幅器、２５はモー
ドスイッチ、２６は２モードループフィルタ、２７はＶ
ＣＯ（電圧制御型発振器）、２８は−９０°移相回路で
ある。
【００１１】上述した２モードＰＬＬ方式の回路は、モ
ードスイッチ２５によって２モードフィルタ２６の時定
数を切替えており、その周波数特性は図１０に示すよう
になる。しかるにこの方式は弱電界地域などの家庭用Ｔ
Ｖ受信機には有効であるが、移動ＴＶ受信用としてはま
だ不十分である。車載用テレビ受信機においては走行時
の移動受信に際し、ゴーストなどのノイズの発生位置や
頻度の時間的変化が激しいため、特にＤ／Ｕ比が大幅に
低下した時は画像乱れが著しくなる欠点がある。このよ
うな位相誤差による画像歪みを軽減する方法として前記
特願平２−１９９７０号の方法を提案した訳であるが、
この方法では車両停止時などの固定受信では画像歪みを
軽減する効果があるが、走行中は画像歪みは軽減できて
も、図８（ａ）に示すような画面全体の水平方向のふら
つき（フラッター）が生じてしまうことがある。
ードスイッチ２５によって２モードフィルタ２６の時定
数を切替えており、その周波数特性は図１０に示すよう
になる。しかるにこの方式は弱電界地域などの家庭用Ｔ
Ｖ受信機には有効であるが、移動ＴＶ受信用としてはま
だ不十分である。車載用テレビ受信機においては走行時
の移動受信に際し、ゴーストなどのノイズの発生位置や
頻度の時間的変化が激しいため、特にＤ／Ｕ比が大幅に
低下した時は画像乱れが著しくなる欠点がある。このよ
うな位相誤差による画像歪みを軽減する方法として前記
特願平２−１９９７０号の方法を提案した訳であるが、
この方法では車両停止時などの固定受信では画像歪みを
軽減する効果があるが、走行中は画像歪みは軽減できて
も、図８（ａ）に示すような画面全体の水平方向のふら
つき（フラッター）が生じてしまうことがある。
【００１２】このため本発明者は、更に、特願平２−３
２４５９０号（特開平４−１９２８８５号）において、
ループゲインの異なる２つのＰＬＬ回路を用いた水平同
期回路を提案しているが、回路構成が複雑かつ大規模と
なってしまい実用的でなく、この点で未だ改良の余地が
ある。
２４５９０号（特開平４−１９２８８５号）において、
ループゲインの異なる２つのＰＬＬ回路を用いた水平同
期回路を提案しているが、回路構成が複雑かつ大規模と
なってしまい実用的でなく、この点で未だ改良の余地が
ある。
【００１３】本発明の目的はテレビ移動受信時に生じる
水平同期のジッタを最小限に抑え、更には受信チャンネ
ル切替時などにおいてロックがはずれた場合のロック引
き込み時間を短縮することを可能とした水平同期回路を
提供することにある。
水平同期のジッタを最小限に抑え、更には受信チャンネ
ル切替時などにおいてロックがはずれた場合のロック引
き込み時間を短縮することを可能とした水平同期回路を
提供することにある。
【００１４】
【課題を解決するための手段】上記目的を達成するた
め、本発明は、位相比較器と、ローパスフィルタと、電
圧制御型発振器と、分周器とを有し、映像信号より分離
した水平同期信号と分周器の出力信号とを上記位相比較
器に入力するようになっているＰＬＬ回路を備えた水平
同期回路において、前記ローパスフィルタと電圧制御型
発振器との間に、ループゲイン減衰手段を挿入したこと
を要旨とする。
め、本発明は、位相比較器と、ローパスフィルタと、電
圧制御型発振器と、分周器とを有し、映像信号より分離
した水平同期信号と分周器の出力信号とを上記位相比較
器に入力するようになっているＰＬＬ回路を備えた水平
同期回路において、前記ローパスフィルタと電圧制御型
発振器との間に、ループゲイン減衰手段を挿入したこと
を要旨とする。
【００１５】なお、受信局切替などによりＰＬＬ回路が
入力に非同期になった時のロックアップタイム（引き込
み時間）短縮のためには、ロック検出手段およびループ
ゲイン切替手段を設けるのが好適である。
入力に非同期になった時のロックアップタイム（引き込
み時間）短縮のためには、ロック検出手段およびループ
ゲイン切替手段を設けるのが好適である。
【００１６】
【作用】ＴＶ移動受信時には前述した理由で水平同期の
乱れにより画像歪みを生じるが、前記ループゲイン減衰
手段によりＰＬＬ回路のループゲイン、特にＤＣループ
ゲインを下げることによって上記画像歪みを低減するこ
とができる。
乱れにより画像歪みを生じるが、前記ループゲイン減衰
手段によりＰＬＬ回路のループゲイン、特にＤＣループ
ゲインを下げることによって上記画像歪みを低減するこ
とができる。
【００１７】
【実施例】以下図面に示す本発明の実施例を説明する。
図１は本発明の水平同期回路に使用されるＰＬＬ回路の
一実施例である。同図において、３１は位相比較器、３
２はローパスフィルタ（ＬＰＦ）、３３はループゲイン
減衰器、３４は電圧制御型発振器（ＶＣＯ）、３５は分
周器である。端子ａには前記パルス発生回路７からのパ
ルスｄ（水平同期信号）が印加され、また端子ｃは前記
タイミング発生回路１１に接続される。
図１は本発明の水平同期回路に使用されるＰＬＬ回路の
一実施例である。同図において、３１は位相比較器、３
２はローパスフィルタ（ＬＰＦ）、３３はループゲイン
減衰器、３４は電圧制御型発振器（ＶＣＯ）、３５は分
周器である。端子ａには前記パルス発生回路７からのパ
ルスｄ（水平同期信号）が印加され、また端子ｃは前記
タイミング発生回路１１に接続される。
【００１８】本発明者の究明した所によれば、ＴＶ移動
受信時に水平同期の乱れにより生じる画像歪みを低減す
るにはＰＬＬ回路のループゲイン、特にＤＣループゲイ
ンを下げるのが効果的であるのが判明している。そのた
め図１の実施例では減衰器３３によりＤＣループゲイン
を低下させている。前記した従来の２モードＰＬＬ方式
の回路では２モードループフィルタ２６のコンデンサｃ
の値を大きくしない限りＤＣループゲインを下げること
ができない。しかしコンデンサｃの値を大きくし過ぎる
とＰＬＬのループ特性が不安定になりやすく、従って２
モードＰＬＬ方式ではＴＶ移動受信時に生じる画像歪み
を低減することができない。
受信時に水平同期の乱れにより生じる画像歪みを低減す
るにはＰＬＬ回路のループゲイン、特にＤＣループゲイ
ンを下げるのが効果的であるのが判明している。そのた
め図１の実施例では減衰器３３によりＤＣループゲイン
を低下させている。前記した従来の２モードＰＬＬ方式
の回路では２モードループフィルタ２６のコンデンサｃ
の値を大きくしない限りＤＣループゲインを下げること
ができない。しかしコンデンサｃの値を大きくし過ぎる
とＰＬＬのループ特性が不安定になりやすく、従って２
モードＰＬＬ方式ではＴＶ移動受信時に生じる画像歪み
を低減することができない。
【００１９】図２は本発明の他の実施例で、更に、受信
チャンネル切替時などロックがはずれた場合の引き込み
時間を短縮するため、ロック検出器３６、ループゲイン
切替器３７が設けられている。ロック検出器３６として
は、例えば、フリップフロップＦＦが用いられ、切替器
３７としてはスイッチＳＷが用いられる。また減衰器３
３としては、例えば、オペアンプ３３ａ、基準電源３３
ｂ、抵抗Ｒ1，Ｒ2，Ｒ3で構成され、抵抗Ｒ3の両端には
スイッチＳＷが接続されている。
チャンネル切替時などロックがはずれた場合の引き込み
時間を短縮するため、ロック検出器３６、ループゲイン
切替器３７が設けられている。ロック検出器３６として
は、例えば、フリップフロップＦＦが用いられ、切替器
３７としてはスイッチＳＷが用いられる。また減衰器３
３としては、例えば、オペアンプ３３ａ、基準電源３３
ｂ、抵抗Ｒ1，Ｒ2，Ｒ3で構成され、抵抗Ｒ3の両端には
スイッチＳＷが接続されている。
【００２０】図２において端子ａに入力された水平同期
信号をクロック、分周器３５の出力をデータとすれば、
ロック検出器３６はＰＬＬ回路が入力にロックしている
か否かの判定を行うことができる。ロック検出器３６の
出力（ハイまたはローの２値出力）によりループゲイン
切替器３７のスイッチＳＷはオープンまたはショートと
なる。
信号をクロック、分周器３５の出力をデータとすれば、
ロック検出器３６はＰＬＬ回路が入力にロックしている
か否かの判定を行うことができる。ロック検出器３６の
出力（ハイまたはローの２値出力）によりループゲイン
切替器３７のスイッチＳＷはオープンまたはショートと
なる。
【００２１】ここで、Ｒ１＝Ｒ２＋Ｒ３；Ｒ２＜Ｒ３と
すれば、減衰器３３の入力と出力との比はスイッチＳＷ
がオープンのとき１：１、ショートのとき１：α（Ｒ２
／Ｒ１＝α）となり、αの値を小さくとればＤＣループ
ゲインを下げることができる。図３の実線はスイッチＳ
Ｗがオープンのとき、破線はショートのときのＰＬＬ回
路の周波数特性を示す。以上により図２のＰＬＬ回路は
アンロック時には図３の実線の特性、ロック時には図３
の破線の特性をとり、ロック時の安定性能に優れ且つ引
き込みの速いＴＶ移動受信に適した水平同期回路が実現
される。
すれば、減衰器３３の入力と出力との比はスイッチＳＷ
がオープンのとき１：１、ショートのとき１：α（Ｒ２
／Ｒ１＝α）となり、αの値を小さくとればＤＣループ
ゲインを下げることができる。図３の実線はスイッチＳ
Ｗがオープンのとき、破線はショートのときのＰＬＬ回
路の周波数特性を示す。以上により図２のＰＬＬ回路は
アンロック時には図３の実線の特性、ロック時には図３
の破線の特性をとり、ロック時の安定性能に優れ且つ引
き込みの速いＴＶ移動受信に適した水平同期回路が実現
される。
【００２２】
【発明の効果】以上説明したように本発明によれば、画
像歪みの低減によるＴＶ移動受信画面の視認性向上を達
成でき、またダイバー制御用同期回路の安定化によるダ
イバー誤動作の防止を図ることができる。
像歪みの低減によるＴＶ移動受信画面の視認性向上を達
成でき、またダイバー制御用同期回路の安定化によるダ
イバー誤動作の防止を図ることができる。
【図１】本発明の一実施例を示すブロック図である。
【図２】本発明の他の実施例を示すブロック図である。
【図３】図２の実施例の周波数特性図である。
【図４】従来の一般的なテレビジョン受像機の水平同期
回路を示すブロック図である。
回路を示すブロック図である。
【図５】安定した受信状態の図４の各部の波形図であ
る。
る。
【図６】改良された水平同期回路の一例を示すブロック
図である。
図である。
【図７】受信映像検波信号にノイズやゴーストが混入し
た場合の図４および図６の各部の波形図である。
た場合の図４および図６の各部の波形図である。
【図８】画像の歪みを示す説明図である。
【図９】従来の２モードＰＬＬ方式の回路図である。
【図１０】図９の方式の周波数特性図である。
３１ 位相比較器 ３２ ＬＰＦ ３３ 減衰器 ３４ ＶＣＯ ３５ 分周器 ３６ ロック検出器 ３７ ループゲイン切替器
Claims (3)
- 【請求項１】 位相比較器と、ローパスフィルタと、電
圧制御型発振器と、分周器とを有し、映像信号より分離
した水平同期信号と分周器の出力信号とを上記位相比較
器に入力するようになっているＰＬＬ回路を備えた水平
同期回路において、 前記ローパスフィルタと電圧制御型発振器との間に、ル
ープゲイン減衰手段を挿入したことを特徴とする水平同
期回路。 - 【請求項２】 前記ＰＬＬ回路のロック検出手段と、該
ロック検出手段の出力に応じて前記ループゲイン減衰手
段の減衰率を切換えるループゲイン切替手段と、を備え
たことを特徴とする請求項１に記載の水平同期回路。 - 【請求項３】 前記ループゲイン減衰手段は抵抗とオペ
アンプとから成ることを特徴とする請求項１に記載の水
平同期回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5184497A JPH0715620A (ja) | 1993-06-28 | 1993-06-28 | 水平同期回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5184497A JPH0715620A (ja) | 1993-06-28 | 1993-06-28 | 水平同期回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0715620A true JPH0715620A (ja) | 1995-01-17 |
Family
ID=16154225
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5184497A Pending JPH0715620A (ja) | 1993-06-28 | 1993-06-28 | 水平同期回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0715620A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002027283A (ja) * | 2000-07-10 | 2002-01-25 | Matsushita Electric Ind Co Ltd | 水平ｐｌｌ回路 |
| US7538166B2 (en) | 2003-12-24 | 2009-05-26 | Sumitomo Chemical Company, Limited | Epoxy compounds and cured epoxy resins obtained by curing the compounds |
-
1993
- 1993-06-28 JP JP5184497A patent/JPH0715620A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002027283A (ja) * | 2000-07-10 | 2002-01-25 | Matsushita Electric Ind Co Ltd | 水平ｐｌｌ回路 |
| US7538166B2 (en) | 2003-12-24 | 2009-05-26 | Sumitomo Chemical Company, Limited | Epoxy compounds and cured epoxy resins obtained by curing the compounds |
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