JPH07115662A - 差動利得補償回路 - Google Patents
差動利得補償回路Info
- Publication number
- JPH07115662A JPH07115662A JP5281829A JP28182993A JPH07115662A JP H07115662 A JPH07115662 A JP H07115662A JP 5281829 A JP5281829 A JP 5281829A JP 28182993 A JP28182993 A JP 28182993A JP H07115662 A JPH07115662 A JP H07115662A
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- JP
- Japan
- Prior art keywords
- fet
- gate
- source
- diode
- signals
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- Pending
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Abstract
(57)【要約】
【目的】 簡単な回路構成で高性能な差動利得補償回路
を提供する。 【構成】 電界効果トランジスタ（ＦＥＴ）１３を可変
インピーダンス素子として用い、再生色信号Ｃの振幅を
再生輝度信号Ｙで変化させて色信号Ｃの差動利得補償を
行う差動利得補償回路において、ＦＥＴ１３のゲートと
ソースとの間に、該ソースから前記ゲートに電流を流す
向きでダイオードＤ１を介設し、このダイオードＤ１に
より、ゲートに加えた輝度信号の同期信号端をソフトに
クランプする。
を提供する。 【構成】 電界効果トランジスタ（ＦＥＴ）１３を可変
インピーダンス素子として用い、再生色信号Ｃの振幅を
再生輝度信号Ｙで変化させて色信号Ｃの差動利得補償を
行う差動利得補償回路において、ＦＥＴ１３のゲートと
ソースとの間に、該ソースから前記ゲートに電流を流す
向きでダイオードＤ１を介設し、このダイオードＤ１に
より、ゲートに加えた輝度信号の同期信号端をソフトに
クランプする。
Description
【０００１】
【産業上の利用分野】本発明は、再生された色信号の差
動利得（Differential Gain 、以下ＤＧと略記する）に
よる変化を再生側で逆補正するＤＧ補償回路に関する。
動利得（Differential Gain 、以下ＤＧと略記する）に
よる変化を再生側で逆補正するＤＧ補償回路に関する。
【０００２】
【従来の技術】まず、ＤＧの説明を行う。図２は再生さ
れた色信号のＤＧによる変化を説明するための波形図で
ある。図２（ｂ）に示す輝度信号Ｙに、図２（ｃ）に示
す振幅が一定の色信号Ｃ（３．５８ＭＨｚ）を乗せた図
２（ａ）に示す信号のうち、輝度信号ＹはＦＭ変調、色
信号Ｃは３．５８ＭＨｚ→６２９ＫＨｚに低域変換して
ＶＴＲに録画再生する。
れた色信号のＤＧによる変化を説明するための波形図で
ある。図２（ｂ）に示す輝度信号Ｙに、図２（ｃ）に示
す振幅が一定の色信号Ｃ（３．５８ＭＨｚ）を乗せた図
２（ａ）に示す信号のうち、輝度信号ＹはＦＭ変調、色
信号Ｃは３．５８ＭＨｚ→６２９ＫＨｚに低域変換して
ＶＴＲに録画再生する。
【０００３】ＶＴＲで再生された色信号Ｃは、図２
（ｄ）に示すように輝度信号Ｙによって振幅変調を受け
た形になる。これはテープヘッドの電磁変換特性による
ものである。即ち、低域変換色信号の変調波に対して、
ＦＭ変調された輝度信号Ｙがバイアスとなり、輝度信号
Ｙの振幅によりバイアスの周波数およびレベルが変化
し、いわゆるバイアス効果が変わるために、色信号Ｃの
振幅が輝度信号Ｙの変化によって変わってしまうのであ
る。これがＤＧである。
（ｄ）に示すように輝度信号Ｙによって振幅変調を受け
た形になる。これはテープヘッドの電磁変換特性による
ものである。即ち、低域変換色信号の変調波に対して、
ＦＭ変調された輝度信号Ｙがバイアスとなり、輝度信号
Ｙの振幅によりバイアスの周波数およびレベルが変化
し、いわゆるバイアス効果が変わるために、色信号Ｃの
振幅が輝度信号Ｙの変化によって変わってしまうのであ
る。これがＤＧである。
【０００４】一般に輝度信号Ｙの振幅が大きくなると、
ＦＭのキャリアは高くなり、再生された色信号Ｃの振幅
は、図２（Ｄ）に示すように大きくなる。この再生され
た色信号ＣのＤＧによる変化を再生側で逆補正するため
に、以下の方式のＤＧ補償回路が種々提案されている。
ＦＭのキャリアは高くなり、再生された色信号Ｃの振幅
は、図２（Ｄ）に示すように大きくなる。この再生され
た色信号ＣのＤＧによる変化を再生側で逆補正するため
に、以下の方式のＤＧ補償回路が種々提案されている。
【０００５】ＤＧ補償回路としては、再生色信号Ｃを、
平衡変調器を利用して再生輝度信号Ｙで変調を掛けるＢ
ＡＬ−ＭＯＤ（Balanced Modulator）方式と、可変イン
ピーダンス素子としての電界効果トランジスタ（以下、
ＦＥＴと略記する）を使って、再生色信号Ｃの振幅を再
生輝度信号Ｙで変化させるＦＥＴ方式と、再生ＡＣＣ
（Automatic Color Control Circuit ）の検波に再生輝
度信号Ｙを加えるＡＣＣ方式とがある。
平衡変調器を利用して再生輝度信号Ｙで変調を掛けるＢ
ＡＬ−ＭＯＤ（Balanced Modulator）方式と、可変イン
ピーダンス素子としての電界効果トランジスタ（以下、
ＦＥＴと略記する）を使って、再生色信号Ｃの振幅を再
生輝度信号Ｙで変化させるＦＥＴ方式と、再生ＡＣＣ
（Automatic Color Control Circuit ）の検波に再生輝
度信号Ｙを加えるＡＣＣ方式とがある。
【０００６】図３はＦＥＴ方式のＤＧ補償回路のブロッ
ク図である。図において、Ａは再録ヘッド、１は再録ア
ンプ、２はローパスフィルタ（以下、ＬＰＦと略記す
る）、３は可変インピーダンス素子としてのＦＥＴ、４
はＡＣＣ、５はコンバータ（ＣＯＮＶ）、６はバンドパ
スフィルタ（以下、ＢＰＦと略記する）である。
ク図である。図において、Ａは再録ヘッド、１は再録ア
ンプ、２はローパスフィルタ（以下、ＬＰＦと略記す
る）、３は可変インピーダンス素子としてのＦＥＴ、４
はＡＣＣ、５はコンバータ（ＣＯＮＶ）、６はバンドパ
スフィルタ（以下、ＢＰＦと略記する）である。
【０００７】図４は従来のＦＥＴ方式のＤＧ補償回路の
要部構成図である。前述したように、ＦＥＴ３を可変イ
ンピーダンス素子として用い、抵抗Ｒ３とＦＥＴ３のド
レインのインピーダンスで、低域変換６２９ＫＨｚ再生
色信号Ｃのゲインを変える。ＦＥＴ３のゲートには再生
輝度信号Ｙを、抵抗Ｒ１、サーミスタＴＨ１、抵抗Ｒ２
のアッテネートとコンデンサＣ１で適当に積分し、輝度
信号Ｙの高域ノズルを抑えて加える。サーミスタＴＨ１
はＦＥＴ３の温度補償を行う。また、可変抵抗ＶＲ１で
ＦＥＴ３のソース抵抗を変え、ＤＧ補正量を変えるよう
にする。
要部構成図である。前述したように、ＦＥＴ３を可変イ
ンピーダンス素子として用い、抵抗Ｒ３とＦＥＴ３のド
レインのインピーダンスで、低域変換６２９ＫＨｚ再生
色信号Ｃのゲインを変える。ＦＥＴ３のゲートには再生
輝度信号Ｙを、抵抗Ｒ１、サーミスタＴＨ１、抵抗Ｒ２
のアッテネートとコンデンサＣ１で適当に積分し、輝度
信号Ｙの高域ノズルを抑えて加える。サーミスタＴＨ１
はＦＥＴ３の温度補償を行う。また、可変抵抗ＶＲ１で
ＦＥＴ３のソース抵抗を変え、ＤＧ補正量を変えるよう
にする。
【０００８】
【発明が解決しようとする課題】しかしながら、上記従
来のＦＥＴ方式のＤＧ補償回路においては、再生輝度信
号ＹのＡＰＬの変化により、ＦＥＴのゲートに加わる輝
度信号Ｙの直流電位が変化し、ＤＧ補正量が変わってし
まう欠点があった。
来のＦＥＴ方式のＤＧ補償回路においては、再生輝度信
号ＹのＡＰＬの変化により、ＦＥＴのゲートに加わる輝
度信号Ｙの直流電位が変化し、ＤＧ補正量が変わってし
まう欠点があった。
【０００９】本発明はＦＥＴ方式を前提とし、簡単な回
路構成で高性能なＤＧ補償回路を提供することを目的と
する。
路構成で高性能なＤＧ補償回路を提供することを目的と
する。
【００１０】
【課題を解決するための手段】上記目的を達成するため
に、本発明は、電界効果トランジスタを可変インピーダ
ンス素子として用い、再生色信号の振幅を再生輝度信号
で変化させて色信号の差動利得補償を行う差動利得補償
回路において、前記電界効果トランジスタのゲートとソ
ースとの間に、該ソースから前記ゲートに電流を流す向
きでダイオードを介設した。
に、本発明は、電界効果トランジスタを可変インピーダ
ンス素子として用い、再生色信号の振幅を再生輝度信号
で変化させて色信号の差動利得補償を行う差動利得補償
回路において、前記電界効果トランジスタのゲートとソ
ースとの間に、該ソースから前記ゲートに電流を流す向
きでダイオードを介設した。
【００１１】
【作用】ＦＥＴのゲートとソースとの間に介設したダイ
オードにより、可変インピーダンス素子であるＦＥＴの
温度補償を行うと共に、ゲートに加えた輝度信号の同期
信号端にクランプを掛ける。
オードにより、可変インピーダンス素子であるＦＥＴの
温度補償を行うと共に、ゲートに加えた輝度信号の同期
信号端にクランプを掛ける。
【００１２】
【実施例】以下、本発明の実施例を図面に基づいて説明
する。図１は実施例に係るＦＥＴ方式のＤＧ補償回路の
要部構成図である。図において、１１はＬＯＷ ＢＡＮ
Ｄの時にオンし、ＤＧ補正量を減らすようにレベルシフ
トするトランジスタ、１２はトランジスタ１１と並列に
設けられ、ＥＥ（Electric to Electric）時にオンし、
ＤＧ補正動作をオフするトランジスタである。勿論、再
生専用回路の場合は、トランジスタ１２は不要である。
１３は可変インピーダンス素子としてのＦＥＴであり、
前記トランジスタ１１，１２はこのＦＥＴ１３のゲー
ト、ソース間に並列に接続されている。１４はＦＥＴ１
３のゲインを稼ぐためのＦＥＴである。また、ＦＥＴ１
３のゲートとソースとの間に、該ソースから前記ゲート
に電流を流す向きでダイオードＤ１を介設している。
する。図１は実施例に係るＦＥＴ方式のＤＧ補償回路の
要部構成図である。図において、１１はＬＯＷ ＢＡＮ
Ｄの時にオンし、ＤＧ補正量を減らすようにレベルシフ
トするトランジスタ、１２はトランジスタ１１と並列に
設けられ、ＥＥ（Electric to Electric）時にオンし、
ＤＧ補正動作をオフするトランジスタである。勿論、再
生専用回路の場合は、トランジスタ１２は不要である。
１３は可変インピーダンス素子としてのＦＥＴであり、
前記トランジスタ１１，１２はこのＦＥＴ１３のゲー
ト、ソース間に並列に接続されている。１４はＦＥＴ１
３のゲインを稼ぐためのＦＥＴである。また、ＦＥＴ１
３のゲートとソースとの間に、該ソースから前記ゲート
に電流を流す向きでダイオードＤ１を介設している。
【００１３】本実施例では、ＦＥＴ１３を可変インピー
ダンス素子として用い、６２９ＫＨｚの再生色信号Ｃの
ゲインを抵抗Ｒ３とＦＥＴ１３で変えてコントロールす
る。ＦＥＴ１３のゲートには輝度信号Ｙを、抵抗Ｒ１と
コンデンサＣ２で積分し、輝度信号Ｙの高域ノイズを抑
えて加える。
ダンス素子として用い、６２９ＫＨｚの再生色信号Ｃの
ゲインを抵抗Ｒ３とＦＥＴ１３で変えてコントロールす
る。ＦＥＴ１３のゲートには輝度信号Ｙを、抵抗Ｒ１と
コンデンサＣ２で積分し、輝度信号Ｙの高域ノイズを抑
えて加える。
【００１４】ダイオードＤ１は、輝度信号Ｙの同期信号
端をソフトにクランプし、輝度信号ＹのＡＰＬの変化に
影響されないようにすると共に、ＦＥＴ１３の温度特性
を補償している。なお、前述の可変抵抗ＲＶ１によって
ＤＧ補正の調整を行う。また、動作時はＦＥＴ１３のド
レインでレベルが約半分（−６ｄＢ）となるので、後段
のＦＥＴ１４で次段に必要なゲインを稼いでいる。
端をソフトにクランプし、輝度信号ＹのＡＰＬの変化に
影響されないようにすると共に、ＦＥＴ１３の温度特性
を補償している。なお、前述の可変抵抗ＲＶ１によって
ＤＧ補正の調整を行う。また、動作時はＦＥＴ１３のド
レインでレベルが約半分（−６ｄＢ）となるので、後段
のＦＥＴ１４で次段に必要なゲインを稼いでいる。
【００１５】
【発明の効果】本発明によれば、可変インピーダンス素
子としてのＦＥＴのゲート、ソース間に、該ソースから
前記ゲートに電流を流す向きでダイオードを設けること
で、ＦＥＴの温度補償を行う（ダイオードの温度特性の
変化によってＦＥＴの温度特性の変化をキャンセルさせ
る）ことができると共に、ゲートに加えた輝度信号の同
期信号端をソフトにクランプし、ＤＧ補償量が輝度信号
のＡＰＬ（Average Picture Level)の変化に影響されな
いようにすることができる。その結果、ダイオードの追
加という簡単で安価な回路構成で高性能なＤＧ補償回路
が実現できる。
子としてのＦＥＴのゲート、ソース間に、該ソースから
前記ゲートに電流を流す向きでダイオードを設けること
で、ＦＥＴの温度補償を行う（ダイオードの温度特性の
変化によってＦＥＴの温度特性の変化をキャンセルさせ
る）ことができると共に、ゲートに加えた輝度信号の同
期信号端をソフトにクランプし、ＤＧ補償量が輝度信号
のＡＰＬ（Average Picture Level)の変化に影響されな
いようにすることができる。その結果、ダイオードの追
加という簡単で安価な回路構成で高性能なＤＧ補償回路
が実現できる。
【図１】本発明の実施例に係るＦＥＴ方式のＤＧ補償回
路の要部構成図である。
路の要部構成図である。
【図２】再生された色信号のＤＧによる変化を説明する
ための波形図である。
ための波形図である。
【図３】ＦＥＴ方式のＤＧ補償回路のブロック図であ
る。
る。
【図４】従来のＦＥＴ方式のＤＧ補償回路の要部構成図
である。
である。
１３ 電界効果トランジスタ Ｄ１ ダイオード
Claims (1)
- 【請求項１】 電界効果トランジスタを可変インピーダ
ンス素子として用い、再生色信号の振幅を再生輝度信号
で変化させて色信号の差動利得補償を行う差動利得補償
回路において、 前記電界効果トランジスタのゲートとソースとの間に、
該ソースから前記ゲートに電流を流す向きでダイオード
を介設したことを特徴とする差動利得補償回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5281829A JPH07115662A (ja) | 1993-10-14 | 1993-10-14 | 差動利得補償回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5281829A JPH07115662A (ja) | 1993-10-14 | 1993-10-14 | 差動利得補償回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07115662A true JPH07115662A (ja) | 1995-05-02 |
Family
ID=17644590
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5281829A Pending JPH07115662A (ja) | 1993-10-14 | 1993-10-14 | 差動利得補償回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07115662A (ja) |
-
1993
- 1993-10-14 JP JP5281829A patent/JPH07115662A/ja active Pending
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