JPH0668708B2 - 定電圧電源装置 - Google Patents
定電圧電源装置Info
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- JPH0668708B2 JPH0668708B2 JP59268019A JP26801984A JPH0668708B2 JP H0668708 B2 JPH0668708 B2 JP H0668708B2 JP 59268019 A JP59268019 A JP 59268019A JP 26801984 A JP26801984 A JP 26801984A JP H0668708 B2 JPH0668708 B2 JP H0668708B2
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- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/10—Regulating voltage or current
- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/468—Regulating voltage or current wherein the variable actually regulated by the final control device is dc characterised by reference voltage circuitry, e.g. soft start, remote shutdown
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は定電圧電源装置に関し、特に絶縁ゲート型電界
効果トランジスタ（Insulated Gate Field Efect Trani
stor以下略してIG・FET）を用いた出力電圧の可変を可能
とした定電圧電源装置に関する。
効果トランジスタ（Insulated Gate Field Efect Trani
stor以下略してIG・FET）を用いた出力電圧の可変を可能
とした定電圧電源装置に関する。
小型電子腕時計，電子卓上計算機等に用いられる集積回
路装置は、集積回路装置の外部から供給される電源を一
旦昇圧回路あるいは降圧回路を介して昇圧もしくは降圧
し供給する方式をとっている。この電源供給方式の場
合，外部の電力供給装置の電源変動が直接集積回路に影
響し，集積回路の動作を不安定にする。以上の点を顧
み，近年のみ集積回路装置は第３図に示すような定電圧
電源を内蔵する方式が多く利用されている。すなわち，
外部から供給される電圧ＶＤＤとＶＳＳとの差電圧で定
電流源１１を駆動し、この定電流源１１の出力電流を負
荷回路１２に流し、負荷回路１２に得られる電圧安定化
回路１３で安定化して出力端子に定電圧出力を得てい
る。
路装置は、集積回路装置の外部から供給される電源を一
旦昇圧回路あるいは降圧回路を介して昇圧もしくは降圧
し供給する方式をとっている。この電源供給方式の場
合，外部の電力供給装置の電源変動が直接集積回路に影
響し，集積回路の動作を不安定にする。以上の点を顧
み，近年のみ集積回路装置は第３図に示すような定電圧
電源を内蔵する方式が多く利用されている。すなわち，
外部から供給される電圧ＶＤＤとＶＳＳとの差電圧で定
電流源１１を駆動し、この定電流源１１の出力電流を負
荷回路１２に流し、負荷回路１２に得られる電圧安定化
回路１３で安定化して出力端子に定電圧出力を得てい
る。
しかしながら、このように内蔵された定電圧電源は，定
電圧電源を構成するトランジスタ，抵抗，ダイオード等
の素子特性により一義的に出力電圧が決められてしま
い，集積回路装置を製造した後に定電圧電源の出力電圧
を可変することができない。あらかじめ集積回路装置の
外部に可変抵抗器等を設けることによって出力電圧を調
節することは可能であるが，これでは外付素子の増加を
きたし、小型電子腕時計，電子卓上計算機等の実装密度
が高い装置では極めて不利となる。更に部品コストや製
造上調整工程が必要となりコストアップになっている。
電圧電源を構成するトランジスタ，抵抗，ダイオード等
の素子特性により一義的に出力電圧が決められてしま
い，集積回路装置を製造した後に定電圧電源の出力電圧
を可変することができない。あらかじめ集積回路装置の
外部に可変抵抗器等を設けることによって出力電圧を調
節することは可能であるが，これでは外付素子の増加を
きたし、小型電子腕時計，電子卓上計算機等の実装密度
が高い装置では極めて不利となる。更に部品コストや製
造上調整工程が必要となりコストアップになっている。
本発明によれば外部から与えられる電源で駆動される定
電流源とダイオードとの直列回路と、ダイオードに並列
に制御電極・共通電極間が接続される複数のトランジス
タと，各トランジスタの出力電流をそれぞれスイッチを
介して供給される電流−電圧変換回路と，この電流−電
圧変換回路からの出力電圧を受け定電圧を出力する電圧
安定化回路とを有する定電圧電源装置を得る。
電流源とダイオードとの直列回路と、ダイオードに並列
に制御電極・共通電極間が接続される複数のトランジス
タと，各トランジスタの出力電流をそれぞれスイッチを
介して供給される電流−電圧変換回路と，この電流−電
圧変換回路からの出力電圧を受け定電圧を出力する電圧
安定化回路とを有する定電圧電源装置を得る。
以下に、図面を参照して本発明をより詳細に説明する。
第１図は本発明の一実施例である。定電流源２１の一端
を外部から供給される第１の電源ＶＤＤに接続し、その
他の一端をＩＧ−ＦＥＴＴ１０のゲートとドレインに接
続する。ＩＧ−ＦＥＴＴ１１〜ＩＧ−ＦＥＴＴ１ｎのそ
れぞれのゲートをＩＧ−ＦＥＴＴ１０のゲート及びドレ
インに接続し，カレントミラーを構成する。ＩＧ−ＦＥ
ＴＴ１１〜ＩＧ−ＦＥＴＴ１ｎ及びＩＧ−ＦＥＴＴ１０
のソースは外部から供給される第２の電源ＶＳＳにそれ
ぞれ接続する。ＩＧ−ＦＥＴＴ１１のドレインをＩＧ−
ＦＥＴＴ２１のソースに接続し，同様にＩＧ−ＦＥＴＴ
１２，ＩＧ−ＦＥＴＴ１３…………ＩＧ−ＦＥＴＴ１ｎ
のドレインをＩＧ−ＦＥＴＴ２２，ＩＧ−ＦＥＴＴ２３
…………ＩＧ−ＦＥＴＴ２ｎのそれぞれのソースに接続
する。ＩＧ−ＦＥＴＴ２１〜ＩＧ−ＦＥＴＴ２ｎはスイ
ッチとして作用し、それぞれのドレインを接続し，負荷
回路２２の一端及び安定化回路に接続する。負荷回路２
２の他端は第１の電源ＶＤＤに接続する。ＩＧ−ＦＥＴ
Ｔ２１のゲートを入力端子Ｉ１１に接続し，同様にＩＧ
−ＦＥＴＴ２２〜ＩＧ−ＦＥＴＴ２ｎのそれぞれのゲー
トを入力端子Ｉ１２〜Ｉ１ｎに接続する。これにより、
ＩＧ−ＦＥＴＴ１ｎとＩＧ−ＦＥＴＴ２ｎとで直列回路
２４ｎが構成され、かかる直列回路２４ｎは複数並列に
接続されている。
第１図は本発明の一実施例である。定電流源２１の一端
を外部から供給される第１の電源ＶＤＤに接続し、その
他の一端をＩＧ−ＦＥＴＴ１０のゲートとドレインに接
続する。ＩＧ−ＦＥＴＴ１１〜ＩＧ−ＦＥＴＴ１ｎのそ
れぞれのゲートをＩＧ−ＦＥＴＴ１０のゲート及びドレ
インに接続し，カレントミラーを構成する。ＩＧ−ＦＥ
ＴＴ１１〜ＩＧ−ＦＥＴＴ１ｎ及びＩＧ−ＦＥＴＴ１０
のソースは外部から供給される第２の電源ＶＳＳにそれ
ぞれ接続する。ＩＧ−ＦＥＴＴ１１のドレインをＩＧ−
ＦＥＴＴ２１のソースに接続し，同様にＩＧ−ＦＥＴＴ
１２，ＩＧ−ＦＥＴＴ１３…………ＩＧ−ＦＥＴＴ１ｎ
のドレインをＩＧ−ＦＥＴＴ２２，ＩＧ−ＦＥＴＴ２３
…………ＩＧ−ＦＥＴＴ２ｎのそれぞれのソースに接続
する。ＩＧ−ＦＥＴＴ２１〜ＩＧ−ＦＥＴＴ２ｎはスイ
ッチとして作用し、それぞれのドレインを接続し，負荷
回路２２の一端及び安定化回路に接続する。負荷回路２
２の他端は第１の電源ＶＤＤに接続する。ＩＧ−ＦＥＴ
Ｔ２１のゲートを入力端子Ｉ１１に接続し，同様にＩＧ
−ＦＥＴＴ２２〜ＩＧ−ＦＥＴＴ２ｎのそれぞれのゲー
トを入力端子Ｉ１２〜Ｉ１ｎに接続する。これにより、
ＩＧ−ＦＥＴＴ１ｎとＩＧ−ＦＥＴＴ２ｎとで直列回路
２４ｎが構成され、かかる直列回路２４ｎは複数並列に
接続されている。
本実施例で構成された定電圧電源回路において，カレン
トミラー回路を構成するＩＧ−ＦＥＴＴ１１〜ＩＧ−Ｆ
ＥＴＴ１ｎの形状，具体的にはチャンネル幅（又はチャ
ンネル長）をＩＧ−ＦＥＴＴ１０に対して適当に違えて
設定すると定電流源２１に流れる定電流ｉ０に対してト
ランジスタの形状比に相当する定電流ｉ１１〜ｉ１ｎを
それぞれのＩＧ−ＦＥＴＴ１１〜ＩＧ−ＦＥＴＴ１ｎに
取り出すことができる。入力端子Ｉ１１に高電位レベル
（以下“１”と称す）を与えるとＩＧ−ＦＥＴＴ２１は
導通状態（以下ＯＮと略す）になり負荷回路２２にはｉ
１１の定電流が流れる。同様に、入力端子Ｉ１２，Ｉ
１３……Ｉ１ｎを“１”にするとＩＧ−ＦＥＴＴ２２〜
ＩＧ−ＦＥＴＴ２ｎがＯＮ状態になり、負荷回路２２に
はｉ１１＋ｉ１２＋…ｉ１ｎの定電流を流すことができ
る。
トミラー回路を構成するＩＧ−ＦＥＴＴ１１〜ＩＧ−Ｆ
ＥＴＴ１ｎの形状，具体的にはチャンネル幅（又はチャ
ンネル長）をＩＧ−ＦＥＴＴ１０に対して適当に違えて
設定すると定電流源２１に流れる定電流ｉ０に対してト
ランジスタの形状比に相当する定電流ｉ１１〜ｉ１ｎを
それぞれのＩＧ−ＦＥＴＴ１１〜ＩＧ−ＦＥＴＴ１ｎに
取り出すことができる。入力端子Ｉ１１に高電位レベル
（以下“１”と称す）を与えるとＩＧ−ＦＥＴＴ２１は
導通状態（以下ＯＮと略す）になり負荷回路２２にはｉ
１１の定電流が流れる。同様に、入力端子Ｉ１２，Ｉ
１３……Ｉ１ｎを“１”にするとＩＧ−ＦＥＴＴ２２〜
ＩＧ−ＦＥＴＴ２ｎがＯＮ状態になり、負荷回路２２に
はｉ１１＋ｉ１２＋…ｉ１ｎの定電流を流すことができ
る。
かくして入力端子Ｉ１１〜Ｉ１ｎを任意に選択すること
により，負荷回路２２に流れる電流を任意に可変するこ
とが可能になり，それぞれの定電流に応じた電圧が負荷
回路２２に発生せしめることができ、さらに安定化回路
により、外部負荷変動に対しても安定な出力電圧を得る
ものである。
により，負荷回路２２に流れる電流を任意に可変するこ
とが可能になり，それぞれの定電流に応じた電圧が負荷
回路２２に発生せしめることができ、さらに安定化回路
により、外部負荷変動に対しても安定な出力電圧を得る
ものである。
第２図は本発明のもう一つの実施例で，カレントミラー
回路をＰチャンネルＩＧ−ＦＥＴで構成した例である。
定電流源３１の一端を第２の電源Ｖｓｓに接続し，その
他の一端をＰチャンネルＩＧ−ＦＥＴＴ３０のゲートと
ドレインに接続する。ＰチャンネルＩＧ−ＦＥＴＴ３１
〜ＩＧＦＥＴＴ３ｎのそれぞれのゲートをＩＧ−ＦＥＴ
Ｔ３０のゲート及びドレインに接続し，カレントミラー
を構成する。ＩＧ−ＦＥＴＴ３１〜ＩＧ−ＦＥＴＴ３ｎ
及びＩＧ−ＦＥＴＴ３０のソースは第１の電源ＶＤＤに
それぞれ接続する。ＩＧ−ＦＥＴＴ３１のドレインをＩ
Ｇ−ＦＥＴＴ４１のソースに接続し，同様にＩＧ−ＦＥ
ＴＴ３２，ＩＧ−ＦＥＴＴ３３……ＩＧ−ＦＥＴＴ３ｎ
のドレインをＩＧ−ＦＥＴＴ４２，ＩＧ−ＦＥＴＴ４３
……ＩＧ−ＦＥＴＴ４ｎのそれぞれのソースに接続す
る。ＩＧ−ＦＥＴＴ４１〜ＩＧ−ＦＥＴＴ４ｎのそれぞ
れのドレインを接続し，負荷回路３２の一端及び安定化
回路に接続する。負荷回路３２の他端は第２の電源Ｖ
ＳＳに接続する。ＩＧ−ＦＥＴＴ４１のゲートを入力端
子Ｔ２１に接続し，同様にＩＧ−ＦＥＴＴ４２〜ＩＧ−
ＦＥＴＴ４ｎのそれぞれのゲートを入力端子Ｉ２２〜Ｉ
２ｎに接続する。これにより、ＩＧ−ＦＥＴＴ３ｎとＩ
Ｇ−ＦＥＴＴ４ｎとで直列回路３４ｎが構成され、かか
る直列回路３４ｎは複数並列に接続されている。
回路をＰチャンネルＩＧ−ＦＥＴで構成した例である。
定電流源３１の一端を第２の電源Ｖｓｓに接続し，その
他の一端をＰチャンネルＩＧ−ＦＥＴＴ３０のゲートと
ドレインに接続する。ＰチャンネルＩＧ−ＦＥＴＴ３１
〜ＩＧＦＥＴＴ３ｎのそれぞれのゲートをＩＧ−ＦＥＴ
Ｔ３０のゲート及びドレインに接続し，カレントミラー
を構成する。ＩＧ−ＦＥＴＴ３１〜ＩＧ−ＦＥＴＴ３ｎ
及びＩＧ−ＦＥＴＴ３０のソースは第１の電源ＶＤＤに
それぞれ接続する。ＩＧ−ＦＥＴＴ３１のドレインをＩ
Ｇ−ＦＥＴＴ４１のソースに接続し，同様にＩＧ−ＦＥ
ＴＴ３２，ＩＧ−ＦＥＴＴ３３……ＩＧ−ＦＥＴＴ３ｎ
のドレインをＩＧ−ＦＥＴＴ４２，ＩＧ−ＦＥＴＴ４３
……ＩＧ−ＦＥＴＴ４ｎのそれぞれのソースに接続す
る。ＩＧ−ＦＥＴＴ４１〜ＩＧ−ＦＥＴＴ４ｎのそれぞ
れのドレインを接続し，負荷回路３２の一端及び安定化
回路に接続する。負荷回路３２の他端は第２の電源Ｖ
ＳＳに接続する。ＩＧ−ＦＥＴＴ４１のゲートを入力端
子Ｔ２１に接続し，同様にＩＧ−ＦＥＴＴ４２〜ＩＧ−
ＦＥＴＴ４ｎのそれぞれのゲートを入力端子Ｉ２２〜Ｉ
２ｎに接続する。これにより、ＩＧ−ＦＥＴＴ３ｎとＩ
Ｇ−ＦＥＴＴ４ｎとで直列回路３４ｎが構成され、かか
る直列回路３４ｎは複数並列に接続されている。
入力端子Ｉ２１に低電位レベル（以下“０”と称す）を
与えるとＩＧ−ＦＥＴＴ４１はＯＮになり負荷回路３２
にはｉ３１の定電流が流れる。同様に入力端子Ｉ２２，
Ｉ２３…Ｉ２ｎを“０”にするとＩＧ−ＦＥＴＴ４２〜
ＩＧ−ＦＥＴＴ４ｎがＯＮ状態になり、負荷回路３２に
はｉ３１＋ｉ３２＋…ｉ３ｎの定電流を流すことができ
る。つまり第１図の実施例と同様に入力端子Ｉ２１〜Ｉ
２ｎを選択することにより負荷回路３２に流れる電流を
可変でき従って負荷回路３２に発生する電圧を可変でき
るものである。
与えるとＩＧ−ＦＥＴＴ４１はＯＮになり負荷回路３２
にはｉ３１の定電流が流れる。同様に入力端子Ｉ２２，
Ｉ２３…Ｉ２ｎを“０”にするとＩＧ−ＦＥＴＴ４２〜
ＩＧ−ＦＥＴＴ４ｎがＯＮ状態になり、負荷回路３２に
はｉ３１＋ｉ３２＋…ｉ３ｎの定電流を流すことができ
る。つまり第１図の実施例と同様に入力端子Ｉ２１〜Ｉ
２ｎを選択することにより負荷回路３２に流れる電流を
可変でき従って負荷回路３２に発生する電圧を可変でき
るものである。
本発明によれば集積回路装置の内部に接っている記憶回
路等の論理出力を入力端子Ｉ１１〜Ｉ１ｎ，Ｉ２１〜Ｉ
２ｎに接続することにより記憶回路等の状態に応じた定
電圧出力を得ることができる。この記憶回路の記憶内容
は、小型腕時計や電子卓上計算機を組み立てた後に電気
的特性等を検査しながら設定することにより容易に定電
圧源の出力電圧を調節することができる。また本実施例
では入力端子Ｉ１１〜Ｉ１ｎ，Ｉ２１〜Ｉ２ｎの信号が
集積回路装置の内部に持つ記憶回路等により与えられる
例であるが，集積回路装置に入力端子を設けることによ
り，集積回路装置の外部から信号を加え前記入力端子Ｉ
１１〜Ｉ１ｎ，Ｉ２１〜Ｉ２ｎに“１”または“０”を
与え定電圧電源の出力電圧を可変することも可能である
ことは言うまでもない。
路等の論理出力を入力端子Ｉ１１〜Ｉ１ｎ，Ｉ２１〜Ｉ
２ｎに接続することにより記憶回路等の状態に応じた定
電圧出力を得ることができる。この記憶回路の記憶内容
は、小型腕時計や電子卓上計算機を組み立てた後に電気
的特性等を検査しながら設定することにより容易に定電
圧源の出力電圧を調節することができる。また本実施例
では入力端子Ｉ１１〜Ｉ１ｎ，Ｉ２１〜Ｉ２ｎの信号が
集積回路装置の内部に持つ記憶回路等により与えられる
例であるが，集積回路装置に入力端子を設けることによ
り，集積回路装置の外部から信号を加え前記入力端子Ｉ
１１〜Ｉ１ｎ，Ｉ２１〜Ｉ２ｎに“１”または“０”を
与え定電圧電源の出力電圧を可変することも可能である
ことは言うまでもない。
本発明によれば，出力電圧の可変・調節の可能な定電圧
発生回路を得ることができる。
発生回路を得ることができる。
第１図は本発明の一実施例を示す回路図，第２図は本発
明の他の実施例を示す回路図，第３図は従来の集積回路
装置内に内蔵される定電圧電源の例を示す回路図であ
る。 １１，２１，３１……定電流源、１２，２２，３２……
負荷回路、Ｔ１０〜Ｔ１ｎ，Ｔ２１〜Ｔ２ｎ……Ｎチャ
ンネルＩＧ−ＦＥＴ、Ｔ３０〜Ｔ３ｎ，Ｔ４１〜Ｔ４ｎ
……ＰチャンネルＩＧ−ＦＥＴ、Ｉ１１〜Ｉ１ｎ，Ｉ
２１〜Ｉ２ｎ……入力端子、１３，２３，３３……安定
化回路、２４１〜２４ｎ，３４１〜３４ｎ……直列回
路、２４，３４……複数の直列回路
明の他の実施例を示す回路図，第３図は従来の集積回路
装置内に内蔵される定電圧電源の例を示す回路図であ
る。 １１，２１，３１……定電流源、１２，２２，３２……
負荷回路、Ｔ１０〜Ｔ１ｎ，Ｔ２１〜Ｔ２ｎ……Ｎチャ
ンネルＩＧ−ＦＥＴ、Ｔ３０〜Ｔ３ｎ，Ｔ４１〜Ｔ４ｎ
……ＰチャンネルＩＧ−ＦＥＴ、Ｉ１１〜Ｉ１ｎ，Ｉ
２１〜Ｉ２ｎ……入力端子、１３，２３，３３……安定
化回路、２４１〜２４ｎ，３４１〜３４ｎ……直列回
路、２４，３４……複数の直列回路
Claims (1)
- 【請求項１】負荷回路（２２）と、複数の直列回路（２
４）と、電圧安定化回路（２３）とを有する定電圧電源
装置であって、複数の直列回路（２４）は、定電流源ト
ランジスタ（Ｔ１ｎ）およびスイッチ（Ｔ２ｎ）からな
る直列回路（２４ｎ）が複数並列に接続された回路であ
り、負荷回路（２２）と複数の直列回路（２４）とは第
１の電源端子（ＶＤＤ）と第２の電源端子（ＶＳＳ）と
の間に直列に接続され、所望の電圧レベルに応じて選択
された直列回路（２４ｎ）のスイッチ（Ｔ２ｎ）を導通
せしめて定電流源トランジスタ（Ｔ１ｎ）の電流を負荷
回路（２２）に供給して負荷回路（２２）と複数の直列
回路（２４）の接続点の電圧レベルを所望の値に可変と
し、電圧安定化回路（２３）は、該接続点の電圧を入力
し、これを安定化して出力するものである定電圧電源装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59268019A JPH0668708B2 (ja) | 1984-12-19 | 1984-12-19 | 定電圧電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59268019A JPH0668708B2 (ja) | 1984-12-19 | 1984-12-19 | 定電圧電源装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61145615A JPS61145615A (ja) | 1986-07-03 |
| JPH0668708B2 true JPH0668708B2 (ja) | 1994-08-31 |
Family
ID=17452764
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59268019A Expired - Fee Related JPH0668708B2 (ja) | 1984-12-19 | 1984-12-19 | 定電圧電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0668708B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4961045A (en) * | 1989-10-27 | 1990-10-02 | Motorola, Inc. | Floating output digital to analog converter |
| JP2009015418A (ja) * | 2007-07-02 | 2009-01-22 | Oki Electric Ind Co Ltd | 定電圧出力回路 |
| JP5171908B2 (ja) * | 2010-09-14 | 2013-03-27 | 株式会社日立製作所 | 電源回路 |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5361044A (en) * | 1976-11-15 | 1978-06-01 | Hitachi Ltd | Circuit for supplying reference voltage |
| JPS5543657A (en) * | 1978-09-25 | 1980-03-27 | Hitachi Ltd | Variable voltage output circuit |
| JPS55141822A (en) * | 1979-04-24 | 1980-11-06 | Matsushita Electric Ind Co Ltd | Digital-analog converter |
| JPS56166628A (en) * | 1980-05-28 | 1981-12-21 | Matsushita Electric Ind Co Ltd | Digital-to-analog converter |
| JPS57178420A (en) * | 1981-04-25 | 1982-11-02 | Toshiba Corp | D/a converter |
-
1984
- 1984-12-19 JP JP59268019A patent/JPH0668708B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61145615A (ja) | 1986-07-03 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |