JPH0634308B2 - デイジタルオ−デイオデイスク再生装置 - Google Patents
デイジタルオ−デイオデイスク再生装置Info
- Publication number
- JPH0634308B2 JPH0634308B2 JP2754784A JP2754784A JPH0634308B2 JP H0634308 B2 JPH0634308 B2 JP H0634308B2 JP 2754784 A JP2754784 A JP 2754784A JP 2754784 A JP2754784 A JP 2754784A JP H0634308 B2 JPH0634308 B2 JP H0634308B2
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- circuit
- bit clock
- digital audio
- oscillator
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/10527—Audio or video recording; Data buffering arrangements
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/14—Digital recording or reproducing using self-clocking codes
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Multimedia (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 本発明はディジタルオーディオディスク再生装置に関
し、特に主発振器（マスタークロック）の周波数を可変
とすることによって、再生音の音程や速さを任意に変化
させること（以下ピッチコントロールと称する）ができ
るようにしたディジタルオーディオディスク再生装置に
関するものである。
し、特に主発振器（マスタークロック）の周波数を可変
とすることによって、再生音の音程や速さを任意に変化
させること（以下ピッチコントロールと称する）ができ
るようにしたディジタルオーディオディスク再生装置に
関するものである。
従来例の構成とその問題点 第１図はピッチコントロールを有するディジタルオーデ
ィオディスク再生装置の従来例の一例を示すブロック図
であり、この図を参照しながら、その動作の概略を説明
する。
ィオディスク再生装置の従来例の一例を示すブロック図
であり、この図を参照しながら、その動作の概略を説明
する。
ディスク１はスピンドルモータ２によって回転駆動さ
れ、レーザ光を用いた光学ピックアップ３によって、情
報信号を読み取られる。情報信号はプリアンプ４で増幅
され、ディジタル回路を駆動するのに十分な振幅と波形
に整形される。整形された信号はＰＬＬで構成されたビ
ットクロック再生回路５に加えられて、情報信号に含ま
れるビツトクロック信号が抽出される。情報信号とビツ
トクロック信号は復調回路６によって復調され、ディン
タリーブ回路７によってインタリーブを解かれ、同時に
時間軸のゆらぎ（ジッタ）を吸収された後、誤り訂正回
路８によって、信号の欠落等による符号誤りを訂正さ
れ、ディジタル．アナログ変換回路９においてオーディ
オ信号に変換されて出力端子１０に至る。上記の信号再
生過程における時間軸（タイミング）の基準となるマス
タクロック信号は、例えば水晶発振器よりなる固定周波
数発振器１１の出力、または例えばＣＲ発振器よりなる
可変周波数発振器１２の出力を、スイッチ１３によって
任意に選択したものを用いている。可変周波数発振器１
２の周波数は、可変抵抗器14の操作によって、任意に、
連続的に変化させることができる。マスタクロック信号
はまた、スピンドルモータ２の回転速度を制御するサー
ボ回路15に加えられて、情報信号から抽出したビツトク
ロックと比較することによって回転制御を行う。また、
マスタクロック信号は、周波数・電圧変換（Ｆ．Ｖ変
換）回路１６によって、マスタクロックの周波数の変化
を直流電圧の変化に変換され、ビットクロック再生回路
５に印加され、中心周波数の制御を行う。
れ、レーザ光を用いた光学ピックアップ３によって、情
報信号を読み取られる。情報信号はプリアンプ４で増幅
され、ディジタル回路を駆動するのに十分な振幅と波形
に整形される。整形された信号はＰＬＬで構成されたビ
ットクロック再生回路５に加えられて、情報信号に含ま
れるビツトクロック信号が抽出される。情報信号とビツ
トクロック信号は復調回路６によって復調され、ディン
タリーブ回路７によってインタリーブを解かれ、同時に
時間軸のゆらぎ（ジッタ）を吸収された後、誤り訂正回
路８によって、信号の欠落等による符号誤りを訂正さ
れ、ディジタル．アナログ変換回路９においてオーディ
オ信号に変換されて出力端子１０に至る。上記の信号再
生過程における時間軸（タイミング）の基準となるマス
タクロック信号は、例えば水晶発振器よりなる固定周波
数発振器１１の出力、または例えばＣＲ発振器よりなる
可変周波数発振器１２の出力を、スイッチ１３によって
任意に選択したものを用いている。可変周波数発振器１
２の周波数は、可変抵抗器14の操作によって、任意に、
連続的に変化させることができる。マスタクロック信号
はまた、スピンドルモータ２の回転速度を制御するサー
ボ回路15に加えられて、情報信号から抽出したビツトク
ロックと比較することによって回転制御を行う。また、
マスタクロック信号は、周波数・電圧変換（Ｆ．Ｖ変
換）回路１６によって、マスタクロックの周波数の変化
を直流電圧の変化に変換され、ビットクロック再生回路
５に印加され、中心周波数の制御を行う。
第２図はビットクロック再生回路の一例を示すブロック
図であって、周知のＰＬＬ（フェーズロックドループ）
を応用したものである。入力端子１７を経て来た情報信
号は、エッジ検出回路１８において、信号のエッジ（Ｈ
からＬ，ＬからＨへの遷移）成分を検出さされ、位相比
較回路１９に加えられる。電圧制御発振器（ＶＣ）２
０の出力もまた位相比較回路１９に加えられており、２
つの信号の位相誤差電圧はローパスフィルタ２１を経て
電圧制御発振器２０の制御電圧となる。ローパスフィル
タ２１と電圧制御発振器２０との間には、加算器２２が
あり、入力端子２３から加えられた直流電圧を、位相誤
差電圧に加算する。電圧制御発振器の出力２４は以上の
回路構成により、ディスクの情報信号のエッジ成分に同
期したビツトクロックとなり、復調器に加えられる。
図であって、周知のＰＬＬ（フェーズロックドループ）
を応用したものである。入力端子１７を経て来た情報信
号は、エッジ検出回路１８において、信号のエッジ（Ｈ
からＬ，ＬからＨへの遷移）成分を検出さされ、位相比
較回路１９に加えられる。電圧制御発振器（ＶＣ）２
０の出力もまた位相比較回路１９に加えられており、２
つの信号の位相誤差電圧はローパスフィルタ２１を経て
電圧制御発振器２０の制御電圧となる。ローパスフィル
タ２１と電圧制御発振器２０との間には、加算器２２が
あり、入力端子２３から加えられた直流電圧を、位相誤
差電圧に加算する。電圧制御発振器の出力２４は以上の
回路構成により、ディスクの情報信号のエッジ成分に同
期したビツトクロックとなり、復調器に加えられる。
入力端子２３から加える直流電圧は、前記周波数・電圧
変換回路１６の出力電圧であり、マスタクロックの周波
数に追従して変化する。この電圧が加算器２２で加算さ
れるので、電圧制御発振器２０の中心周波数は、マスタ
クロックの周波数に追従して変化することになり、ディ
スクの回転速度のゆらぎ等に対するＰＬＬのロックレン
ジの余裕度を、マスタクロック周波数の変化に無関係に
ほぼ一定に保つことができるものである。
変換回路１６の出力電圧であり、マスタクロックの周波
数に追従して変化する。この電圧が加算器２２で加算さ
れるので、電圧制御発振器２０の中心周波数は、マスタ
クロックの周波数に追従して変化することになり、ディ
スクの回転速度のゆらぎ等に対するＰＬＬのロックレン
ジの余裕度を、マスタクロック周波数の変化に無関係に
ほぼ一定に保つことができるものである。
上述の従来例の問題点を、第１図を参照しながら説明す
る。
る。
マスタクロックの周波数の変化の速さは、可変抵抗器１
４を操作した場合は、その動かす速さで決まり、ゆっく
り変化させることも、急激に変化させることもできる。
また可変周波数発振器１２の出力周波数を規準周波数
（固定周波数発振器１１の周波数に等しい）から大幅に
ずらした状態でスイッチ１３を切換えた場合は、マスタ
クロックの周波数は階段状に変化する。マスタクロック
の周波数が急激に（ないしは階段状に）変化した場合、
ビットクロック再生回路５の中心周波数はただちに追従
し、変化後の周波数のビツトクロックに対応できるが、
ディスク１の回転速度は、ディスク自身の慣性モーメン
トとスピンドルモータ２のトルクで決まる応答時定数で
しか、回転速度を変化させることができない。このた
め、ディスクからの情報信号に含まれるビツトクロック
周波数が、ディスクの回転速度が整定するまでの間は、
ビットクロック再生回路５のＰＬＬのロックレンジをは
ずれることになり、クリックノイズや音声信号のとぎれ
を発生するという問題がある。
４を操作した場合は、その動かす速さで決まり、ゆっく
り変化させることも、急激に変化させることもできる。
また可変周波数発振器１２の出力周波数を規準周波数
（固定周波数発振器１１の周波数に等しい）から大幅に
ずらした状態でスイッチ１３を切換えた場合は、マスタ
クロックの周波数は階段状に変化する。マスタクロック
の周波数が急激に（ないしは階段状に）変化した場合、
ビットクロック再生回路５の中心周波数はただちに追従
し、変化後の周波数のビツトクロックに対応できるが、
ディスク１の回転速度は、ディスク自身の慣性モーメン
トとスピンドルモータ２のトルクで決まる応答時定数で
しか、回転速度を変化させることができない。このた
め、ディスクからの情報信号に含まれるビツトクロック
周波数が、ディスクの回転速度が整定するまでの間は、
ビットクロック再生回路５のＰＬＬのロックレンジをは
ずれることになり、クリックノイズや音声信号のとぎれ
を発生するという問題がある。
発明の目的 本発明は上述のような従来のピッチコントロール付ディ
ジタルオーディオディスク再生装置における、マスタク
ロック周波数が急激に変化したときのクリックノイズや
音声信号のとぎれの発生に着目し、その発生を防止する
ことを目的とするものである。
ジタルオーディオディスク再生装置における、マスタク
ロック周波数が急激に変化したときのクリックノイズや
音声信号のとぎれの発生に着目し、その発生を防止する
ことを目的とするものである。
発明の構成 本発明のディジタルオーディオディスク再生装置は、上
記のビットクロック再生回路５の、マスタクロック周波
数の変化に対する追従に適度の時間遅れをもたせ、ディ
スクの回転速度の変化と略同等の時定数とすることによ
って、情報信号に含まれるビツトクロック周波数が、ビ
ットクロック再生回路５のロックレンジの中にあるよう
にしたことを特徴としている。
記のビットクロック再生回路５の、マスタクロック周波
数の変化に対する追従に適度の時間遅れをもたせ、ディ
スクの回転速度の変化と略同等の時定数とすることによ
って、情報信号に含まれるビツトクロック周波数が、ビ
ットクロック再生回路５のロックレンジの中にあるよう
にしたことを特徴としている。
実施例の説明 本発明の一実施例を、図面を参照しながら説明する。
第３図は、本発明のディジタルオーディオディスク再生
装置の一実施例を示すブロック図である。第１図と従来
例と共通の部分には同一の番号を付してあり、従来例と
異なる部分のみについて説明する。
装置の一実施例を示すブロック図である。第１図と従来
例と共通の部分には同一の番号を付してあり、従来例と
異なる部分のみについて説明する。
マスタクロック周波数は、周波数・電圧変換回路１６に
よって、直流電圧に変換された後、時定数回路２５を経
てビットクロック再生回路５に加えられ、マスタクロッ
クの周波数の変化に追従して、ビットクロック再生回路
の中心周波数が変化する。マスタクロックの周波数が急
激にないしは階段状に変化した場合でも、時定数回路２
５の作用によって、ビットクロック再生回路５の中心周
波数はゆるやかに変化することになる。ここで、時定数
回路２５の時定数を、ディスク１の回転速度の変化の時
定数と同等に選んでおけば、ディスクの情報信号に含ま
れるビツトクロックの周波数の変化（すなわち回転速度
の変化）と、ＰＬＬの中心周波数の変化（すなわち時定
数回路２５の出力電圧の変化）とほぼ一致し、ロックレ
ンジをはずれることがない。
よって、直流電圧に変換された後、時定数回路２５を経
てビットクロック再生回路５に加えられ、マスタクロッ
クの周波数の変化に追従して、ビットクロック再生回路
の中心周波数が変化する。マスタクロックの周波数が急
激にないしは階段状に変化した場合でも、時定数回路２
５の作用によって、ビットクロック再生回路５の中心周
波数はゆるやかに変化することになる。ここで、時定数
回路２５の時定数を、ディスク１の回転速度の変化の時
定数と同等に選んでおけば、ディスクの情報信号に含ま
れるビツトクロックの周波数の変化（すなわち回転速度
の変化）と、ＰＬＬの中心周波数の変化（すなわち時定
数回路２５の出力電圧の変化）とほぼ一致し、ロックレ
ンジをはずれることがない。
発明の効果 上述のように本発明のディジタルオーディオディスク再
生装置は、ビットクロック再生回路の中心周波数の変化
を、ディスクの回転速度の変化に追従させた応答速度と
することにより、マスタクロックの周波数が急激に変化
した場合（ピッチコントロールの操作によって生ずる）
のＰＬＬのロックはずれを防止し、もってクリックノイ
ズの発生や音のとぎれを防止することができるものであ
り、ディジタルオーディオディスク再生装置の品位を向
上させる実用上の効果の大なるものである。
生装置は、ビットクロック再生回路の中心周波数の変化
を、ディスクの回転速度の変化に追従させた応答速度と
することにより、マスタクロックの周波数が急激に変化
した場合（ピッチコントロールの操作によって生ずる）
のＰＬＬのロックはずれを防止し、もってクリックノイ
ズの発生や音のとぎれを防止することができるものであ
り、ディジタルオーディオディスク再生装置の品位を向
上させる実用上の効果の大なるものである。
第１図は従来のディジタルオーディオディスク再生装置
のブロック図、第２図はそのビットクロック再生回路の
構成図、第３図は本発明のディジタルオーディオディス
ク再生装置の一実施例を示すブロック図である。 ５……ビットクロック再生回路、６……復調回路、７…
…デインタリーブ回路、８……誤り訂正回路、１１……
固定周波数発振器、１２……可変周波数発振器、１５…
…サーボ回路、１８……エッジ検出回路、１９……位相
比較器。
のブロック図、第２図はそのビットクロック再生回路の
構成図、第３図は本発明のディジタルオーディオディス
ク再生装置の一実施例を示すブロック図である。 ５……ビットクロック再生回路、６……復調回路、７…
…デインタリーブ回路、８……誤り訂正回路、１１……
固定周波数発振器、１２……可変周波数発振器、１５…
…サーボ回路、１８……エッジ検出回路、１９……位相
比較器。
Claims (1)
- 【請求項１】周波数可変の発振器と、該発振器の周波数
の変化に追従して回転速度が変化するターンテーブル
と、上記発振器の周波数の変化に追従して中心周波数が
変化するビットクロック再生回路を有し、上記ビットク
ロック再生回路の中心周波数の変化の時定数を、上記タ
ーンテーブルの回転速度の変化の時定数と略同等にした
ことを特徴とするディジタルオーディオディスク再生装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2754784A JPH0634308B2 (ja) | 1984-02-16 | 1984-02-16 | デイジタルオ−デイオデイスク再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2754784A JPH0634308B2 (ja) | 1984-02-16 | 1984-02-16 | デイジタルオ−デイオデイスク再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60171680A JPS60171680A (ja) | 1985-09-05 |
| JPH0634308B2 true JPH0634308B2 (ja) | 1994-05-02 |
Family
ID=12224098
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2754784A Expired - Lifetime JPH0634308B2 (ja) | 1984-02-16 | 1984-02-16 | デイジタルオ−デイオデイスク再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0634308B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0619911B2 (ja) * | 1985-03-06 | 1994-03-16 | ヤマハ株式会社 | Ｃｄプレ−ヤのピツチコントロ−ル回路 |
| JPS62257676A (ja) * | 1986-04-30 | 1987-11-10 | Pioneer Electronic Corp | コンパクトデイスクプレ−ヤ |
| US5661425A (en) * | 1994-06-20 | 1997-08-26 | Sharp Kabushiki Kaisha | Digital PLL circuit |
-
1984
- 1984-02-16 JP JP2754784A patent/JPH0634308B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60171680A (ja) | 1985-09-05 |
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