JPH06267201A - シリアル・デジタル・ビデオ・データのエラー検出装置 - Google Patents
シリアル・デジタル・ビデオ・データのエラー検出装置Info
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- Compression Or Coding Systems Of Tv Signals (AREA)
Abstract
ログ変換された後、ハイパス・フィルタ30で広域ろ波
される。第1フィルタ手段30からの出力は2乗回路3
2で符号が整えられ、比較器34でスレッシホールド値
と比較される。2乗回路32からの信号がスレッシホー
ルド値を越えたときエラー信号が出力される。 【効果】 本発明によりデータ・コーディングせずに動
作中のシリアル・デジタル・ビデオ用のエラーを検出す
る装置を提供することができる。
Description
データのエラー検出装置に関し、特に特別なデータ・コ
ーディングをせずに動作中のシリアル・デジタル・ビデ
オ・データのエラーを検出する。
に、コンポジット又はコンポーネント・デジタル・ビデ
オ・データを伝送するデジタル・シリアル規格は熟慮す
べき問題である。提案されたデジタル・シリアル規格
は、シリアル・データ流の直流成分を低下させ、クロッ
ク再生を容易にするスクランブラ/デスクランブラを用
いる。シリアル・デジタル・データ伝送リンクの動作測
定はスレッシホールド・ヘッドルームを決める必要があ
る。ビット・エラー・レイト(BER)は、特にリンク
が非偶発的、すなわちデータに依存する時、リンク特性
の工業規格測定である。しかしBERテスターは、テス
トデータがリンクに負荷をかける原因になるので、たい
ていは非動作中に用いられる。
9574号に、受信装置がフィールド内に1ビット以上
のエラーが生じたかどうかを判断できるように送信装置
で巡回冗長コード(CRC)をフィールド毎に挿入する
ことを必要とするデジタル・テレビジョン装置の誤り検
出装置が開示されている。これにより平均して約5エラ
ー/フィールドまでのBERの判断ができ、全ての送信
装置及び受信装置がエンコーディング及びデコーディン
グ・ハードウエアを持つことが必要となる。本発明の目
的は、データ・コーディングせずに動作中のシリアル・
デジタル・ビデオ・データのエラーを検出する装置を提
供することである
アル・デジタル・ビデオ・データのナイキスト領域をろ
波して、ビデオ・スペクトラムからビット・エラーによ
って生じたインパルス・スペクトラムを分離して、その
スペクトラム特性よりビットエラーの発生を検出するシ
リアル・デジタル・ビデオのエラー検出又は隠蔽のため
の装置を提供する。シリアル・デジタル・ビデオはデジ
タル・デモジュレータに入力し、アナログに変換され、
広域ろ波される。ろ波されたアナログ信号は2乗され、
エラーを検出するためにスレッシホールドと比較され
る。エラーは計数されても、適当な方法で表示されても
よい。エラーの隠蔽は、エラーが生じた点の受信したデ
ジタル値をデジタル・ビデオの平均デジタル値に置換す
るように入力及び出力間のデジタル・ビデオ経路内にメ
ジアン・フィルタをスイッチで挿入してもよい。さら
に、エラーの発生は、ビデオ・イメージにおいて、場所
の視覚的表示をメモリ内に与え、エラーの生じたシリア
ル・ビデオによって位置づけられてもよい。
は、データの直流成分を抑え、クロック再生を容易にす
るスクランブラ/デスクランブラを用いる。シリアル・
デジタル・ビデオ・データはデスクランブルされ、プロ
トコルデータが取り除かれ、パラレル・ビデオ・データ
に変換される。パラレル・ビデオ・データはデジタル・
アナログ・コンバータ(DAC)に加えられ、ビデオ出
力を生成するためにローパス・フィルタでろ波される。
シリアル・デジタル・伝送リンク内において伝搬するシ
ングル・ビット・エラーの70%の信号は、30%以上
の10ビット・データ内に振幅誤差を生じる。実際、全
てのシングル・ビット・エラーの90%は、検出された
ビデオにおいて15%以上の振幅エラーを生じる。ビッ
ト・エラーは、本質的にランダム極性のデータ・インパ
ルス及び10ビット・ビデオ・パラレルデータである。
データ・インパルスは帯域制限されず、ナイキスト周波
数を通過するエネルギを持ち、サンプリング周波数fs
の半分である。これがビデオ経路内の再生フィルタで循
環してビデオ画像におけるエラーの可視度をさらに増加
する。もう一方のビデオデータはアンチ・エイリアシン
グ・フィルタにより殆どいつも帯域制限され自然なビデ
オ信号にされる。図1に示されるように、ビット・エラ
ーは、デジタル・アナログ・変換器によりアナログ信号
に変換されたとき、パラレル・デジタル・ビデオ・デー
タポイントにステップ状の急激な振幅変化を生じる。こ
れが、アナログ信号に付加される1サンプル期間の矩形
状のパルスを生じる。
以下に帯域制限される。ナイキスト周波数付近で周波数
対振幅応答特性の急激な低下が始まる。一方インパルス
はナイキスト周波数の近傍で一定の周波数スペクトラム
を持つ。故に、デジタル・ビデオの周波数スペクトラム
のナイキスト領域をハイパス・フィルターでろ波するこ
とによりインパルス・スペクトラムがビデオ・スペクト
ラムから取り除かれる。ろ波されたインパルスが与えら
れたスレッシホールドを越えるとき、信号のビデオ成分
からインパルスが識別され、その時生じたエラーが検出
される。
ある。パラレル・デジタル・ビデオ・データは、パラレ
ル・クロック信号と共にエラー検出装置10に入力す
る。パラレル・デジタル・ビデオ・データは最初の伝送
でデジタル・デモジュレータ及びそのローパス・フィル
タ出力により直流からのナイキスト帯域にろ波される。
デジタル・デモジュレータ20は、2コンプリメント2
2、1/2分周器24及び選択スイッチ26を有する。
パラレル・デジタル・ビデオ・データは、2コンプリメ
ント及び選択スイッチ26の一方の入力に入力する。2
コンプリメント22からの出力は、選択スイッチ26の
他方の入力に入力する。選択スイッチ26は、1/2分
周器24の出力で制御され、1/2分周器は入力として
パラレル・クロックが入力される。パラレルクロックの
交互のサイクルでスイッチ26は直接、又は2コンプリ
メントされたパラレル・デジタル・ビデオ・データを出
力する。
ログ変換器28に加えられ、アナログビデオ信号が生成
される。アナログ・ビデオ信号はアナログ・ハイパス・
フィルタ30でろ波され、望ましい広域通過レスポンス
をもたらしている。代わりに、デジタル・ビデオ・デー
タがアナログ・データに変換される前にデジタル的にろ
波してもよい。本実施例ではアナログ・ハイパス・フィ
ルタ30を用いる。フィルタ30の出力は、2乗回路と
して形成され、負のエラーを正のエラーに変換して検出
を容易にするマルチプライヤ32に入力する。マルチプ
ライヤ32からの2乗された出力は、コンパレータ34
に入力する。コンパレータの入力には、可変スレッシホ
ールド・レベルも入力される。もし、マルチプライヤ3
2からの2乗された出力が、可変スレッシホールド・レ
ベルを越えれば、エラーが検出される。エラーはフィー
ルド毎に生じているエラーの数を計数するカウンタ36
に入力されてもよく、また以下に記載されるようにエラ
ーの位置を示すために用いられてもよい。
交互にデジタル・データを簡単に反転する適当なデジタ
ル・デモジュレータ20が用いられてもよい。デモジュ
レータ20は、半分のサンプルス周波数fsによりデジ
タル・データを掛け算し、ナイキスト領域をDC付近の
帯域に変換する。コンパレータ34のスレッシホールド
は、エラー検出の望まれる最少振幅を検出するレベル、
又は最も目だち不快な画素エラーだけを検出する高い値
に設定してもよく、エラーが検出されたときは小さい振
幅のパラレル・ビデオ・データに変換され、それにより
上記ビットエラーの画素エラーを無視している。
れていたシリアル・ビデオ・データはパラレル・デジタ
ル・ビデオ・データに変換され、遅延回路40を通して
デジタル・アナログ変換器(DAC)42に入力する。
DAC42の出力はローパス・フィルタ44に入力し、
ビデオ・出力信号を生じる。遅延回路40の出力は、多
数のデータ・サンプルを管理するメジアン・フィルタの
ようなデータ・フィルタ46に入力する。遅延回路40
からのろ波されていない出力、及びデータ・フィルタ4
6からのろ波されたデータは、2入力スイッチ48に入
力する。2入力スイッチ48からの出力は、DAC42
に入力し、図2のエラー検出器からのエラー信号により
決定される。デジタル・ビデオ・データ信号にエラー・
データが検出されたとき、データ・フィルタ46の出力
がDAC42に入力するので、エラー検出器の固有処理
時間を遅延回路40が補償する。第2遅延フィルタ49
は2入力スイッチ48への経路内に含まれ、エラー信号
が検出され、2入力スイッチがデータ・フィルタ46を
選択したときに、スイッチ48のDAC42へ出力する
信号に切れ目が生じないようにデータ・フィルタ46の
処理時間を補償する。
使用法は図4に示されるようにエラーの位置をデジタル
・ビデオ信号上に位置づける。エラー信号が生じたとき
ビデオ・メモリ50は、パラレル・クロックによりクロ
ック動作させられ、垂直・水平検出回路52によりアド
レス指定され、フラグ・ビットをストアする。メモリ5
0からのフラグ・ビットは、エクスクルーシブ・オア回
路54に共に入力するパラレル・ビデオ・データのフラ
グ・バイトの位置を示すのに用いられる。エクスクルー
シブ・オア回路54の出力はDAC42に入力し、ロー
パス・フィルタ44によってろ波され、ビデオ出力信号
を生成する。ビデオ出力信号が画像表示器に表示された
とき、生じたエラー信号の画像画素値の代わりにフラグ
又はマーカー値を有する。これがエラーの生じた場所を
視覚的に決定する能力を与え、相関するエラーはランダ
ムに生じているビデオ・イメージ・データに関連があ
る。
に生じたときに、シリアル・デジタル・ビデオ・データ
から出力されるパラレル・ビデオ・データのスペクトラ
ム解析を行うことによってエラーを示すインパルスを検
出し、特殊なハードウエアを必要とせずにフラグを立て
るシリアル・デジタル・ビデオのエラー検出装置を提供
する。
ずに動作中のシリアル・デジタル・ビデオ用のエラーを
検出する装置を提供することができる。
ラー検出装置のブロック図である。
ラーを示す図である。
のブロック図である。
装置のブロック図である。
Claims (1)
- 【請求項1】 シリアル・デジタル・ビデオ・データか
ら変換されたパラレル・デジタル・ビデオ・データをろ
波して高域通過信号を出力する第1フィルタ手段と、 上記高域通過信号を2乗する2乗回路と、 上記2乗回路からの信号及びスレッシホールド値を比較
して、上記2乗回路からの信号が上記スレッシホールド
値を越えたときにエラー信号を出力する比較手段を具え
たことを特徴とするシリアル・デジタル・ビデオ・デー
タのエラー検出装置。
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