JPH06202889A - 多重入出力回路系の故障検出装置 - Google Patents
多重入出力回路系の故障検出装置Info
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- JPH06202889A JPH06202889A JP5017105A JP1710593A JPH06202889A JP H06202889 A JPH06202889 A JP H06202889A JP 5017105 A JP5017105 A JP 5017105A JP 1710593 A JP1710593 A JP 1710593A JP H06202889 A JPH06202889 A JP H06202889A
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Abstract
加することにより、多重選択信号の出力状態を正確に把
握できるようにする。 【構成】 多くの入力信号を複数のブロックにグループ
化し、入力信号点数を１／グループ数に縮小して信号を
読み取る、所謂マルチプレックス入力回路において、故
障検出回路１０は演算器２の出力指示に係わりなく、出
力インターフェイス４が多重入力回路５に選択信号０1,
０2 …０ｎを送出している情報Ｍ1,Ｍ2 …Ｍｎを読み取
り、選択信号のうち何れか１つの出力が実行されている
時のみ正常な入力信号と判定して、その結果ＡN をイン
ターフェイス６に対して送出するようにした。
Description
成形機の電気制御装置に適用される制御回路の故障検出
装置に関するものである。
出力処理装置では、選択指令信号によって複数の選択ス
イッチの何れか１つを択一的に作動させる回路を構成し
ている。このような選択回路においては、同信号入力を
防止するために同時多重出力装置の指令信号が選択であ
るのか、或いは非選択であるのかの正確な検出が必須の
ものとなっている。従来の多重選択検出方法として、例
えば特開平２−１８０４９５号公報のものがある。この
例では選択信号が出力されていないにも拘わらず選択信
号が生成された場合や、選択信号が１つしか出力されて
いないのに多重の選択信号が生成された場合を対象とし
て故障を検出していた。
法では、正常に１つの選択指令信号の出力行為を実行し
たにも拘わらず、出力回路の異常により選択出力が実行
されなかった故障については検出できなかった。従って
このような場合でも多重選択出力回路系の異常を確実に
検出する必要があった。本発明では、入力信号を読み取
るために出力した入力選択出力信号が正しく１つの選択
出力信号が出力されている場合に限り「正常」の判定結
果を出力する監視回路を設け、多重入出力回路系の信頼
性を高めるための故障検出回路を提供することである。
本発明による故障検出回路はもともと少ない入力回路点
数で出力回路点数が倍となる入力点数の機能拡大をもた
らし、安価な制御装置に使用することが可能となってお
り、本回路が判定した結果の、即ち出力点数が１点であ
るという１つの信号を見て入力信号を正確に処理できる
と共に、異常時の処理への分岐も可能である。
の入力信号を複数のブロックにグループ化し、入力信号
点数を１／グループ数に縮小して信号を読み取る、所謂
マルチプレックス入力回路において、出力は多重選択信
号であり、同多重選択信号のうち何れか１つの出力が実
行されている時のみ正常な入力信号として読み取ること
ができるよう異常検出回路を設けてなるもので、これを
課題解決のための手段とするものである。
重出力選択信号のすべてを常時監視していて逐次その判
定結果を出力し、制御装置において入力信号グループの
うちの１つを読み取るために必ず多重出力のうちの１点
を指定し、出力行為を行なった後、入力信号が確定する
までの時間を待って入力信号を読み取る。この時同時に
故障検出回路が発生する故障情報も読み取り、「正常」
であれば読み取った入力信号は所要の目的に使用し、
「異常」であれば読み取った入力信号では制御を継続せ
ず「異常」時の処理を行なわせる。
と、図面は本発明の実施例を示し、図１は多重選択出力
回路で多重入力回路を構成した例を示す。図において制
御装置１の演算器２は予め設定されたプログラムの情報
をメモリ３より読み出し、所要の動作を実行する。今外
部信号を読み取るため、演算器２は出力インターフェイ
ス４に対し多重出力のうちの１点を動作させる。この信
号は多重入力回路５に伝達され、複数の入力信号をブロ
ック毎にグループ化し、このグループの中から１グルー
プを選択し、入力インターフェイス６に送出する。演算
器２は入力信号グループの情報が確定するまでの予め決
められた時間待機した後、入力インターフェイス６から
確定した入力信号を読み取り、メモリ３に一時記憶して
おくと共に所要の目的に使用する。図２は図１の多重入
力回路部の詳細図であり、多重出力選択回路にｎ点、多
重入力回路５にＮ点の回路を設けたもので、制御装置１
は入力信号点数をｎ×Ｎ個と拡張して使用することが出
来ることを示している。図３は図１の制御装置１に本発
明の実施例を示す故障検出回路１０を付加した多重入出
力回路系の故障検出装置の実施例である。故障検出回路
１０は演算器２の出力指示に無関係に出力インターフェ
イス４が多重入力回路５に選択信号０1,０2 …０ｎを送
出している情報Ｍ1,Ｍ2 …Ｍｎを読み取り、判定し、そ
の結果を入力インターフェイス６に対し送出する。
みで実施した例である。多重出力選択のモニタ端子情報
Ｍ1,Ｍ2,Ｍ3 …Ｍｎは、制御装置１の出力インターフェ
イス４の出力側が「動作」の時信号電圧がＯＶとなり、
ＥN1i(ｉ＝１〜ｎ）の電圧がＯＶ側となり、次段の比較
演算器１１への加算信号にならない。同様にＥN2i(ｉ＝
１〜ｎ）の電圧もＯＶ側となり、次段の比較演算器１２
への加算信号にならない。比較演算器１１に対しては比
較基準値２１が設けられており、この値は次の(1) 式で
求められる。
較基準値設定器２２が設けられており、この値は次の
(2)式で求められる。
出回路１０への動作信号点数と故障検出回路の判定結果
は表１の通りである。
出回路をハードとソフトの組合せで実施した例である。
演算器３０は予めプログラムとして設定されたメモリ３
１の手順に従い、入力インターフェイス３２からＭ1,Ｍ
2,Ｍ3 …Ｍｎの多重出力選択の端子情報を読み取り、動
作（ＯＮ）している点数を集計する。動作点数が１以外
であれば異常と判断して出力インターフェイス３３に非
動作（ＯＦＦ）を出力し、動作点数が１であれば出力イ
ンターフェイス３３に動作（ＯＮ）を出力する。このよ
うに故障検出回路１０がハードのみから構成された場合
でも、マイコン等のプログラムにより構成された場合で
も、図３に示すように演算器２は入力インターフェイス
６を介し、故障検出回路１０の出力ＡN の情報を容易に
読み取り、正常動作又は異常動作処理を行なうことがで
きる。
と、図３、図４で示すように簡単な故障検出回路を付加
するのみで動作してはならない信号を読み取って誤動作
させたり、動作させる必要があるのに信号を読み取れず
に作動しないといった状況をなくすことができる。しか
もマルチプレクサの機能を損ねることなく、出力ポート
の機能が正常か異常であるかを、１つの入力信号をチェ
ックするのみで入力情報の正確な把握ができ、直ちに必
要な対応をとれるなど安価で確実に多重選択出力回路系
の異常を検出できる。
した例を示すブロック図である。
検出装置のブロック図である。
構成例を示す回路図である。
ソフトの組合せの構成例を示すブロック図である。
ソフトの組合せの構成例を示すブロック図である。
Claims (1)
- 【請求項１】 多くの入力信号を複数のブロックにグル
ープ化し、入力信号点数を１／グループ数に縮小して信
号を読み取る、所謂マルチプレックス入力回路におい
て、出力は多重選択信号であり、同多重選択信号のうち
何れか１つの出力が実行されている時のみ正常な入力信
号として読み取ることができるよう異常検出回路を設け
たことを特徴とする多重入出力回路系の故障検出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP01710593A JP3202382B2 (ja) | 1993-01-07 | 1993-01-07 | 多重入出力処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP01710593A JP3202382B2 (ja) | 1993-01-07 | 1993-01-07 | 多重入出力処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06202889A true JPH06202889A (ja) | 1994-07-22 |
| JP3202382B2 JP3202382B2 (ja) | 2001-08-27 |
Family
ID=11934752
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP01710593A Expired - Fee Related JP3202382B2 (ja) | 1993-01-07 | 1993-01-07 | 多重入出力処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3202382B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6776100B2 (en) | 2001-12-21 | 2004-08-17 | Thomas V. Cutcher | Method and apparatus for transferring an image to a substrate |
| JP4684917B2 (ja) | 2006-02-28 | 2011-05-18 | 富士通テン株式会社 | 電子制御装置 |
-
1993
- 1993-01-07 JP JP01710593A patent/JP3202382B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP3202382B2 (ja) | 2001-08-27 |
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