JPH06165507A - 整流回路 - Google Patents
整流回路Info
- Publication number
- JPH06165507A JPH06165507A JP4137866A JP13786692A JPH06165507A JP H06165507 A JPH06165507 A JP H06165507A JP 4137866 A JP4137866 A JP 4137866A JP 13786692 A JP13786692 A JP 13786692A JP H06165507 A JPH06165507 A JP H06165507A
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- JP
- Japan
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- transistor
- stage
- signal source
- output
- transistors
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Abstract
(57)【要約】
【目的】 部品点数を減らして構成を簡単にし、低コス
トにすること。 【構成】 この整流回路は、交流信号源（ＯＳＣ）と直
流基準電源（Ｖref ）の接続点と交流信号源の残りの端
子を、カレントミラー段に接続された差動入力段を構成
する各制御トランジスタ（Ｑ１３，Ｑ１６）の入力端に
それぞれ接続し、さらにこれらの制御トランジスタの出
力側に抵抗（Ｒ２）を架け渡して差動増幅段を構成する
制御トランジスタのひとつ（Ｑ１６）の出力側から整流
された出力を得るようにする。
トにすること。 【構成】 この整流回路は、交流信号源（ＯＳＣ）と直
流基準電源（Ｖref ）の接続点と交流信号源の残りの端
子を、カレントミラー段に接続された差動入力段を構成
する各制御トランジスタ（Ｑ１３，Ｑ１６）の入力端に
それぞれ接続し、さらにこれらの制御トランジスタの出
力側に抵抗（Ｒ２）を架け渡して差動増幅段を構成する
制御トランジスタのひとつ（Ｑ１６）の出力側から整流
された出力を得るようにする。
Description
【０００１】
【産業上の利用分野】本発明は、整流回路に関する。
【０００２】
【従来の技術】従来、一般に用いられている整流回路
は、たとえば図４のような構成である。図４において、
Ｖｒｅｆ は直流基準電源、ＯＳＣはピーク電圧Ｖ１の
交流信号源、Ｑ１ないしＱ６はトランジスタ、Ｄ１はダ
イオード、ＡＰ１は増幅器、Ｒ１は抵抗、ＩＳ１，ＩＳ
２は電流源、ＡＭは電流計である。
は、たとえば図４のような構成である。図４において、
Ｖｒｅｆ は直流基準電源、ＯＳＣはピーク電圧Ｖ１の
交流信号源、Ｑ１ないしＱ６はトランジスタ、Ｄ１はダ
イオード、ＡＰ１は増幅器、Ｒ１は抵抗、ＩＳ１，ＩＳ
２は電流源、ＡＭは電流計である。
【０００３】このような構成において、増幅器ＡＰ１
は、トランジスタＱ１，Ｑ３のエミッタ電位を基準電圧
Ｖｒｅｆ に設定する機能を有する。基準電圧Ｖｒｅｆ
上で変化するピーク電圧Ｖ１の交流信号は、Ｒ１によ
り電流に変化されてトランジスタＱ１またはＱ３の出力
電流の変化として後段に伝えられ、トランジスタＱ５の
コレクタ電流として図に示されるようにピーク電流がＶ
１／Ｒの全波整流波形として取り出されるようになって
いる。
は、トランジスタＱ１，Ｑ３のエミッタ電位を基準電圧
Ｖｒｅｆ に設定する機能を有する。基準電圧Ｖｒｅｆ
上で変化するピーク電圧Ｖ１の交流信号は、Ｒ１によ
り電流に変化されてトランジスタＱ１またはＱ３の出力
電流の変化として後段に伝えられ、トランジスタＱ５の
コレクタ電流として図に示されるようにピーク電流がＶ
１／Ｒの全波整流波形として取り出されるようになって
いる。
【０００４】
【発明が解決しようとする課題】しかしながら、このよ
うな構成では、整流器の入力インピーダンスはＲ１とな
り、出力インピーダンスの高い信号源では、電圧の低下
を招く可能性がある。また、トランジスタＱ１，Ｑ３の
エミッタ電圧を一定に保つ増幅器ＡＰ１が必要になり、
部品点数が多く、コストもこれ以上低減できない構造と
なっている。
うな構成では、整流器の入力インピーダンスはＲ１とな
り、出力インピーダンスの高い信号源では、電圧の低下
を招く可能性がある。また、トランジスタＱ１，Ｑ３の
エミッタ電圧を一定に保つ増幅器ＡＰ１が必要になり、
部品点数が多く、コストもこれ以上低減できない構造と
なっている。
【０００５】
【課題を解決するための手段】このような問題を解決す
るために、本発明では、交流信号源と直流基準電源の接
続点と交流信号源の残りの端子を、カレントミラー段に
接続された差動入力段を構成する各制御トランジスタの
入力端にそれぞれ接続し、さらにこれらの制御トランジ
スタのエミッタ間に抵抗を架け渡して差動増幅段を構成
する制御トランジスタのひとつの出力側から整流された
出力を得るようにしたことを特徴とする整流回路が提供
される。
るために、本発明では、交流信号源と直流基準電源の接
続点と交流信号源の残りの端子を、カレントミラー段に
接続された差動入力段を構成する各制御トランジスタの
入力端にそれぞれ接続し、さらにこれらの制御トランジ
スタのエミッタ間に抵抗を架け渡して差動増幅段を構成
する制御トランジスタのひとつの出力側から整流された
出力を得るようにしたことを特徴とする整流回路が提供
される。
【０００６】
【作用】このようにすれば、従来のように増幅器を使用
することがなくなり、部品点数を減少して、従来よりも
低コストにすることができる。
することがなくなり、部品点数を減少して、従来よりも
低コストにすることができる。
【０００７】
【実施例】図１は、本発明による整流回路の一実施例を
示し、同図において、図４と同じものあるいは同じ機能
を有するものは、同符号を用いて示してある。
示し、同図において、図４と同じものあるいは同じ機能
を有するものは、同符号を用いて示してある。
【０００８】同図において、Ｑ１１ないしＱ１９はトラ
ンジスタ、ＩＳ３は電流源である。そして、トランジス
タＱ１１，Ｑ１４，Ｑ１７は、カレントミラー段を構成
し、トランジスタＱ１３，Ｑ１６は、差動入力段を構成
し、トランジスタＱ１２，Ｑ１５は、負荷段を構成し、
トランジスタＱ１８，Ｑ１９は、出力段をそれぞれを構
成している。この場合、負荷段を構成するトランジスタ
Ｑ１２のベース、コレクタとトランジスタＱ１５のベー
スとは共通接続されるとともに、トランジスタＱ１３の
コレクタとも接続されている。また、カレントミラー段
のトランジスタＱ１４とＱ１７のベースは、共通に接続
され、電流源ＩＳ３およびトランジスタＱ１１のベー
ス、コレクタに接続されている。このような構成におい
て、図４と基本的に異なる点は、交流信号源ＯＳＣと直
流電源Ｖｒｅｆ との接続点Ｐ１を差動入力段を構成す
る制御トランジスタＱ１３のベースに接続し、交流信号
源ＯＳＣの他端Ｐ２を差動入力段を構成する制御トラン
ジスタＱ１６のベースに接続するとともに、制御トラン
ジスタＱ１６の出力側（コレクタ側）から出力段を構成
する出力電流制御トランジスタ対Ｑ１８，Ｑ１９の共通
入力端に制御信号を供給するようにし、さらに差動入力
段を構成する両制御トランジスタＱ１３，Ｑ１６のエミ
ッタ側、すなわち、トランジスタＱ１３のエミッタとト
ランジスタＱ１４のコレクタとの接続点と、トランジス
タＱ１６のエミッタとトランジスタＱ１７のコレクタと
の接続点との間に、抵抗Ｒ２を架け渡すように構成した
ことにある。
ンジスタ、ＩＳ３は電流源である。そして、トランジス
タＱ１１，Ｑ１４，Ｑ１７は、カレントミラー段を構成
し、トランジスタＱ１３，Ｑ１６は、差動入力段を構成
し、トランジスタＱ１２，Ｑ１５は、負荷段を構成し、
トランジスタＱ１８，Ｑ１９は、出力段をそれぞれを構
成している。この場合、負荷段を構成するトランジスタ
Ｑ１２のベース、コレクタとトランジスタＱ１５のベー
スとは共通接続されるとともに、トランジスタＱ１３の
コレクタとも接続されている。また、カレントミラー段
のトランジスタＱ１４とＱ１７のベースは、共通に接続
され、電流源ＩＳ３およびトランジスタＱ１１のベー
ス、コレクタに接続されている。このような構成におい
て、図４と基本的に異なる点は、交流信号源ＯＳＣと直
流電源Ｖｒｅｆ との接続点Ｐ１を差動入力段を構成す
る制御トランジスタＱ１３のベースに接続し、交流信号
源ＯＳＣの他端Ｐ２を差動入力段を構成する制御トラン
ジスタＱ１６のベースに接続するとともに、制御トラン
ジスタＱ１６の出力側（コレクタ側）から出力段を構成
する出力電流制御トランジスタ対Ｑ１８，Ｑ１９の共通
入力端に制御信号を供給するようにし、さらに差動入力
段を構成する両制御トランジスタＱ１３，Ｑ１６のエミ
ッタ側、すなわち、トランジスタＱ１３のエミッタとト
ランジスタＱ１４のコレクタとの接続点と、トランジス
タＱ１６のエミッタとトランジスタＱ１７のコレクタと
の接続点との間に、抵抗Ｒ２を架け渡すように構成した
ことにある。
【０００９】このように構成すれば、整流回路入力部そ
のものは、高インピーダンス素子として作用し、交流信
号源ＯＳＣから図に示されるようなピーク値Ｖ１の交流
信号が差動入力段に供給されると、差動入力段を構成す
る制御トランジスタＱ１３，Ｑ１６のエミッタ側に架け
渡された抵抗Ｒ２を流れる電流をＶ１／Ｒ２とすること
ができ、トランジスタＱ１９の出力側に、図示されるよ
うなピーク値が（Ｖ１／Ｒ２）＊２の半波整流出力波形
を得ることができる。
のものは、高インピーダンス素子として作用し、交流信
号源ＯＳＣから図に示されるようなピーク値Ｖ１の交流
信号が差動入力段に供給されると、差動入力段を構成す
る制御トランジスタＱ１３，Ｑ１６のエミッタ側に架け
渡された抵抗Ｒ２を流れる電流をＶ１／Ｒ２とすること
ができ、トランジスタＱ１９の出力側に、図示されるよ
うなピーク値が（Ｖ１／Ｒ２）＊２の半波整流出力波形
を得ることができる。
【００１０】したがって、このような構成にすれば、出
力は、半波整流であるが回路構成は、従来よりも部品点
数も少なく簡単であり、低コストの整流回路とすること
ができる。また、このような簡単な回路構成でも入力イ
ンピーダンスを高くすることができるため、出力インピ
ーダンスの多少高い信号源でも精度よく整流することが
できる等の効果を奏する。
力は、半波整流であるが回路構成は、従来よりも部品点
数も少なく簡単であり、低コストの整流回路とすること
ができる。また、このような簡単な回路構成でも入力イ
ンピーダンスを高くすることができるため、出力インピ
ーダンスの多少高い信号源でも精度よく整流することが
できる等の効果を奏する。
【００１１】図２は、本発明の他の実施例を示してい
る。同図において、図２と異なる点は、差動入力段を構
成するトランジスタＱ１３の入力側にトランジスタＱ２
１を配置してダーリントン構造にしたものである。この
ようにすれば、差動入力段の入力インピーダンスをさら
に高めることができる。
る。同図において、図２と異なる点は、差動入力段を構
成するトランジスタＱ１３の入力側にトランジスタＱ２
１を配置してダーリントン構造にしたものである。この
ようにすれば、差動入力段の入力インピーダンスをさら
に高めることができる。
【００１２】図３は、本発明のさらに他の実施例を示
し、差動入力段の両制御トランジスタＱ１３，Ｑ１６の
入力側に増幅器ＡＰ２，ＡＰ３を追加したものである。
このようにしてもカレントミラー構造の入力インピーダ
ンスをさらに高めることができる。
し、差動入力段の両制御トランジスタＱ１３，Ｑ１６の
入力側に増幅器ＡＰ２，ＡＰ３を追加したものである。
このようにしてもカレントミラー構造の入力インピーダ
ンスをさらに高めることができる。
【００１３】また、上述した実施例では、ＮＰＮ入力段
のものを示したが、ＮＰＮトランジスタとＰＮＰトラン
ジスタを入れ換えてＰＮＰ入力段の回路を用いても同様
の動作をさせることができる。ＮＰＮ入力は、Ｖｒｅｆ
が高めのとき有効であり、ＰＮＰ入力は、Ｖｒｅｆ
が低めのとき有効である。
のものを示したが、ＮＰＮトランジスタとＰＮＰトラン
ジスタを入れ換えてＰＮＰ入力段の回路を用いても同様
の動作をさせることができる。ＮＰＮ入力は、Ｖｒｅｆ
が高めのとき有効であり、ＰＮＰ入力は、Ｖｒｅｆ
が低めのとき有効である。
【００１４】
【発明の効果】以上述べたように、本発明による整流回
路を用いれば、回路構成を従来よりも簡単にすることが
でき、部品点数も少なく、低コストにすることができ
る。また、入力インピーダンスを高く取ることができ
る、出力インピーダンスが少々高い信号源でも精度よく
整流できることになる。
路を用いれば、回路構成を従来よりも簡単にすることが
でき、部品点数も少なく、低コストにすることができ
る。また、入力インピーダンスを高く取ることができ
る、出力インピーダンスが少々高い信号源でも精度よく
整流できることになる。
【００１５】
【図１】本発明による整流回路の一実施例を示す回路図
である。
である。
【図２】本発明の整流回路の他の実施例を示す回路図で
ある。
ある。
【図３】本発明の整流回路の他の実施例を示す回路図で
ある。
ある。
【図４】従来の整流回路の一例を示す回路図である。
Ｑ１〜Ｑ６、Ｑ１１〜Ｑ１９、Ｑ２１ トランジスタ Ｒ１，Ｒ２ 抵抗 Ｄ１ ダイオード ＯＳＣ 交流信号源 Ｖｒｅｆ 直流基準電源 ＩＳ１〜ＩＳ３ 電流源 ＡＰ１〜ＡＰ３ 増幅器 ＡＭ 電流計
Claims (1)
- 【請求項１】 交流信号源と直流基準電源の接続点と交
流信号源の残りの端子を、カレントミラー段に接続され
た差動入力段を構成する各トランジスタのベースにそれ
ぞれ接続し、さらにこれらのトランジスタのエミッタ側
に抵抗を架け渡して差動増幅段を構成するトランジスタ
のひとつの出力側から整流された出力を得るようにした
ことを特徴とする整流回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13786692A JP3221058B2 (ja) | 1992-04-30 | 1992-04-30 | 整流回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13786692A JP3221058B2 (ja) | 1992-04-30 | 1992-04-30 | 整流回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06165507A true JPH06165507A (ja) | 1994-06-10 |
| JP3221058B2 JP3221058B2 (ja) | 2001-10-22 |
Family
ID=15208568
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13786692A Expired - Lifetime JP3221058B2 (ja) | 1992-04-30 | 1992-04-30 | 整流回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3221058B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9525397B2 (en) | 2011-03-29 | 2016-12-20 | Avago Technologies General Ip (Singapore) Pte. Ltd. | Acoustic resonator comprising acoustic reflector, frame and collar |
-
1992
- 1992-04-30 JP JP13786692A patent/JP3221058B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9525397B2 (en) | 2011-03-29 | 2016-12-20 | Avago Technologies General Ip (Singapore) Pte. Ltd. | Acoustic resonator comprising acoustic reflector, frame and collar |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3221058B2 (ja) | 2001-10-22 |
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Legal Events
| Date | Code | Title | Description |
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