JPH0530523A - デイジタルクロマ信号のエンコーダ回路 - Google Patents
デイジタルクロマ信号のエンコーダ回路Info
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- JPH0530523A JPH0530523A JP3207123A JP20712391A JPH0530523A JP H0530523 A JPH0530523 A JP H0530523A JP 3207123 A JP3207123 A JP 3207123A JP 20712391 A JP20712391 A JP 20712391A JP H0530523 A JPH0530523 A JP H0530523A
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Abstract
(57)【要約】
【目的】 クロマ信号の品質を損わずに簡略化した構成
によって、高精度化したディジタルクロマ信号のエンコ
ーダ回路を提供する。 【構成】 色差信号時分割回路41により、１／２ＣＣＤ
駆動周波数により時分割した色差信号を、ディジタルＬ
ＰＦ44を経て周波数変換器45により周波数が４ｆSCのデ
ィジタル色差信号を形成して、ディジタル平衡変調器46
に印加し、ここで平衡変調制御信号生成器47からの制御
信号により、Ｒ−Ｙ，Ｂ−Ｙ，−(Ｒ−Ｙ)，−(Ｂ−Ｙ)
を順次、切換えてサブキャリア周波数のクロマ信号を
得、これをクリップ回路48で、バースト信号以外のブラ
ンキング期間を除去した後、Ｄ／Ａ変換器15によってア
ナログ信号にする。
によって、高精度化したディジタルクロマ信号のエンコ
ーダ回路を提供する。 【構成】 色差信号時分割回路41により、１／２ＣＣＤ
駆動周波数により時分割した色差信号を、ディジタルＬ
ＰＦ44を経て周波数変換器45により周波数が４ｆSCのデ
ィジタル色差信号を形成して、ディジタル平衡変調器46
に印加し、ここで平衡変調制御信号生成器47からの制御
信号により、Ｒ−Ｙ，Ｂ−Ｙ，−(Ｒ−Ｙ)，−(Ｂ−Ｙ)
を順次、切換えてサブキャリア周波数のクロマ信号を
得、これをクリップ回路48で、バースト信号以外のブラ
ンキング期間を除去した後、Ｄ／Ａ変換器15によってア
ナログ信号にする。
Description
【０００１】
【産業上の利用分野】本発明は、ビデオカメラ等におい
て使用するディジタルクロマ信号のエンコーダ回路に関
する。
て使用するディジタルクロマ信号のエンコーダ回路に関
する。
【０００２】
【従来の技術】図４は従来のアナログクロマ信号のエン
コーダ回路の構成を示している。
コーダ回路の構成を示している。
【０００３】図４において、11は例えばビデオカメラに
おける撮像部で、その撮像出力はＣＤＳ・ＡＧＣ・ガン
マ処理回路12によって必要な、ＣＤＳ・ＡＧＣ・ガンマ
補正等の処理が行なわれた後、Ａ／Ｄ変換器13により撮
像部11のクロック周波数ｆCKと同じサンプリング周波数
によってサンプリングされてディジタル信号に変換さ
れ、ディジタル シグナル プロセッサ(ＤＳＰ)14によっ
て輝度信号Ｙと、色差信号Ｒ−Ｙ，Ｂ−Ｙを生成し、そ
れをＤ／Ａ変換器15によってアナログ信号に変換する。
おける撮像部で、その撮像出力はＣＤＳ・ＡＧＣ・ガン
マ処理回路12によって必要な、ＣＤＳ・ＡＧＣ・ガンマ
補正等の処理が行なわれた後、Ａ／Ｄ変換器13により撮
像部11のクロック周波数ｆCKと同じサンプリング周波数
によってサンプリングされてディジタル信号に変換さ
れ、ディジタル シグナル プロセッサ(ＤＳＰ)14によっ
て輝度信号Ｙと、色差信号Ｒ−Ｙ，Ｂ−Ｙを生成し、そ
れをＤ／Ａ変換器15によってアナログ信号に変換する。
【０００４】そのアナログ信号化された輝度信号Ｙ以外
の色差信号Ｒ−Ｙ，Ｂ−Ｙはアナログエンコーダ16にお
いて、位相が互に90°異なる第１、第２のサブキャリア
ＳＣ１，ＳＣ２により変調され、バーストフラグパルス
(ＢＦＰ)から生成したバースト信号をミックスすること
により、クロマ信号Ｃが生成される。
の色差信号Ｒ−Ｙ，Ｂ−Ｙはアナログエンコーダ16にお
いて、位相が互に90°異なる第１、第２のサブキャリア
ＳＣ１，ＳＣ２により変調され、バーストフラグパルス
(ＢＦＰ)から生成したバースト信号をミックスすること
により、クロマ信号Ｃが生成される。
【０００５】図５は上述したアナログのクロマ信号に対
応するディジタルクロマ信号のエンコーダの回路構成
図、図６は、その各部の波形を示す図である。
応するディジタルクロマ信号のエンコーダの回路構成
図、図６は、その各部の波形を示す図である。
【０００６】図５において、例えばビデオカメラのＣＣ
Ｄ(電荷結合素子)を駆動するクロック周波数ｆCKの半
分、１／２ｆCKのディジタル色差信号Ｒ−Ｙ，Ｂ−Ｙ
は、クロック信号(Ｂ)で駆動されるラッチ回路(Ｌ)25に
よってラッチされる。前記のクロック信号(Ｂ)は、遅延
回路(ＤＬ)23によりｆCK／２を数nsの遅延時間τだけ遅
延させた信号(Ａ)をラッチ回路(Ｌ)24によってサブキャ
リアｆSCの４倍の周波数４ｆSCでラッチしたものであ
り、ラッチ回路(Ｌ)25の出力(Ｃ)はｆCK／２と４ｆSCの
位相差が重なり合うところはノイズが発生するので、そ
の位置は間引いてラッチしノイズの発生を防止してい
る。
Ｄ(電荷結合素子)を駆動するクロック周波数ｆCKの半
分、１／２ｆCKのディジタル色差信号Ｒ−Ｙ，Ｂ−Ｙ
は、クロック信号(Ｂ)で駆動されるラッチ回路(Ｌ)25に
よってラッチされる。前記のクロック信号(Ｂ)は、遅延
回路(ＤＬ)23によりｆCK／２を数nsの遅延時間τだけ遅
延させた信号(Ａ)をラッチ回路(Ｌ)24によってサブキャ
リアｆSCの４倍の周波数４ｆSCでラッチしたものであ
り、ラッチ回路(Ｌ)25の出力(Ｃ)はｆCK／２と４ｆSCの
位相差が重なり合うところはノイズが発生するので、そ
の位置は間引いてラッチしノイズの発生を防止してい
る。
【０００７】上記、出力(Ｃ)はミックス回路26によりバ
ーストフラグパルス(ＢＦＰ)をミックスした後、ラッチ
回路(Ｌ)27によってラッチされ、４ｆSCの周波数のＲ−
Ｙ，Ｂ−Ｙのディジタル色差信号(Ｄ)を得る。
ーストフラグパルス(ＢＦＰ)をミックスした後、ラッチ
回路(Ｌ)27によってラッチされ、４ｆSCの周波数のＲ−
Ｙ，Ｂ−Ｙのディジタル色差信号(Ｄ)を得る。
【０００８】これらは色差生成回路28Ａ，28Ｂで色差信
号−(Ｒ−Ｙ)，−(Ｂ−Ｙ)を生成した後、スイッチ回路
29により色差信号Ｒ−Ｙ，Ｂ−Ｙ，−(Ｒ−Ｙ)，−(Ｂ
−Ｙ)を制御信号(Ｅ),（Ｆ)に従って切換えることによ
り、平衡変調されたクロマ信号(Ｇ)を得る。ここで制御
信号(Ｅ)及び(Ｆ)は周波数４ｆSCを分周器30により１／
４に分周した信号と、それをラッチ回路(Ｌ)31により90
°位相シフトした信号である。
号−(Ｒ−Ｙ)，−(Ｂ−Ｙ)を生成した後、スイッチ回路
29により色差信号Ｒ−Ｙ，Ｂ−Ｙ，−(Ｒ−Ｙ)，−(Ｂ
−Ｙ)を制御信号(Ｅ),（Ｆ)に従って切換えることによ
り、平衡変調されたクロマ信号(Ｇ)を得る。ここで制御
信号(Ｅ)及び(Ｆ)は周波数４ｆSCを分周器30により１／
４に分周した信号と、それをラッチ回路(Ｌ)31により90
°位相シフトした信号である。
【０００９】クロマ信号(Ｇ)は、例えばＮＴＳＣ方式の
画像の場合は色差信号Ｒ−Ｙ，Ｂ−Ｙ，−(Ｒ−Ｙ)，−
(Ｂ−Ｙ)の繰返し信号であり、また、画像がＰＡＬ方式
の場合は色差信号Ｒ−Ｙと、−(Ｒ−Ｙ)が、１水平ライ
ンおきに逆になった信号である。
画像の場合は色差信号Ｒ−Ｙ，Ｂ−Ｙ，−(Ｒ−Ｙ)，−
(Ｂ−Ｙ)の繰返し信号であり、また、画像がＰＡＬ方式
の場合は色差信号Ｒ−Ｙと、−(Ｒ−Ｙ)が、１水平ライ
ンおきに逆になった信号である。
【００１０】
【発明が解決しようとする課題】しかしながら、上記図
４、図５のエンコーダ回路の構成では、次に示すような
問題点があった。すなわち、 (ａ)、図４のアナログエンコーダ回路の構成では、ＩＣ
化するとしても、周辺のコンデサ、フィルタ等が多く、
また直流再生のためにクランプ回路を必要とし、それに
伴って発生するオフセットなどにより精度が低下するの
で、その補正回路が必要で、しかも、ディジタル信号処
理に比べてＳ／Ｎが劣る。
４、図５のエンコーダ回路の構成では、次に示すような
問題点があった。すなわち、 (ａ)、図４のアナログエンコーダ回路の構成では、ＩＣ
化するとしても、周辺のコンデサ、フィルタ等が多く、
また直流再生のためにクランプ回路を必要とし、それに
伴って発生するオフセットなどにより精度が低下するの
で、その補正回路が必要で、しかも、ディジタル信号処
理に比べてＳ／Ｎが劣る。
【００１１】(ｂ)、図５のディジタルエンコーダ回路の
構成では、周波数をｆCKから４ｆCKに変換の際、両者の
位相を比較して重なりを間引いて、１個前のデータによ
り置き換えるから、図６に示すディジタル色差信号(Ｄ)
の斜線部分のようにフィールドによって間引いたり、間
引かなかったりする箇所が生じて、フィールド間、また
はフレーム間で画像面がぎらぎらする現象が起こる。
構成では、周波数をｆCKから４ｆCKに変換の際、両者の
位相を比較して重なりを間引いて、１個前のデータによ
り置き換えるから、図６に示すディジタル色差信号(Ｄ)
の斜線部分のようにフィールドによって間引いたり、間
引かなかったりする箇所が生じて、フィールド間、また
はフレーム間で画像面がぎらぎらする現象が起こる。
【００１２】この現象は、例えばＰＡＬ方式の場合はｆ
CKに対して４ｆSCはフィールドにより位相が異なるため
である。もちろんＮＴＳＣ方式の場合位相は常に一定で
はあるが、図５のラッチ回路(Ｌ)24，25の精度と４ｆSC
のジッタを考慮すると、やはり同じようにぎらぎら現象
は発生すると考えられる。
CKに対して４ｆSCはフィールドにより位相が異なるため
である。もちろんＮＴＳＣ方式の場合位相は常に一定で
はあるが、図５のラッチ回路(Ｌ)24，25の精度と４ｆSC
のジッタを考慮すると、やはり同じようにぎらぎら現象
は発生すると考えられる。
【００１３】さらに、キャラクタミックス回路21，ブラ
ンキングミックス回路22が図５のように周波数変換前に
あると、それらキャラクタのエッジや、画面サイドはぎ
らぎらになる。また、これらの回路21，22は、ｆCKのデ
ィジタル輝度信号Ｙにもミックスするため、たとえばｆ
CK／２のディジタル色差信号を４ｆSCに周波数変換した
後、キャラクタやブランキング信号をミックスすると、
輝度信号Ｙのキャラクタやブランキング信号との間に位
相ずれやぎらぎら現象を生ずる。
ンキングミックス回路22が図５のように周波数変換前に
あると、それらキャラクタのエッジや、画面サイドはぎ
らぎらになる。また、これらの回路21，22は、ｆCKのデ
ィジタル輝度信号Ｙにもミックスするため、たとえばｆ
CK／２のディジタル色差信号を４ｆSCに周波数変換した
後、キャラクタやブランキング信号をミックスすると、
輝度信号Ｙのキャラクタやブランキング信号との間に位
相ずれやぎらぎら現象を生ずる。
【００１４】(ｃ)、図５のスイッチ回路29の制御信号
(Ｅ)と(Ｆ)は、単に４ｆSCを１／４分周した信号を用い
ているので平衡変調して得られるクロマ信号(Ｇ)は、ｆ
SCに対する水平同期信号の位相を合わせることができな
い。
(Ｅ)と(Ｆ)は、単に４ｆSCを１／４分周した信号を用い
ているので平衡変調して得られるクロマ信号(Ｇ)は、ｆ
SCに対する水平同期信号の位相を合わせることができな
い。
【００１５】本発明は、以上のような従来の問題点に鑑
みて、高精度で調整を要せずエッジのぎらぎらを軽減
し、サブキャリアｆSCに対する水平同期信号の位相合わ
せを可能にしたディジタル信号処理によるディジタルク
ロマ信号のエンコーダ回路の提供を目的とする。
みて、高精度で調整を要せずエッジのぎらぎらを軽減
し、サブキャリアｆSCに対する水平同期信号の位相合わ
せを可能にしたディジタル信号処理によるディジタルク
ロマ信号のエンコーダ回路の提供を目的とする。
【００１６】
【課題を解決するための手段】本発明は、ｆCK／２のデ
ィジタル色差信号をディジタルＬＰＦ(ローパスフィル
タ)を用いて帯域制限した後、周波数４ｆSCのディジタ
ル色差信号に変換してディジタル平衡変調することによ
り、クロマ信号を生成することを特徴とする。
ィジタル色差信号をディジタルＬＰＦ(ローパスフィル
タ)を用いて帯域制限した後、周波数４ｆSCのディジタ
ル色差信号に変換してディジタル平衡変調することによ
り、クロマ信号を生成することを特徴とする。
【００１７】なお、ディジタルＬＰＦに入力する色差信
号は、Ｒ−ＹとＢ−ＹをｆCKの周波数によって時分割し
て１つにした信号であり、ディジタルＬＰＦのクロック
周波数を等価的にｆCK／２として行なうものである。
号は、Ｒ−ＹとＢ−ＹをｆCKの周波数によって時分割し
て１つにした信号であり、ディジタルＬＰＦのクロック
周波数を等価的にｆCK／２として行なうものである。
【００１８】また、前記のｆCKから４ｆSCへの周波数変
換は前段にディジタルＬＰＦを挿入して、ｆCKと４ｆSC
の位相を比較し、位相が合うところは４ｆSCでのサンプ
リングを行なわず、間引いて１個前のデータにより補間
し、平衡変調の後バースト信号以外のブランキング期間
をクリップする回路を兼ねた構成である。なお、４ｆSC
をｆSCに分周するには、ＮＴＳＣ方式では４フィールド
ごとに、またＰＡＬ方式の場合は８フィールドごとに分
周器をリセットさせる。
換は前段にディジタルＬＰＦを挿入して、ｆCKと４ｆSC
の位相を比較し、位相が合うところは４ｆSCでのサンプ
リングを行なわず、間引いて１個前のデータにより補間
し、平衡変調の後バースト信号以外のブランキング期間
をクリップする回路を兼ねた構成である。なお、４ｆSC
をｆSCに分周するには、ＮＴＳＣ方式では４フィールド
ごとに、またＰＡＬ方式の場合は８フィールドごとに分
周器をリセットさせる。
【００１９】
【作用】本発明によれば、例えばキャクタミックスやブ
ランキングミックスは、ディジタルＬＰＦ及びｆCK／２
から４ｆSCへの周波数変換の前で処理するから、キャラ
クタのエッジやブランキングのエッジのぎらぎら現象を
起こさないディジタル変調を行なうことができ、かつ、
輝度信号との位相ずれのないコンポジットビデオ信号が
得られる。
ランキングミックスは、ディジタルＬＰＦ及びｆCK／２
から４ｆSCへの周波数変換の前で処理するから、キャラ
クタのエッジやブランキングのエッジのぎらぎら現象を
起こさないディジタル変調を行なうことができ、かつ、
輝度信号との位相ずれのないコンポジットビデオ信号が
得られる。
【００２０】また、色差信号Ｒ−Ｙ，Ｂ−Ｙは平衡変調
による相互干渉を防止するため、従来から周波数変換前
にＢＰＦがかけられているが、周波数変換の前に挿入す
るディジタルＬＰＦの特性を、上記ＢＰＦの特性に合わ
せることにより画質を損うことなく、フィールド間、ま
たはフレーム間のクロマ信号エッジのぎらぎら現象を排
除できるエンコーダが実現される。
による相互干渉を防止するため、従来から周波数変換前
にＢＰＦがかけられているが、周波数変換の前に挿入す
るディジタルＬＰＦの特性を、上記ＢＰＦの特性に合わ
せることにより画質を損うことなく、フィールド間、ま
たはフレーム間のクロマ信号エッジのぎらぎら現象を排
除できるエンコーダが実現される。
【００２１】また、ディジタルＬＰＦは周波数がｆCK／
２のディジタル色差信号Ｒ−Ｙ，Ｂ−Ｙを周波数ｆCKに
より時分割して１つにした信号で処理するので回路が削
減され、さらにｆCKから４ｆSCへの周波数変換回路も、
前段にディジタルＬＰＦを配置するので回路規模が簡単
になり、平衡変調後、バースト信号期間以外のブランキ
ング期間をクリップすることで、ディジタルＬＰＦから
ブランキング期間に流れ込む色差信号が一掃される。さ
らにｆSCに対する水平同期信号の位相合わせが可能な高
品位のコンポジットビデオ信号を得ることができる。
２のディジタル色差信号Ｒ−Ｙ，Ｂ−Ｙを周波数ｆCKに
より時分割して１つにした信号で処理するので回路が削
減され、さらにｆCKから４ｆSCへの周波数変換回路も、
前段にディジタルＬＰＦを配置するので回路規模が簡単
になり、平衡変調後、バースト信号期間以外のブランキ
ング期間をクリップすることで、ディジタルＬＰＦから
ブランキング期間に流れ込む色差信号が一掃される。さ
らにｆSCに対する水平同期信号の位相合わせが可能な高
品位のコンポジットビデオ信号を得ることができる。
【００２２】
【実施例】以下、本発明を実施例により図面を用いて説
明する。
明する。
【００２３】図１は本発明の一実施例のにおけるディジ
タルクロマ信号のエンコーダ回路の構成を示す図、図２
は図１の要部の波形図である。
タルクロマ信号のエンコーダ回路の構成を示す図、図２
は図１の要部の波形図である。
【００２４】まず、図１において図４と同じ部分には同
じ符号を用いており、ディジタルシグナルプロセッサ
(ＤＳＰ)14により生成したｆCK／２のディジタル色差信
号Ｒ−Ｙ(Ａ)，Ｂ−Ｙ(Ｂ)は、色差信号時分割回路41に
おいて、クロック周波数ｆCKで交互にサプリングされた
信号(Ｃ)を得る。
じ符号を用いており、ディジタルシグナルプロセッサ
(ＤＳＰ)14により生成したｆCK／２のディジタル色差信
号Ｒ−Ｙ(Ａ)，Ｂ−Ｙ(Ｂ)は、色差信号時分割回路41に
おいて、クロック周波数ｆCKで交互にサプリングされた
信号(Ｃ)を得る。
【００２５】これを、キャラクタミックス回路42，ブラ
ンキングミックス回路(ＢＬ)43を経てディジタルＬＰＦ
44に印加する。なお、その場合、信号(Ｃ)と位相があっ
たＳＥＬ信号(Ｄ)の立下がりエッジに同期させる。つま
り、色差信号Ｒ−Ｙに同期させてミックスすることによ
り、信号(Ｃ)をＲ−ＹとＢ−Ｙに分離する際のエッジが
着色される疑似信号の発生を防止する。
ンキングミックス回路(ＢＬ)43を経てディジタルＬＰＦ
44に印加する。なお、その場合、信号(Ｃ)と位相があっ
たＳＥＬ信号(Ｄ)の立下がりエッジに同期させる。つま
り、色差信号Ｒ−Ｙに同期させてミックスすることによ
り、信号(Ｃ)をＲ−ＹとＢ−Ｙに分離する際のエッジが
着色される疑似信号の発生を防止する。
【００２６】ディジタルＬＰＦ44は、例えば図３に示す
ような、ｆCKで２段ずつ遅延させた信号を加算してｆCK
／２として構成するディジタルＬＰＦと等価になる。こ
こで色差信号Ｒ−Ｙ，Ｂ−Ｙは、それぞれ約１ないし1.
5MHzに帯域制限されている。
ような、ｆCKで２段ずつ遅延させた信号を加算してｆCK
／２として構成するディジタルＬＰＦと等価になる。こ
こで色差信号Ｒ−Ｙ，Ｂ−Ｙは、それぞれ約１ないし1.
5MHzに帯域制限されている。
【００２７】ディジタルＬＰＦ44の出力および、色差信
号時分割回路41からのＳＥＬ信号(Ｄ)は周波数変換器45
に供給され、ＳＥＬ信号(Ｄ)はラッチ回路(Ｌ)451にお
いてｆCKでラッチされ、信号(Ｆ)と、それを反転した信
号(Ｅ)を出力する。このとき、周波数変換器45に入力さ
れる信号(Ｄ)と、時分割された信号(Ｃ)との関係は、信
号(Ｃ)がディジタルＬＰＦ44までに受ける遅延がｆCKの
偶数倍になっていなければならない。
号時分割回路41からのＳＥＬ信号(Ｄ)は周波数変換器45
に供給され、ＳＥＬ信号(Ｄ)はラッチ回路(Ｌ)451にお
いてｆCKでラッチされ、信号(Ｆ)と、それを反転した信
号(Ｅ)を出力する。このとき、周波数変換器45に入力さ
れる信号(Ｄ)と、時分割された信号(Ｃ)との関係は、信
号(Ｃ)がディジタルＬＰＦ44までに受ける遅延がｆCKの
偶数倍になっていなければならない。
【００２８】ラッチ回路(Ｌ)452では色差信号(Ｅ)によ
り時分割された色差信号のＲ−Ｙの部分を、ラッチ回路
(Ｌ)453では信号(Ｆ)により時分割色差信号のＢ−Ｙの
部分を、夫々ラッチして信号(Ｇ)及び(Ｈ)を得る。
り時分割された色差信号のＲ−Ｙの部分を、ラッチ回路
(Ｌ)453では信号(Ｆ)により時分割色差信号のＢ−Ｙの
部分を、夫々ラッチして信号(Ｇ)及び(Ｈ)を得る。
【００２９】さらに、信号(Ｇ)はラッチ回路(Ｌ)454に
おいて信号(Ｆ)によりラッチされ、信号(Ｉ)を得る。こ
のようにして色差信号Ｒ−Ｙ，Ｂ−Ｙの位相を合せて疑
似信号の発生を防止している。
おいて信号(Ｆ)によりラッチされ、信号(Ｉ)を得る。こ
のようにして色差信号Ｒ−Ｙ，Ｂ−Ｙの位相を合せて疑
似信号の発生を防止している。
【００３０】信号(Ｈ)と(Ｉ)は、信号(Ｆ)を遅延回路
(ＤＬ)455で数ns遅らせた信号(Ｊ)と、４ｆSCをラッチ
回路(Ｌ)456で位相比較した信号(Ｋ)を用いて、それぞ
れラッチ回路(Ｌ)458，457によりサンプリングして、信
号(Ｍ)および(Ｌ)を得る。これからさらに、図５の場合
と同様に４ｆSCでサンプリングして、周波数変換した色
差信号(Ｏ)と(Ｎ)を得、それをディジタル平衡変調器46
によってクロマ信号が生成される。
(ＤＬ)455で数ns遅らせた信号(Ｊ)と、４ｆSCをラッチ
回路(Ｌ)456で位相比較した信号(Ｋ)を用いて、それぞ
れラッチ回路(Ｌ)458，457によりサンプリングして、信
号(Ｍ)および(Ｌ)を得る。これからさらに、図５の場合
と同様に４ｆSCでサンプリングして、周波数変換した色
差信号(Ｏ)と(Ｎ)を得、それをディジタル平衡変調器46
によってクロマ信号が生成される。
【００３１】なお、ディジタル平衡変調器46を制御する
信号(Ｐ)，(Ｑ)は制御信号生成器47によって生成される
が、図６の場合と異なるのは水平同期信号ＨＤと垂直同
期信号ＶＤからラッチ回路(Ｌ)471によってフィールド
パルスを生成させ、１／２分周器472によってフレーム
パルスを生成し、スイッチ回路473で、ＮＴＳＣの場合
は、このフレームパルスを、ＰＡＬ方式のときは、この
フレームパルスを、さらに分周器474によって１／２分
周したパルスを選択し、その信号によって４ｆSCの１／
４分周器475をリセットすることによって、ｆSCに対す
る水平同期信号の位相を調整している。
信号(Ｐ)，(Ｑ)は制御信号生成器47によって生成される
が、図６の場合と異なるのは水平同期信号ＨＤと垂直同
期信号ＶＤからラッチ回路(Ｌ)471によってフィールド
パルスを生成させ、１／２分周器472によってフレーム
パルスを生成し、スイッチ回路473で、ＮＴＳＣの場合
は、このフレームパルスを、ＰＡＬ方式のときは、この
フレームパルスを、さらに分周器474によって１／２分
周したパルスを選択し、その信号によって４ｆSCの１／
４分周器475をリセットすることによって、ｆSCに対す
る水平同期信号の位相を調整している。
【００３２】つまり、ＮＴＳＣ方式では４ｆSCごとに、
ＰＡＬ方式では８フィールドごとに１／４分周器475を
リセットすることになる。また、分周器476は水平同期
信号ＨＤの１／２分周器で、その出力はＰＡＬ方式のと
きは１水平ラインごとに色差信号Ｒ−Ｙを反転させて変
調するために、スイッチ回路(ＳＷ)477を制御する。も
ちろん、ＰＡＬ方式のときは、このスイッチ回路(ＳＷ)
477はリセットがかけられる。
ＰＡＬ方式では８フィールドごとに１／４分周器475を
リセットすることになる。また、分周器476は水平同期
信号ＨＤの１／２分周器で、その出力はＰＡＬ方式のと
きは１水平ラインごとに色差信号Ｒ−Ｙを反転させて変
調するために、スイッチ回路(ＳＷ)477を制御する。も
ちろん、ＰＡＬ方式のときは、このスイッチ回路(ＳＷ)
477はリセットがかけられる。
【００３３】クリップ回路48では、ディジタルＬＰＦ44
によってブランキング期間に洩れこむ色差信号を除去す
るため、バーストフラグパルスと、ブランキングパルス
とから、バースト信号期間以外をクリップしている。
によってブランキング期間に洩れこむ色差信号を除去す
るため、バーストフラグパルスと、ブランキングパルス
とから、バースト信号期間以外をクリップしている。
【００３４】以上のようにして生成されたディジタルの
クロマ信号は、Ｄ／Ａ変換器15を経てアナログのクロマ
信号に形成される。
クロマ信号は、Ｄ／Ａ変換器15を経てアナログのクロマ
信号に形成される。
【００３５】本発明は以上のようにしてディジタルクロ
マ信号を形成するものであり、撮像素子の水平画素が76
8個までのディジタルビデオカメラに対応可能である。
マ信号を形成するものであり、撮像素子の水平画素が76
8個までのディジタルビデオカメラに対応可能である。
【００３６】
【発明の効果】以上、詳細に説明したように本発明のデ
ィジタルクロマ信号のエンコーダ回路は、クロマ信号の
形成に必要なディジタル平衡変調のために用いるｆCK／
２のディジタル色差信号を４ｆSCのディジタル色差信号
に変換する変換回路を、ディジタルＬＰＦとクリップ回
路とを組合せて形成しているので構成が簡略化される。
また、その簡略化と時分割した色差信号をディジタルＬ
ＰＦにより帯域制御するので回路の規模の削減が可能に
なる。
ィジタルクロマ信号のエンコーダ回路は、クロマ信号の
形成に必要なディジタル平衡変調のために用いるｆCK／
２のディジタル色差信号を４ｆSCのディジタル色差信号
に変換する変換回路を、ディジタルＬＰＦとクリップ回
路とを組合せて形成しているので構成が簡略化される。
また、その簡略化と時分割した色差信号をディジタルＬ
ＰＦにより帯域制御するので回路の規模の削減が可能に
なる。
【００３７】さらに、サブキャリアと水平同期信号対応
のディジタル平衡変調を実現するから、高精度で高品位
のクロマ信号の生成が可能となり、カラービデオカメラ
等の信号処理に用いて大きな効果が期待できる。
のディジタル平衡変調を実現するから、高精度で高品位
のクロマ信号の生成が可能となり、カラービデオカメラ
等の信号処理に用いて大きな効果が期待できる。
【図１】本発明の一実施例におけるディジタルクロマ信
号のエンコーダ回路の構成図である。
号のエンコーダ回路の構成図である。
【図２】図１の各要部における信号波形図である。
【図３】図１のディジタルＬＰＦの構成例を示す図であ
る。
る。
【図４】従来のアナログエンコーダ回路の構成図であ
る。
る。
【図５】従来のディジタルエンコーダ回路の構成図であ
る。
る。
【図６】図５の各部の信号波形を示した図である。
11…撮像部、 12…ＣＤＳ・ＡＧＣ・ガンマ処理回路、
13…Ａ／Ｄ変換器、14…ディジタルシグナルプロセッ
サ(ＤＳＰ)、 15…Ｄ／Ａ変換器、 41…色差信号時分
割回路、 42…キャラクタミックス回路、 43…ブラン
キングミックス回路、 44…ディジタルＬＰＦ、 45…
周波数変換器、 46…ディジタル平衡変調器、 47…平
衡変調制御信号生成器、 48…クリップ回路。
13…Ａ／Ｄ変換器、14…ディジタルシグナルプロセッ
サ(ＤＳＰ)、 15…Ｄ／Ａ変換器、 41…色差信号時分
割回路、 42…キャラクタミックス回路、 43…ブラン
キングミックス回路、 44…ディジタルＬＰＦ、 45…
周波数変換器、 46…ディジタル平衡変調器、 47…平
衡変調制御信号生成器、 48…クリップ回路。
Claims (1)
- 【特許請求の範囲】 【請求項１】 ＣＣＤ撮影素子を用いるビデオカメラ等
において、撮像した画像信号をＣＣＤ駆動周波数により
Ａ／Ｄ変換して、ディジタル信号処理により得たＣＣＤ
駆動周波数の１／２の周波数の色差信号Ｒ−Ｙ，Ｂ−Ｙ
を、ディジタル平衡変調するため、４倍のサブキャリア
周波数によってサンプリングする周波数変換手段と、そ
の周波数変換手段のまえにディジタルＬＰＦを挿入する
手段と、前記ディジタルＬＰＦには色差信号Ｒ−Ｙ，Ｂ
−Ｙを時分割で交互にサンプリングした色差信号を通過
させる手段と、前記４倍のサブキャリア周波数に周波数
変換した色差信号Ｒ−Ｙ，Ｂ−Ｙをサブキャリア信号に
対する水平同期位相を調整するサブキャリア平衡変調手
段と、前記、ディジタルＬＰＦによりブランキング期間
に洩れた色差信号を、平衡変調後に除去する手段とを備
えたことを特徴とするディジタルクロマ信号のエンコー
ダ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3207123A JP2997961B2 (ja) | 1991-07-25 | 1991-07-25 | ディジタルクロマ信号のエンコーダ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3207123A JP2997961B2 (ja) | 1991-07-25 | 1991-07-25 | ディジタルクロマ信号のエンコーダ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0530523A true JPH0530523A (ja) | 1993-02-05 |
| JP2997961B2 JP2997961B2 (ja) | 2000-01-11 |
Family
ID=16534577
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3207123A Expired - Fee Related JP2997961B2 (ja) | 1991-07-25 | 1991-07-25 | ディジタルクロマ信号のエンコーダ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2997961B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07327237A (ja) * | 1994-05-31 | 1995-12-12 | Victor Co Of Japan Ltd | ビデオ信号処理回路 |
| US5638135A (en) * | 1995-04-06 | 1997-06-10 | Ricoh Company, Ltd. | Digital color encoder with improved circuitry |
| EP0810797A2 (en) * | 1996-05-29 | 1997-12-03 | Oki Electric Industry Co., Ltd. | Digital colour signal modulating apparatus |
-
1991
- 1991-07-25 JP JP3207123A patent/JP2997961B2/ja not_active Expired - Fee Related
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07327237A (ja) * | 1994-05-31 | 1995-12-12 | Victor Co Of Japan Ltd | ビデオ信号処理回路 |
| US5638135A (en) * | 1995-04-06 | 1997-06-10 | Ricoh Company, Ltd. | Digital color encoder with improved circuitry |
| EP0810797A2 (en) * | 1996-05-29 | 1997-12-03 | Oki Electric Industry Co., Ltd. | Digital colour signal modulating apparatus |
| EP0810797A3 (en) * | 1996-05-29 | 1998-08-12 | Oki Electric Industry Co., Ltd. | Digital colour signal modulating apparatus |
| US6061101A (en) * | 1996-05-29 | 2000-05-09 | Oki Electric Industry Co., Ltd. | Digital color signal modulating apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2997961B2 (ja) | 2000-01-11 |
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