JPS6354891A - デジタル色復調装置 - Google Patents
デジタル色復調装置Info
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- JPS6354891A JPS6354891A JP61199393A JP19939386A JPS6354891A JP S6354891 A JPS6354891 A JP S6354891A JP 61199393 A JP61199393 A JP 61199393A JP 19939386 A JP19939386 A JP 19939386A JP S6354891 A JPS6354891 A JP S6354891A
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- Japan
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- signal
- circuit
- composite video
- digital
- video signal
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- 238000006243 chemical reaction Methods 0.000 claims description 9
- 238000000926 separation method Methods 0.000 claims description 9
- 230000001934 delay Effects 0.000 claims description 3
- 230000001360 synchronised effect Effects 0.000 claims description 3
- 238000000034 method Methods 0.000 claims description 2
- 239000000284 extract Substances 0.000 claims 1
- 238000005070 sampling Methods 0.000 abstract description 4
- 238000010586 diagram Methods 0.000 description 4
- 230000006870 function Effects 0.000 description 2
- 230000003111 delayed effect Effects 0.000 description 1
- RDYMFSUJUZBWLH-UHFFFAOYSA-N endosulfan Chemical compound C12COS(=O)OCC2C2(Cl)C(Cl)=C(Cl)C1(Cl)C2(Cl)Cl RDYMFSUJUZBWLH-UHFFFAOYSA-N 0.000 description 1
- NJPPVKZQTLUDBO-UHFFFAOYSA-N novaluron Chemical compound C1=C(Cl)C(OC(F)(F)C(OC(F)(F)F)F)=CC=C1NC(=O)NC(=O)C1=C(F)C=CC=C1F NJPPVKZQTLUDBO-UHFFFAOYSA-N 0.000 description 1
- 230000000750 progressive effect Effects 0.000 description 1
Landscapes
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はテレビジョン受像機のデジタル信号処理に関し
、特に色復調系の改良に関する。
、特に色復調系の改良に関する。
従来の技術
従来、この種の色復調はＡ／Ｄ変換に用いるクロック信
号としてバースト信号に位相ロックした４倍のサブキャ
リヤ周波数（以下４Ｆ０と称する）が用いられ、４Ｆ０
のデータが（Ｒ−Ｙ）、（Ｂ−Ｙ）、−（Ｒ−Ｙ）、−
（Ｂ−Ｙ）の関係になるように位相をづらし、１個おき
にデータを抜き取ることにより色復調を行っていた。
号としてバースト信号に位相ロックした４倍のサブキャ
リヤ周波数（以下４Ｆ０と称する）が用いられ、４Ｆ０
のデータが（Ｒ−Ｙ）、（Ｂ−Ｙ）、−（Ｒ−Ｙ）、−
（Ｂ−Ｙ）の関係になるように位相をづらし、１個おき
にデータを抜き取ることにより色復調を行っていた。
発明が解決しようとする問題点
上述した形式の従来の色復調方式は、例えばＶＴＲより
出力されるようなバースト信号と水平同期信号とが同期
していないようなアナログ・コンポジット信号を受けて
も色復調は行える。しかしなから、このようなシステム
では４Ｆｓｃでビデオ信号をＡ／Ｄ変換しているので１
ラインが９１０サンプルにならず、ライン上での走査線
を２倍にするためのメモリへの２度書きや走査線補間の
ような処理を行う場合には、１ラインのサンプル数が水
平周期にロックした固定値とはならず変動するため、Ｉ
Ｈの遅延線を作るのが難しく回路も極めて煩雑となると
いう問題があった。
出力されるようなバースト信号と水平同期信号とが同期
していないようなアナログ・コンポジット信号を受けて
も色復調は行える。しかしなから、このようなシステム
では４Ｆｓｃでビデオ信号をＡ／Ｄ変換しているので１
ラインが９１０サンプルにならず、ライン上での走査線
を２倍にするためのメモリへの２度書きや走査線補間の
ような処理を行う場合には、１ラインのサンプル数が水
平周期にロックした固定値とはならず変動するため、Ｉ
Ｈの遅延線を作るのが難しく回路も極めて煩雑となると
いう問題があった。
問題点を解決するための手段
本発明の色復調装置は、水平周期に位相ロックした内部
システムクロック信号を作成して出力する第２のＰＬＬ
回路を設け、これより出力される称する）の内部システ
ムクロック信号で動作するデジタル・ビデオ信号をＹ／
Ｃ分離することにより得た色信号と、第１のＰＬＬ回路
より出力されるバースト信号に位相ロックしたアナログ
・サブキャリヤ信号をデジタル・サブキャリヤ信号に変
換して得たものとを乗算するとともに、さらにこのデジ
タル・サブキャリヤ信号を９０度位相遅延したものと上
記色信号とを乗算し、この一対の乗算回路を設けて直交
復調するよう構成したものである。
システムクロック信号を作成して出力する第２のＰＬＬ
回路を設け、これより出力される称する）の内部システ
ムクロック信号で動作するデジタル・ビデオ信号をＹ／
Ｃ分離することにより得た色信号と、第１のＰＬＬ回路
より出力されるバースト信号に位相ロックしたアナログ
・サブキャリヤ信号をデジタル・サブキャリヤ信号に変
換して得たものとを乗算するとともに、さらにこのデジ
タル・サブキャリヤ信号を９０度位相遅延したものと上
記色信号とを乗算し、この一対の乗算回路を設けて直交
復調するよう構成したものである。
作用
上記色復調装置の各デジタル処理回路部のすべてを上記
第２ＰＬＬ回路で作成されたような内部システムクロッ
クで駆動しているから、バースト周波数と水平周波数と
の間に所定の相関関係がないアナログ・コンポジットビ
デオ信号を受ても、１ラインのサンプル数を水平周期に
ロックした固定値として上記各回路部のデジタル信号処
理を可能としている。
第２ＰＬＬ回路で作成されたような内部システムクロッ
クで駆動しているから、バースト周波数と水平周波数と
の間に所定の相関関係がないアナログ・コンポジットビ
デオ信号を受ても、１ラインのサンプル数を水平周期に
ロックした固定値として上記各回路部のデジタル信号処
理を可能としている。
実施例
次に本発明について図面を参照して説明する。
第１図は本発明のブロック図である。１１はアナログ・
コンポジットビデオ信号の入力端子で、この信号を第１
Ａ／Ｄ変換器１２．第１ＰＬＬ回路１４．タイミング回
路１６へ出力している。
コンポジットビデオ信号の入力端子で、この信号を第１
Ａ／Ｄ変換器１２．第１ＰＬＬ回路１４．タイミング回
路１６へ出力している。
第１Ａ／Ｄ変換器１２は９１０Ｆ、（７）内部システム
クロック信号で動作し、タイミング回路１６より後述の
クランプパルスが与えられることによりＹ／Ｃ分離回路
１３ヘデジタル・コンポジットビデオ信号を出力する。
クロック信号で動作し、タイミング回路１６より後述の
クランプパルスが与えられることによりＹ／Ｃ分離回路
１３ヘデジタル・コンポジットビデオ信号を出力する。
Ｙ／Ｇ分離回路１３は第１Ａ／Ｄ変換器１２の出力を輝
度信号Ｙと、サブキャリヤ信号で変調されている色信号
Ｃに分離し、輝度信号Ｙを出力端子２４へ、色信号Ｃを
後述の第１及び第２乗算器２０．２１へ出力する。
度信号Ｙと、サブキャリヤ信号で変調されている色信号
Ｃに分離し、輝度信号Ｙを出力端子２４へ、色信号Ｃを
後述の第１及び第２乗算器２０．２１へ出力する。
タイミング回路１６は入力端子１１より与えられたアナ
ログ・コンポジットビデオ信号より水平・垂直同期信号
を分離し、そのうち水平同期信号と同期しかつ水平周期
をもつＨパルスと、水平同期信号のバックポーチ期間に
応じて出力されるりランプパルスと、アナログ・コンポ
ジットビデオ信号に含まれるバースト信号を抽出するた
めのタイミングで出力されるバーストゲートパルスとを
生成する。
ログ・コンポジットビデオ信号より水平・垂直同期信号
を分離し、そのうち水平同期信号と同期しかつ水平周期
をもつＨパルスと、水平同期信号のバックポーチ期間に
応じて出力されるりランプパルスと、アナログ・コンポ
ジットビデオ信号に含まれるバースト信号を抽出するた
めのタイミングで出力されるバーストゲートパルスとを
生成する。
１５はこのタイミング回路１６より出力されたＨパルス
に位相ロックする第２ＰＬＬ回路で、例えば９１０Ｆ、
の内部システムクロック信号を出力する。
に位相ロックする第２ＰＬＬ回路で、例えば９１０Ｆ、
の内部システムクロック信号を出力する。
第１ＰＬＬ回路１４は入力端子１１より与えられたアナ
ログ・コンポジットビデオ信号とタイミング回路１６よ
り与えられたバーストゲートパルスにより動作し、アナ
ログ・サブキャリヤ信号を出力する。
ログ・コンポジットビデオ信号とタイミング回路１６よ
り与えられたバーストゲートパルスにより動作し、アナ
ログ・サブキャリヤ信号を出力する。
１７は第１ＰＬＬ回路１４より出力されたアナログ・サ
ブキャリヤ信号をデジタルに変換する第２Ａ／Ｄ変換回
路で、デジタル・サブキャリヤ信号を次段の遅延回路１
８へ出力する。
ブキャリヤ信号をデジタルに変換する第２Ａ／Ｄ変換回
路で、デジタル・サブキャリヤ信号を次段の遅延回路１
８へ出力する。
遅延回路１８は、Ｙ／Ｃ分離回路１３の遅延分、デジタ
ル・サブキャリヤ信号を遅延して、次段の９０度位相器
１９と、第１乗算器２０に出力する。９０度位相器１９
は、この場合１サンプル遅延器となる。
ル・サブキャリヤ信号を遅延して、次段の９０度位相器
１９と、第１乗算器２０に出力する。９０度位相器１９
は、この場合１サンプル遅延器となる。
第１及び第２乗算器２０．２１は周知のデジタル乗算器
で、色信号Ｃとすでに述べたデジタル・サブキャリヤ信
号との乗算を行う、その結果、第１乗算器２０は色差信
号Ｂ−Ｙ（Ｑ）、第２乗算器２１は色差信号Ｒ−Ｙ （
Ｉ）を各々個別に出力する。
で、色信号Ｃとすでに述べたデジタル・サブキャリヤ信
号との乗算を行う、その結果、第１乗算器２０は色差信
号Ｂ−Ｙ（Ｑ）、第２乗算器２１は色差信号Ｒ−Ｙ （
Ｉ）を各々個別に出力する。
２２．２３は周知のデジタル・フィルタで構成され、第
１及び第２乗算器２０．２１で生じる２Ｆ０付近の高調
波成分を除去する第１、第２低域通過型フィルタである
。したがって、出力端子２５．２６より引き出される色
差信号Ｂ−Ｙ （Ｑ）、Ｒ−Ｙ（Ｉ）は、このフィルタ
２２．２３を介して出力される。
１及び第２乗算器２０．２１で生じる２Ｆ０付近の高調
波成分を除去する第１、第２低域通過型フィルタである
。したがって、出力端子２５．２６より引き出される色
差信号Ｂ−Ｙ （Ｑ）、Ｒ−Ｙ（Ｉ）は、このフィルタ
２２．２３を介して出力される。
次に各部の動作について以下に説明する。
先ず、入力端子１１には７５ΩＩＶ、、でアナログ・コ
ンポジットビデオ信号がここでは入力される。第１Ａ／
Ｄ変換器１２は入力端子１１に受けた信号を８ビツトの
デジタル・コンポジットビデオ信号に変換している。ま
た第１Ａ／Ｄ変換器１２は、タイミング回路１６より供
給されるクランプパルスにより動作するペデスタルクラ
ンプ回路と、低域通過型フィルタとを内蔵し、第２ＰＬ
Ｌ回路１５より出力される９１０Ｆ、の内部システムク
ロックパルスにより標本化している。この第１Ａ／Ｄ変
換器１２よりデジタル・コンポジットビデオ信号が与え
られるＹ／Ｃ分離回路１３は、例えば第２図に示すよう
なデジタルフィルタにより構成され１坪度信号Ｙとサブ
キャリヤ信号で変調されている色信号Ｃとを分離して出
力する。
ンポジットビデオ信号がここでは入力される。第１Ａ／
Ｄ変換器１２は入力端子１１に受けた信号を８ビツトの
デジタル・コンポジットビデオ信号に変換している。ま
た第１Ａ／Ｄ変換器１２は、タイミング回路１６より供
給されるクランプパルスにより動作するペデスタルクラ
ンプ回路と、低域通過型フィルタとを内蔵し、第２ＰＬ
Ｌ回路１５より出力される９１０Ｆ、の内部システムク
ロックパルスにより標本化している。この第１Ａ／Ｄ変
換器１２よりデジタル・コンポジットビデオ信号が与え
られるＹ／Ｃ分離回路１３は、例えば第２図に示すよう
なデジタルフィルタにより構成され１坪度信号Ｙとサブ
キャリヤ信号で変調されている色信号Ｃとを分離して出
力する。
ここで、１３１は前段の第１Ａ／Ｄ変換器１２よりデジ
タル・コンポジットビデオ信号が与えられる端子であり
、１３２は上記輝度信号Ｙを出力する端子、１３３は上
記輝度信号Ｙを出力する端子である。また、Ｚ−１は１
／９１０ Ｆ、の遅延線、１４０，１４２は各々正・負
の１７２重み付は回路で、これらは周知の回路で形成さ
れ、ここではその詳細を省略する。
タル・コンポジットビデオ信号が与えられる端子であり
、１３２は上記輝度信号Ｙを出力する端子、１３３は上
記輝度信号Ｙを出力する端子である。また、Ｚ−１は１
／９１０ Ｆ、の遅延線、１４０，１４２は各々正・負
の１７２重み付は回路で、これらは周知の回路で形成さ
れ、ここではその詳細を省略する。
一方、第１ＰＬＬ回路１４は入力端子１１から与えられ
るアナログ・コンポジットビデオ信号とタイミング回路
１６から与えられるバーストゲートパルスにより、バー
スト信号に位相ロックしたアナログ・サブキャリヤ信号
を出力する。第２Ａ／Ｄ変換器１７は、このアナログ・
サブキャリヤ信号を受けてすでに述べたように例えば、
８ビツトのデジタル・サブキャリヤ信号を出力する。こ
の第２Ａ／Ｄ変換器１７は、ここでは上述のアナログ・
サブキャリヤ信号に含まれる高調波成分を除去する低域
通過型フィルタと、Ａ／Ｄ変換器のダイナミックレンジ
に信号を増幅する増幅器と。
るアナログ・コンポジットビデオ信号とタイミング回路
１６から与えられるバーストゲートパルスにより、バー
スト信号に位相ロックしたアナログ・サブキャリヤ信号
を出力する。第２Ａ／Ｄ変換器１７は、このアナログ・
サブキャリヤ信号を受けてすでに述べたように例えば、
８ビツトのデジタル・サブキャリヤ信号を出力する。こ
の第２Ａ／Ｄ変換器１７は、ここでは上述のアナログ・
サブキャリヤ信号に含まれる高調波成分を除去する低域
通過型フィルタと、Ａ／Ｄ変換器のダイナミックレンジ
に信号を増幅する増幅器と。
Ａ／Ｄ変換器のダイナミックレンジのセンターにバイア
スするバイアス回路とを内蔵している。また、この第２
Ａ／Ｄ変換器１７は、第２ＰＬＬ回路１５より出力され
る９１０Ｆ、の内部システムクロックパルスによって入
力された上述のアナログ・サブキャリヤ信号を標本化し
ている。
スするバイアス回路とを内蔵している。また、この第２
Ａ／Ｄ変換器１７は、第２ＰＬＬ回路１５より出力され
る９１０Ｆ、の内部システムクロックパルスによって入
力された上述のアナログ・サブキャリヤ信号を標本化し
ている。
このようにして得たデジタル・サブキャリヤ信号は遅延
回路１８によって、上述のＹ／Ｃ分離回路１３における
信号処理で生じた遅延分を補償される。その結果、遅延
回路１８を経たデジタル・サブキャリヤ信号は、上述の
Ｙ／Ｃ分離回路１３で分離された色信号Ｃと第１乗算器
２０で乗算処理される。
回路１８によって、上述のＹ／Ｃ分離回路１３における
信号処理で生じた遅延分を補償される。その結果、遅延
回路１８を経たデジタル・サブキャリヤ信号は、上述の
Ｙ／Ｃ分離回路１３で分離された色信号Ｃと第１乗算器
２０で乗算処理される。
また、遅延回路１８を経たデジタル・サブキャリヤ信号
は、ここで分枝されて９０度位相器１９にも供給される
。この１サンプル遅延器として働く９０度位相器１９は
、サブキャリヤ信号により直交変調されている色信号Ｃ
の復調用に使用すべく、遅延回路１８を経たデジタル・
サブキャリヤ信号を９０度位相遅延して第２乗算器２１
へ供給する。第２乗算器２１は、乗算器２０と同様にし
て上述のＹ／Ｃ分雌分路回路１３離された色信号Ｃが与
えられている。第１乗算器２０及び第２乗算器２１は、
ここでは８ビツト７８ビツトの乗算器で構成され、遅延
回路１８を経たデジタル・サブキャリヤ信号と、９０度
位相器１９を経たデジタル・サブキャリヤ信号とのそれ
ぞれと、上述の色信号Ｃとにより、直交復調を行ってい
る。 その結果、この第１乗算器２０及び第２乗算器２
１からは、それぞれ（Ｂ−Ｙ）、（Ｒ−Ｙ）の各色差信
号が引き出されるが、ここでは各乗算器の後段に周知の
デジタルフィルタで形成される低域通過型フィルタ２２
．２３が配置されている。
は、ここで分枝されて９０度位相器１９にも供給される
。この１サンプル遅延器として働く９０度位相器１９は
、サブキャリヤ信号により直交変調されている色信号Ｃ
の復調用に使用すべく、遅延回路１８を経たデジタル・
サブキャリヤ信号を９０度位相遅延して第２乗算器２１
へ供給する。第２乗算器２１は、乗算器２０と同様にし
て上述のＹ／Ｃ分雌分路回路１３離された色信号Ｃが与
えられている。第１乗算器２０及び第２乗算器２１は、
ここでは８ビツト７８ビツトの乗算器で構成され、遅延
回路１８を経たデジタル・サブキャリヤ信号と、９０度
位相器１９を経たデジタル・サブキャリヤ信号とのそれ
ぞれと、上述の色信号Ｃとにより、直交復調を行ってい
る。 その結果、この第１乗算器２０及び第２乗算器２
１からは、それぞれ（Ｂ−Ｙ）、（Ｒ−Ｙ）の各色差信
号が引き出されるが、ここでは各乗算器の後段に周知の
デジタルフィルタで形成される低域通過型フィルタ２２
．２３が配置されている。
この低域通過型フィルタ２２．２３は、すでに述べたよ
うに第１乗算器２０及び第２乗算器２１の出力に、２Ｆ
ｓｃを中心とした高調波成分が含まれているため、これ
を除去する目的で配置されている。
うに第１乗算器２０及び第２乗算器２１の出力に、２Ｆ
ｓｃを中心とした高調波成分が含まれているため、これ
を除去する目的で配置されている。
ここで、第１乗算器２０及び第２乗算器２１の出力は、
復調軸を変えることにより、それぞれ（Ｂ−Ｙ）、（Ｒ
−Ｙ）の各色差信号に変わり、いわゆるＩ、Ｑ信号を引
き出すことも可能であり、このようにしても本願の趣旨
を変更するものではない。
復調軸を変えることにより、それぞれ（Ｂ−Ｙ）、（Ｒ
−Ｙ）の各色差信号に変わり、いわゆるＩ、Ｑ信号を引
き出すことも可能であり、このようにしても本願の趣旨
を変更するものではない。
ところで、第２ＰＬＬ回路１５はタイミング回路１６よ
り出力されるＨパルスに位相ロックした９１０Ｆ、の内
部システムクロックパルスを出力している。この内部シ
ステムクロックパルスは、以上説明してきた各部回路の
内、上述の第１果算器２０及び第２乗算器２１と、第１
ＰＬＬ回路１４を除く各部回路へ駆動パルスとして供給
されている。
り出力されるＨパルスに位相ロックした９１０Ｆ、の内
部システムクロックパルスを出力している。この内部シ
ステムクロックパルスは、以上説明してきた各部回路の
内、上述の第１果算器２０及び第２乗算器２１と、第１
ＰＬＬ回路１４を除く各部回路へ駆動パルスとして供給
されている。
発明の詳細
な説明したように、本発明は水平パルスに位相ロックさ
れたＰＬＬ回路から出力される９１０ＦＨのクロック信
号によりシステムが動作しているので、１ラインは９１
０サンプルとなり、画像データに垂直の相関がとれ、ま
たサブキャリヤ信号をＡ／Ｄ変換したものと色信号Ｃを
乗算することにより色差信号を復調する方式なのでサン
プリングクロックがバースト信号に位相ロックしていな
くても色復調が可能となる。
れたＰＬＬ回路から出力される９１０ＦＨのクロック信
号によりシステムが動作しているので、１ラインは９１
０サンプルとなり、画像データに垂直の相関がとれ、ま
たサブキャリヤ信号をＡ／Ｄ変換したものと色信号Ｃを
乗算することにより色差信号を復調する方式なのでサン
プリングクロックがバースト信号に位相ロックしていな
くても色復調が可能となる。
第１図は本発明の一実施例における順次走査変換システ
ムの要部ブロック回路図、第２図は第１図に示すＹ／Ｃ
分雛分路回路実施例を示す回路図である。 １１・・入力端子、 １２・・第１Ａ／Ｄ変換器、 １３・・Ｙ／Ｃ分離回路、 １４・・第１ＰＬＬ回路、 １５・・第２ＰＬＬ回路、 １６・・タイミング回路、 １７・・第２Ａ／Ｄ変換回路、 １８・・遅延回路、 １９・・９０度位相器、 ２ｏ・・第１乗算器、 ２１・・第２乗算器、 ２２・・第１低域通過型フィルタ、 ２３・・第２低域通過型フィルタ、 ２４・・輝度信舟Ｙの出力端子、 ２５．２６・・色差信号の出力端子。
ムの要部ブロック回路図、第２図は第１図に示すＹ／Ｃ
分雛分路回路実施例を示す回路図である。 １１・・入力端子、 １２・・第１Ａ／Ｄ変換器、 １３・・Ｙ／Ｃ分離回路、 １４・・第１ＰＬＬ回路、 １５・・第２ＰＬＬ回路、 １６・・タイミング回路、 １７・・第２Ａ／Ｄ変換回路、 １８・・遅延回路、 １９・・９０度位相器、 ２ｏ・・第１乗算器、 ２１・・第２乗算器、 ２２・・第１低域通過型フィルタ、 ２３・・第２低域通過型フィルタ、 ２４・・輝度信舟Ｙの出力端子、 ２５．２６・・色差信号の出力端子。
Claims (1)
- 【特許請求の範囲】 アナログ・コンポジットビデオ信号をデジタル・コンポ
ジットビデオ信号に変換して輝度信号と色信号を分離す
る回路と、前記アナログ・コンポジットビデオ信号から
アナログ・サブキャリヤ信号を抽出してＡ／Ｄ変換する
ことにより得たデジタル・サブキャリヤ信号と、これを
９０度位相遅延させたデジタル・サブキャリヤ信号との
各々を前記分離された色信号に乗算する回路とを少なく
とも備えることによって、前記アナログ・コンポジット
ビデオ信号をデジタル処理する形式のデジタル色復調装
置であって、 前記アナログ・コンポジットビデオ信号に含まれる水平
同期信号と同期しかつ水平周期をもつＨパルスと、前記
水平同期信号のバックポーチ期間に応じて出力されるク
ランプパルスと、前記アナログ・コンポジットビデオ信
号に含まれるバースト信号を抽出するためのタイミング
で出力されるバーストゲートパルスとを前記アナログ・
コンポジットビデオ信号から生成するタイミング回路と
このタイミング回路から前記バーストゲートパルスが与
えられることにより、前記アナログ・コンポジットビデ
オ信号から抽出したバースト信号にサブキャリヤ信号を
位相ロックして出力する第１のＰＬＬ回路と、 前記タイミング回路から前記Ｈパルスが与えられること
により水平周期に位相ロックした内部システムクロック
信号を作成して出力する第２のＰＬＬ回路とを設け、 前記タイミング回路から出力されるクランプパルスを前
記アナログ・コンポジットビデオ信号をデジタル・コン
ポジットビデオ信号に変換するＡ／Ｄ変換回路に与える
とともに、 前記第２のＰＬＬ回路から出力される前記内部システム
クロック信号で、前記第１のＰＬＬ回路より出力された
サブキャリヤ信号をデジタル信号に変換するＡ／Ｄ変換
回路や、前記アナログ・コンポジットビデオ信号をデジ
タル・コンポジットビデオ信号に変換する前記Ａ／Ｄ変
換回路や、前記輝度信号と色信号を分離するＹ／Ｃ分離
回路及び、前記デジタル・サブキャリヤ信号を９０度位
相遅延させた位相器等のすべてを駆動することにより、
バースト周波数と水平周波数との間に所定の相関関係が
ないアナログ・コンポジットビデオ信号を受ても、１ラ
インのサンプル数を水平周期にロックした固定値として
前記デジタル信号処理を可能としたデジタル色復調装置
。
Priority Applications (7)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61199393A JPH0815342B2 (ja) | 1986-08-26 | 1986-08-26 | デジタル色復調装置 |
| MYPI87001439A MY102145A (en) | 1986-08-26 | 1987-08-24 | Digital color demodulator. |
| KR1019870009302A KR950008133B1 (ko) | 1986-08-26 | 1987-08-26 | 디지탈 색 복조기 |
| US07/089,392 US4799102A (en) | 1986-08-26 | 1987-08-26 | Digital color demodulator |
| DE3750690T DE3750690T2 (de) | 1986-08-26 | 1987-08-26 | Demodulator für ein FBAS-Signal. |
| EP87112418A EP0259701B1 (en) | 1986-08-26 | 1987-08-26 | Demodulator for a color composite video signal |
| CA000545435A CA1270321A (en) | 1986-08-26 | 1987-08-26 | Digital color demodulator |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61199393A JPH0815342B2 (ja) | 1986-08-26 | 1986-08-26 | デジタル色復調装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6354891A true JPS6354891A (ja) | 1988-03-09 |
| JPH0815342B2 JPH0815342B2 (ja) | 1996-02-14 |
Family
ID=16407032
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61199393A Expired - Lifetime JPH0815342B2 (ja) | 1986-08-26 | 1986-08-26 | デジタル色復調装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0815342B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08340550A (ja) * | 1996-07-15 | 1996-12-24 | Hitachi Ltd | ディジタルテレビジョン信号処理装置 |
| US5654767A (en) * | 1994-05-23 | 1997-08-05 | Mitsubishi Denki Kabushiki Kaisha | Digital chrominance signal demodulating device |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57150293A (en) * | 1981-03-13 | 1982-09-17 | Sony Corp | Timing pulse generating device |
-
1986
- 1986-08-26 JP JP61199393A patent/JPH0815342B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57150293A (en) * | 1981-03-13 | 1982-09-17 | Sony Corp | Timing pulse generating device |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5654767A (en) * | 1994-05-23 | 1997-08-05 | Mitsubishi Denki Kabushiki Kaisha | Digital chrominance signal demodulating device |
| JPH08340550A (ja) * | 1996-07-15 | 1996-12-24 | Hitachi Ltd | ディジタルテレビジョン信号処理装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0815342B2 (ja) | 1996-02-14 |
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