JPH0530179Y2 - - Google Patents
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- Publication number
- JPH0530179Y2 JPH0530179Y2 JP1985058397U JP5839785U JPH0530179Y2 JP H0530179 Y2 JPH0530179 Y2 JP H0530179Y2 JP 1985058397 U JP1985058397 U JP 1985058397U JP 5839785 U JP5839785 U JP 5839785U JP H0530179 Y2 JPH0530179 Y2 JP H0530179Y2
- Authority
- JP
- Japan
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- circuit
- voltage
- output
- pulse signal
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- Expired - Lifetime
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- 238000009499 grossing Methods 0.000 claims description 12
- 238000001514 detection method Methods 0.000 claims description 11
- 230000000087 stabilizing effect Effects 0.000 claims description 8
- 239000003990 capacitor Substances 0.000 description 5
- 230000006641 stabilisation Effects 0.000 description 3
- 238000011105 stabilization Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000006378 damage Effects 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000009977 dual effect Effects 0.000 description 1
Landscapes
- Continuous-Control Power Sources That Use Transistors (AREA)
- Dc-Dc Converters (AREA)
Description
【考案の詳細な説明】
〔産業上の利用分野〕
本考案は電圧安定化回路に関する。
本考案はシリーズレギユレータ及びスイツチン
グレギユレータを有する電圧安定化回路におい
て、スイツチングレギユレータ用の制御器が２組
設けられた集積回路（IC）構成の制御回路設け、
一方の制御器を用いてシリーズレギユレータを制
御すると共に、他方の制御器及び平滑回路を用い
てスイツチングレギユレータを制御するようにし
たものである。
グレギユレータを有する電圧安定化回路におい
て、スイツチングレギユレータ用の制御器が２組
設けられた集積回路（IC）構成の制御回路設け、
一方の制御器を用いてシリーズレギユレータを制
御すると共に、他方の制御器及び平滑回路を用い
てスイツチングレギユレータを制御するようにし
たものである。
従来のシリーズレギユレータにおいては、負荷
電圧を検出し、この負荷電圧検出電圧をトランジ
スタを用いてツエナーダイオードよりの基準電圧
と比較し、その比較出力を電源及び負荷間に直列
に挿入されたトランジスタのベースに供給して、
負荷電圧の定電圧制御を行うようにしていた。
電圧を検出し、この負荷電圧検出電圧をトランジ
スタを用いてツエナーダイオードよりの基準電圧
と比較し、その比較出力を電源及び負荷間に直列
に挿入されたトランジスタのベースに供給して、
負荷電圧の定電圧制御を行うようにしていた。
一方、従来のスイツチングレギユレータにおい
ては、スイツチング素子、トランス、チヨークコ
ール、整流回路、平滑回路等を有する出力回路
を、三角波発振器、比較回路、パルス幅変調器、
出力トランジスタ等から成るIC構成の制御回路
にて制御するようにしている。
ては、スイツチング素子、トランス、チヨークコ
ール、整流回路、平滑回路等を有する出力回路
を、三角波発振器、比較回路、パルス幅変調器、
出力トランジスタ等から成るIC構成の制御回路
にて制御するようにしている。
かかる点に鑑み、本考案はシリーズレギユレー
タ及びスイツチングレギユレータを有する電圧安
定化回路において、シリーズレギユレータ及びス
イツチングレギユレータを互いに独立に動作させ
得るにも拘らず部品点数を大幅に削減できると共
に、シリーズレギユレータ及びスイツチングレギ
ユレータの温度特性のばらつきによる各定電圧特
性のばらつきを低減することのできる回路を提案
しようとするものである。
タ及びスイツチングレギユレータを有する電圧安
定化回路において、シリーズレギユレータ及びス
イツチングレギユレータを互いに独立に動作させ
得るにも拘らず部品点数を大幅に削減できると共
に、シリーズレギユレータ及びスイツチングレギ
ユレータの温度特性のばらつきによる各定電圧特
性のばらつきを低減することのできる回路を提案
しようとするものである。
本考案による定電圧安定化回路は、直流電源Ｂ
及び出力端子Ｔ間にトランジスタＱのエミツタ・
コレクタ間が挿入され、第１の負荷電圧検出電圧
に応じてトランジスタＱのベースバイアスを制御
するようにしたシリーズレギユレータ１と、第２
の負荷電圧検出電圧に応じてパルス幅が制御され
たパルス信号に応じて出力スイツチング素子のス
イツチングが制御されるようにしたスイツチング
レギユレータ２とを備えた電圧安定化回路におい
て、第１の負荷電圧検出電圧を第１の基準電圧と
比較する第１の比較回路７と、その比較出力に応
じたパルス幅のパルス信号を発生する第１のパル
ス幅変調器１０と、第２の負荷電圧検出電圧を第
２の基準電圧と比較する第２の比較回路８と、そ
の比較出力に応じたパルス幅のパルス信号を発生
する第２のパルス幅変調器１１とを１つの集積回
路内に形成した制御回路５と、第１のパルス幅変
調器１０よりのパルス信号を平滑して、シリーズ
レギユレータ１のトランジスタＱのベースに供給
する平滑回路１５とを設けて成り、第２のパルス
幅変調器１１よりのパルス信号に基づいて、スイ
ツチングレギユレータ２の出力スイツチング素子
のスイツチングを制御するようにしたものであ
る。
及び出力端子Ｔ間にトランジスタＱのエミツタ・
コレクタ間が挿入され、第１の負荷電圧検出電圧
に応じてトランジスタＱのベースバイアスを制御
するようにしたシリーズレギユレータ１と、第２
の負荷電圧検出電圧に応じてパルス幅が制御され
たパルス信号に応じて出力スイツチング素子のス
イツチングが制御されるようにしたスイツチング
レギユレータ２とを備えた電圧安定化回路におい
て、第１の負荷電圧検出電圧を第１の基準電圧と
比較する第１の比較回路７と、その比較出力に応
じたパルス幅のパルス信号を発生する第１のパル
ス幅変調器１０と、第２の負荷電圧検出電圧を第
２の基準電圧と比較する第２の比較回路８と、そ
の比較出力に応じたパルス幅のパルス信号を発生
する第２のパルス幅変調器１１とを１つの集積回
路内に形成した制御回路５と、第１のパルス幅変
調器１０よりのパルス信号を平滑して、シリーズ
レギユレータ１のトランジスタＱのベースに供給
する平滑回路１５とを設けて成り、第２のパルス
幅変調器１１よりのパルス信号に基づいて、スイ
ツチングレギユレータ２の出力スイツチング素子
のスイツチングを制御するようにしたものであ
る。
かかる本考案によれば、制御回路５の第１のパ
ルス幅変調器１０よりのパルス信号が平滑回路１
５によつて平滑されてトランジスタＱのベースに
供給されることにより、シリーズレギユレータ１
より定電圧が出力されると共に、第２のパルス幅
変調器１１よりのパルス信号に基づいて、スイツ
チングレギユレータ２の出力スイツチング素子の
スイツチングが制御されて定電圧が出力され、そ
の各定電圧は独立に得られる。
ルス幅変調器１０よりのパルス信号が平滑回路１
５によつて平滑されてトランジスタＱのベースに
供給されることにより、シリーズレギユレータ１
より定電圧が出力されると共に、第２のパルス幅
変調器１１よりのパルス信号に基づいて、スイツ
チングレギユレータ２の出力スイツチング素子の
スイツチングが制御されて定電圧が出力され、そ
の各定電圧は独立に得られる。
以下に第１図を参照して、本考案による電圧安
定化回路の一例について説明する。１はシリーズ
レギユレータ、２はスイツチングレギユレータを
夫々示し、両者の出力回路をスイツチングレギユ
レータ用の制御回路で制御するようにしている。
先ず、シリーズレギユレータ１の出力回路３につ
いて説明する。Ｂは直流電源であつて、これより
Ｅ（Ｖ）の入力直流電圧が得られる。Ｔは、安定
化された出力直流電圧の得られる出力端子であ
る。直流電源Ｂには並列に、リツプル除去用のコ
ンデンサＣが接続されている。直流電源Ｂの正極
はPNP型のトランジスタのエミツタに接続され、
そのコレクタが出力端子Ｔに接続される。トラン
ジスタＱのエミツタ・ベース間に、ベースバイア
ス用の抵抗器R1が接続される。出力端子Ｔと接
地との間には、平滑用コンデンサC2が接続され
る。RLは、出力端子Ｔ及び接地間に接続された
負荷を示す。トランジスタＱのコレクタ及び接地
間に、抵抗器R2及びR3の直列回路が接続され、
その接続中点より負荷電圧検出電圧が得られるよ
うになされている。
定化回路の一例について説明する。１はシリーズ
レギユレータ、２はスイツチングレギユレータを
夫々示し、両者の出力回路をスイツチングレギユ
レータ用の制御回路で制御するようにしている。
先ず、シリーズレギユレータ１の出力回路３につ
いて説明する。Ｂは直流電源であつて、これより
Ｅ（Ｖ）の入力直流電圧が得られる。Ｔは、安定
化された出力直流電圧の得られる出力端子であ
る。直流電源Ｂには並列に、リツプル除去用のコ
ンデンサＣが接続されている。直流電源Ｂの正極
はPNP型のトランジスタのエミツタに接続され、
そのコレクタが出力端子Ｔに接続される。トラン
ジスタＱのエミツタ・ベース間に、ベースバイア
ス用の抵抗器R1が接続される。出力端子Ｔと接
地との間には、平滑用コンデンサC2が接続され
る。RLは、出力端子Ｔ及び接地間に接続された
負荷を示す。トランジスタＱのコレクタ及び接地
間に、抵抗器R2及びR3の直列回路が接続され、
その接続中点より負荷電圧検出電圧が得られるよ
うになされている。
次に上述の出力回路３を制御するスイツチング
レギユレータ用の制御回路５の概要について説明
する。これはテキサスインスツルメンツ社製のデ
ユアル・スイツチング・レギユレータ・コントロ
ールIC（TL1451）である。６は、直流電源Ｂよ
りの直流電圧を受けて、基準電圧を発生する基準
電圧発生回路である。９は三角波発振器で、抵抗
器ｒ、コンデンサｃが外付けされる。７，８は一
対のレベル比較回路であつて、その各比較出力が
一対のパルス幅変調器１０，１１に夫々供給され
ると共に、三角波発振器９よりの三角波信号がパ
ルス幅変調器１０，１１に共通に供給されてレベ
ル比較され、これより比較回路７，８の比較出力
に応じたデユーテイのパルス信号が出力される。
パルス幅変調器１０，１１よりの各パルス信号が
出力トランジスタ１２，１３の各ベースに夫々供
給される。トランジスタ１２のエミツタは夫々接
地される。１４は保護回路であつて、詳細の図示
を省略するも、過負荷時及び入力直流電圧の過大
低下時に、これを検出して、トランジスタ１２，
１３のベースに供給されるパルス信号のデユーテ
イを零、即ちトランジスタ１２，１３をオフにす
るものである。
レギユレータ用の制御回路５の概要について説明
する。これはテキサスインスツルメンツ社製のデ
ユアル・スイツチング・レギユレータ・コントロ
ールIC（TL1451）である。６は、直流電源Ｂよ
りの直流電圧を受けて、基準電圧を発生する基準
電圧発生回路である。９は三角波発振器で、抵抗
器ｒ、コンデンサｃが外付けされる。７，８は一
対のレベル比較回路であつて、その各比較出力が
一対のパルス幅変調器１０，１１に夫々供給され
ると共に、三角波発振器９よりの三角波信号がパ
ルス幅変調器１０，１１に共通に供給されてレベ
ル比較され、これより比較回路７，８の比較出力
に応じたデユーテイのパルス信号が出力される。
パルス幅変調器１０，１１よりの各パルス信号が
出力トランジスタ１２，１３の各ベースに夫々供
給される。トランジスタ１２のエミツタは夫々接
地される。１４は保護回路であつて、詳細の図示
を省略するも、過負荷時及び入力直流電圧の過大
低下時に、これを検出して、トランジスタ１２，
１３のベースに供給されるパルス信号のデユーテ
イを零、即ちトランジスタ１２，１３をオフにす
るものである。
しかして、シリーズレギユレータ３の出力回路
４の抵抗器R2，R3の接続中点よりの負荷電圧検
出電圧が、制御回路５の比較回路７に供給され
る。そして、基準電圧発生回路６よりの基準電圧
が抵抗器Ra，Rbの直列回路の両端に印加され、
その接続中点よりの基準電圧が比較回路７に供給
される。比較回路７の比較出力がパルス幅変調器
１０に供給されて三角波発振器９よりの三角波と
比較され、これより得られたパルス信号が出力ト
ランジスタ１２のベースに供給される。トランジ
スタ１２のコレクタよりのパルス信号が、抵抗器
R4，R5及びコンデンサC1からなるＴ型の平滑回
路１５に供給されて平滑され、その平滑出力がト
ランジスタＱのベースに供給される。
４の抵抗器R2，R3の接続中点よりの負荷電圧検
出電圧が、制御回路５の比較回路７に供給され
る。そして、基準電圧発生回路６よりの基準電圧
が抵抗器Ra，Rbの直列回路の両端に印加され、
その接続中点よりの基準電圧が比較回路７に供給
される。比較回路７の比較出力がパルス幅変調器
１０に供給されて三角波発振器９よりの三角波と
比較され、これより得られたパルス信号が出力ト
ランジスタ１２のベースに供給される。トランジ
スタ１２のコレクタよりのパルス信号が、抵抗器
R4，R5及びコンデンサC1からなるＴ型の平滑回
路１５に供給されて平滑され、その平滑出力がト
ランジスタＱのベースに供給される。
次にスイツチングレギユレータ２について説明
する。４は出力回路であつて、図示せざるもスイ
ツチング素子、トランス、コンデンサ、整流回
路、平滑回路等を有する。この出力回路３は電圧
安定化された例えば４つの異なる出力直流電圧を
発生する出力端子T1，T2，T3及びT4を有し、
夫々に負荷RL1，RL2，RL3及びRL4が接地との
間に夫々接続されている。そして、例えば出力端
子T4と接地と間に抵抗器RA，RBの直列回路が接
続され、その接続中点より負荷電圧検出電圧が得
られて、制御回路５の比較回路８に供給される。
基準電圧発生回路６よりの電圧が、抵抗器Rc，
Rdの直列回路の両端に印加され、その接続中点
よりの基準電圧が比較回路８に供給される。比較
回路８よりの比較出力がパルス幅変調器１１に供
給されて、三角波発振器９よりの三角波と比較さ
れ、これより得られたパルス信号が出力用トラン
ジスタ１３のベースに供給される。トランジスタ
１３のコレクタよりパルス信号が得られて、出力
回路４のスイツチング素子に供給される。
する。４は出力回路であつて、図示せざるもスイ
ツチング素子、トランス、コンデンサ、整流回
路、平滑回路等を有する。この出力回路３は電圧
安定化された例えば４つの異なる出力直流電圧を
発生する出力端子T1，T2，T3及びT4を有し、
夫々に負荷RL1，RL2，RL3及びRL4が接地との
間に夫々接続されている。そして、例えば出力端
子T4と接地と間に抵抗器RA，RBの直列回路が接
続され、その接続中点より負荷電圧検出電圧が得
られて、制御回路５の比較回路８に供給される。
基準電圧発生回路６よりの電圧が、抵抗器Rc，
Rdの直列回路の両端に印加され、その接続中点
よりの基準電圧が比較回路８に供給される。比較
回路８よりの比較出力がパルス幅変調器１１に供
給されて、三角波発振器９よりの三角波と比較さ
れ、これより得られたパルス信号が出力用トラン
ジスタ１３のベースに供給される。トランジスタ
１３のコレクタよりパルス信号が得られて、出力
回路４のスイツチング素子に供給される。
次にこの電圧安定化回路の動作を説明しよう。
シリーズレギユレータ１においては、負荷電圧が
低くなると、パルス幅変調器１０より、第２図Ａ
に示す如きデユーテイの小さなパルス信号が得ら
れ、これが出力トランジスタ１３によつて増幅さ
れて平滑回路１５に供給される。これによりトラ
ンジスタＱのベースには、第２図Ｂに示す如きレ
ベルの低い直流電圧が印加される。このため、ト
ランジスタＱのエミツタ・コレクタ間インピーダ
ンスが低下して、負荷電圧の低下を抑えてこれを
一定にする。又、負荷電圧が高くなると、パルス
幅変調器１０より第２図Ｃに示すごときデユーテ
イの大なるパルス信号が得られ、これが出力トラ
ンジスタ１２によつて増幅されて、平滑回路１５
に供給される。これにより、トランジスタＱのベ
ースには、第２図Ｄに示す如きレベルの高い直流
電圧が印加される。このためトランジスタＱのエ
ミツタ・コレクタ間インピーダンスが上昇して、
負荷電圧の増大を抑えてこれを一定にする。
シリーズレギユレータ１においては、負荷電圧が
低くなると、パルス幅変調器１０より、第２図Ａ
に示す如きデユーテイの小さなパルス信号が得ら
れ、これが出力トランジスタ１３によつて増幅さ
れて平滑回路１５に供給される。これによりトラ
ンジスタＱのベースには、第２図Ｂに示す如きレ
ベルの低い直流電圧が印加される。このため、ト
ランジスタＱのエミツタ・コレクタ間インピーダ
ンスが低下して、負荷電圧の低下を抑えてこれを
一定にする。又、負荷電圧が高くなると、パルス
幅変調器１０より第２図Ｃに示すごときデユーテ
イの大なるパルス信号が得られ、これが出力トラ
ンジスタ１２によつて増幅されて、平滑回路１５
に供給される。これにより、トランジスタＱのベ
ースには、第２図Ｄに示す如きレベルの高い直流
電圧が印加される。このためトランジスタＱのエ
ミツタ・コレクタ間インピーダンスが上昇して、
負荷電圧の増大を抑えてこれを一定にする。
スイツチングレギユレータ２においては、出力
端子T4よりの負荷電圧の大小に応じて、パルス
幅変調器１１よりのパルス信号のデユーテイが変
化し、このパルス信号が増幅器１３によつて増幅
された後出力回路３に供給され、その内部のスイ
ツチング素子にスイツチング信号として供給され
る。そして、出力端子T1〜T4の負荷電圧が一定
となるように、スイツチング素子のオンオフの期
間が制御される。
端子T4よりの負荷電圧の大小に応じて、パルス
幅変調器１１よりのパルス信号のデユーテイが変
化し、このパルス信号が増幅器１３によつて増幅
された後出力回路３に供給され、その内部のスイ
ツチング素子にスイツチング信号として供給され
る。そして、出力端子T1〜T4の負荷電圧が一定
となるように、スイツチング素子のオンオフの期
間が制御される。
上述せる本考案によれば、シリーズレギユレー
タ及びスイツチングレギユレータを有する電圧安
定化回路において、シリーズレギユレータ及びス
イツチングレギユレータを互いに独立に動作させ
得るにも拘らず部品点数を大幅に削減できると共
に、シリーズレギユレータ及びスイツチングレギ
ユレータの温度特性のばらつきによる各定電圧特
性のばらつきを低減することのできる回路を得る
ことができる。
タ及びスイツチングレギユレータを有する電圧安
定化回路において、シリーズレギユレータ及びス
イツチングレギユレータを互いに独立に動作させ
得るにも拘らず部品点数を大幅に削減できると共
に、シリーズレギユレータ及びスイツチングレギ
ユレータの温度特性のばらつきによる各定電圧特
性のばらつきを低減することのできる回路を得る
ことができる。
スイツチングレギユレータ用の制御回路に上述
の如き保護回路が設けられている場合には、スイ
ツチングレギユレータ及びシリーズレギユレータ
において、過負荷時及び入力直流電圧の過大低下
時において、各出力回路の夫々可変インピーダン
ス素子、スイツチング素子を破壊から保護するこ
とができる。
の如き保護回路が設けられている場合には、スイ
ツチングレギユレータ及びシリーズレギユレータ
において、過負荷時及び入力直流電圧の過大低下
時において、各出力回路の夫々可変インピーダン
ス素子、スイツチング素子を破壊から保護するこ
とができる。
第１図は本考案の電圧安定化回路の一例を示す
回路図、第２図はその説明に供する波形図であ
る。 １はシリーズレギユレータ、２はスイツチング
レギユレータ、３はシリーズレギユレータの出力
回路、４はスイツチングレギユレータの出力回
路、５は制御回路、６は基準電圧発生回路、７，
８は比較回路、９は三角波発振器、１０，１１は
パルス幅変調器、１５は平滑回路、Ｑはトランジ
スタである。
回路図、第２図はその説明に供する波形図であ
る。 １はシリーズレギユレータ、２はスイツチング
レギユレータ、３はシリーズレギユレータの出力
回路、４はスイツチングレギユレータの出力回
路、５は制御回路、６は基準電圧発生回路、７，
８は比較回路、９は三角波発振器、１０，１１は
パルス幅変調器、１５は平滑回路、Ｑはトランジ
スタである。
Claims (1)
- 【実用新案登録請求の範囲】 直流電源及び出力端子間にトランジスタのエミ
ツタ・コレクタ間が挿入され、第１の負荷電圧検
出電圧に応じて上記トランジスタのベースバイア
スを制御するようにしたシリーズレギユレータ
と、 第２の負荷電圧検出電圧に応じてパルス幅が制
御されたパルス信号に応じて出力スイツチング素
子のスイツチングが制御されるようにしたスイツ
チングレギユレータとを備えた電圧安定化回路に
おいて、 上記第１の負荷電圧検出電圧を第１の基準電圧
と比較する第１の比較回路と、その比較出力に応
じたパルス幅のパルス信号を発生する第１のパル
ス幅変調器と、上記第２の負過電圧検出電圧を第
２の基準電圧と比較する第２の比較回路と、その
比較出力に応じたパルス幅のパルス信号を発生す
る第２のパルス幅変調器とを１つの集積回路内に
形成した制御回路と、 上記第１のパルス幅変調器よりのパルス信号を
平滑して、上記シリーズレギユレータの上記トラ
ンジスタのベースに供給する平滑回路とを設けて
成り、 上記第２のパルス幅変調器よりのパルス信号に
基づいて、上記スイツチングレギユレータの上記
出力スイツチング素子のスイツチングを制御する
ようにして成る電圧安定化回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1985058397U JPH0530179Y2 (ja) | 1985-04-19 | 1985-04-19 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1985058397U JPH0530179Y2 (ja) | 1985-04-19 | 1985-04-19 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61176615U JPS61176615U (ja) | 1986-11-04 |
| JPH0530179Y2 true JPH0530179Y2 (ja) | 1993-08-02 |
Family
ID=30583856
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1985058397U Expired - Lifetime JPH0530179Y2 (ja) | 1985-04-19 | 1985-04-19 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0530179Y2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS592573Y2 (ja) * | 1978-02-28 | 1984-01-24 | ソニー株式会社 | 定電圧電源回路 |
-
1985
- 1985-04-19 JP JP1985058397U patent/JPH0530179Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61176615U (ja) | 1986-11-04 |
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