JPH05264648A - Ｉｃテスタの容量負荷制御回路 - Google Patents

Ｉｃテスタの容量負荷制御回路

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Publication number
JPH05264648A
JPH05264648A JP4093618A JP9361892A JPH05264648A JP H05264648 A JPH05264648 A JP H05264648A JP 4093618 A JP4093618 A JP 4093618A JP 9361892 A JP9361892 A JP 9361892A JP H05264648 A JPH05264648 A JP H05264648A
Authority
JP
Japan
Prior art keywords
capacitive load
switch
mode
control circuit
turned
Prior art date
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Pending
Application number
JP4093618A
Other languages
English (en)
Inventor
Toshiki Nakamura
敏樹 中村
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Ando Electric Co Ltd
Original Assignee
Ando Electric Co Ltd
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Filing date
Publication date
Application filed by Ando Electric Co Ltd filed Critical Ando Electric Co Ltd
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Abstract

(57)【要約】 【目的】 容量負荷５をスイッチ２のオン・オフのタイ
ミングに同期させて接続状態と非接続状態にし、Ｏモー
ドからＩモードにリアルタイムに切り換えてもＩモード
のときに容量負荷５を非接続状態にする。 【構成】 制御信号１２をスイッチ２のオンオフと同期
させ、ＴＲ６Ａは制御信号１２でオンになる。ＴＲ６Ｂ
は容量負荷５に接続され、ＴＲ６Ａのオンオフでオンオ
フする。ＯモードのときはＴＲ６Ｂをオンにして容量負
荷５を接続状態にし、ＩモードのときはＴＲ６Ｂをオフ
にして容量負荷５を非接続状態にする。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明は、測定されるＩＣ（以
下、ＤＵＴという。）の出力端子に容量負荷を接続して
ＤＵＴの測定する場合に、Ｉモードのときは容量負荷を
非接続状態にする容量負荷制御回路についてのものであ
る。
【０００２】
【従来の技術】次に、従来技術によるＩＣテスタの構成
を図２により説明する。図２の１はドライバ、２はスイ
ッチ、３は比較器、４はＤＵＴ、５は容量負荷である。
ドライバ１には信号１１が入力され、スイッチ２にはド
ライバ１の出力が入力される。スイッチ２の出力には比
較器３、ＤＵＴ４、容量負荷５が接続される。ドライバ
１からＤＵＴ４へ信号を加える状態をＩモードといい、
ＤＵＴ４の出力信号を比較器３で判定する状態をＯモー
ドという。Ｉモードではスイッチ２をオン、Ｏモードで
はスイッチ２をオフにする。
【０００３】
【発明が解決しようとする課題】図２では、Ｉモードで
もＤＵＴ４に容量負荷５が接続されている。このため、
ドライバ１からＤＵＴ４に加える信号が容量負荷５によ
る周波数特性の劣化とインピーダンス不整合によるリン
ギングをうけ、高速レイトでのテストができない。
【０００４】この発明は、容量負荷５をスイッチ２のオ
ン・オフのタイミングに同期させて接続状態と非接続状
態にし、ＯモードからＩモードにリアルタイムに切り換
えてもＩモードのときに容量負荷５を非接続状態にする
容量負荷制御回路の提供を目的とする。
【０００５】
【課題を解決するための手段】この目的を達成するた
め、この発明では、制御信号１２をスイッチ２のオンオ
フに同期させ、制御信号１２でオンになるトランジスタ
（以下、ＴＲという。）６Ａと、容量負荷５に接続さ
れ、ＴＲ６ＡのオンオフでオンオフするＴＲ６Ｂとを備
え、ＯモードのときはＴＲ６Ａをオンにして容量負荷５
を接続状態にし、ＩモードのときはＴＲ６Ａをオフにし
て容量負荷５を非接続状態にする。
【０００６】
【作用】次に、この発明によるＩＣテスタの容量負荷制
御回路の構成を図１により説明する。図１の６は容量負
荷制御回路であり、その他は図２と同じものである。容
量負荷制御回路６は容量負荷５に接続され、ＴＲ６Ａ・
６Ｂ、ダイオード６Ｃ・６Ｄ・６Ｅで構成される。
【０００７】スイッチ２のオンオフに同期した制御信号
１２をＴＲ６Ａに供給する。ＴＲ６Ａがオンになると、
ダイオード６Ｃ・６Ｄがオンになる。ダイオード６Ｃ・
６Ｄがオンになると、ＴＲ６Ｂがオンになり、ダイオー
ド６Ｅがオンになる。これにより、容量負荷５が接続状
態になる。ＴＲ６Ａがオフのときは、ダイオード６Ｃ・
６Ｄ・６ＥとＴＲ６Ｂがオフになり、容量負荷５は非接
続状態になる。
【０００８】
【発明の効果】この発明によれば、容量負荷をスイッチ
のオン・オフのタイミングに同期させて接続状態と非接
続状態にするので、ＯモードからＩモードにリアルタイ
ムに切り換えてもＩモードのときに容量負荷５を非接続
状態にすることができる。また、低出力インピーダンス
のため、容量負荷を制御する制御回路の抵抗分の影響が
ほとんどないという効果がある。
【図面の簡単な説明】
【図１】この発明によるＩＣテスタの容量負荷制御回路
の構成図である。
【図２】従来技術によるＩＣテスタの構成図である。
【符号の説明】
１ ドライバ ２ スイッチ ３ 比較器 ４ ＤＵＴ ５ 容量負荷 ６ 容量負荷制御回路 ６Ａ・６Ｂ ＴＲ（トランジスタ） ６Ｃ・６Ｄ・６Ｅ ダイオード

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】 信号(11)が入力されるドライバ(1) と、
    ドライバ(1) の出力が入力されるスイッチ(2) と、スイ
    ッチ(2) の出力に接続される比較器(3) と、スイッチ
    (2) の出力に接続されるＤＵＴ(4) と、スイッチ(2) の
    出力に接続される容量負荷(5) とで構成され、Ｉモード
    のときはスイッチ(2) をオンにしてドライバ(1) から信
    号(11)をＤＵＴ４に加え、Ｏモードのときはスイッチ
    (2) をオフにしてＤＵＴ４の出力を比較器(3) で比較す
    るＩＣテスタにおいて、 制御信号(12)をスイッチ(2) のオンオフに同期させ、制
    御信号(12)でオンになる第１のトランジスタ(6A)と、 容量負荷(5) に接続され、第１のトランジスタ(6A)のオ
    ンオフでオンオフする第２のトランジスタ(6B)とを備
    え、 Ｏモードのときは第１のトランジスタ(6A)をオンにして
    容量負荷(5) を接続状態にし、Ｉモードのときは第１の
    トランジスタ(6A)をオフにして容量負荷(5) を非接続状
    態にすることを特徴とするＩＣテスタの容量負荷制御回
    路。
JP4093618A 1992-03-19 1992-03-19 Ｉｃテスタの容量負荷制御回路 Pending JPH05264648A (ja)

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JPH05264648A true JPH05264648A (ja) 1993-10-12

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Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6332588U (ja) * 1986-08-21 1988-03-02
JPH0363058A (ja) * 1989-08-01 1991-03-19 Matsushita Seiko Co Ltd 香り発生装置
JPH0388541U (ja) * 1989-12-27 1991-09-10
JPH0435439U (ja) * 1990-07-24 1992-03-25
JPH05237257A (ja) * 1992-02-28 1993-09-17 Ace Denken:Kk 体感式遊技機

Patent Citations (5)

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