JPH05250074A - マイクロコンピュータ - Google Patents
マイクロコンピュータInfo
- Publication number
- JPH05250074A JPH05250074A JP4084465A JP8446592A JPH05250074A JP H05250074 A JPH05250074 A JP H05250074A JP 4084465 A JP4084465 A JP 4084465A JP 8446592 A JP8446592 A JP 8446592A JP H05250074 A JPH05250074 A JP H05250074A
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- JP
- Japan
- Prior art keywords
- power supply
- circuit
- voltage
- external power
- power source
- Prior art date
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- Pending
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- Microcomputers (AREA)
Abstract
(57)【要約】
【目的】 スタンバイ（ホールド）時における消費電流
を削減する。 【構成】 通常動作時は外部電源端子ＶDDに接続されて
いる外部電源ラインから各部に電力が供給される。ホー
ルド時には、ＣＰＵ６は電源切換信号線１２を介して電
源切換回路２に切換信号を送る。切換回路２は内部電源
発生回路１１の発生する低電圧を発振器用インバータ
４、タイミングジェネレータ５、周辺回路７に印加す
る。
を削減する。 【構成】 通常動作時は外部電源端子ＶDDに接続されて
いる外部電源ラインから各部に電力が供給される。ホー
ルド時には、ＣＰＵ６は電源切換信号線１２を介して電
源切換回路２に切換信号を送る。切換回路２は内部電源
発生回路１１の発生する低電圧を発振器用インバータ
４、タイミングジェネレータ５、周辺回路７に印加す
る。
Description
【０００１】
【産業上の利用分野】本発明は、マイクロコンピュータ
に関し、特にホールド状態での消費電流を削減せしめた
マイクロコンピュータに関する。
に関し、特にホールド状態での消費電流を削減せしめた
マイクロコンピュータに関する。
【０００２】
【従来の技術】従来のマイクロコンピュータでは、命令
を実行しているＲＵＮ状態と命令を実行しないホールド
状態とで電源系を切り換えることはなく、例えば電源が
５Ｖ系ならばＲＵＮ状態でもホールド状態でも常に５Ｖ
が供給されていた。しかしホールド状態では命令を実行
しないため、ＲＵＮ状態に比べれば消費電流は少なくな
る。
を実行しているＲＵＮ状態と命令を実行しないホールド
状態とで電源系を切り換えることはなく、例えば電源が
５Ｖ系ならばＲＵＮ状態でもホールド状態でも常に５Ｖ
が供給されていた。しかしホールド状態では命令を実行
しないため、ＲＵＮ状態に比べれば消費電流は少なくな
る。
【０００３】
【発明が解決しようとする課題】従来のマイクロコンピ
ュータでは、ＲＵＮ時とホールド状態時とで同じ電源電
圧により駆動していたため、ホールド時に消費電流は少
なくなるものの電池駆動などのセットにおいては、十分
低い値とは言えず、より一層の低消費電流化が望まれて
いた。
ュータでは、ＲＵＮ時とホールド状態時とで同じ電源電
圧により駆動していたため、ホールド時に消費電流は少
なくなるものの電池駆動などのセットにおいては、十分
低い値とは言えず、より一層の低消費電流化が望まれて
いた。
【０００４】
【課題を解決するための手段】本発明のマイクロコンピ
ュータは、外部電源電圧を降圧する内部電源発生回路を
備え、少なくとも１個の回路ブロックは通常動作時には
外部電源電圧が印加され、ホールド状態時には前記内部
電源発生回路が発生する降圧電圧が印加されるように構
成されている。
ュータは、外部電源電圧を降圧する内部電源発生回路を
備え、少なくとも１個の回路ブロックは通常動作時には
外部電源電圧が印加され、ホールド状態時には前記内部
電源発生回路が発生する降圧電圧が印加されるように構
成されている。
【０００５】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。図１は、本発明の第１の実施例を示すブロ
ック図である。本実施例のマイクロコンピュータは、発
振子入力端子ＸIN、発振子出力端子ＸOUT 、外部電源端
子ＶDD、フィードバック抵抗Ｒ、外部電源ライン１、電
源切換回路２、降圧電源ライン３、発振器用インバータ
４、タイミングジェネレータ５、ＣＰＵ６、周辺回路
７、ＲＯＭ８、ＲＡＭ９、バス１０、内部電源発生回路
１１および電源切換信号線１２を備えている。
て説明する。図１は、本発明の第１の実施例を示すブロ
ック図である。本実施例のマイクロコンピュータは、発
振子入力端子ＸIN、発振子出力端子ＸOUT 、外部電源端
子ＶDD、フィードバック抵抗Ｒ、外部電源ライン１、電
源切換回路２、降圧電源ライン３、発振器用インバータ
４、タイミングジェネレータ５、ＣＰＵ６、周辺回路
７、ＲＯＭ８、ＲＡＭ９、バス１０、内部電源発生回路
１１および電源切換信号線１２を備えている。
【０００６】この回路で、いまＲＵＮ状態であるものと
すると、各回路ブロックは外部電源端子ＶDDから入力さ
れる外部電源電圧が外部電源ライン１を介して供給され
る。
すると、各回路ブロックは外部電源端子ＶDDから入力さ
れる外部電源電圧が外部電源ライン１を介して供給され
る。
【０００７】ここで、ホールド命令が提起されると、Ｃ
ＰＵ６はホールド状態に入る。このときＣＰＵ６は、電
源切換回路２へ電源切換信号線１２を介して切換信号を
伝達する。電源切換回路２は、インバータ４、タイミン
グジェネレータ５および周辺回路７へ印加される電圧を
内部電源発生回路１１が発生する降圧電圧に切り換え
る。これにより、本マイクロコンピュータのホールド状
態時の消費電流は極限状態にまで削減される。
ＰＵ６はホールド状態に入る。このときＣＰＵ６は、電
源切換回路２へ電源切換信号線１２を介して切換信号を
伝達する。電源切換回路２は、インバータ４、タイミン
グジェネレータ５および周辺回路７へ印加される電圧を
内部電源発生回路１１が発生する降圧電圧に切り換え
る。これにより、本マイクロコンピュータのホールド状
態時の消費電流は極限状態にまで削減される。
【０００８】図２は、本発明の第２の実施例を示すブロ
ック図である。第１の実施例では、ホールド状態で動作
する回路に関して内部電源に切り換えていたが、ホール
ド状態で動作しているすべての回路に専用電源配線を引
き回すことは、チップ面積を拡大しない限り困難であ
る。
ック図である。第１の実施例では、ホールド状態で動作
する回路に関して内部電源に切り換えていたが、ホール
ド状態で動作しているすべての回路に専用電源配線を引
き回すことは、チップ面積を拡大しない限り困難であ
る。
【０００９】ところで、図１の回路で電源電圧が切り換
えられる回路ブロックの内、最も消費電流の大きいブロ
ックは発振器用のインバータ４である。よって、第２の
実施例では、発振用インバータ４のみに電源切換回路を
接続し、ホールド状態における低消費電流化を実現して
いる。
えられる回路ブロックの内、最も消費電流の大きいブロ
ックは発振器用のインバータ４である。よって、第２の
実施例では、発振用インバータ４のみに電源切換回路を
接続し、ホールド状態における低消費電流化を実現して
いる。
【００１０】
【発明の効果】以上説明したように、本発明のマイクロ
コンピュータは、外部電源電圧を降圧する内部電圧発生
回路を備え、ホールド状態時には１乃至複数個の回路ブ
ロックを降圧された電源によって駆動するものであるの
で、ホールド時における消費電流を削減することがで
き、例えば電池駆動のセットであれば、動作時間の長期
化が実現できる。
コンピュータは、外部電源電圧を降圧する内部電圧発生
回路を備え、ホールド状態時には１乃至複数個の回路ブ
ロックを降圧された電源によって駆動するものであるの
で、ホールド時における消費電流を削減することがで
き、例えば電池駆動のセットであれば、動作時間の長期
化が実現できる。
【図１】本発明の第１の実施例を示すブロック図。
【図２】本発明の第２の実施例を示すブロック図。
１…外部電源ライン、 ２…電源切換回路、 ３…
降圧電源ライン、４…発振器用インバータ、 ５…タ
イミングジェネレータ、 ６…ＣＰＵ、７…周辺回
路、 ８…ＲＯＭ、 ９…ＲＡＭ、 １０バス、
１１…内部電源発生回路、 １２…電源切換信号
線、 Ｒ…発振器のフィードバック抵抗、 ＶDD…
外部電源端子、 ＸIN…発振子入力端子、 ＸOUT
…発振子出力端子。
降圧電源ライン、４…発振器用インバータ、 ５…タ
イミングジェネレータ、 ６…ＣＰＵ、７…周辺回
路、 ８…ＲＯＭ、 ９…ＲＡＭ、 １０バス、
１１…内部電源発生回路、 １２…電源切換信号
線、 Ｒ…発振器のフィードバック抵抗、 ＶDD…
外部電源端子、 ＸIN…発振子入力端子、 ＸOUT
…発振子出力端子。
Claims (1)
- 【請求項１】 外部電源電圧を降圧する内部電源発生回
路を備え、少なくとも１個の回路ブロックは通常動作時
には外部電源電圧が印加され、ホールド状態時には前記
内部電源発生回路が発生する降圧電圧が印加されるよう
に構成されているマイクロコンピュータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4084465A JPH05250074A (ja) | 1992-03-06 | 1992-03-06 | マイクロコンピュータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4084465A JPH05250074A (ja) | 1992-03-06 | 1992-03-06 | マイクロコンピュータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05250074A true JPH05250074A (ja) | 1993-09-28 |
Family
ID=13831380
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4084465A Pending JPH05250074A (ja) | 1992-03-06 | 1992-03-06 | マイクロコンピュータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05250074A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100736748B1 (ko) * | 2005-09-14 | 2007-07-09 | 삼성전자주식회사 | 컴퓨터 및 그 제어방법 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03185509A (ja) * | 1989-12-14 | 1991-08-13 | Seiko Instr Inc | 携帯情報機 |
-
1992
- 1992-03-06 JP JP4084465A patent/JPH05250074A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03185509A (ja) * | 1989-12-14 | 1991-08-13 | Seiko Instr Inc | 携帯情報機 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100736748B1 (ko) * | 2005-09-14 | 2007-07-09 | 삼성전자주식회사 | 컴퓨터 및 그 제어방법 |
| US7802122B2 (en) | 2005-09-14 | 2010-09-21 | Samsung Electronics Co., Ltd. | Computer and control method thereof |
| US8635485B2 (en) | 2005-09-14 | 2014-01-21 | Samsung Electronics Co., Ltd. | Computer and control method thereof |
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