JPH05249148A - 集積コンパレータ回路 - Google Patents
集積コンパレータ回路Info
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- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
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- G01R19/00—Arrangements for measuring currents or voltages or for indicating presence or sign thereof
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Abstract
と、主電路に関して直列回路を形成する2つの相補型ト
ランジスタと、第一及び第二の動作電圧端子とを備えた
集積コンパレータ回路において、同種の回路素子のみで
構成して回路素子及びその製造上の公差による特性の変
動をなくす。 【構成】コンパレータ回路は2つの相補型MOSFET
3、4からなるインバータと、2つの相補型MOSFE
T1、2の直列回路を有している。インバータのMOS
FETのゲート端子は直列回路のMOSFETの接続点
10に接続されている。比較すべき電圧Ue は直列回路
と1つの供給電圧端子との間に加えられる。開閉点はM
OSFETの変換特性UGS/ID を調整することによっ
て定められる。
Description
ジスタからなるインバータと、主電路に関して直列回路
を形成する2つの相補型トランジスタと、第一及び第二
の動作電圧端子とを備えた集積コンパレータ回路に関す
る。
ィーツェ・シェンク(Tietze-Schenk)著の「半導体回路
技術(Halbleiterschaltungstechnik)」第7版、140
頁以下に記載されている。この回路はバイポーラトラン
ジスタと、抵抗と、電源とを含んでいる。同一の型のそ
れぞれのコンパレータが同一の特性を持つためには、入
力差働増幅器のトランジスタのパラメータの再現性が良
くなければならない。演算増幅器の開閉点の絶対値はさ
らに電源に関係する。その特性もまた必ずしも常に簡単
かつ再現性よく設定されない。ここに使用される集積抵
抗も同様にその特性が変動する。その上、製造上の変動
もその構造によって異なる構成要素に非常に多様に作用
する。
頭に記載した種類の集積コンパレータ回路であって、電
源及び抵抗を必要とせず、同種の構成素子のみが使用さ
れるものを提供することにある。
コンパレータ回路が次の特徴を有することによって達成
される。即ち、 a)トランジスタがMOS型電界効果トランジスタ(以
下MOSFETと称す)であり、 b)インバータのMOSFETのゲート端子が直列回路
のMOSFETの接続点に接続され、 c)直列回路及びインバータが一方では第一の端子に、
他方では第三の端子もしくは第二の端子にそれぞれ接続
され、 d)第二及び第三の端子は比較すべき電圧の入力端子で
あり、 e)それぞれ第一の端子に接続されたMOSFET及び
第二の端子もしくは第三の端子に接続されたMOSFE
Tが同一のチャネル形である。
下に示されている。
発明を詳しく説明する。この発明の作用は図2の図表に
より説明する。
ネル形MOSFET3とnチャネル形MOSFET4よ
りなるインバータを含んでいる。両MOSFETはドレ
ーン側Dで互いに接続されている。MOSFET3のソ
ース端子Sは端子5に、MOSFET4のソース端子S
は端子6に接続されている。端子5、6には供給電圧V
DDが印加される。MOSFET3及び4のドレーン端子
Dは出力端子7に接続されている。集積コンパレータ回
路はさらに直列接続された2つの相補型MOSFET1
とMOSFET2とを有している。pチャネル形MOS
FET1のソース端子Sは端子5に、nチャネル形MO
SFET2のソース端子Sは第三の端子8に接続されて
いる。MOSFET1及び2のドレーン端子Dは互いに
電気的に接続されている。接続点10はインバータのM
OSFET3及び4のゲート端子Gに接続されている。
直列回路のMOSFET1及び2のゲート端子Gはその
ドレーン端子Dに接続されているので、MOSFET1
及び2はMOSダイオードとして動作する。端子8及び
6は比較すべき電圧Ue の入力端子を形成している。
T2のソース端子Sは0ボルトにある。MOSFET1
及び2は、接続点10に所定の電位を設定する分圧器を
形成している。分圧比はこの場合次のように選ばれてい
る。即ち、Ue =0ボルトの状態においてMOSFET
3がMOSFET4より小さい抵抗を形成するように導
通制御される。そのため端子6、7にかかる電圧はHレ
ベルにある。この状態は図2においてMOSFET1及
び2の変換特性(UGS/ID )の交点A1によって与え
られている。MOSFET1及び2の変換特性は図2で
は同様にそれぞれ1及び2で示されている。インバータ
の開閉点SはMOSFET3及び4の変換特性の交点S
によって与えられている。MOSFET3及び4の変換
特性は図2でそれぞれ3及び4で示されている。
続点10における電位はVDDの方向にずれる。これによ
りMOSFET4はより強く導電性となり、MOSFE
T3の導電性は低下する。従って出力電圧Ua はLレベ
ルに低下する。出力側における負の電圧変移はそれ故、
入力端6、8に電圧Ue がかかっていることを指す。電
圧Ua は次いでシュミットトリガーに導かれる。その出
力信号レベルは論理的に「0」或いは「1」に相当する
ように選ばれている。
った動作閾値を設定するために、MOSFET2と4の
変換特性は異なるように選ばれている。MOSFET1
と3の変換特性は同じにすることもできるが、同じであ
る必要はない。図2の図表ではMOSFET1と3の変
換特性は同じであるが、MOSFET2はMOSFET
4の変換特性よりも急峻な変換特性を持っている。従っ
て0ボルトより大きい動作閾値ΔUが得られる。電圧U
e を印加することにより変換特性はインバータの出力端
子6、7における前記の両状態とはっきり区別できる範
囲にずれる。MOSFET2のずれた伝達特性は図2に
は破線2 で示されている。
FET4の変換特性が同一であることも考えられる。し
かしながらこの場合にはコンパレータ回路はUe =0で
動作することになる。
のソース端子Sと端子5との間に電圧Ue を印加するこ
とも可能である。この場合MOSFET1の変換特性を
MOSFET3の変換特性より急峻にするのがよい。M
OSFET2と4の変換特性は同じにすることもできる
が、同じである必要はない。
のチャネル形のものが使用される。
ゲート端子G及びドレーン端子Dは互いに接続されてい
る。しかしながらゲート端子は固定電位におくこともで
きる。
パラメータが同一の場合、例えばMOSFETのチャネ
ル幅の変更によって設定される。図1の実施例ではそれ
故MOSFET2のチャネル幅はMOSFET4のチャ
ネル幅よりも大きく設定され得る。MOSFET1と3
のチャネル幅は同じにすることができる。集積コンパレ
ータ回路のすべてのMOSFETが同じ製造条件で作ら
れることによって製造プロセスにおける変動はすべて4
つのMOSFETの特性に同じ程度に作用する。これに
より集積コンパレータ回路のパラメータが良好に維持さ
れ、同一型のインバータの開閉点が製造上の変動には実
質的に無関係になるという効果がある。
Claims (3)
- 【請求項1】2つの相補型トランジスタ(3、4)から
なるインバータと、主電路に関して直列回路を形成する
2つの相補型トランジスタ(1、2)と、第一及び第二
の動作電圧端子(5、6)とを備えた集積コンパレータ
回路において、 a)前記トランジスタがMOS型電界効果トランジスタ
(1、2、3、4)であり、 b)前記インバータのMOS型電界効果トランジスタ
(3、4)のゲート端子が直列回路のMOS型電界効果
トランジスタ(1、2)の接続点(10)に接続され、 c)前記直列回路及びインバータが一方で第一の端子
(5)と、他方で第三の端子(8)もしくは第二の端子
(6)にそれぞれ接続され、 d)第二及び第三の端子(6、8)は比較すべき電圧
(Ue )の入力端子であり、 e)それぞれ第一の端子(5)に接続されたMOS型電
界効果トランジスタ(1、3)及び第二の端子(6)も
しくは第三の端子(8)に接続されたMOS型電界効果
トランジスタ(2、4)が同一のチャネル形である、こ
とを特徴とする集積コンパレータ回路。 - 【請求項2】直列回路の電界効果トランジスタ(1、
2)のゲート端子及びドレーン端子が互いに接続されて
いることを特徴とする請求項1記載の集積コンパレータ
回路。 - 【請求項3】第一の端子(5)に接続されたMOS型電
界効果トランジスタ(1、3)の変換特性(UGS/
ID )が同じで、第三の端子(8)に接続されたMOS
型電界効果トランジスタ(2)の変換特性は第二の端子
(6)に接続されたMOS型電界効果トランジスタ
(4)の変換特性より急峻であることを特徴とする請求
項1記載の集積コンパレータ回路。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE4138860A DE4138860C1 (ja) | 1991-11-26 | 1991-11-26 | |
DE4138860.7 | 1991-11-26 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH05249148A true JPH05249148A (ja) | 1993-09-28 |
JP3249608B2 JP3249608B2 (ja) | 2002-01-21 |
Family
ID=6445619
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP33557292A Expired - Lifetime JP3249608B2 (ja) | 1991-11-26 | 1992-11-20 | 集積コンパレータ回路 |
Country Status (4)
Country | Link |
---|---|
US (1) | US5434521A (ja) |
EP (1) | EP0544143B1 (ja) |
JP (1) | JP3249608B2 (ja) |
DE (2) | DE4138860C1 (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8314638B2 (en) | 2009-02-17 | 2012-11-20 | Renesas Electronics Corporation | Comparator circuit |
JP2021082861A (ja) * | 2019-11-14 | 2021-05-27 | 富士電機株式会社 | コンパレータ |
Families Citing this family (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR950012079A (ko) * | 1993-10-29 | 1995-05-16 | 발도르프, 옴케 | 집적 비교기 회로 |
EP0753754A3 (de) * | 1995-07-12 | 1998-01-07 | Siemens Aktiengesellschaft | Integrierte Komparatorschaltung |
DE19530481C1 (de) * | 1995-08-18 | 1997-03-27 | Siemens Ag | Integrierbare Komparatorschaltung mit einstellbarer Ansprechschwelle |
DE10350596B4 (de) * | 2003-10-30 | 2007-01-04 | Infineon Technologies Ag | Komparator und auf dem Komparator basierender Analog-Digital-Wandler |
TW200813444A (en) * | 2006-09-13 | 2008-03-16 | Advanced Analog Technology Inc | Negative voltage detector |
US10734985B2 (en) * | 2018-12-17 | 2020-08-04 | Qualcomm Incorporated | Comparators for power and high-speed applications |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3270832D1 (en) * | 1982-02-06 | 1986-06-05 | Itt Ind Gmbh Deutsche | Integrated comparator circuit |
JPS60124124A (ja) * | 1983-12-08 | 1985-07-03 | Nec Corp | 入力回路 |
US4709172A (en) * | 1985-08-19 | 1987-11-24 | Dallas Semiconductor Corporation | Input-voltage detector circuit for CMOS integrated circuit |
JPH0756931B2 (ja) * | 1988-04-18 | 1995-06-14 | 三菱電機株式会社 | 閾値制御型電子装置およびそれを用いた比較器 |
EP0360884A1 (de) * | 1988-09-26 | 1990-04-04 | Siemens Aktiengesellschaft | CMOS-Differentialkomparator mit Offsetspannung |
DE3906482A1 (de) * | 1989-03-01 | 1990-09-06 | Siemens Ag | Signalpegelwandler zur umsetzung von ttl- auf cmos-logik-signalpegeln |
US5274275A (en) * | 1991-03-29 | 1993-12-28 | Brooktree Corporation | Comparator |
US5289054A (en) * | 1992-03-24 | 1994-02-22 | Intel Corporation | Fast electronic comparator |
US5287070A (en) * | 1992-09-02 | 1994-02-15 | Ncr Corporation | Balanced voltage comparator |
-
1991
- 1991-11-26 DE DE4138860A patent/DE4138860C1/de not_active Expired - Fee Related
-
1992
- 1992-11-10 DE DE59208956T patent/DE59208956D1/de not_active Expired - Lifetime
- 1992-11-10 EP EP92119216A patent/EP0544143B1/de not_active Expired - Lifetime
- 1992-11-19 US US07/978,637 patent/US5434521A/en not_active Expired - Lifetime
- 1992-11-20 JP JP33557292A patent/JP3249608B2/ja not_active Expired - Lifetime
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8314638B2 (en) | 2009-02-17 | 2012-11-20 | Renesas Electronics Corporation | Comparator circuit |
JP2021082861A (ja) * | 2019-11-14 | 2021-05-27 | 富士電機株式会社 | コンパレータ |
Also Published As
Publication number | Publication date |
---|---|
JP3249608B2 (ja) | 2002-01-21 |
DE59208956D1 (de) | 1997-11-13 |
EP0544143A2 (de) | 1993-06-02 |
EP0544143B1 (de) | 1997-10-08 |
EP0544143A3 (en) | 1993-07-21 |
US5434521A (en) | 1995-07-18 |
DE4138860C1 (ja) | 1993-06-03 |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20011004 |
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Free format text: PAYMENT UNTIL: 20111109 Year of fee payment: 10 |
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S111 | Request for change of ownership or part of ownership |
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R350 | Written notification of registration of transfer |
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Free format text: PAYMENT UNTIL: 20111109 Year of fee payment: 10 |
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