JPH05211268A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPH05211268A
JPH05211268A JP4007174A JP717492A JPH05211268A JP H05211268 A JPH05211268 A JP H05211268A JP 4007174 A JP4007174 A JP 4007174A JP 717492 A JP717492 A JP 717492A JP H05211268 A JPH05211268 A JP H05211268A
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JP
Japan
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lead
chip
semiconductor chip
wire
package
Prior art date
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Withdrawn
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JP4007174A
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English (en)
Inventor
Wataru Kikuchi
渉 菊地
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NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPH05211268A publication Critical patent/JPH05211268A/ja
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    • HELECTRICITY
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    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
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    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
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    • H01L2224/481Disposition
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    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
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    • H01L2224/48465Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch

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  • Wire Bonding (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】 【目的】薄型モールドパッケージは非常に薄いためボン
ディングワイヤーのループ高を十分確保できないため、
ワイヤーのループ形状を精度よく制御しなければならな
い。 【構成】半導体チップ1上まで達するように成形された
リード2の先端と半導体チップの電極パッド6をバンプ
4を介して接着する。また、半導体チップ1は、チップ
固定用リード3に固着され全体がモールド封入されてい
る。 【効果】リード先端を直接電極パッドと接続したのでボ
ンディングのようにワイヤーのループ高を確保する必要
がないため薄型パッケージの組立に適する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体装置に関し、特
に薄型モールドパッケージに適用して有用な半導体装置
の構造に関する。
【0002】
【従来の技術】従来のモールド封入された半導体装置
は、図3に示すようにダイシングされた半導体チップ1
はパッケージに固定するためのチップ固定用リード部9
に、Ag粒子を混入して導電性をもたせたエポキシ系接
着剤10等で接着され、ベークすることで硬化するとい
う性質を利用して固定される。次に外部との信号の入出
力を行うため、半導体チップ1上のボンディングパッド
6とパッケージのリード2間を金ワイヤー等の金属細線
11で接続する。ボンディングを終えたパッケージは、
外気による腐食や汚染を防止し信頼性を保つためにプラ
スチック材7で封入を行いリード成形して完成する。
【0003】現在、半導体装置を組込む装置自体の小
型、薄型化により、SOP(Small Outlin
e Package)等の表面実装タイプのパッケージ
が主流となっている。しかし、さらなる装置の小型・薄
型化やカード等への用途により、半導体装置の薄型化が
要求されるようになってきた。このような情況の中、T
SOP(Thin Small Outline Pa
ckage)等の薄型パッケージの重要性が増してきて
いる。
【0004】
【発明が解決しようとする課題】この従来のモールドパ
ッケージを薄型化するためには、パッケージ厚が1mm
程度と非常に薄いためボンディングワイヤーのループ高
を十分確保できないという問題点がある。単純にボンデ
ィングワイヤーのループ高を低くすると半導体チップ端
とワイヤーが極端に近づくか、最悪の場合は接触してし
まう。従って、ループ高を低くおさえつつ、ボンディン
グワイヤーのループ形状を精度よく制御しなければなら
ない。
【0005】一方、他の解決方法として図3(b)のよ
うに半導体チップ固定位置を下げることでワイヤー高さ
を確保するということも可能である。しかし、この場
合、半導体チップ固定用リードの周囲のモールド厚が薄
くなり、内部クラックが発生しやすくなるという問題が
生じる。
【0006】
【課題を解決するための手段】本発明の半導体装置は、
半導体チップ上まで達するように成形されたリードフレ
ームのリードフレーム先端と半導体チップの電極パッド
をバンプを介して接続し、かつ半導体チップをチップ固
定用リードに固着し、全体をモールド封入したことを特
徴とする。
【0007】
【実施例】次に本発明について図面を参照して説明す
る。図1は本発明の一実施例の半導体装置の断面図であ
る。図2は、モールド封入以前のリード成形のされてい
ない半導体チップ1に対するリードフレームの位置及び
形状を示した平面図である。
【0008】ダイシングされた半導体チップ1は、あら
かじめチップ上の電極パッド6上に銅などでバンプ4を
形成しておく。次にリードフレーム全体を半導体チップ
1上から圧着して、リードフレーム先端と電極パッド6
及びチップ固定用リード3と半導体チップ1を接着す
る。なお、あらかじめ固定用リード3の裏側には接着用
テープ5を貼り付けておく。また、リード先端は電極パ
ッド6との接続のため細く加工している必要がある。
【0009】
【発明の効果】以上説明したように本発明は、リード先
端を直接電極パッドと接続したので、ボンディングのよ
うにワイヤーのループ高を確保する必要がないため薄型
パッケージの組立に適する。
【図面の簡単な説明】
【図1】本発明の一実施例の半導体装置の断面図であ
る。
【図2】半導体チップに対するリードフレームの位置と
形状を示した平面図である。
【図3】(a),(b)は従来の半導体装置を示した断
面図である。
【符号の説明】
1 半導体チップ 2 リードフレーム 3,9 半導体チップ固定用リード 4 バンプ 5 接着テープ 6 電極パッド 7 プラスチック材 8 保護膜 10 接着剤 11 ボンディングワイヤー

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 半導体チップ上まで達するように成形さ
    れたリードフレームのリードフレーム先端と半導体チッ
    プの電極パッドをバンプを介して接続し、かつ半導体チ
    ップをチップ固定用リードに固着し、モールドで封入し
    たことを特徴とする半導体装置。
JP4007174A 1992-01-20 1992-01-20 半導体装置 Withdrawn JPH05211268A (ja)

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Application Number Priority Date Filing Date Title
JP4007174A JPH05211268A (ja) 1992-01-20 1992-01-20 半導体装置

Applications Claiming Priority (1)

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JP4007174A JPH05211268A (ja) 1992-01-20 1992-01-20 半導体装置

Publications (1)

Publication Number Publication Date
JPH05211268A true JPH05211268A (ja) 1993-08-20

Family

ID=11658718

Family Applications (1)

Application Number Title Priority Date Filing Date
JP4007174A Withdrawn JPH05211268A (ja) 1992-01-20 1992-01-20 半導体装置

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JP (1) JPH05211268A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20010008823A (ko) * 1999-07-05 2001-02-05 이중구 비엘피 패키지
KR20030025481A (ko) * 2001-09-21 2003-03-29 주식회사 칩팩코리아 플립칩 반도체패키지 및 그의 제조방법
KR20040017625A (ko) * 2002-08-22 2004-02-27 주식회사 칩팩코리아 플립 칩 패키지

Cited By (3)

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KR20030025481A (ko) * 2001-09-21 2003-03-29 주식회사 칩팩코리아 플립칩 반도체패키지 및 그의 제조방법
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Effective date: 19990408