JPH05181447A - 表示制御装置 - Google Patents
表示制御装置Info
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- JPH05181447A JPH05181447A JP3345717A JP34571791A JPH05181447A JP H05181447 A JPH05181447 A JP H05181447A JP 3345717 A JP3345717 A JP 3345717A JP 34571791 A JP34571791 A JP 34571791A JP H05181447 A JPH05181447 A JP H05181447A
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Abstract
(57)【要約】
【目的】 キャラクタＲＯＭの容量増加をすることな
く、同一文字の通常字体の他にイタリック字体を表示す
ることを可能とする。 【構成】 データシフト制御回路１６によりキャラクタ
ドットデータのシフトレジスタ１４ｂへの格納位置を切
り換えることにより、各ライン毎に表示タイミングをず
らすことができ、通常字体からイタリック字体を生成す
る。
く、同一文字の通常字体の他にイタリック字体を表示す
ることを可能とする。 【構成】 データシフト制御回路１６によりキャラクタ
ドットデータのシフトレジスタ１４ｂへの格納位置を切
り換えることにより、各ライン毎に表示タイミングをず
らすことができ、通常字体からイタリック字体を生成す
る。
Description
【０００１】
【産業上の利用分野】この発明は、表示制御装置に関
し、たとえば、ＣＲＴ管などのディスプレイに、文字等
を表示させるときに、キャラクタＲＯＭの容量を増やす
ことなく、通常字体のキャラクタドットデータから、斜
字体（以下、イタリック字体と呼ぶ。）を形成すること
を可能にした画面表示装置内蔵シングルチップマイクロ
コンピュータによるものである。
し、たとえば、ＣＲＴ管などのディスプレイに、文字等
を表示させるときに、キャラクタＲＯＭの容量を増やす
ことなく、通常字体のキャラクタドットデータから、斜
字体（以下、イタリック字体と呼ぶ。）を形成すること
を可能にした画面表示装置内蔵シングルチップマイクロ
コンピュータによるものである。
【０００２】
【従来の技術】従来より、テレビジョンの画面等にチャ
ンネルや種々の動作状態を表す文字やパターン等を表示
させることが行われている。図９は、シングルチップマ
イクロコンピュータ内の従来の画面表示装置のシステム
ブロック図である。１は読み出しアドレス制御回路、２
は同期信号入力回路、３は発振回路、４はＨカウンタ、
５はタイミングジェネレータ、６は表示位置検出回路、
７は入力制御回路、８はアドレス制御回路、９は表示制
御レジスタ、１０は表示用データＲＡＭ、１１はデータ
制御回路、１２はキャラクタＲＯＭ、１３は合成回路、
１４ａはシフトレジスタ、１５ａは表示制御回路であ
る。
ンネルや種々の動作状態を表す文字やパターン等を表示
させることが行われている。図９は、シングルチップマ
イクロコンピュータ内の従来の画面表示装置のシステム
ブロック図である。１は読み出しアドレス制御回路、２
は同期信号入力回路、３は発振回路、４はＨカウンタ、
５はタイミングジェネレータ、６は表示位置検出回路、
７は入力制御回路、８はアドレス制御回路、９は表示制
御レジスタ、１０は表示用データＲＡＭ、１１はデータ
制御回路、１２はキャラクタＲＯＭ、１３は合成回路、
１４ａはシフトレジスタ、１５ａは表示制御回路であ
る。
【０００３】図９において、水平及び垂直同期信号は同
期信号入力回路２を介して入力され、発振回路３および
Ｈカウンタ４に与えられる。発振回路３は、水平同期信
号毎にリセットされつつ、所定周波数で発振する。発振
回路３の発振出力はタイミングジェネレータ５に与えら
れ、タイミングジェネレータ５はその発振出力に基づい
て、各部の動作に必要なタイミング信号を生成して各部
に出力する。Ｈカウンタ４は垂直同期信号毎にリセット
されつつ水平同期信号をカウントする。Ｈカウンタ４の
カウント値は、表示すべき文字や、パターンなどの表示
位置を検出するための表示位置検出回路６に与えられ
る。
期信号入力回路２を介して入力され、発振回路３および
Ｈカウンタ４に与えられる。発振回路３は、水平同期信
号毎にリセットされつつ、所定周波数で発振する。発振
回路３の発振出力はタイミングジェネレータ５に与えら
れ、タイミングジェネレータ５はその発振出力に基づい
て、各部の動作に必要なタイミング信号を生成して各部
に出力する。Ｈカウンタ４は垂直同期信号毎にリセット
されつつ水平同期信号をカウントする。Ｈカウンタ４の
カウント値は、表示すべき文字や、パターンなどの表示
位置を検出するための表示位置検出回路６に与えられ
る。
【０００４】一方、所望の文字あるいは、パターン表示
を行うためのデータ及びアドレスは入力制御回路７を介
して入力される。アドレス制御回路８は、入力されたア
ドレスに従って表示制御レジスタ９及び表示用データＲ
ＡＭ１０をアドレス指定する。表示制御レジスタ９及び
表示用データＲＡＭ１０は同一アドレス空間上に異なっ
たアドレスを割り当てて配置されており、これにより前
記入力されたデータがデータ制御回路１１を介して表示
制御レジスタ９及び表示用データＲＡＭ１０の指定され
たアドレスに書き込まれる。データには、文字コードデ
ータ、色情報データ、表示モードデータ、表示位置デー
タなどが含まれる。
を行うためのデータ及びアドレスは入力制御回路７を介
して入力される。アドレス制御回路８は、入力されたア
ドレスに従って表示制御レジスタ９及び表示用データＲ
ＡＭ１０をアドレス指定する。表示制御レジスタ９及び
表示用データＲＡＭ１０は同一アドレス空間上に異なっ
たアドレスを割り当てて配置されており、これにより前
記入力されたデータがデータ制御回路１１を介して表示
制御レジスタ９及び表示用データＲＡＭ１０の指定され
たアドレスに書き込まれる。データには、文字コードデ
ータ、色情報データ、表示モードデータ、表示位置デー
タなどが含まれる。
【０００５】表示位置検出回路６は、表示制御レジスタ
９に格納されている表示位置データとＨカウンタ４のカ
ウント値とを比較し、両者が一致すると一致信号を、読
み出しアドレス制御回路１に与える。これにより、読み
出しアドレス制御回路１は、能動化され、表示用データ
ＲＡＭ１０に対しアドレス指定を行って、先に書き込ま
れたデータの読みだしを開始する。表示用データＲＡＭ
１０は、先に書き込まれた文字コードに対応したアドレ
スをキャラクタＲＯＭ１２に与え、これに応答してキャ
ラクタＲＯＭ１２からは対応の字体フォントが読み出さ
れる。
９に格納されている表示位置データとＨカウンタ４のカ
ウント値とを比較し、両者が一致すると一致信号を、読
み出しアドレス制御回路１に与える。これにより、読み
出しアドレス制御回路１は、能動化され、表示用データ
ＲＡＭ１０に対しアドレス指定を行って、先に書き込ま
れたデータの読みだしを開始する。表示用データＲＡＭ
１０は、先に書き込まれた文字コードに対応したアドレ
スをキャラクタＲＯＭ１２に与え、これに応答してキャ
ラクタＲＯＭ１２からは対応の字体フォントが読み出さ
れる。
【０００６】１つのフォント字体は、例えば図１０に示
すように、Ｌ×ｍドットの画素で構成されている。キャ
ラクタＲＯＭ１２がこの字体フォントをｎ文字分内蔵し
ているものとすれば、キャラクタＲＯＭ１２の容量はＬ
×ｍ×ｎドット相当となる。キャラクタＲＯＭ１２から
読み出された字体フォントのデータは、必要に応じ合成
回路１３で合成される。合成回路１３の出力データはシ
フトレジスタ１４ａでパラレル形式からシリアル形式に
変換され、表示制御回路１５ａに与えられる。表示制御
回路１５ａはシフトレジスタ１４ａからの字体フォント
データに加え、表示用データＲＡＭ１０から文字色及び
背景色などを表す色情報データ及び表示制御レジスタ９
から文字の修飾等を表す表示モードデータを受け、字体
フォントデータ及び色情報データを表示モードデータの
示す表示モードに従って表示制御する。こうして表示制
御回路１５ａから、赤、緑、青の出力信号や輝度制御信
号等が導出され、これらの信号に従って画面上に所望の
文字やパターンが表示される。
すように、Ｌ×ｍドットの画素で構成されている。キャ
ラクタＲＯＭ１２がこの字体フォントをｎ文字分内蔵し
ているものとすれば、キャラクタＲＯＭ１２の容量はＬ
×ｍ×ｎドット相当となる。キャラクタＲＯＭ１２から
読み出された字体フォントのデータは、必要に応じ合成
回路１３で合成される。合成回路１３の出力データはシ
フトレジスタ１４ａでパラレル形式からシリアル形式に
変換され、表示制御回路１５ａに与えられる。表示制御
回路１５ａはシフトレジスタ１４ａからの字体フォント
データに加え、表示用データＲＡＭ１０から文字色及び
背景色などを表す色情報データ及び表示制御レジスタ９
から文字の修飾等を表す表示モードデータを受け、字体
フォントデータ及び色情報データを表示モードデータの
示す表示モードに従って表示制御する。こうして表示制
御回路１５ａから、赤、緑、青の出力信号や輝度制御信
号等が導出され、これらの信号に従って画面上に所望の
文字やパターンが表示される。
【０００７】字体フォントのドットデータは、その字体
を表す文字コードデータをデコードすることで生成され
るキャラクタＲＯＭ１２のアドレスの領域に縦方向のド
ット数毎に格納されている。図１０の場合、縦ｌドット
分のフォントデータをＬ個のアドレス番地に各１ライン
毎に格納して、そのアドレスを上から順にＡＤ1 、ＡＤ
2 、ＡＤ3 、ＡＤ4 、・・・・・、ＡＤL-1、ＡＤLとす
れば、キャラクタＲＯＭ１２からこの順にドットデータ
を出力する。読み出しアドレス制御回路１は、１文字の
縦何ライン目かを１〜Ｌカウントして、各ライン毎に表
示文字のドットデータを順次出力する。これを１〜Ｌラ
インまで操作を繰り返し一行分の文字表示を完了する。
を表す文字コードデータをデコードすることで生成され
るキャラクタＲＯＭ１２のアドレスの領域に縦方向のド
ット数毎に格納されている。図１０の場合、縦ｌドット
分のフォントデータをＬ個のアドレス番地に各１ライン
毎に格納して、そのアドレスを上から順にＡＤ1 、ＡＤ
2 、ＡＤ3 、ＡＤ4 、・・・・・、ＡＤL-1、ＡＤLとす
れば、キャラクタＲＯＭ１２からこの順にドットデータ
を出力する。読み出しアドレス制御回路１は、１文字の
縦何ライン目かを１〜Ｌカウントして、各ライン毎に表
示文字のドットデータを順次出力する。これを１〜Ｌラ
インまで操作を繰り返し一行分の文字表示を完了する。
【０００８】
【発明が解決しようとする課題】従来の画面表示装置の
場合、イタリック字体を画面表示しようとする場合、通
常字体のドットデータとは別にイタリック字体専用にド
ットデータを準備して、記憶させておく必要がある。即
ち同じ文字の通常字体とイタリック字体は全く異なる字
体として、キャラクタＲＯＭに記憶しておかなければな
らない。このことはメモリ容量の増大、チップ面積の増
大を招く。
場合、イタリック字体を画面表示しようとする場合、通
常字体のドットデータとは別にイタリック字体専用にド
ットデータを準備して、記憶させておく必要がある。即
ち同じ文字の通常字体とイタリック字体は全く異なる字
体として、キャラクタＲＯＭに記憶しておかなければな
らない。このことはメモリ容量の増大、チップ面積の増
大を招く。
【０００９】この発明は、上記の様な問題点を解決する
為のもので、キャラクタＲＯＭ等の容量増加をすること
なく、通常字体を斜めに傾けてイタリック字体等の他の
字体を機械的に生成することが可能である表示制御装置
を提供することを目的としている。
為のもので、キャラクタＲＯＭ等の容量増加をすること
なく、通常字体を斜めに傾けてイタリック字体等の他の
字体を機械的に生成することが可能である表示制御装置
を提供することを目的としている。
【００１０】
【課題を解決するための手段】この発明に係わる表示制
御装置は、テレビジョンの画面上に文字、数字、記号等
のパターンを表示する画面表示装置を制御するシングル
チップマイクロコンピュータ等において、表示パターン
（キャラクタドットデータ）を記憶する記憶手段（キャ
ラクタＲＯＭ）と、前記キャラクタドットデータをパラ
レル−シリアル変換を行なって表示パターンを部分的に
出力する出力手段（シフトレジスタ）と、前記出力手段
（シフトレジスタ）の前記キャラクタドットデータを格
納する位置を換えること、あるいは、出力手段（シフト
レジスタ）へのクロックを遅延させること等により出力
のタイミングをずらすことができる出力制御手段（デー
タシフト制御回路あるいはディレイ回路等）を備えたこ
とを特徴とするものである。
御装置は、テレビジョンの画面上に文字、数字、記号等
のパターンを表示する画面表示装置を制御するシングル
チップマイクロコンピュータ等において、表示パターン
（キャラクタドットデータ）を記憶する記憶手段（キャ
ラクタＲＯＭ）と、前記キャラクタドットデータをパラ
レル−シリアル変換を行なって表示パターンを部分的に
出力する出力手段（シフトレジスタ）と、前記出力手段
（シフトレジスタ）の前記キャラクタドットデータを格
納する位置を換えること、あるいは、出力手段（シフト
レジスタ）へのクロックを遅延させること等により出力
のタイミングをずらすことができる出力制御手段（デー
タシフト制御回路あるいはディレイ回路等）を備えたこ
とを特徴とするものである。
【００１１】
【作用】この発明によれば、表示制御装置内部に、記憶
手段（キャラクタＲＯＭ）からの表示パターン（キャラ
クタドットデータ）をシフトレジスタに格納する位置を
換えることができるデータシフト制御回路やシフトレジ
スタへのクロックを遅延させるディレイ回路等を備え、
タイミングを変えて出力するようにしたので、通常字体
からイタリック字体を生成することができる。
手段（キャラクタＲＯＭ）からの表示パターン（キャラ
クタドットデータ）をシフトレジスタに格納する位置を
換えることができるデータシフト制御回路やシフトレジ
スタへのクロックを遅延させるディレイ回路等を備え、
タイミングを変えて出力するようにしたので、通常字体
からイタリック字体を生成することができる。
【００１２】
実施例１．図１は、この発明の実施例を示す表示装置の
システムブロック図の一部である。図１において、１６
はデータシフト制御回路、１７はデコーダ、１は読み出
しアドレス制御回路、１０は表示用データＲＡＭ、１３
は合成回路、１４ｂはシフトレジスタ、１５ｂは表示制
御回路である。なお、その他の画面表示装置のブロック
図は図９に示した従来のものと同一である。
システムブロック図の一部である。図１において、１６
はデータシフト制御回路、１７はデコーダ、１は読み出
しアドレス制御回路、１０は表示用データＲＡＭ、１３
は合成回路、１４ｂはシフトレジスタ、１５ｂは表示制
御回路である。なお、その他の画面表示装置のブロック
図は図９に示した従来のものと同一である。
【００１３】ここでは図２に示す縦１４ドット横１０ド
ットを文字構成とする通常字体（ａ）をイタリック字体
（ｂ）に変換する場合について述べる。デコーダ１７に
は表示用データＲＡＭ１０から、字体選択ビット２１が
入力される。これは、各文字毎に含まれる、表示モード
データとして、文字コードデータ、色情報データ等と共
にデータ制御回路１１から表示用データＲＡＭ１０に入
力されたデータである。表示される文字が、通常字体で
表示されるか、あるいは、イタリック字体で表示される
かという情報は、このビットにより伝えられる。一方、
読み出しアドレス制御回路１からは、１文字の縦何ライ
ン目かを示すカウント値２２がデコーダ１７に入力され
る。読み出しアドレス制御回路１では従来、表示位置検
出回路６からの表示許可信号をもとに、１文字たてＬド
ット分のカウントを１からＬまで順次行って、そのカウ
ント値２２をキャラクタＲＯＭ１２で文字コードと共に
デコードしてキャラクタドットデータを出力する。この
実施例の場合では、読み出しアドレス制御回路１からの
カウント値２２をデコーダ１７にも入力する。
ットを文字構成とする通常字体（ａ）をイタリック字体
（ｂ）に変換する場合について述べる。デコーダ１７に
は表示用データＲＡＭ１０から、字体選択ビット２１が
入力される。これは、各文字毎に含まれる、表示モード
データとして、文字コードデータ、色情報データ等と共
にデータ制御回路１１から表示用データＲＡＭ１０に入
力されたデータである。表示される文字が、通常字体で
表示されるか、あるいは、イタリック字体で表示される
かという情報は、このビットにより伝えられる。一方、
読み出しアドレス制御回路１からは、１文字の縦何ライ
ン目かを示すカウント値２２がデコーダ１７に入力され
る。読み出しアドレス制御回路１では従来、表示位置検
出回路６からの表示許可信号をもとに、１文字たてＬド
ット分のカウントを１からＬまで順次行って、そのカウ
ント値２２をキャラクタＲＯＭ１２で文字コードと共に
デコードしてキャラクタドットデータを出力する。この
実施例の場合では、読み出しアドレス制御回路１からの
カウント値２２をデコーダ１７にも入力する。
【００１４】従来の場合、シフトレジスタ１４ａは、横
１０ドットのキャラクタドットデータを格納するように
１０個のフリップフロップ回路を直列に接続して構成さ
れており、このシフトレジスタ１４ａに１０ドット分の
データがパラレルに入力されて、発振回路からの表示用
クロックのタイミングに合わせてシリアルに出力されて
いく。この実施例では、イタリック字体を実現するため
に、フリップフロップ回路を１６個直列に接続してシフ
トレジスタ１４ｂを構成する。この１６個の中、横１０
ドットのデータをどのフリップフロップに格納するかを
１文字の縦何ドット目を表示するかに応じて決定するこ
とでイタリック字体を生成できる。
１０ドットのキャラクタドットデータを格納するように
１０個のフリップフロップ回路を直列に接続して構成さ
れており、このシフトレジスタ１４ａに１０ドット分の
データがパラレルに入力されて、発振回路からの表示用
クロックのタイミングに合わせてシリアルに出力されて
いく。この実施例では、イタリック字体を実現するため
に、フリップフロップ回路を１６個直列に接続してシフ
トレジスタ１４ｂを構成する。この１６個の中、横１０
ドットのデータをどのフリップフロップに格納するかを
１文字の縦何ドット目を表示するかに応じて決定するこ
とでイタリック字体を生成できる。
【００１５】図３は図１でのシフトレジスタ１４ｂ、デ
ータシフト制御回路１６を示す回路図である。シフトレ
ジスタ１４ｂはセットリセットＤフリップフロップ回路
（以下、ＳＲ−ＤＦＦと呼ぶ）１８ａ〜１８ｐを直列接
続して構成されており、またデータシフト制御回路１６
はデコーダ１７からの出力信号２３を受けてトランスミ
ッションゲート２０によりキャラクタドットデータの格
納位置を変更することができる。また、図内のリセット
Ｄフリップフロップ回路（以下、Ｒ−ＤＦＦと呼ぶ）１
９ａ〜１９ｆはイタリック字体の次に通常字体が表示さ
れるときに、オーバーラップされる領域が生じるので、
その際には前に表示されているイタリック字体を優先さ
せて表示するために設けている。
ータシフト制御回路１６を示す回路図である。シフトレ
ジスタ１４ｂはセットリセットＤフリップフロップ回路
（以下、ＳＲ−ＤＦＦと呼ぶ）１８ａ〜１８ｐを直列接
続して構成されており、またデータシフト制御回路１６
はデコーダ１７からの出力信号２３を受けてトランスミ
ッションゲート２０によりキャラクタドットデータの格
納位置を変更することができる。また、図内のリセット
Ｄフリップフロップ回路（以下、Ｒ−ＤＦＦと呼ぶ）１
９ａ〜１９ｆはイタリック字体の次に通常字体が表示さ
れるときに、オーバーラップされる領域が生じるので、
その際には前に表示されているイタリック字体を優先さ
せて表示するために設けている。
【００１６】その回路図を簡略に示したのが図４であ
る。表示文字が通常字体の場合、字体選択ビットによっ
て、デコーダ１７からの出力信号２３は固定されて、図
４（ｃ）に示すように、１文字の縦何ライン目であるか
に係わらずシフトレジスタ１４ｂへの格納位置は変化し
ない。図３ではデコーダ１７からの出力信号２３はＳＬ
ＡＮＴ０＝”Ｈ”、ＳＬＡＮＴ１〜ＳＬＡＮＴ６＝”
Ｌ”で固定される。イタリック字体の場合には、字体選
択ビット２１によりデコーダ１７は能動化され、図３内
のＳＬＡＮＴ０〜ＳＬＡＮＴ６の信号の中１つが ”
Ｈ”出力される。今、図２のように縦２ドット毎に右側
へ１ドットずつシフトするように考えると、ライン１と
ライン２の時には図４（ａ）のようにＳＲ−ＤＦＦ１８
ｇ〜１８ｐにキャラクタドットデータを格納する。また
ライン３、４では図４（ｂ）のようにＳＲ−ＤＦＦ１８
ｆ〜１８ｏに格納する。順にライン５、６、ライン７、
８、・・・・・、ライン１３、１４とそれぞれの場合
に、格納位置をずらせていき、図２（ｂ）のイタリック
字体を生成することができる。
る。表示文字が通常字体の場合、字体選択ビットによっ
て、デコーダ１７からの出力信号２３は固定されて、図
４（ｃ）に示すように、１文字の縦何ライン目であるか
に係わらずシフトレジスタ１４ｂへの格納位置は変化し
ない。図３ではデコーダ１７からの出力信号２３はＳＬ
ＡＮＴ０＝”Ｈ”、ＳＬＡＮＴ１〜ＳＬＡＮＴ６＝”
Ｌ”で固定される。イタリック字体の場合には、字体選
択ビット２１によりデコーダ１７は能動化され、図３内
のＳＬＡＮＴ０〜ＳＬＡＮＴ６の信号の中１つが ”
Ｈ”出力される。今、図２のように縦２ドット毎に右側
へ１ドットずつシフトするように考えると、ライン１と
ライン２の時には図４（ａ）のようにＳＲ−ＤＦＦ１８
ｇ〜１８ｐにキャラクタドットデータを格納する。また
ライン３、４では図４（ｂ）のようにＳＲ−ＤＦＦ１８
ｆ〜１８ｏに格納する。順にライン５、６、ライン７、
８、・・・・・、ライン１３、１４とそれぞれの場合
に、格納位置をずらせていき、図２（ｂ）のイタリック
字体を生成することができる。
【００１７】ところで、表示用データＲＡＭ１０には、
イタリック字体、通常字体を選択する表示モードデータ
の他に色情報データも含まれており、文字毎に表示色を
変えることができる。例えば、図５のようにイタリック
字体で表示色を変えるときには、通常字体の場合とは異
なったタイミングで色情報の切り換えを行う必要があ
る。この切り換えは表示制御回路１５ｂで行われている
ので、読みだしアドレス制御回路１からの縦ラインカウ
ント値２２を入力して、図５のように各ライン毎にタイ
ミングを切り換える。図５はＡ、Ｂをイタリック字体で
異なる表示色で表示する場合を示したものであり、ライ
ン１及びライン２を表示するときはタイミングｔ１で色
を変化させ、ライン３及びライン４を表示するときはタ
イミングｔ２で色を変化させ、以下同様に、ライン１３
及びライン１４を表示するときはタイミングｔ７で色を
変化させる場合を示している。こうすることで、イタリ
ック字体の場合でも正常な文字着色が可能となる。
イタリック字体、通常字体を選択する表示モードデータ
の他に色情報データも含まれており、文字毎に表示色を
変えることができる。例えば、図５のようにイタリック
字体で表示色を変えるときには、通常字体の場合とは異
なったタイミングで色情報の切り換えを行う必要があ
る。この切り換えは表示制御回路１５ｂで行われている
ので、読みだしアドレス制御回路１からの縦ラインカウ
ント値２２を入力して、図５のように各ライン毎にタイ
ミングを切り換える。図５はＡ、Ｂをイタリック字体で
異なる表示色で表示する場合を示したものであり、ライ
ン１及びライン２を表示するときはタイミングｔ１で色
を変化させ、ライン３及びライン４を表示するときはタ
イミングｔ２で色を変化させ、以下同様に、ライン１３
及びライン１４を表示するときはタイミングｔ７で色を
変化させる場合を示している。こうすることで、イタリ
ック字体の場合でも正常な文字着色が可能となる。
【００１８】以上のように、この実施例では、テレビジ
ョン等の画面上に文字、数字、記号等のパターンを表示
する表示制御装置を内蔵したシングルチップマイクロコ
ンピュータにおいて、読みだしアドレス制御回路と表示
用データＲＡＭからのデータを入力するデコーダと、上
記デコーダの出力値を入力し、キャラクタドットデータ
を記憶、出力する記憶装置（キャラクタＲＯＭ）と前記
キャラクタドットデータをパラレル−シリアル変換を行
うシフトレジスタの間に設けられた、前記シフトレジス
タに前記キャラクタドットデータを格納する位置を換え
ることができるデータシフト制御回路を備えたことを特
徴とする表示制御装置内蔵シングルチップマイクロコン
ピュータを説明した。
ョン等の画面上に文字、数字、記号等のパターンを表示
する表示制御装置を内蔵したシングルチップマイクロコ
ンピュータにおいて、読みだしアドレス制御回路と表示
用データＲＡＭからのデータを入力するデコーダと、上
記デコーダの出力値を入力し、キャラクタドットデータ
を記憶、出力する記憶装置（キャラクタＲＯＭ）と前記
キャラクタドットデータをパラレル−シリアル変換を行
うシフトレジスタの間に設けられた、前記シフトレジス
タに前記キャラクタドットデータを格納する位置を換え
ることができるデータシフト制御回路を備えたことを特
徴とする表示制御装置内蔵シングルチップマイクロコン
ピュータを説明した。
【００１９】実施例２．以下、この発明の他の実施例を
図について説明する。図６において、２４はディレイ回
路、２５は表示用クロック発生回路、１４ｃはシフトレ
ジスタ、２６は表示用クロック発生回路２５の出力する
クロック、２７はデコーダ１７の出力信号２３によりク
ロック２６の接続をきりかえるスイッチ、２８は、シフ
トレジスタ１４ｃ内にあってクロック２６ａ、２６ｂを
きりかえる回路であり、その他の部分は、実施例１と同
様である。
図について説明する。図６において、２４はディレイ回
路、２５は表示用クロック発生回路、１４ｃはシフトレ
ジスタ、２６は表示用クロック発生回路２５の出力する
クロック、２７はデコーダ１７の出力信号２３によりク
ロック２６の接続をきりかえるスイッチ、２８は、シフ
トレジスタ１４ｃ内にあってクロック２６ａ、２６ｂを
きりかえる回路であり、その他の部分は、実施例１と同
様である。
【００２０】図７に表示するＩの通常文字を表示する場
合について説明する。Ｉの文字の表示データを表示用デ
ータＲＡＭ１０に入力する。表示用データＲＡＭ１０の
データの出力はキャラクタＲＯＭ１２に入力される。キ
ャラクタＲＯＭ１２ではＩのフォントのデータがあらか
じめ記憶されており、表示のそう査線に従って、つまり
図７（ａ）の１〜１２に従ってフォントデータがシフト
レジスタ１４ｃに入力される。この場合、デコーダ１７
の出力信号２３は通常文字の指定をしており、スイッチ
２７はＡ−Ｂを接続する。そして、表示用クロック発生
回路２５からのクロック２６がシフトレジスタ１４ｃに
入力されることにより、クロック２６に従って、フォン
トデータがシフトされ、図７（ｂ）の様な波形が出力さ
れる。このことが図７（ａ）のそう査線３〜１０におい
て同様にくりかえされる。
合について説明する。Ｉの文字の表示データを表示用デ
ータＲＡＭ１０に入力する。表示用データＲＡＭ１０の
データの出力はキャラクタＲＯＭ１２に入力される。キ
ャラクタＲＯＭ１２ではＩのフォントのデータがあらか
じめ記憶されており、表示のそう査線に従って、つまり
図７（ａ）の１〜１２に従ってフォントデータがシフト
レジスタ１４ｃに入力される。この場合、デコーダ１７
の出力信号２３は通常文字の指定をしており、スイッチ
２７はＡ−Ｂを接続する。そして、表示用クロック発生
回路２５からのクロック２６がシフトレジスタ１４ｃに
入力されることにより、クロック２６に従って、フォン
トデータがシフトされ、図７（ｂ）の様な波形が出力さ
れる。このことが図７（ａ）のそう査線３〜１０におい
て同様にくりかえされる。
【００２１】次にイタリック字体等の文字をななめに表
示する場合について説明する。Ｉを表示する時、キャラ
クタＲＯＭ１２のフォントデータをシフトレジスタ１４
ｃに入力させるが、デコーダ１７からの出力信号２３が
スイッチ２７をＡ−Ｃ接続とするので、表示用クロック
発生回路２５からのクロック２６は直接シフトレジスタ
１４ｃに入力されるのではなく、ディレイ回路２４を介
して入力される。この時ディレイ回路２４はそう査線３
の表示を遅らせるため、ディレイ時間を図８に示すよう
なＤ3 の時間だけ遅らせるようにする。また、そう査線
４についてはＤ4 の時間だけ遅らせるようにする。この
時、Ｄ3 ＞Ｄ4 に設定する。同様にＤ5 〜Ｄ9 までディ
レイタイムを設定する。この時、Ｄ3 ＞Ｄ4 ＞Ｄ5 ＞Ｄ
6＞Ｄ7 ＞Ｄ8 ＞Ｄ9 になるようにする。このように遅
らせたクロックをシフトレジスタに入力することによ
り、文字をななめに表示することができる。
示する場合について説明する。Ｉを表示する時、キャラ
クタＲＯＭ１２のフォントデータをシフトレジスタ１４
ｃに入力させるが、デコーダ１７からの出力信号２３が
スイッチ２７をＡ−Ｃ接続とするので、表示用クロック
発生回路２５からのクロック２６は直接シフトレジスタ
１４ｃに入力されるのではなく、ディレイ回路２４を介
して入力される。この時ディレイ回路２４はそう査線３
の表示を遅らせるため、ディレイ時間を図８に示すよう
なＤ3 の時間だけ遅らせるようにする。また、そう査線
４についてはＤ4 の時間だけ遅らせるようにする。この
時、Ｄ3 ＞Ｄ4 に設定する。同様にＤ5 〜Ｄ9 までディ
レイタイムを設定する。この時、Ｄ3 ＞Ｄ4 ＞Ｄ5 ＞Ｄ
6＞Ｄ7 ＞Ｄ8 ＞Ｄ9 になるようにする。このように遅
らせたクロックをシフトレジスタに入力することによ
り、文字をななめに表示することができる。
【００２２】なお、シフトレジスタ１４ｃは、ディレイ
回路２４からのクロック２６ｂとクロック発生回路２５
からのクロック２６ａとを入力するため、きりかえ回路
２８があり、通常文字かイタリック文字かをデコーダ１
７の出力信号２３により判定して、入力するクロックを
選択している。
回路２４からのクロック２６ｂとクロック発生回路２５
からのクロック２６ａとを入力するため、きりかえ回路
２８があり、通常文字かイタリック文字かをデコーダ１
７の出力信号２３により判定して、入力するクロックを
選択している。
【００２３】また、前記のディレイ回路２４は、容量Ｃ
を抵抗ＲとのＣＲ時定数によってディレイ回路２４を構
成し、遅延Ｄ3 〜Ｄ9 の時間を設定することができる。
を抵抗ＲとのＣＲ時定数によってディレイ回路２４を構
成し、遅延Ｄ3 〜Ｄ9 の時間を設定することができる。
【００２４】以上のように、この実施例では、表示装置
の画面上に水平同期信号に同期して、文字等のパターン
を表示する表示制御装置において、パターンをななめに
表示をする時にＮ番目のそう査線のドットの位置と、Ｎ
＋１番目のそう査線のドットの位置を、ＣＲの時定数に
より、Ｎ＋１番目の位置を遅らせることにより、ななめ
に表示するようにしたことを特徴とした表示制御装置を
説明した。
の画面上に水平同期信号に同期して、文字等のパターン
を表示する表示制御装置において、パターンをななめに
表示をする時にＮ番目のそう査線のドットの位置と、Ｎ
＋１番目のそう査線のドットの位置を、ＣＲの時定数に
より、Ｎ＋１番目の位置を遅らせることにより、ななめ
に表示するようにしたことを特徴とした表示制御装置を
説明した。
【００２５】
【発明の効果】以上のように、この発明によれば、キャ
ラクタＲＯＭ等の記憶手段に記憶されるフォントドット
データ容量を増やすことなく、イタリック字体等の他の
パターンの表示ができ、回路面積の抑制を可能とすると
ともに、機能性の高い画面表示制御をする事が可能とな
る。
ラクタＲＯＭ等の記憶手段に記憶されるフォントドット
データ容量を増やすことなく、イタリック字体等の他の
パターンの表示ができ、回路面積の抑制を可能とすると
ともに、機能性の高い画面表示制御をする事が可能とな
る。
【図１】この発明の一実施例をしめす画面表示装置のシ
ステムブロック図の一部図である。
ステムブロック図の一部図である。
【図２】文字構成領域を縦１４ドット横１０ドットとし
た場合の通常字体の表示例とその字体から機械的に生成
したイタリック字体を示した図である。
た場合の通常字体の表示例とその字体から機械的に生成
したイタリック字体を示した図である。
【図３】図１におけるデータシフト制御回路、シフトレ
ジスタの一実施例を示す回路図である。
ジスタの一実施例を示す回路図である。
【図４】イタリック字体を生成するためのシフトレジス
タへのキャラクタドットデータの格納位置を示すブロッ
ク図である。
タへのキャラクタドットデータの格納位置を示すブロッ
ク図である。
【図５】イタリック表示した際の色情報の切り換えタイ
ミングを示す図である。
ミングを示す図である。
【図６】この発明の他の実施例を示す図である。
【図７】通常字体及びタイミングを示す図である。
【図８】イタリック字体及びタイミングを示す図であ
る。
る。
【図９】従来のシングルチップマイクロコンピュータ内
部の画面表示装置のシステムブロック図である。
部の画面表示装置のシステムブロック図である。
【図１０】１文字分のフォントのドット構成の一例を示
す図である。
す図である。
１ 読み出しアドレス制御回路 ２ 同期信号入力回路 ３ 発振回路 ４ Ｈカウンタ ５ タイミングジェネレータ ６ 表示位置検出回路 ７ 入力制御回路 ８ アドレス制御回路 ９ 表示制御レジスタ １０ 表示用データＲＡＭ １１ データ制御回路 １２ キャラクタＲＯＭ（記憶手段の一例） １３ 合成回路 １４ａ，１４ｂ，１４ｃ シフトレジスタ（出力手段の
一例） １５ａ，１５ｂ 表示制御回路 １６ データシフト制御回路（出力制御手段の一例） １７ デコーダ １８ａ〜１８ｐ セットリセットＤフリップフロップ回
路（ＳＲ−ＤＦＦ） １９ａ〜１９ｂ リセットＤフリップフロップ回路（Ｒ
−ＤＦＦ） ２０ トランスミッションゲート ２１ 字体選択ビット ２２ 縦ラインカウント値 ２３ デコーダの出力信号 ２４ ディレイ回路（出力制御手段の一例） ２５ 表示用クロック発生回路 ２６ クロック ２７ スイッチ ２８ きりかえ回路
一例） １５ａ，１５ｂ 表示制御回路 １６ データシフト制御回路（出力制御手段の一例） １７ デコーダ １８ａ〜１８ｐ セットリセットＤフリップフロップ回
路（ＳＲ−ＤＦＦ） １９ａ〜１９ｂ リセットＤフリップフロップ回路（Ｒ
−ＤＦＦ） ２０ トランスミッションゲート ２１ 字体選択ビット ２２ 縦ラインカウント値 ２３ デコーダの出力信号 ２４ ディレイ回路（出力制御手段の一例） ２５ 表示用クロック発生回路 ２６ クロック ２７ スイッチ ２８ きりかえ回路
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成４年４月１５日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】０００７
【補正方法】変更
【補正内容】
【０００７】字体フォントのドットデータは、その字体
を表す文字コードデータをデコードすることで生成され
るキャラクタＲＯＭ１２のアドレスの領域に横方向のド
ット数毎に格納されている。図１０の場合、縦ｌドット
分のフォントデータをＬ個のアドレス番地に各１ライン
毎に格納して、そのアドレスを上から順にＡＤ1 、ＡＤ
2 、ＡＤ3 、ＡＤ4 、・・・・・、ＡＤL-1、ＡＤLとす
れば、キャラクタＲＯＭ１２からこの順にドットデータ
を出力する。読み出しアドレス制御回路１は、１文字の
縦何ライン目かを１〜Ｌカウントして、各ライン毎に表
示文字のドットデータを順次出力する。これを１〜Ｌラ
インまで操作を繰り返し一行分の文字表示を完了する。
を表す文字コードデータをデコードすることで生成され
るキャラクタＲＯＭ１２のアドレスの領域に横方向のド
ット数毎に格納されている。図１０の場合、縦ｌドット
分のフォントデータをＬ個のアドレス番地に各１ライン
毎に格納して、そのアドレスを上から順にＡＤ1 、ＡＤ
2 、ＡＤ3 、ＡＤ4 、・・・・・、ＡＤL-1、ＡＤLとす
れば、キャラクタＲＯＭ１２からこの順にドットデータ
を出力する。読み出しアドレス制御回路１は、１文字の
縦何ライン目かを１〜Ｌカウントして、各ライン毎に表
示文字のドットデータを順次出力する。これを１〜Ｌラ
インまで操作を繰り返し一行分の文字表示を完了する。
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】００２４
【補正方法】変更
【補正内容】
【００２４】以上のように、この実施例では、表示装置
の画面上に水平同期信号に同期して、文字等のパターン
を表示する表示制御装置において、パターンをななめに
表示をする時にＮ番目のそう査線のドットの位置と、Ｎ
＋１番目のそう査線のドットの位置を、ＣＲの時定数に
より、Ｎ＋１番目の位置を遅らせることにより、ななめ
に表示するようにしたことを特徴とした表示制御装置を
説明した。なお、ディレイ回路２４の遅延手段はＣＲの
時定数によるものだけでなく、表示用クロックを１パル
ス毎に遅らせて出力させる様なディジタル的な遅延方法
であっても実現できる。
の画面上に水平同期信号に同期して、文字等のパターン
を表示する表示制御装置において、パターンをななめに
表示をする時にＮ番目のそう査線のドットの位置と、Ｎ
＋１番目のそう査線のドットの位置を、ＣＲの時定数に
より、Ｎ＋１番目の位置を遅らせることにより、ななめ
に表示するようにしたことを特徴とした表示制御装置を
説明した。なお、ディレイ回路２４の遅延手段はＣＲの
時定数によるものだけでなく、表示用クロックを１パル
ス毎に遅らせて出力させる様なディジタル的な遅延方法
であっても実現できる。
【手続補正３】
【補正対象書類名】図面
【補正対象項目名】図３
【補正方法】変更
【補正内容】
【図３】
Claims (2)
- 【請求項１】 以下の要素を有する表示制御装置 （ａ）文字、記号等の表示パターンを記憶する記憶手
段、（ｂ）上記記憶手段に記憶された表示パターンの一
部を構成する部分パターンを順に入力してその部分パタ
ーンを所定の出力タイミングで出力する出力手段、
（ｃ）上記出力手段の出力タイミングを部分パターン毎
に異なる出力タイミングにする出力制御手段。 - 【請求項２】 上記表示制御装置において、上記出力手
段をシフトレジスタで構成し、上記出力制御手段を少な
くとも以下のいずれかの手段で構成したことを特徴とす
る表示制御装置 （ａ）シフトレジスタの部分パターンを入力する位置を
変更することにより出力タイミングを制御する出力制御
手段、（ｂ）シフトレジスタへ入力するクロックを遅延
させることにより出力タイミングを制御する出力制御手
段。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3345717A JP3003734B2 (ja) | 1991-12-27 | 1991-12-27 | 表示制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3345717A JP3003734B2 (ja) | 1991-12-27 | 1991-12-27 | 表示制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05181447A true JPH05181447A (ja) | 1993-07-23 |
| JP3003734B2 JP3003734B2 (ja) | 2000-01-31 |
Family
ID=18378489
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3345717A Expired - Fee Related JP3003734B2 (ja) | 1991-12-27 | 1991-12-27 | 表示制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3003734B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5929839A (en) * | 1996-08-09 | 1999-07-27 | Mitsubishi Denki Kabushiki Kaisha | Image display control apparatus |
-
1991
- 1991-12-27 JP JP3345717A patent/JP3003734B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5929839A (en) * | 1996-08-09 | 1999-07-27 | Mitsubishi Denki Kabushiki Kaisha | Image display control apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3003734B2 (ja) | 2000-01-31 |
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