JPH044616B2 - - Google Patents

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JPH044616B2
JPH044616B2 JP57168912A JP16891282A JPH044616B2 JP H044616 B2 JPH044616 B2 JP H044616B2 JP 57168912 A JP57168912 A JP 57168912A JP 16891282 A JP16891282 A JP 16891282A JP H044616 B2 JPH044616 B2 JP H044616B2
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read
pipeline
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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00—Error detection; Error correction; Monitoring
    • G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/14—Error detection or correction of the data by redundancy in operation
    • G06F11/1402—Saving, restoring, recovering or retrying
    • G06F11/1405—Saving, restoring, recovering or retrying at machine instruction level
    • G06F11/141—Saving, restoring, recovering or retrying at machine instruction level for bus or memory accesses
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/22—Microcontrol or microprogram arrangements
    • G—PHYSICS
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    • G06F—ELECTRIC DIGITAL DATA PROCESSING
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    • G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Software Systems (AREA)
  • Quality & Reliability (AREA)
  • Retry When Errors Occur (AREA)
  • Debugging And Monitoring (AREA)

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明はマイクロプログラム制御装置、特にマ
イクロプログラムによつてパイプラインを制御す
る装置における、マイクロ命令のエラー検出・訂
正方式に関する。
〔発明の従来技術〕
マイクロ命令の信頼性を向上するため、制御記
憶装置のマイクロ命令にエラー検出・訂正コード
（以下ECCコードと称す）を付加することが行な
われている。その場合、ECCコードの解読には
時間がかかるため、読出されたマイクロ命令の実
行とECCチエツクとを並行して行ない、もしエ
ラーが検出された場合にはその命令の実行を打ち
切り、訂正されたマイクロ命令を用いてリトライ
することが行なわれている。
一方、パイプライン制御装置をマイクロプログ
ラムで制御する場合にはこのリトライ動作は単純
には行なえず、パイプラインの段数やマイクロプ
ログラムの構成等に応じて所定のステツプ数だけ
戻つてリトライする必要がある。そのため制御記
憶装置が１ビツトの固定障害を生じると、その部
分のマイクロ命令を実行する度に数ステツプのリ
トライとなるため、効率低下を招く。
〔発明の目的〕
本発明は上記の問題を解決し、固定障害を生じ
ても最小の付加時間でマイクロプログラムの処理
を可能にすることにある。
〔発明の構成〕
本発明は、制御記憶装置から読出されるマイク
ロ命令を順次実行するのと並行して該読出された
マイクロ命令のエラー検出を行ない、エラー検出
時には当該エラーを生じたマイクロ命令若しくは
該マイクロ命令を含む所定の範囲のマイクロ命令
についてリトライを行なうとともに、該リトライ
時には読出されたマイクロ命令のエラー検出及び
エラー時にはエラー訂正を行なつた後に該マイク
ロ命令を実行するインタロツクモードで動作する
ようにし、かつ上記エラーを生じたマイクロ命令
のアドレスを保持しておき、該制御装置のマイク
ロ命令読出しと並行して該保持したマイクロ命令
のアドレスと以後制御記憶装置のマイクロ命令を
読出すアドレスとの比較処理を行い、一致する
と、その時に該制御記憶装置から読出された該マ
イクロ命令についてインタロツクモードで動作す
るようにしたものである。
〔発明の実施例〕
図は本発明の一実施例ブロツク図であり、１は
機械語命令レジスタ、２は制御記憶アドレスレジ
スタ（CSAR）、３は制御記憶装置（CS）、４は
マイクロ命令レジスタ（MIR）、５はパイプライ
ン制御部、６はアドレス更新回路、７はECC回
路、８はタイミング制御部、９はエラーアドレス
保持レジスタ、１０は比較回路、１１はクロツク
制御部である。
通常は、機械語命令レジスタ１中の命令コード
により定まる初期値がCSAR２にセツトされ、以
下該機械語命令に係る一連のマイクロ命令をCS
から読出すように、アドレス更新回路６にて（若
しくはネクスト・アドレス・方式で）順次マイク
ロ命令アドレスがCSAR２にセツトされる。CS
３から読出されたマイクロ命令は直接MIR４に
セツトされ、パイプライン５の制御に用いられ
る。それと並行してMIR４の内容はECC回路７
でチエツクされる。エラーが無い場合にはMIR
４の内容はパイプライン５中のレジスタを順次伝
播しつつ、各部の制御に用いられる。
ここでECC回路７にてエラーが検出されると
直ちに処理は中断され、リトライ動作に入る。リ
トライは当該機械語命令に係る一連のマイクロ命
令の最初から行なわれる。これは、エラー検出さ
れる前までのマイクロ命令はパイプライン５の途
中まで実行されているので、該エラーを生じたマ
イクロ命令のみをリトライするわけには行かない
ためである。またリトライ時には、クロツク制御
部１１を制御してインタロックモードで動作す
る。インタロックモードとは、MIR４に読出さ
れたマイクロ命令をECチエツクし、もしエラー
があれば訂正してMIR４に書き直した後に
CSAR２、CS３、MIR４及びパイプライン５の
クロツクを１サイクル進めるようにするモードで
ある。当該機械語命令をこのようなインタロック
モードで処理した後、次の機械語命令がIRIにセ
ツトされた以後は、通常のとおりマイクロ命令の
実行はECCチエツクと並行して行なわれる。
さらに本発明ではエラーが検出された場合、そ
のマイクロ命令のアドレスをエラーアドレス保持
レジスタ９に保持する。保持されたアドレスは常
時CSAR２の内容と比較回路１０にて比較され、
もし一致がとれると、そのマイクロ命令のみはイ
ンタロックモードで実行するよう、クロツク制御
部１１を制御する。
〔発明の効果〕
以下の如く動作するため、初めてエラーを生じ
た命令においてはリトライのために数ステツプ戻
ることが生じるが、２度目からはリトライするこ
となくインタロックモードにするのみで、パイプ
ラインの流れをくずすことなく処理をすすめるこ
とができる。その場合インタロックモードにされ
るのはエラーを生じたマイクロ命令のみであるの
で、時間増分はECC回路による遅れ１回分のみ
で済む。
尚、アドレス保持レジスタ９は複数個のアドレ
スを保持するようにし、比較回路１０も複数設け
て並列に比較し、いずれか１つでも一致すればイ
ンタロックモードにするようにしてもよい。
またECC回路７でエラーが検出された時点で
は、CSAR２の内容は既に次のマイクロ命令のア
ドレスを指すように先行制御する場合には、前回
のCSアドレスを保持するレジスタを設ける等す
ればよいことは明らかである。
【図面の簡単な説明】
図は本発明の一実施例ブロツク図であり、１は
機械語命令レジスタ、２は制御記憶アドレスレジ
スタ（CSAR）、３は制御記憶装置（CS）、４は
マイクロ命令レジスタ（MIR）、５はパイプライ
ン制御部、６はアドレス更新回路、７はECC回
路、８はタイミング制御部、９はエラーアドレス
保持レジスタ、１０は比較回路、１１はクロツク
制御回路である。

Claims (1)

    【特許請求の範囲】
  1. １ 機械語命令によつて定まるアドレスを最初の
    アドレスとし、前記アドレス以降のアドレスで似
    て制御記憶装置から読み出される複数のマイクロ
    命令をパイプライン内のレジスタを順次伝播せし
    めてパイプライン内の各ステートの制御に用い、
    且つ前記読み出された命令を前記パイプライン内
    のレジスタに順次伝播せしめるのと並列して該読
    み出されたマイクロ命令のエラー検出を行い、あ
    るマイクロ命令の最初のエラー検出時には当該エ
    ラーを生じたマイクロ命令が定められた前記機械
    語命令に係わる一連のマイクロ命令の最初のマイ
    クロ命令からリトライを行ない、前記一連のマイ
    クロ命令のリトライ時には読み出されたマイクロ
    命令のエラー検出を行い、エラーがあつた場合は
    エラー訂正を行つた後にパイプラインのクロツク
    を進め該マイクロ命令をパイプライン内のレジス
    タに投入するインターロツクモードで動作するよ
    うにし、且つ前記エラーが生じたマイクロ命令の
    アドレスを保持しておき、以後、該制御装置のマ
    イクロ命令読み出しと並行して該保持したマイク
    ロ命令のアドレスと制御記憶装置のマイクロ命令
    を読み出すアドレスとの比較処理を行い、一致す
    ると、その時に該制御記憶装置から読み出された
    該マイクロ命令についてのみインターロツクモー
    ドで動作するようにしたことを特徴とするマイク
    ロプログラム制御装置のエラー処理方式。
JP57168912A 1982-09-28 1982-09-28 マイクロプログラム制御装置のエラ−処理方式 Granted JPS5958547A (ja)

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JP57168912A JPS5958547A (ja) 1982-09-28 1982-09-28 マイクロプログラム制御装置のエラ−処理方式
US06/534,134 US4566103A (en) 1982-09-28 1983-09-20 Method for recovering from error in a microprogram-controlled unit
CA000437131A CA1200909A (en) 1982-09-28 1983-09-20 Method for recovering from error in a microprogram- controlled unit
AU19559/83A AU540151B2 (en) 1982-09-28 1983-09-26 Error recovery in micro-program controlled unit
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EP83305828A EP0105710B1 (en) 1982-09-28 1983-09-28 Method for recovering from error in a microprogram-controlled unit
KR1019830004555A KR860001476B1 (ko) 1982-09-28 1983-09-28 마이크로 프로그램 제어장치의 에러로부터 회복하는 방법

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JPH044616B2 true JPH044616B2 (ja) 1992-01-28

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EP (1) EP0105710B1 (ja)
JP (1) JPS5958547A (ja)
KR (1) KR860001476B1 (ja)
AU (1) AU540151B2 (ja)
BR (1) BR8305314A (ja)
CA (1) CA1200909A (ja)
DE (1) DE3377820D1 (ja)
ES (1) ES525977A0 (ja)

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AU1955983A (en) 1984-04-05
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