JPH04329461A - 障害処理方式 - Google Patents
障害処理方式Info
- Publication number
- JPH04329461A JPH04329461A JP3126588A JP12658891A JPH04329461A JP H04329461 A JPH04329461 A JP H04329461A JP 3126588 A JP3126588 A JP 3126588A JP 12658891 A JP12658891 A JP 12658891A JP H04329461 A JPH04329461 A JP H04329461A
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- JP
- Japan
- Prior art keywords
- processor
- processors
- diagnostic interface
- bus
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- Prior art date
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- Pending
Links
- 238000000034 method Methods 0.000 claims description 6
- 230000010365 information processing Effects 0.000 claims description 5
- 230000015654 memory Effects 0.000 abstract description 7
- 238000010586 diagram Methods 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
- Multi Processors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は互いに独立して動作可能
な２台のプロセッサを有する情報処理装置に於いて、障
害情報を採集する障害処理方式に関する。
な２台のプロセッサを有する情報処理装置に於いて、障
害情報を採集する障害処理方式に関する。
【０００２】
【従来の技術】従来、２台の独立して動作可能なプロセ
ッサを有する情報処理装置に於いては、各プロセッサ対
応に自プロセッサの障害情報を採集する採集装置（プロ
セッサ等により構成される）を設け、プロセッサに障害
が発生した場合、対応する採集装置が障害情報を採集す
るようにしている。
ッサを有する情報処理装置に於いては、各プロセッサ対
応に自プロセッサの障害情報を採集する採集装置（プロ
セッサ等により構成される）を設け、プロセッサに障害
が発生した場合、対応する採集装置が障害情報を採集す
るようにしている。
【０００３】
【発明が解決しようとする課題】上述したように、従来
は、各プロセッサ対応に採集装置を設けなければならな
かったため、ハードウェア量が多くなるという問題があ
った。
は、各プロセッサ対応に採集装置を設けなければならな
かったため、ハードウェア量が多くなるという問題があ
った。
【０００４】本発明の目的は少ないハードウェア量で障
害情報を採集できるようにすることにある。
害情報を採集できるようにすることにある。
【０００５】
【課題を解決するための手段】本発明は上記目的を達成
するため、互いに独立して動作可能な２台のプロセッサ
を有する情報処理装置に於いて、前記２台のプロセッサ
を診断インタフェースにより接続し、前記２台のプロセ
ッサは相手プロセッサの障害を検出することにより、前
記診断インタフェースを介して相手プロセッサの障害情
報を採集する。
するため、互いに独立して動作可能な２台のプロセッサ
を有する情報処理装置に於いて、前記２台のプロセッサ
を診断インタフェースにより接続し、前記２台のプロセ
ッサは相手プロセッサの障害を検出することにより、前
記診断インタフェースを介して相手プロセッサの障害情
報を採集する。
【０００６】
【作用】２台のプロセッサは診断インタフェースを介し
て接続されている。そして、各プロセッサは相手プロセ
ッサの障害を、例えばデータ送受信が行なえなくなるこ
とにより検出すると、診断インタフェースを介して相手
プロセッサの障害情報を採集する。
て接続されている。そして、各プロセッサは相手プロセ
ッサの障害を、例えばデータ送受信が行なえなくなるこ
とにより検出すると、診断インタフェースを介して相手
プロセッサの障害情報を採集する。
【０００７】
【実施例】次に本発明の実施例について図面を参照して
詳細に説明する。
詳細に説明する。
【０００８】図１は本発明の実施例のブロック図であり
、互いに独立して動作可能な２台のプロセッサ１０１，
１０２と、プロセッサ１０１，１０２を接続する共通バ
ス１００と、プロセッサ１０１，１０２に接続されたバ
ス１０４，１０５と、バス１０４，１０５に接続された
バス切替回路１０６，１０９、メモリ１０７，１１０、
Ｉ／Ｏアダプタ１０８，１１１と、プロセッサ１０１，
１０２をバス切替回路１０６，１０９及びバス１０４，
１０５を介して接続するための診断インタフェース１０
３とを備えている。
、互いに独立して動作可能な２台のプロセッサ１０１，
１０２と、プロセッサ１０１，１０２を接続する共通バ
ス１００と、プロセッサ１０１，１０２に接続されたバ
ス１０４，１０５と、バス１０４，１０５に接続された
バス切替回路１０６，１０９、メモリ１０７，１１０、
Ｉ／Ｏアダプタ１０８，１１１と、プロセッサ１０１，
１０２をバス切替回路１０６，１０９及びバス１０４，
１０５を介して接続するための診断インタフェース１０
３とを備えている。
【０００９】バス切替回路１０６はバス１０４と診断イ
ンタフェース１０３とを接続するか否かを制御し、バス
切替回路１０９はバス１０５と診断インタフェース１０
３とを接続するか否かを制御する。
ンタフェース１０３とを接続するか否かを制御し、バス
切替回路１０９はバス１０５と診断インタフェース１０
３とを接続するか否かを制御する。
【００１０】プロセッサ１０１，１０２は通常、共通バ
ス１００を介してプロセッサ間のデータ送受信を行なう
と共に、相手プロセッサ１０１，１０２に接続されるメ
モリ１０７，１１０のリード，ライトを行なう。これに
より、情報処理装置の一連の処理に於ける処理の分担及
び同時処理を可能にする。
ス１００を介してプロセッサ間のデータ送受信を行なう
と共に、相手プロセッサ１０１，１０２に接続されるメ
モリ１０７，１１０のリード，ライトを行なう。これに
より、情報処理装置の一連の処理に於ける処理の分担及
び同時処理を可能にする。
【００１１】通常は上述した動作が行なわれるが、例え
ば、プロセッサ１０１が動作できなくなる障害（プロセ
ッサ１０１の障害，メモリ１０７の障害）が発生すると
、以下の処理が行なわれる。
ば、プロセッサ１０１が動作できなくなる障害（プロセ
ッサ１０１の障害，メモリ１０７の障害）が発生すると
、以下の処理が行なわれる。
【００１２】プロセッサ１０１が動作できなくなる障害
が発生すると、プロセッサ１０２によってそれが検出さ
れる。尚、プロセッサ１０２はプロセッサ１０１が動作
できなくなる障害の発生を、例えば、共通バス１００を
介したデータ送受信が実施できなくなることにより検出
するものである。
が発生すると、プロセッサ１０２によってそれが検出さ
れる。尚、プロセッサ１０２はプロセッサ１０１が動作
できなくなる障害の発生を、例えば、共通バス１００を
介したデータ送受信が実施できなくなることにより検出
するものである。
【００１３】プロセッサ１０２はプロセッサ１０１が動
作できなくなる障害の発生を検出すると、先ず、バス切
替回路１０９にバス切替要求を出力する。
作できなくなる障害の発生を検出すると、先ず、バス切
替回路１０９にバス切替要求を出力する。
【００１４】バス切替回路１０９はプロセッサ１０２か
らバス切替要求が加えられることにより、バス１０５と
診断インタフェース１０３とを接続し、更に、診断イン
タフェース１０３を介してバス切替回路１０６にバス切
替要求を出力する。バス切替回路１０９からのバス切替
要求を受けると、バス切替回路１０６はバス１０４と診
断インタフェース１０３とを接続する。これにより、プ
ロセッサ１０１とプロセッサ１０２とが診断インタフェ
ース１０３を介して接続される。
らバス切替要求が加えられることにより、バス１０５と
診断インタフェース１０３とを接続し、更に、診断イン
タフェース１０３を介してバス切替回路１０６にバス切
替要求を出力する。バス切替回路１０９からのバス切替
要求を受けると、バス切替回路１０６はバス１０４と診
断インタフェース１０３とを接続する。これにより、プ
ロセッサ１０１とプロセッサ１０２とが診断インタフェ
ース１０３を介して接続される。
【００１５】その後、プロセッサ１０２はバス１０５，
診断インタフェース１０３，バス１０４を介してプロセ
ッサ１０１の障害情報（プログラムカウンタ等のレジス
タの値等）及びメモリ１０７の必要個所の内容を採集し
、バス１０５に接続されるＩ／Ｏアダプタ１１１を介し
て外部に採集した情報を出力する。
診断インタフェース１０３，バス１０４を介してプロセ
ッサ１０１の障害情報（プログラムカウンタ等のレジス
タの値等）及びメモリ１０７の必要個所の内容を採集し
、バス１０５に接続されるＩ／Ｏアダプタ１１１を介し
て外部に採集した情報を出力する。
【００１６】プロセッサ１０２は採集した情報を外部に
出力すると、バス切替回路１０９に復帰要求を出力する
。
出力すると、バス切替回路１０９に復帰要求を出力する
。
【００１７】この復帰要求を受けると、バス切替回路１
０９はバス１０５と診断インタフェース１０３とを切り
離すと共に、診断インタフェース１０３を介してバス切
替回路１０６に復帰要求を出力する。バス切替回路１０
６ではバス切替回路１０９からの復帰要求に応答してバ
ス１０４と診断インタフェース１０３とを切り離す。
０９はバス１０５と診断インタフェース１０３とを切り
離すと共に、診断インタフェース１０３を介してバス切
替回路１０６に復帰要求を出力する。バス切替回路１０
６ではバス切替回路１０９からの復帰要求に応答してバ
ス１０４と診断インタフェース１０３とを切り離す。
【００１８】また、必要な障害情報を採集した後、診断
インタフェース１０３を介してプロセッサ１０１のレジ
スタ値を変更し、プロセッサ１０１に再試行処理及び回
復処理を実施させることも可能である。
インタフェース１０３を介してプロセッサ１０１のレジ
スタ値を変更し、プロセッサ１０１に再試行処理及び回
復処理を実施させることも可能である。
【００１９】また、プロセッサ１０２が動作できなくな
る障害が発生した場合も、プロセッサ１０１によって同
様の処理が行なわれ、プロセッサ１０２の障害情報及び
メモリ１１０の内容が採集され、Ｉ／Ｏアダプタ１０８
を介して外部に出力される。
る障害が発生した場合も、プロセッサ１０１によって同
様の処理が行なわれ、プロセッサ１０２の障害情報及び
メモリ１１０の内容が採集され、Ｉ／Ｏアダプタ１０８
を介して外部に出力される。
【００２０】
【発明の効果】以上説明したように、本発明は、診断イ
ンタフェースを介して２台のプロセッサを接続し、一方
のプロセッサに障害が発生した場合、他方のプロセッサ
が診断インタフェースを介して相手プロセッサの障害情
報を採集するものであるので、従来例に比較してハード
ウェア量を少なくすることができる効果がある。
ンタフェースを介して２台のプロセッサを接続し、一方
のプロセッサに障害が発生した場合、他方のプロセッサ
が診断インタフェースを介して相手プロセッサの障害情
報を採集するものであるので、従来例に比較してハード
ウェア量を少なくすることができる効果がある。
【図１】本発明の実施例のブロック図である。
１００…共通バス
１０１，１０２…プロセッサ
１０３…診断インタフェース
１０４，１０５…バス
１０６，１０９…バス切替回路
１０７，１１０…メモリ
１０８，１１１…Ｉ／Ｏアダプタ
Claims (3)
- 【請求項１】 互いに独立して動作可能な２台のプロ
セッサを有する情報処理装置に於いて、前記２台のプロ
セッサを診断インタフェースにより接続し、前記２台の
プロセッサは相手プロセッサの障害を検出することによ
り、前記診断インタフェースを介して相手プロセッサの
障害情報を採集することを特徴とする障害処理方式。 - 【請求項２】 前記プロセッサは相手プロセッサとの
データの送受信が行なえなくなることにより、相手プロ
セッサの障害を検出することを特徴とする請求項１記載
の障害処理方式。 - 【請求項３】 前記採集する障害情報はレジスタの値
を含むことを特徴とする請求項１または２記載の障害処
理方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3126588A JPH04329461A (ja) | 1991-04-30 | 1991-04-30 | 障害処理方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3126588A JPH04329461A (ja) | 1991-04-30 | 1991-04-30 | 障害処理方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04329461A true JPH04329461A (ja) | 1992-11-18 |
Family
ID=14938897
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3126588A Pending JPH04329461A (ja) | 1991-04-30 | 1991-04-30 | 障害処理方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04329461A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009009200A (ja) * | 2007-06-26 | 2009-01-15 | Hitachi Ltd | ストレージシステム及びストレージシステムの制御方法 |
-
1991
- 1991-04-30 JP JP3126588A patent/JPH04329461A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009009200A (ja) * | 2007-06-26 | 2009-01-15 | Hitachi Ltd | ストレージシステム及びストレージシステムの制御方法 |
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