JPH0425209A - 可変利得増幅器 - Google Patents
可変利得増幅器Info
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- JPH0425209A JPH0425209A JP2129832A JP12983290A JPH0425209A JP H0425209 A JPH0425209 A JP H0425209A JP 2129832 A JP2129832 A JP 2129832A JP 12983290 A JP12983290 A JP 12983290A JP H0425209 A JPH0425209 A JP H0425209A
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- Japan
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- amplifier
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- 238000006243 chemical reaction Methods 0.000 claims abstract description 12
- 238000010586 diagram Methods 0.000 description 12
- 230000002238 attenuated effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000003321 amplification Effects 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G3/00—Gain control in amplifiers or frequency changers without distortion of the input signal
- H03G3/02—Manually-operated control
- H03G3/04—Manually-operated control in untuned amplifiers
- H03G3/10—Manually-operated control in untuned amplifiers having semiconductor devices
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G1/00—Details of arrangements for controlling amplification
- H03G1/0005—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal
- H03G1/0017—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal the device being at least one of the amplifying solid state elements of the amplifier
- H03G1/0023—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal the device being at least one of the amplifying solid state elements of the amplifier in emitter-coupled or cascode amplifiers
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は可変利得増幅器に関し、特に利得制御信号によ
り利得を可変させるこ、との出来るビデオカメラシステ
ム等の可変利得増幅器に関する。
り利得を可変させるこ、との出来るビデオカメラシステ
ム等の可変利得増幅器に関する。
可変利得増幅器は多くの電子回路で用いらているが、特
にビデオカメラシステムの映像信号のレベル制御に使い
られ、ｌ ／ ｎ倍〜１倍〜ｎ倍の利得可変範囲をもつ
従来の可変利得増幅器の一例としては、第４図に示すよ
うな回路がある。
にビデオカメラシステムの映像信号のレベル制御に使い
られ、ｌ ／ ｎ倍〜１倍〜ｎ倍の利得可変範囲をもつ
従来の可変利得増幅器の一例としては、第４図に示すよ
うな回路がある。
増幅回路ＩＡは、ｎＡ倍（Ａは“０”を除く実数、ｎは
１より大きい実数、以下同じ）の利得を有し、減衰回路
５は利得制御信号Ｖ。０により増幅回路ＩＡの出力を０
〜１倍の範囲で減衰させて出力する。また、利得制御信
号Ｖ。０の可変中心値で１７ ｎ倍に減衰させる。
１より大きい実数、以下同じ）の利得を有し、減衰回路
５は利得制御信号Ｖ。０により増幅回路ＩＡの出力を０
〜１倍の範囲で減衰させて出力する。また、利得制御信
号Ｖ。０の可変中心値で１７ ｎ倍に減衰させる。
今、この利得制御信号ＶＱＣのレベルが最大の時、減衰
回路５の入力に対する減衰比を“ｌ”、中心電圧値の時
−１最小値の時“０”と設定されているものとすると、
利得制御信号Ｖ。。のレベルが最小値の時、出力信号Ｖ
。のレベルｖ０は入力信号ｖ１のレベルをＶ、として、 ｖ。＝ｖ、ｘｎＡＸＯ＝０ ・・印１
１）利得制御信号Ｖ。０のレベルが中心値の時は、ｖ、
＝ｖ＋ＸｎＡＸ−＝Ａｙ、 −＝−（２）
利得制御信号■。００レベルが最大の時は、ｖ、＝ｖ、
ＸｎＡＸｌ＝ｎＡｖ＋ −・印−（ａ）とな
る。
回路５の入力に対する減衰比を“ｌ”、中心電圧値の時
−１最小値の時“０”と設定されているものとすると、
利得制御信号Ｖ。。のレベルが最小値の時、出力信号Ｖ
。のレベルｖ０は入力信号ｖ１のレベルをＶ、として、 ｖ。＝ｖ、ｘｎＡＸＯ＝０ ・・印１
１）利得制御信号Ｖ。０のレベルが中心値の時は、ｖ、
＝ｖ＋ＸｎＡＸ−＝Ａｙ、 −＝−（２）
利得制御信号■。００レベルが最大の時は、ｖ、＝ｖ、
ＸｎＡＸｌ＝ｎＡｖ＋ −・印−（ａ）とな
る。
この時の利得可変特性を第５図に示す。即ち、この可変
利得増幅器は、０倍〜へ倍〜ｎＡ倍なる利得範囲を有す
ることになる。
利得増幅器は、０倍〜へ倍〜ｎＡ倍なる利得範囲を有す
ることになる。
第６図にこの可変利得増幅器の具体的な回路例を示す。
この回路は、トランジスタＱｌ １．Ｑｌ ２と、定電
流源Ｉｔ、Ｉ２と、抵抗Ｒ１１〜Ｒ１３，Ｒ１７とで利
得ｎＡの増幅回路ｌＡを形成し、トランジスタＱ１３．
Ｑ１４と、抵抗Ｒ１４〜Ｒ１７とで利得制御信号Ｖ。Ｃ
により減衰量が変化する減衰回路５を形成している。ト
ランジスタＱＩ３．Ｑ１４のエミツタ面積比は（１／ｉ
ｎ）対（１／ ｎ ）となっている。
流源Ｉｔ、Ｉ２と、抵抗Ｒ１１〜Ｒ１３，Ｒ１７とで利
得ｎＡの増幅回路ｌＡを形成し、トランジスタＱ１３．
Ｑ１４と、抵抗Ｒ１４〜Ｒ１７とで利得制御信号Ｖ。Ｃ
により減衰量が変化する減衰回路５を形成している。ト
ランジスタＱＩ３．Ｑ１４のエミツタ面積比は（１／ｉ
ｎ）対（１／ ｎ ）となっている。
ここで、可変利得範囲が０倍〜１倍〜２倍の可変利得増
幅器を実現するには、Ａ二１．ｎ＝２として、抵抗Ｒ１
１，Ｒ１７の抵抗比を１対２に、トランジスタＱ１３．
Ｑ１４のエミツタ面積比を１対１に設定すればよい。
幅器を実現するには、Ａ二１．ｎ＝２として、抵抗Ｒ１
１，Ｒ１７の抵抗比を１対２に、トランジスタＱ１３．
Ｑ１４のエミツタ面積比を１対１に設定すればよい。
また、前述したように、可変利得範囲がＡ／ｎ倍〜Ａ倍
〜ｎＡ倍の可変利得増幅器を実現するには、利得制御信
号■。０のレベルの最小値を“０パとせず、減衰回路５
の減衰量がｌ ／ ｎ ”となるようなレベルとすれば
よい。
〜ｎＡ倍の可変利得増幅器を実現するには、利得制御信
号■。０のレベルの最小値を“０パとせず、減衰回路５
の減衰量がｌ ／ ｎ ”となるようなレベルとすれば
よい。
終
上述した従来の可変利得増幅器和は、利得制御信号■。
０を最小値にすると利得の最小値は“０”となる構成と
なっているので、Ａ／ｎ倍〜Ａ倍〜ｎＡ倍なる利得可変
範囲に設定しようとすると、利得制御信号■。０のレベ
ル可変範囲が中心値（Ｖ ＧＣＣＥＮ ）に対して対称
な特性にならないという欠点があり、また、最小利得を
Ａ／ｎ倍に設定するには、減衰器５のばらつきの影響等
により利得制御信号Ｖ。Ｃのレベルの設定がクリティカ
ルとなり設定しにくいという欠点がある。
なっているので、Ａ／ｎ倍〜Ａ倍〜ｎＡ倍なる利得可変
範囲に設定しようとすると、利得制御信号■。０のレベ
ル可変範囲が中心値（Ｖ ＧＣＣＥＮ ）に対して対称
な特性にならないという欠点があり、また、最小利得を
Ａ／ｎ倍に設定するには、減衰器５のばらつきの影響等
により利得制御信号Ｖ。Ｃのレベルの設定がクリティカ
ルとなり設定しにくいという欠点がある。
本発明の目的は、Ａ／ｎ倍〜Ａ倍〜ｎＡ倍の利得可変範
囲を得るのに、クリティカルな設定を必要とせず、容易
に利得制御信号のレベルのレベル可変範囲の中心値に対
して対称な利得可変特性となるようにすることができる
可変利得増幅器を提供することにある。
囲を得るのに、クリティカルな設定を必要とせず、容易
に利得制御信号のレベルのレベル可変範囲の中心値に対
して対称な利得可変特性となるようにすることができる
可変利得増幅器を提供することにある。
本発明の可変利得増幅器は、入力信号をＡ／ｎ倍（Ａは
０”以外の実数、ｎはｌより大きい実数、以下同じ）の
利得で増幅する第１の増幅回路と、前記入力信号をＡ（
ｎ−１／ｎ）倍の利得で増加する第２の増幅回路と、こ
の第２の増幅回路の出力信号を入力しこの出力信号のレ
ベルを、所定のレベル可変範囲をもつ利得制御信号のレ
ベルを対応する比率で、かつこの利得制御信号のレベル
可変範囲の中心値レベルでは１／（ｎ＋１）の比率で変
換して出力するレベル変換手段と、このレベル変換手段
の出力信号と前記第１の増幅回路の出力信号とを加算す
る加算回路とを有している。
０”以外の実数、ｎはｌより大きい実数、以下同じ）の
利得で増幅する第１の増幅回路と、前記入力信号をＡ（
ｎ−１／ｎ）倍の利得で増加する第２の増幅回路と、こ
の第２の増幅回路の出力信号を入力しこの出力信号のレ
ベルを、所定のレベル可変範囲をもつ利得制御信号のレ
ベルを対応する比率で、かつこの利得制御信号のレベル
可変範囲の中心値レベルでは１／（ｎ＋１）の比率で変
換して出力するレベル変換手段と、このレベル変換手段
の出力信号と前記第１の増幅回路の出力信号とを加算す
る加算回路とを有している。
また、レベル変換手段の第２の増幅回路の出力信号に対
するレベル変換比率を、利得制御信号のレベル可変範囲
の最小値レベルでは“０″、最大値レベルでは““１”
として構成される。
するレベル変換比率を、利得制御信号のレベル可変範囲
の最小値レベルでは“０″、最大値レベルでは““１”
として構成される。
次に、本発明の実施例について図面を参照して説明する
。
。
第１図は本発明の一実施例を示すブロック図である。
この実施例は、入力信号ＶＺをＡ ／ ｎ倍（Ａは００
″以外の実数、ｎは１より大きい実数、以下同じ）の利
得で増幅する第１の増幅回路ｌと、入力信号Ｖ１をＡ（
ｎ−１／ｎ）倍の利得で増幅する第２の増幅回路２と、
この第２の増幅回路２の出力信号を入力しこの出力信号
のレベルを、所定のレベル可変範囲をもつ利得制御信号
のレベルと対応する比率で、かつこの利得制御信号のレ
ベル可変範囲の中心値レベルではｌ／（ｎ＋１）、最小
値レベル“０”、最大値レベルでは″“１”の比率で変
換して出力するレベル変換手段の分配回路３と、この分
配回路３の出力信号と第１の増幅回路ｌの出力信号とを
１対ｌで加算する加算回路４とを有する構成となってい
る。
″以外の実数、ｎは１より大きい実数、以下同じ）の利
得で増幅する第１の増幅回路ｌと、入力信号Ｖ１をＡ（
ｎ−１／ｎ）倍の利得で増幅する第２の増幅回路２と、
この第２の増幅回路２の出力信号を入力しこの出力信号
のレベルを、所定のレベル可変範囲をもつ利得制御信号
のレベルと対応する比率で、かつこの利得制御信号のレ
ベル可変範囲の中心値レベルではｌ／（ｎ＋１）、最小
値レベル“０”、最大値レベルでは″“１”の比率で変
換して出力するレベル変換手段の分配回路３と、この分
配回路３の出力信号と第１の増幅回路ｌの出力信号とを
１対ｌで加算する加算回路４とを有する構成となってい
る。
次に、この実施例の動作について説明する。
いま、 利得制御信号Ｖ。Ｃのレベルがこのレベル可変
範囲の最小値（ＶＯＣＭＩＮ）の時、出方信号Ｖ。
範囲の最小値（ＶＯＣＭＩＮ）の時、出方信号Ｖ。
のレベルｖ０は、
・・・・（４）
利得制御信号■。Ｃのレベルがレベル可変範囲の中＝Ａ
ｖｌ ・・・（５
）利得制御信号■。Ｃのレベルがレベル可変範囲の最大
値■。Ｃ）ＪＡＸの時には ・・・（６） となる。
ｖｌ ・・・（５
）利得制御信号■。Ｃのレベルがレベル可変範囲の最大
値■。Ｃ）ＪＡＸの時には ・・・（６） となる。
よって利得制御信号Ｖ。０のレベルがレベル可変範囲の
最小値、中心値、最大値において、この可例えば１７２
倍〜１倍〜２倍の利得の可変利得増幅器を実現する時に
は、Ａ＝＝１．ｎ＝２として、増幅回路ｌの利得を０．
５．増幅回路２の利得を１．５゜分配回路３の入力レベ
ル対出力レベルの比率を利得制御信号Ｖ。０のレベルの
中心値で１／３に設定すればよいことになる。
最小値、中心値、最大値において、この可例えば１７２
倍〜１倍〜２倍の利得の可変利得増幅器を実現する時に
は、Ａ＝＝１．ｎ＝２として、増幅回路ｌの利得を０．
５．増幅回路２の利得を１．５゜分配回路３の入力レベ
ル対出力レベルの比率を利得制御信号Ｖ。０のレベルの
中心値で１／３に設定すればよいことになる。
第３図は、この実施例の各部の具体的の回路例を示す回
路図である。
路図である。
この回路は、第１の増幅回路１が、ベースを入力信号Ｖ
１用の入力端子Ｔ、を接続しコレクタを電源電圧Ｖ。０
の電源端子と接続する第１のトランジスタＱｌと、一端
を入力端子Ｔ１と接続する直列接続された第１の抵抗Ｒ
ＩＡ、ＲＩＢと、ベースヲこの第１の抵抗ＲＩＡ、Ｒ１
ｂの他端と接続しコレクタを出力端子Ｔ。と接続する第
２のトランジスタＱ２と、トランジスタＱｌ、Ｑ２のエ
ミッタ間に接続された第２の抵抗Ｒ２と、一端をトラン
ジスタＱ２のコレクタと接続し他端を電源端子と接続す
る第３の抵抗Ｒ３と、トランジスタＱｌ、Ｑ２のエミッ
タと接地端子との間に接続された定電流源ＩＩ、Ｉ２と
を含んで形成され、第２の増幅器２が、トランジスタＱ
１と、抵抗ＲＩＡ、 Ｒｌａと、し 抵抗Ｒ３；ｚ、ベースを抵抗ＲＩ Ａ、ＲＩ Ｂ（Ｄ他
端と接続しトランジスタＱ４を介して抵抗Ｒ３を負荷抵
抗とする第３のトランジスタＱ３と、トランジスタＱｌ
、Ｑ３のエミッタ間に接続された第４の抵抗Ｒ４と、ト
ランジスタＱ３のエミッタと接地端子との間に接続され
た定電流源工３とを含んでい形成され、分配回路３が、
抵抗Ｒ３と、一端を利得制御信号■。０用の入力端子Ｔ
。０と接続する第５の抵抗Ｒ５と、ベースをこの抵抗Ｒ
５の他端と接続しコレクタを抵抗Ｒ３の一端と接続しエ
ミッタをトランジスタＱ３のコレクタと接続する第４の
トランジスタＱ４と、一端を抵抗Ｒ５の他端と接続する
直列接続された第６の抵抗Ｒ６Ａ、Ｒ６Ｂと、ベースを
この抵抗Ｒ６Ａ、Ｒ６，の他端と接続しエミッタをトラ
ンジスタＱ４のエミッタと接続する第５のトランジスタ
Ｑ５と、このトランジスタＱ５のコレクタと電源端子と
の間に接続された第７の抵抗Ｒ７とを含み、トランジス
タＱ３のコレクタの信号をトランジスタＱ４．Ｑ５のコ
レクタに１／（ｎ＋１）対ｎ／（ｎ＋１）に分配する回
路で形成され、加算回路４が抵抗Ｒ３で形成された構成
となっている。
１用の入力端子Ｔ、を接続しコレクタを電源電圧Ｖ。０
の電源端子と接続する第１のトランジスタＱｌと、一端
を入力端子Ｔ１と接続する直列接続された第１の抵抗Ｒ
ＩＡ、ＲＩＢと、ベースヲこの第１の抵抗ＲＩＡ、Ｒ１
ｂの他端と接続しコレクタを出力端子Ｔ。と接続する第
２のトランジスタＱ２と、トランジスタＱｌ、Ｑ２のエ
ミッタ間に接続された第２の抵抗Ｒ２と、一端をトラン
ジスタＱ２のコレクタと接続し他端を電源端子と接続す
る第３の抵抗Ｒ３と、トランジスタＱｌ、Ｑ２のエミッ
タと接地端子との間に接続された定電流源ＩＩ、Ｉ２と
を含んで形成され、第２の増幅器２が、トランジスタＱ
１と、抵抗ＲＩＡ、 Ｒｌａと、し 抵抗Ｒ３；ｚ、ベースを抵抗ＲＩ Ａ、ＲＩ Ｂ（Ｄ他
端と接続しトランジスタＱ４を介して抵抗Ｒ３を負荷抵
抗とする第３のトランジスタＱ３と、トランジスタＱｌ
、Ｑ３のエミッタ間に接続された第４の抵抗Ｒ４と、ト
ランジスタＱ３のエミッタと接地端子との間に接続され
た定電流源工３とを含んでい形成され、分配回路３が、
抵抗Ｒ３と、一端を利得制御信号■。０用の入力端子Ｔ
。０と接続する第５の抵抗Ｒ５と、ベースをこの抵抗Ｒ
５の他端と接続しコレクタを抵抗Ｒ３の一端と接続しエ
ミッタをトランジスタＱ３のコレクタと接続する第４の
トランジスタＱ４と、一端を抵抗Ｒ５の他端と接続する
直列接続された第６の抵抗Ｒ６Ａ、Ｒ６Ｂと、ベースを
この抵抗Ｒ６Ａ、Ｒ６，の他端と接続しエミッタをトラ
ンジスタＱ４のエミッタと接続する第５のトランジスタ
Ｑ５と、このトランジスタＱ５のコレクタと電源端子と
の間に接続された第７の抵抗Ｒ７とを含み、トランジス
タＱ３のコレクタの信号をトランジスタＱ４．Ｑ５のコ
レクタに１／（ｎ＋１）対ｎ／（ｎ＋１）に分配する回
路で形成され、加算回路４が抵抗Ｒ３で形成された構成
となっている。
なお、トランジスタＱ４．Ｑ５のエミツタ面積比は１／
（ｎ＋１）対ｎ／（ｎ＋１）に設定されている。
（ｎ＋１）対ｎ／（ｎ＋１）に設定されている。
ここで、前述と同様に利得可変範囲が１／２倍〜１倍〜
２倍の可変利得増幅器を実現するには、抵抗Ｒ２と抵抗
Ｒ３の抵抗比を１対２に、抵抗Ｒ４と抵抗Ｒ３の抵抗比
を２対３に、トランジスタＱ４．Ｑ５のエミツタ面積比
を１対２に設定すればよい。
２倍の可変利得増幅器を実現するには、抵抗Ｒ２と抵抗
Ｒ３の抵抗比を１対２に、抵抗Ｒ４と抵抗Ｒ３の抵抗比
を２対３に、トランジスタＱ４．Ｑ５のエミツタ面積比
を１対２に設定すればよい。
〔発明の効果〕
以上説明したように本発明は、入力信号をそれぞれＡ／
ｎ倍、Ａ（ｎ−１／ｎ）倍する第１及び第２の増幅回路
と、第２の増幅回路の出力信号を利得制御信号のレベル
のレベル可変範囲の中心値で１／（ｎ＋１）倍するレベ
ル変換手段を設け、第１の増幅回路の出力信号とレベル
変換手段の出力信号とをｌ対ｌで加算する構成とするこ
とにより、Ａ ／ ｎ倍〜Ａ倍〜ｎＡ倍の利得可変範囲
を得るのに、クリティカルな設定を必要とせず、容易に
利得制御信号のレベルのレベル可変範囲の中心値に対し
て対称な利得可変特性とすることができる効果がある。
ｎ倍、Ａ（ｎ−１／ｎ）倍する第１及び第２の増幅回路
と、第２の増幅回路の出力信号を利得制御信号のレベル
のレベル可変範囲の中心値で１／（ｎ＋１）倍するレベ
ル変換手段を設け、第１の増幅回路の出力信号とレベル
変換手段の出力信号とをｌ対ｌで加算する構成とするこ
とにより、Ａ ／ ｎ倍〜Ａ倍〜ｎＡ倍の利得可変範囲
を得るのに、クリティカルな設定を必要とせず、容易に
利得制御信号のレベルのレベル可変範囲の中心値に対し
て対称な利得可変特性とすることができる効果がある。
第１図及び第２図は本発明の一実施例を示すブロック図
及びこの実施例の動作及び効果を説明するための利得可
変特性図、第３図は第１図に示された実施例の各部の具
体的な回路例を示す回路図、第４図及び第５図はそれぞ
れ従来の可変利得増幅器の一例を示すブロック図及びこ
の例の動作及び課題を説明するための利得可変特性図、
第６図は第４図に示された可変利得増幅器の各部の具体
的１回路例を示す回路図である。 １、 ＩＡ、 ２・・・・・・増幅回路、３・・・・
・・分配回路、４・・・・・・加算回路、５・・・・・
・減衰回路、Ｉｆ〜■２・・・・・・定電流源、Ｑｌ〜
Ｑ５．Ｑｌ １−Ｑｌ ４・・・・・・トランジスタ、
ＲＩＡ、ＲＩＢ、Ｒ２〜Ｒ５，Ｒ６Ａ。 Ｒ６ｅ、Ｒ７，Ｒ１１”−Ｒ１７・・・・・・抵抗。 代理人 弁理士 内 原 晋 党 図 （利得制評侶号ＶＧＣのしベル） 躬 ？ 図 ＣＩＣ 兜 図 （利得制ｆｐ信号ＶＧｃのしＮルノ 刀 図
及びこの実施例の動作及び効果を説明するための利得可
変特性図、第３図は第１図に示された実施例の各部の具
体的な回路例を示す回路図、第４図及び第５図はそれぞ
れ従来の可変利得増幅器の一例を示すブロック図及びこ
の例の動作及び課題を説明するための利得可変特性図、
第６図は第４図に示された可変利得増幅器の各部の具体
的１回路例を示す回路図である。 １、 ＩＡ、 ２・・・・・・増幅回路、３・・・・
・・分配回路、４・・・・・・加算回路、５・・・・・
・減衰回路、Ｉｆ〜■２・・・・・・定電流源、Ｑｌ〜
Ｑ５．Ｑｌ １−Ｑｌ ４・・・・・・トランジスタ、
ＲＩＡ、ＲＩＢ、Ｒ２〜Ｒ５，Ｒ６Ａ。 Ｒ６ｅ、Ｒ７，Ｒ１１”−Ｒ１７・・・・・・抵抗。 代理人 弁理士 内 原 晋 党 図 （利得制評侶号ＶＧＣのしベル） 躬 ？ 図 ＣＩＣ 兜 図 （利得制ｆｐ信号ＶＧｃのしＮルノ 刀 図
Claims (1)
- 【特許請求の範囲】 １、入力信号をＡ／ｎ倍（Ａは“０”以外の実数、ｎは
１より大きい実数、以下同じ）の利得で増幅する第１の
増幅回路と、前記入力信号をＡ（ｎ−１／ｎ）倍の利得
で増幅する第２の増幅回路と、この第２の増幅回路の出
力信号を入力しこの出力信号のレベルを、所定のレベル
可変範囲をもつ利得制御信号のレベルと対応する比率で
、かつこの利得制御信号のレベル可変範囲の中心値レベ
ルでは１／（ｎ＋１）の比率で変換して出力するレベル
変換手段と、このレベル変換手段の出力信号と前記第１
の増幅回路の出力信号とを加算する加算回路とを有する
ことを特徴とする可変利得増幅器。 ２、レベル変換手段の第２の増幅回路の出力信号に対す
るレベル変換比率を、利得制御信号のレベル可変範囲の
最小値レベルでは“０”、最大値レベルでは“１”とす
る請求項１記載の可変利得増幅器。 ３、第１の増幅回路が、ベースを入力信号用の入力端子
と接続しコレクタを電源端子と接続する第１のトランジ
スタと、一端を前記入力端子と接続する第１の抵抗と、
ベースをこの第１の抵抗の他端と接続しコレクタを出力
端子と接続する第２のトランジスタと、前記第１及び第
２のトランジスタのエミッタ間に接続された第２の抵抗
と、一端を前記第２のトランジスタのコレクタと接続し
、他端を前記電源端子と接続する第３の抵抗とを含んで
形成され、第２の増幅器が、前記第１のトランジスタと
、前記第１の抵抗と、前記第３の抵抗と、ベースを前記
第１の抵抗の他端と接続し前記第３の抵抗を負荷抵抗と
する第３のトランジスタと、前記第１及び第３のトラン
ジスタのエミッタ間に接続された第４の抵抗とを含んで
形成され、レベル変換手段が、前記第３の抵抗と、一端
を利得制御信号用の入力端子と接続する第５の抵抗と、
ベースをこの第５の抵抗の他端と接続しコレクタを前記
第３の抵抗の一端と接続しエミッタを前記第３のトラン
ジタのコレクタと接続する第４のトランジスタと、一端
を前記第５の抵抗の他端と接続する第６の抵抗と、ベー
スをこの第６の抵抗の他端と接続しエミッタを前記第４
のトランジスタのエミッタと接続する第５のトランジス
タと、この第５のトランジスタのコレクタと前記電源端
子との間に接続された第７の抵抗とを含み、前記第３の
トランジスタのコレクタの信号を前記第４及び第５のト
ランジスタのコレクタに１／（ｎ＋１）対ｎ／（ｎ＋１
）に分配する分配回路で形成され、加算回路が前記第３
の抵抗で形成された請求項１記載の可変利得増幅器。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2129832A JP2690599B2 (ja) | 1990-05-18 | 1990-05-18 | 可変利得増幅器 |
| US07/702,628 US5113149A (en) | 1990-05-18 | 1991-05-17 | Variable gain amplifier |
| DE69111510T DE69111510T2 (de) | 1990-05-18 | 1991-05-20 | Verstärker mit variabler Verstärkung. |
| EP91304495A EP0457622B1 (en) | 1990-05-18 | 1991-05-20 | Variable gain amplifier |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2129832A JP2690599B2 (ja) | 1990-05-18 | 1990-05-18 | 可変利得増幅器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0425209A true JPH0425209A (ja) | 1992-01-29 |
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