JPH0424999A - 電子部品の取付構造 - Google Patents

電子部品の取付構造

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Publication number
JPH0424999A
JPH0424999A JP2124757A JP12475790A JPH0424999A JP H0424999 A JPH0424999 A JP H0424999A JP 2124757 A JP2124757 A JP 2124757A JP 12475790 A JP12475790 A JP 12475790A JP H0424999 A JPH0424999 A JP H0424999A
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JP
Japan
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electronic component
circuit board
multilayer circuit
hole
electrode pattern
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Pending
Application number
JP2124757A
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English (en)
Inventor
Kosaku Ishii
石井 宏作
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Filing date
Publication date
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Publication of JPH0424999A publication Critical patent/JPH0424999A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野コ この発明は多層回路基板への電子部品の取付構造に係り
、特に多層回路基板の小型化を図るものに関する。
[従来の技術] 第2図は従来の電子部品の取付構造を示す断面図である
。図において、1は多層回路基板、2は多層回路基板1
の一表面に設けられた電極ノ々ターン、3は多層回路基
板1に取り付けられる電子部品、4は半田等の導電性接
続材である0多層回路基板1への電子部品3の取り付け
は、多層回路基板1の電極パターン2上に電子部品5の
導電部5αを設置し、電極パターン2と電子部品6の導
電部6αとを導電性接続材4により接続固定して多層回
路基板1に電子部品5を取り付けていた。
[発明が解決しようとする課題] 上記のような従来の電子部品の取付構造では、多層回路
基板1の一表面に設けられた電極パターン2上に電子部
品6を取り付けるために多層回路基板1上に電子部品6
全体が位置し、多層回路基板1上の電子部品3の占める
面積が太き(なり、多層回路基板1を小型化できないと
いう問題点があった。
この発明は上記の課題を解決すべ(なされたもので、多
層回路基板上に占める電子部品の取付面積を減少させ、
多層回路基板の小型化を図ることを目的としたものであ
る。
[課題を解決するための手段] 本発明の電子部品の取付構造は、多層回路基板に内層パ
ターンまで達する電子部品挿入用の孔を形成し、表層に
電極パターンを設け、前記孔内に両端に導電部を有する
電子部品を挿入配置し、前記内層パターン及び前記電極
パターンと前記電子部品の導電部とを導電性接続材によ
り接続固定することを特徴・とする。
[実施例] 第1図はこの発明の一実施例を示す断面図である。図に
おいて、10はガラスエポキシ、紙フエノール等で形成
された多層回路基板、11は多層回路基板10にプレス
加工或いはドリル加工により形成された電子部品挿入用
の孔、12は多層回路基板100表層に設けられた電極
パターン、16は多層回路基板10に取り付けられる両
端に導電部15αを有する筒状の電子部品で、丸部型の
ものとしてモールド抵抗、ダイオード、コンデンサ、イ
ンダクタ等があり、角筒型のものとして、チップ抵抗、
チップコンデンサ等のチップ部品がある。14は半田或
いは導電性接着剤等の導電性接続材である。15は多層
回路基板1oの内層パターンである。
多層回路基板10への電子部品13の取り付けは、まず
、内層パターン15上に導電性接着剤の導電性接続材1
4を塗布し、多層回路基板10に形成された孔11に電
子部品16を圧入して孔11内に電子部品15を挿入配
置する。次に、多層回路基板100表面を半田液にデイ
ツプし、多層回路基板10の電極パターン12と電子部
品15の導電部15αとを半田の導電性接続材14によ
り接続固定して、多層回路基板10に電子部品13を取
り付けている。このとき、電子部品13の殆んどが多層
回路基板10の孔11内に位置して多層回路基板10に
内蔵された形となり、多層回路基板10上の電子部品1
5の占有面積は電子部品15の導電部15αだけとなり
、多層回路基板10上の電子部品16の占有面積が減少
する。また、電子部品16の両端の導電部15αは多層
回路基板10の表層に設けた電極パタシン12及び内層
パターン15に電気的に接続されているから、従来例の
ように多層回路基板の表面に取り付けた電子部品の導電
部を多層回路基板にスルーホールを設けて多層回路基板
の内層に接続しな(でも済み、接続コストが安価となる
また、前述の説明では電極パターン12への電子部品1
3の取り付けを半田液にデイツプして行っているが、電
極パターン12と電子部品16の導電部分に導電性接続
材14として半田クリーム或いは導電性接着剤を印刷等
により塗布し、加熱装置により加熱して半田クリーム或
いは導電性接着剤を硬化させるこ′ともできる。
[発明の効果コ この発明は以上の説明から明らかなように、多層回路基
板に内層パターンまで達する電子部品挿入用の孔を形成
し、多層回路基板の表層に電極パターンを設け、その孔
内に両端に導電部を有する電子部品を挿入配置し、電極
パターン及び内層パターンを設け、その孔内に両端に導
電部を有する電子部品を挿入配置し、電極パターン及び
内層パターンと電子部品の導電部とを導電性接続材によ
F)接続固定して多層回路基板に電子部品を取っ付付る
ようにしたので、電子部品の殆んどが多層回路基板に内
蔵され、多層回路基板上の電子部品の占有面積が減少t
7、多層回路基板面積を小さくして多層回路基板の小型
化を図ることができるという効果を有する。
【図面の簡単な説明】
第1図はこの発明の一実施例を示す断面図、第2図は従
来の電子部品の取付構造を示す断面図である。 ・・・・・・・・・多層回路基板 ・−・・・・・・・孔 ・・・・・・・・・電極ノぐターン ・・・・・・・・・電子部品 α・・・・・・導電部 ・・・・・・・・・導電性接続材 ・・・・・・・・・内層パターン

Claims (1)

    【特許請求の範囲】
  1. 多層回路基板に内層パターンまで達する電子部品挿入用
    の孔を形成し、表層に電極パターンを設け、前記孔内に
    両端に導電部を有する電子部品を挿入配置し、前記内層
    パターン及び前記電極パターンと前記電子部品の導電部
    とを導電性接続材により接続固定することを特徴とする
    電子部品の取付構造。
JP2124757A 1990-05-15 1990-05-15 電子部品の取付構造 Pending JPH0424999A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001035990A (ja) * 1999-07-22 2001-02-09 Kyocera Corp 半導体装置
JP2019109232A (ja) * 2017-12-15 2019-07-04 キーサイト テクノロジーズ, インク. 1組の抵抗器を通る電流の流れを観測するテストフィクスチャ

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001035990A (ja) * 1999-07-22 2001-02-09 Kyocera Corp 半導体装置
JP2019109232A (ja) * 2017-12-15 2019-07-04 キーサイト テクノロジーズ, インク. 1組の抵抗器を通る電流の流れを観測するテストフィクスチャ

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